JPS5995500U - 記憶装置 - Google Patents
記憶装置Info
- Publication number
- JPS5995500U JPS5995500U JP18003083U JP18003083U JPS5995500U JP S5995500 U JPS5995500 U JP S5995500U JP 18003083 U JP18003083 U JP 18003083U JP 18003083 U JP18003083 U JP 18003083U JP S5995500 U JPS5995500 U JP S5995500U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- selector
- storage device
- output
- exclusive
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
- Hardware Redundancy (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
添付図面は本考案に係る記憶装置を示すブロック図であ
る。 図において、11−A、 11−Bは2重化されり記
憶ユニット、12はセレクタ、13はレジスタ、14は
エラー検出部、15は選択ラッチ回路、16および17
はそれぞれ、選択ラッチ回路15を構成するイクスクル
ーシブ・オア回路およびフリップφフロップ回路である
。
る。 図において、11−A、 11−Bは2重化されり記
憶ユニット、12はセレクタ、13はレジスタ、14は
エラー検出部、15は選択ラッチ回路、16および17
はそれぞれ、選択ラッチ回路15を構成するイクスクル
ーシブ・オア回路およびフリップφフロップ回路である
。
Claims (1)
- 【実用新案登録請求の範囲】 1 同一のアドレス信号により同一のデータが書込みま
たは読出される2重化された第1の記憶ユニットおよび
第2の記憶ユニットと、該第1および第2の記憶ユニッ
トから読み出したデータのいずれか一方を選択して出力
するセレクタと、該セレクタから出力された前記データ
のエラー検出を行なうエラー検出部とを具備する記憶装
置において、前記セレクタに協働する選択゛ ラ
ッチ回路を付加し、該選択ラッチ回路は、前記エラー検
出部がエラー検出を行なう度毎に、前記セレクタに対し
前記第1または第2の記憶ユニットを択−交互的に選択
せしめるようにしたことを特徴とする記憶装置。 2 選択ラッチ回路がイクスクルーシブ・オア回路およ
びフリップ・70ツブ回路からなり、該イクスクルーシ
ブ・オア回路はエラー検出部の出力および該フリップ・
フロップ回路の分岐出力を入力とし、該フリップ・フロ
ップ回路は前記イクスクルーシブ・オア回路の出力を入
力としてセレクタを制御するための出力を送出する実用
新案登録請求の範囲第1項記載の記憶装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18003083U JPS5995500U (ja) | 1983-11-24 | 1983-11-24 | 記憶装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18003083U JPS5995500U (ja) | 1983-11-24 | 1983-11-24 | 記憶装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5995500U true JPS5995500U (ja) | 1984-06-28 |
JPS6117479Y2 JPS6117479Y2 (ja) | 1986-05-28 |
Family
ID=30390458
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP18003083U Granted JPS5995500U (ja) | 1983-11-24 | 1983-11-24 | 記憶装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5995500U (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH10289162A (ja) * | 1997-04-11 | 1998-10-27 | Aisin Aw Co Ltd | データ処理方法 |
JP2008090542A (ja) * | 2006-09-29 | 2008-04-17 | Fujitsu Ltd | エラー処理方法及び情報処理装置 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4980938A (ja) * | 1972-12-06 | 1974-08-05 |
-
1983
- 1983-11-24 JP JP18003083U patent/JPS5995500U/ja active Granted
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4980938A (ja) * | 1972-12-06 | 1974-08-05 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH10289162A (ja) * | 1997-04-11 | 1998-10-27 | Aisin Aw Co Ltd | データ処理方法 |
JP2008090542A (ja) * | 2006-09-29 | 2008-04-17 | Fujitsu Ltd | エラー処理方法及び情報処理装置 |
Also Published As
Publication number | Publication date |
---|---|
JPS6117479Y2 (ja) | 1986-05-28 |
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