JPS5995500U - 記憶装置 - Google Patents

記憶装置

Info

Publication number
JPS5995500U
JPS5995500U JP18003083U JP18003083U JPS5995500U JP S5995500 U JPS5995500 U JP S5995500U JP 18003083 U JP18003083 U JP 18003083U JP 18003083 U JP18003083 U JP 18003083U JP S5995500 U JPS5995500 U JP S5995500U
Authority
JP
Japan
Prior art keywords
circuit
selector
storage device
output
exclusive
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP18003083U
Other languages
English (en)
Other versions
JPS6117479Y2 (ja
Inventor
豊木 則行
会沢 勲
坂井 高志
Original Assignee
富士通株式会社
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 富士通株式会社 filed Critical 富士通株式会社
Priority to JP18003083U priority Critical patent/JPS5995500U/ja
Publication of JPS5995500U publication Critical patent/JPS5995500U/ja
Application granted granted Critical
Publication of JPS6117479Y2 publication Critical patent/JPS6117479Y2/ja
Granted legal-status Critical Current

Links

Landscapes

  • Techniques For Improving Reliability Of Storages (AREA)
  • Hardware Redundancy (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
添付図面は本考案に係る記憶装置を示すブロック図であ
る。 図において、11−A、  11−Bは2重化されり記
憶ユニット、12はセレクタ、13はレジスタ、14は
エラー検出部、15は選択ラッチ回路、16および17
はそれぞれ、選択ラッチ回路15を構成するイクスクル
ーシブ・オア回路およびフリップφフロップ回路である

Claims (1)

  1. 【実用新案登録請求の範囲】 1 同一のアドレス信号により同一のデータが書込みま
    たは読出される2重化された第1の記憶ユニットおよび
    第2の記憶ユニットと、該第1および第2の記憶ユニッ
    トから読み出したデータのいずれか一方を選択して出力
    するセレクタと、該セレクタから出力された前記データ
    のエラー検出を行なうエラー検出部とを具備する記憶装
    置において、前記セレクタに協働する選択゛    ラ
    ッチ回路を付加し、該選択ラッチ回路は、前記エラー検
    出部がエラー検出を行なう度毎に、前記セレクタに対し
    前記第1または第2の記憶ユニットを択−交互的に選択
    せしめるようにしたことを特徴とする記憶装置。 2 選択ラッチ回路がイクスクルーシブ・オア回路およ
    びフリップ・70ツブ回路からなり、該イクスクルーシ
    ブ・オア回路はエラー検出部の出力および該フリップ・
    フロップ回路の分岐出力を入力とし、該フリップ・フロ
    ップ回路は前記イクスクルーシブ・オア回路の出力を入
    力としてセレクタを制御するための出力を送出する実用
    新案登録請求の範囲第1項記載の記憶装置。
JP18003083U 1983-11-24 1983-11-24 記憶装置 Granted JPS5995500U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP18003083U JPS5995500U (ja) 1983-11-24 1983-11-24 記憶装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP18003083U JPS5995500U (ja) 1983-11-24 1983-11-24 記憶装置

Publications (2)

Publication Number Publication Date
JPS5995500U true JPS5995500U (ja) 1984-06-28
JPS6117479Y2 JPS6117479Y2 (ja) 1986-05-28

Family

ID=30390458

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18003083U Granted JPS5995500U (ja) 1983-11-24 1983-11-24 記憶装置

Country Status (1)

Country Link
JP (1) JPS5995500U (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10289162A (ja) * 1997-04-11 1998-10-27 Aisin Aw Co Ltd データ処理方法
JP2008090542A (ja) * 2006-09-29 2008-04-17 Fujitsu Ltd エラー処理方法及び情報処理装置

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4980938A (ja) * 1972-12-06 1974-08-05

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4980938A (ja) * 1972-12-06 1974-08-05

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10289162A (ja) * 1997-04-11 1998-10-27 Aisin Aw Co Ltd データ処理方法
JP2008090542A (ja) * 2006-09-29 2008-04-17 Fujitsu Ltd エラー処理方法及び情報処理装置

Also Published As

Publication number Publication date
JPS6117479Y2 (ja) 1986-05-28

Similar Documents

Publication Publication Date Title
JPS5995500U (ja) 記憶装置
JPS5942640U (ja) フリツプフロツプ回路
JPS5980839U (ja) キ−スイツチ回路
JPS5836445U (ja) デ−タ選択回路
JPS59130144U (ja) パリテイ・チエツク回路
JPH0386456U (ja)
JPS6016202U (ja) 分散形デイジタル調節計
JPS59134842U (ja) 車載電子機器用のワンチツプマイコンのメモリ拡張装置
JPS6121057U (ja) 情報記録装置
JPS59161185U (ja) デジタル画像表示回路
JPS596251U (ja) ビツト構成変換回路
JPS58127499U (ja) メモリ回路
JPS6082354U (ja) カ−ド読取装置
JPS59138894U (ja) ドツト表示装置
JPH0282135U (ja)
JPS6089700U (ja) 記憶回路
JPS5862500U (ja) メモリのパリテイチエツク回路
JPS60107988U (ja) パ−ソナルコンピユ−タ
JPS60144332U (ja) シリアルデ−タ入力−パラレルデ−タ出力回路
JPS59112400U (ja) メモリ装置
JPS593385U (ja) 信号処理回路
JPS5851361U (ja) マイクロコンピユ−タ制御回路
JPS59130298U (ja) マイクロコンピユ−タ
JPS59100306U (ja) シ−ケンス制御演算装置
JPS6170U (ja) 信号選択回路