JPS595935Y2 - 厚膜印刷回路 - Google Patents

厚膜印刷回路

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JPS595935Y2
JPS595935Y2 JP1979109061U JP10906179U JPS595935Y2 JP S595935 Y2 JPS595935 Y2 JP S595935Y2 JP 1979109061 U JP1979109061 U JP 1979109061U JP 10906179 U JP10906179 U JP 10906179U JP S595935 Y2 JPS595935 Y2 JP S595935Y2
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JP
Japan
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pattern
resistance
resistor
thick film
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JP1979109061U
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JPS5626911U (ja
Inventor
吉韋 香川
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アルプス電気株式会社
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Publication date
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Description

【考案の詳細な説明】 本考案は厚膜印刷回路におけるプリントパターンの形状
に関し、その目的とするところはトランジスタ等のバイ
アス供給用の抵抗を印刷する際に発生する抵抗値のバラ
ツキを少なくシ、バイアス電圧を均一にした厚膜印刷回
路を提供するにある。
一般に、トランジスタにバイアス電圧を印加するには第
１図に示すようにトランジスタ１のベースに抵抗２，３
で分圧した電位を与え、コレクタ、エミツタには抵抗４
，５が接続され、抵抗２，４の一端から電源が印加され
、抵抗３，５の他端は接地される構或である。
上述の回路においてベースにバイアス電圧を与える抵抗
２，３および抵抗２，３のリード線６，７，８（電極）
を厚膜印刷するには第２図に示すように（第１図と同じ
部分には同一符号を付す）基板上に電極パターン６，７
．８を導電性のペーストを用いて予め印刷して形或した
うえ、次に、抵抗性のペーストを一度に印刷して抵抗パ
ターン２，３を形或するものであり、抵抗パターン２の
抵抗値をＲ１、そのパターン形状の幅をｄ１、長さをｌ
１、抵抗パターン３の抵抗値をＲ２、そのパターン形状
の幅をｄ２、長さをｌ２とすると（ｌ１，ｌ２は電極パ
ターンの間隔でもある）、Ｒ．＞Ｒ２の場合であると、
抵抗パターン２，３の長さはｌ １＞ ７ ２として設
定し、かつ、幅をｄ１〈ｄ２として必要な電圧の分圧を
行っていた。
しかしながら、従来のようなパターン構或では電極パタ
ーン６，７．８がいかなる場合でも指定された間隔ｌ
．， ｌ２をもって形威されるということが困難であっ
て、第３図に示すように電極パターン６，７．８の端部
にダレ９・・・・・・が導電性ペーストを印刷する際に
生じ、実効的な長さが変ってしまい、設定した通りの抵
抗値が得られなかった。
ダレ９・・・・・・は大きい場合３０μともなるが、こ
の値はｌ１，ｌ２がいかなる大きさの時でも略等しい値
であるからｌ ｔ， ｌ ２の大きさによっては影響力
が大きくなり、抵抗値Ｒ１，Ｒ２の比が変わってしまう
。
また、抵抗パターン２，３のパターン幅ｄ１，ｄ２も抵
抗性ペーストを印刷する際に抵抗パターン２，３の端部
に生ずるダレによってバラツキができてしまい、ｄ ．
＋ｄ２であると影響力が違い分圧された電圧のバラツ
キの要因となる。
この関係を式で表わすと面積抵抗（単位面積当りの抵抗
パターンの抵抗値）をｒ、電極パターンのバラツキを△
ｌ、抵抗パターンのバラツキを△ｄとすると抵抗パター
ン２，３の抵抗値Ｒｌ，Ｒ２はとなり、分圧された電圧
■は電源電圧をＥとするとなる。
従って、電極パターン６，７，８、抵抗パターン２、３
にダレが生じることによって分圧された電圧にバラツキ
が生じる。
また、抵抗値のバラック要因が抵抗パターン２，３の長
さｌ１，ｌ２、幅ｄ１，ｄ２がダレによって変化するた
めにパターン設計が非常に困難となる欠点があった。
本考案は上記欠点を解消したもので、その実施例を第４
図に示して説明すると、第４図は電源電圧を士に分圧す
る際のパターン構戊であり、基板上に等間隔に電極パタ
ーン１０，１１．１２を導電性ペーストで形或し、次に
、等しい幅で抵抗パターン１３，１４．１５を抵抗性ペ
ーストで形戒する。
なお、＋に分圧するために電極パターン１１．１２間に
２つの抵抗パターン１４．１５を設けた。
抵抗パターン１３，１４．１５は電極パターンが等間隔
で位置しているので長さが等しく、また、幅も等しくし
てあるので、抵抗値が全て等しく形威され、電極パター
ン１１には電源電圧を＋に分圧したものが得られる。
電極パターン１０，１１，１２、抵抗パターン１３，１
４．１５のダレを考慮すると、電極パターンの間隔ｌ、
ダレの長さ△ｌ、抵抗パターンの幅ｄ、ダレの大きさ△
ｄ、すると抵抗パターンの抵抗値Ｒは となり、抵抗値にはダレの影響が表われるが、抵抗パタ
ーン１３，１４．１５の形状がすべて同じであるので抵
抗値はみんな同じＲになる。
そこで、分圧される電圧■をみると、 となり、ダレに関係なく一定した分圧値が得られる。
また、電源電圧を子に分圧するには電極パターン１０．
１１の間に抵抗パターンを独立して２つ設け、電極パタ
ーン１１．１２間に抵抗パターンを独立して３つ設け、
それぞれの抵抗パターンを同．一形状にすると良い。
叙上のように本考案によると、分圧用抵抗を厚膜印刷す
る際に、抵抗パターンをそれぞれ長さ、幅の等しい同一
形状とし、一方あるいは両方の抵抗パターンに並列に同
一形状の抵抗パターンを設けることにより、所望の分圧
比が自由に得られ、がっ、抵抗パターンがすべて独立し
て同一形状にあるので電極パターン、抵抗パターンのダ
レが生じても分圧比に全く無関係となり、一定の分圧さ
れた電圧が得られる等の極めて大きな効果を奏する。
【図面の簡単な説明】
第１図は一般的なトランジスタのバイアス回路を示す回
路図、第２図は従来の分圧用抵抗の印刷パターンを示す
平面図、第３図はダレを示す印刷パターンの断側面図、
第４図は本考案による実施例を示す平面図である。 １０〜１２・・・・・・電極パターン、１３〜１５・・
・・・・抵抗パターン。

Claims (1)

    【実用新案登録請求の範囲】
  1. 相互の間隔が略等しい複数個の電極パターンを設け、該
    電極パターン間にパターン幅が略等しい抵抗パターンを
    設け、該抵抗パターンのうちの少なくとも１つの抵抗パ
    ターンに並列に同一形状の抵抗パターンを設けたことを
    特徴とする厚膜印刷回路。
JP1979109061U 1979-08-08 1979-08-08 厚膜印刷回路 Expired JPS595935Y2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP1979109061U JPS595935Y2 (ja) 1979-08-08 1979-08-08 厚膜印刷回路
CA000357692A CA1149519A (en) 1979-08-08 1980-08-06 Thick film printed circuit
US06/175,954 US4331949A (en) 1979-08-08 1980-08-07 Thick film printed circuit

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1979109061U JPS595935Y2 (ja) 1979-08-08 1979-08-08 厚膜印刷回路

Publications (2)

Publication Number Publication Date
JPS5626911U JPS5626911U (ja) 1981-03-12
JPS595935Y2 true JPS595935Y2 (ja) 1984-02-23

Family

ID=14500600

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1979109061U Expired JPS595935Y2 (ja) 1979-08-08 1979-08-08 厚膜印刷回路

Country Status (3)

Country Link
US (1) US4331949A (ja)
JP (1) JPS595935Y2 (ja)
CA (1) CA1149519A (ja)

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Also Published As

Publication number Publication date
CA1149519A (en) 1983-07-05
US4331949A (en) 1982-05-25
JPS5626911U (ja) 1981-03-12

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