JPS5940738A - デ−タ通信装置 - Google Patents
デ−タ通信装置Info
- Publication number
- JPS5940738A JPS5940738A JP57150876A JP15087682A JPS5940738A JP S5940738 A JPS5940738 A JP S5940738A JP 57150876 A JP57150876 A JP 57150876A JP 15087682 A JP15087682 A JP 15087682A JP S5940738 A JPS5940738 A JP S5940738A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- baud rate
- baud
- transmitter
- data
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L5/00—Arrangements affording multiple use of the transmission path
- H04L5/14—Two-way operation using the same type of signal, i.e. duplex
- H04L5/1438—Negotiation of transmission parameters prior to communication
- H04L5/1446—Negotiation of transmission parameters prior to communication of transmission speed
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Quality & Reliability (AREA)
- Computer Networks & Wireless Communication (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、送受信機間でシリアルデータ信号を適宜設定
された車−レートで送受信するようにしたデータ通信装
置に胸するものであり、その目的とするところは、送信
機側ホーレートを知ることなく受信機側ボーレートを自
動的に設定でき、ボーレートの切換操作が不敬なデータ
通信装置を提供することにある。
された車−レートで送受信するようにしたデータ通信装
置に胸するものであり、その目的とするところは、送信
機側ホーレートを知ることなく受信機側ボーレートを自
動的に設定でき、ボーレートの切換操作が不敬なデータ
通信装置を提供することにある。
一般に、この種のデータ通信装置にあっては、送信機側
ホーレートを確認して受信機側ボーレートをそのホーレ
ートに合致させる操作が心安であり、従来では、ボーレ
ートの変更がある毎に、受信機に設けられ九ボーレート
設定スイ・νチを操作しなけれはならず、操作が煩しい
上、第１図に示すように板数の端末器（Ｔ、）〜（Ｔｎ
）から交換機（ＣＶ）を介してそれぞれ異ったホーレー
トで送られるデータ信号を七ンタ（ＣＴ）で受信するよ
うなデータ通信システムにおいては各ホーレートに対応
する１ＥＪ号線を設けなけれはならないという欠点があ
つだ。本発明は上記の点に鑑みて為されたものである。
ホーレートを確認して受信機側ボーレートをそのホーレ
ートに合致させる操作が心安であり、従来では、ボーレ
ートの変更がある毎に、受信機に設けられ九ボーレート
設定スイ・νチを操作しなけれはならず、操作が煩しい
上、第１図に示すように板数の端末器（Ｔ、）〜（Ｔｎ
）から交換機（ＣＶ）を介してそれぞれ異ったホーレー
トで送られるデータ信号を七ンタ（ＣＴ）で受信するよ
うなデータ通信システムにおいては各ホーレートに対応
する１ＥＪ号線を設けなけれはならないという欠点があ
つだ。本発明は上記の点に鑑みて為されたものである。
以下、実施例について図を用いて説明する。第２図は本
発明の基本構成を示すブロック図であり、（１）は送信
機、ｆ２１ ＃ｉ受信機で、送受信機ｆ１１ ＋２１間
で信号線（１）を介してシリアルデータよシなるデータ
信号を適宜設定されたボーレートで送受信するようにな
っている。この送信機（２）からは予め定められた］−
ド信号をデータ信号の送出に先立って送出するようにな
っている。一方、受信機（２）には、最初に受信された
信号が予め定められた〕−ド信号であることを前提とし
て送信機側ボーレートを識別するボーレート識別部（３
）と、データ信号を受信する信号処理回路＋６＋のボー
レートをこの送信機側ボーレートに一致させるボーレー
ト設定部（４）とが設けられており、受信機（２）で最
初に受信された信号に基いて送信機側ボーレートを識別
してこのボーし一トに受信機側のボーレートを自１１的
に一致させるようになっているので、送信機側ボーレー
トを知ることなく受信機側ボーレートを自動的に設定で
き、ホーレートの切換操作を磨製としないものである。
発明の基本構成を示すブロック図であり、（１）は送信
機、ｆ２１ ＃ｉ受信機で、送受信機ｆ１１ ＋２１間
で信号線（１）を介してシリアルデータよシなるデータ
信号を適宜設定されたボーレートで送受信するようにな
っている。この送信機（２）からは予め定められた］−
ド信号をデータ信号の送出に先立って送出するようにな
っている。一方、受信機（２）には、最初に受信された
信号が予め定められた〕−ド信号であることを前提とし
て送信機側ボーレートを識別するボーレート識別部（３
）と、データ信号を受信する信号処理回路＋６＋のボー
レートをこの送信機側ボーレートに一致させるボーレー
ト設定部（４）とが設けられており、受信機（２）で最
初に受信された信号に基いて送信機側ボーレートを識別
してこのボーし一トに受信機側のボーレートを自１１的
に一致させるようになっているので、送信機側ボーレー
トを知ることなく受信機側ボーレートを自動的に設定で
き、ホーレートの切換操作を磨製としないものである。
以下、具体的に説明する。第８図は本発明一実施例を示
すもので、（１０）は信号線（りを介して受信される最
初の信号（Ｖｃ）をシフトレジスタ（Ｉすに選択的に入
力する入力スイッチであり、シフトレジスタ（１１）は
最初に受信された信号（Ｖｃ）を最高ホーレート（９６
００ボー）のり０ツク（ＣＬ、）によって読み込んで保
持する。（１′４はＵＳＡＲＴ （１３１および複数個
のボーレート９６００．４８００．２４００、・・・・
・・・・・に対応するり０ツク（ＣＬｔ、（ＣＬ、）、
（ＣＬ３）・・・・・・を切換えるアナ０ジスイツチ（
１４）よシなるコード再生部であｆｉ 、 ＵＳＡＲＴ
ｔｌａ＋は受信端子（ＲｘＤ）に入力されるシリアルデ
ータを所定のり０ツク（ＣＬＩ）、（ＣＬ４）、（ＣＬ
３）・・・・・・に基いてＪ＼うしルヂータに変換して
データバス（ＤＢ）に出力するとともに、データバス（
ＤＢ）を介して入力されるパラレルデータを所定のり０
ツク（ＣＬＩ）、（ＣＬ。
すもので、（１０）は信号線（りを介して受信される最
初の信号（Ｖｃ）をシフトレジスタ（Ｉすに選択的に入
力する入力スイッチであり、シフトレジスタ（１１）は
最初に受信された信号（Ｖｃ）を最高ホーレート（９６
００ボー）のり０ツク（ＣＬ、）によって読み込んで保
持する。（１′４はＵＳＡＲＴ （１３１および複数個
のボーレート９６００．４８００．２４００、・・・・
・・・・・に対応するり０ツク（ＣＬｔ、（ＣＬ、）、
（ＣＬ３）・・・・・・を切換えるアナ０ジスイツチ（
１４）よシなるコード再生部であｆｉ 、 ＵＳＡＲＴ
ｔｌａ＋は受信端子（ＲｘＤ）に入力されるシリアルデ
ータを所定のり０ツク（ＣＬＩ）、（ＣＬ４）、（ＣＬ
３）・・・・・・に基いてＪ＼うしルヂータに変換して
データバス（ＤＢ）に出力するとともに、データバス（
ＤＢ）を介して入力されるパラレルデータを所定のり０
ツク（ＣＬＩ）、（ＣＬ。
）、（ＣＬ９）・・・・・・に基いてシリアルデータに
変換して送信端子（ＴｘＤ ）に出力するようにしたも
ので、ＩＪ−５ＡＲＴ （ｌ均に印加されるり０ツク（
ＣＬｔ、（ＣＬＪ 、 （ＣＬ、）・・・・・・をアナ
Ｏタスイ・フチ０＜で選択することによって、複数個の
異なるボーレートに基いて受信端子（ＲｘＤ）に印加さ
れるシリアルデータよりなる信号すなわちシフトレジス
タ（川からくシ返し続出された信号（Ｖｃつ（■ｃ″）
・・・・・・をそれぞれパラレルデータに変換すること
によシ再生して再生コード信号を出力するようになって
いる。識別部はＣＰＵ （１５）にて形成され、コード
再生部０匂にて再生された再生コード信号が予め定めら
れたコード信号（内部メｔりに記憶させている）と一致
しているかどうかをチェックするもので、 ＣＰＵ（Ｉ
［ｉ）からアナ０ジスイツチＯ荀を制御してり０ツク（
ｃｉ−＋）、（ＣＬり、（ＣＬ３）・・・・・・を順次
切換えるり０ツク切換信号が出力されており、いずれの
り０ツク（ＣＬＩ）、（ＣＬｔ）、（ＣＬ３）・・・・
・・で信号（Ｖｃ’）、（■ｃ″）・・・・・・ を再
生したときに予め定められたコード信号が得られるかを
チェックし、予め定められたコード信号が得られたとき
、そのりｏツク（ＣＬｔ、（ＣＬｇ）、（ＣＬ３）−Ｑ
−に対応する車−レートで送信機（１）からデータ信号
が送出されているものと判断して、そのボーレートにて
信号処理回路＋６＋ （ＵＳＡＲＴ （ｌ：ｌが兼用さ
れている）を作動させ以後のデータ信号を再生するもの
である。
変換して送信端子（ＴｘＤ ）に出力するようにしたも
ので、ＩＪ−５ＡＲＴ （ｌ均に印加されるり０ツク（
ＣＬｔ、（ＣＬＪ 、 （ＣＬ、）・・・・・・をアナ
Ｏタスイ・フチ０＜で選択することによって、複数個の
異なるボーレートに基いて受信端子（ＲｘＤ）に印加さ
れるシリアルデータよりなる信号すなわちシフトレジス
タ（川からくシ返し続出された信号（Ｖｃつ（■ｃ″）
・・・・・・をそれぞれパラレルデータに変換すること
によシ再生して再生コード信号を出力するようになって
いる。識別部はＣＰＵ （１５）にて形成され、コード
再生部０匂にて再生された再生コード信号が予め定めら
れたコード信号（内部メｔりに記憶させている）と一致
しているかどうかをチェックするもので、 ＣＰＵ（Ｉ
［ｉ）からアナ０ジスイツチＯ荀を制御してり０ツク（
ｃｉ−＋）、（ＣＬり、（ＣＬ３）・・・・・・を順次
切換えるり０ツク切換信号が出力されており、いずれの
り０ツク（ＣＬＩ）、（ＣＬｔ）、（ＣＬ３）・・・・
・・で信号（Ｖｃ’）、（■ｃ″）・・・・・・ を再
生したときに予め定められたコード信号が得られるかを
チェックし、予め定められたコード信号が得られたとき
、そのりｏツク（ＣＬｔ、（ＣＬｇ）、（ＣＬ３）−Ｑ
−に対応する車−レートで送信機（１）からデータ信号
が送出されているものと判断して、そのボーレートにて
信号処理回路＋６＋ （ＵＳＡＲＴ （ｌ：ｌが兼用さ
れている）を作動させ以後のデータ信号を再生するもの
である。
以下、具体的動作について説明する。
いま、送信機ｔ１）から最初に送出される信号（Ｖｃ）
として予め定められたコード信号（例えはＥＮＱ −Ａ
ＳＣＩＩ ）が送出されると、受信機（２）では最初に
受信された信号（Ｖｃ）を最高ホーレート（９６００ボ
ー）のりＯツク（ＣＬＩ ）でシフトレジスタ（ｌりに
読込んで保持する。このシフトレジスタ（０）に読込ま
れた信号（Ｖｃ）はくり返して読み出されてＵＳＡＲＴ
０３１の受信端子（ＲｘＤ）に入力されるようになっ
ており、各くり返して読出された信号（■ｃ’）（Ｖｃ
”）・・・・・・がＵＳＡＲＴ（＋３１に入力される毎
にりＯ・νり（ＣＬｌ）、（ＣＬＩ）、（ＣＬＩ）・・
・・・・が順次切換えられるようになっている。
として予め定められたコード信号（例えはＥＮＱ −Ａ
ＳＣＩＩ ）が送出されると、受信機（２）では最初に
受信された信号（Ｖｃ）を最高ホーレート（９６００ボ
ー）のりＯツク（ＣＬＩ ）でシフトレジスタ（ｌりに
読込んで保持する。このシフトレジスタ（０）に読込ま
れた信号（Ｖｃ）はくり返して読み出されてＵＳＡＲＴ
０３１の受信端子（ＲｘＤ）に入力されるようになっ
ており、各くり返して読出された信号（■ｃ’）（Ｖｃ
”）・・・・・・がＵＳＡＲＴ（＋３１に入力される毎
にりＯ・νり（ＣＬｌ）、（ＣＬＩ）、（ＣＬＩ）・・
・・・・が順次切換えられるようになっている。
ここに、送信機側ボーレートが４ｓｏｏ＋ｔニーである
場合には、ＵＳＡＲＴ Ｑ３）にてボーレートが９６０
０車−のりＯツク（ＣＬＩ）に基いて信号（Ｖｃ’）を
再生した再生コード信号はボーレートが異っているため
に、予め定められた］−ド信号（ＥＮＱ）とは全く別の
ものになり、ＣＰＵ（＋５）ではボーレートの不一致と
判断してＵＳＡＲＴ（１：１のり０ツクを次のボーレー
ト（，４８００ボー）の９０・νり（ＣＬｔ）に切換え
るとともに再び入力される信号（ｖｃつをホーレート４
８００ボーで外生ずる。この場合、ボーレートが一致し
ているので、コード再生部（１２）からは予め定められ
た］−ド信号（ＥＮＱ）が正常に再生され、ＣＰＵＱ６
）ではボーレートの一致が確認される。ボーレートの一
致が確認されると、以後の信号処理はＵＳＡＲＴ （１
３）のり０ツクをり０ツク（ＣＬｆ）に固定してボーレ
ート４８００ポーで行なわれる。図中（１６＞はシフト
レジスタ（１１）に保持されている信号を〈シ返して読
出すたアンド回路（１〜出力によって制御されるように
なっている。第４図（ａ）〜（Ｃ）は各点（Ａ）〜（Ｃ
）の電圧波形、同図（ｄ）は受信機（２）から送信機（
］）に確認信号（ＶＯＫ）を送り返すタイ三′Ｊジを示
すタイムチトートである０ 第５図は他の実施例を示すもので、（２１）は送受信機
間で設定し得る最高ポーレー） （９６００ボー）に対
応するり０ツク周波数（９６００Ｈｚ ）の基準パルス
信号（Ｖｐ）を出力するパルス発振器、（財）は基準パ
ルス信号（Ｖｐ）を最初受信された信号（Ｖｃ）のＨレ
ベル（あるいはＬレベル）区間だけ計数するようにしだ
カウンタであり、パルス発振器（２１）およびカウンタ
（２２にてボーレート識別部（３）が形成されている。
場合には、ＵＳＡＲＴ Ｑ３）にてボーレートが９６０
０車−のりＯツク（ＣＬＩ）に基いて信号（Ｖｃ’）を
再生した再生コード信号はボーレートが異っているため
に、予め定められた］−ド信号（ＥＮＱ）とは全く別の
ものになり、ＣＰＵ（＋５）ではボーレートの不一致と
判断してＵＳＡＲＴ（１：１のり０ツクを次のボーレー
ト（，４８００ボー）の９０・νり（ＣＬｔ）に切換え
るとともに再び入力される信号（ｖｃつをホーレート４
８００ボーで外生ずる。この場合、ボーレートが一致し
ているので、コード再生部（１２）からは予め定められ
た］−ド信号（ＥＮＱ）が正常に再生され、ＣＰＵＱ６
）ではボーレートの一致が確認される。ボーレートの一
致が確認されると、以後の信号処理はＵＳＡＲＴ （１
３）のり０ツクをり０ツク（ＣＬｆ）に固定してボーレ
ート４８００ポーで行なわれる。図中（１６＞はシフト
レジスタ（１１）に保持されている信号を〈シ返して読
出すたアンド回路（１〜出力によって制御されるように
なっている。第４図（ａ）〜（Ｃ）は各点（Ａ）〜（Ｃ
）の電圧波形、同図（ｄ）は受信機（２）から送信機（
］）に確認信号（ＶＯＫ）を送り返すタイ三′Ｊジを示
すタイムチトートである０ 第５図は他の実施例を示すもので、（２１）は送受信機
間で設定し得る最高ポーレー） （９６００ボー）に対
応するり０ツク周波数（９６００Ｈｚ ）の基準パルス
信号（Ｖｐ）を出力するパルス発振器、（財）は基準パ
ルス信号（Ｖｐ）を最初受信された信号（Ｖｃ）のＨレ
ベル（あるいはＬレベル）区間だけ計数するようにしだ
カウンタであり、パルス発振器（２１）およびカウンタ
（２２にてボーレート識別部（３）が形成されている。
図中、（ロ）は信号線（１）を介して受信される最初の
信号（Ｖｃ）をボーレート識別部（３）に入力するとと
もに以後のデータ信号をＵＳＡＲＴ Ｈの受信端子（Ｒ
ｘＤ）に入力するための切換スイッチ、（２３１伐均は
立下り検出回路、醜）は８進あるいは４進のカウンタ、
（ハ）はアンド回路であシ、立下シ検出回路（財）、カ
ウンタ（２４）およびアンド回路（ホ）にてカウンタ（
社）の動作タイミンクを制御するゲート回路が形成され
立下り検出回路□□□出力によってカウンタ（２′４出
力をう・シチ回路し７）にラッチするタイ三−Ｊ／）お
よび切換スイッチ（ロ））をＵＳＡＲＴ （１３１側（
ａ−ｃ側）に切換えルタイ＝ン’）を設定するようにな
っている。
信号（Ｖｃ）をボーレート識別部（３）に入力するとと
もに以後のデータ信号をＵＳＡＲＴ Ｈの受信端子（Ｒ
ｘＤ）に入力するための切換スイッチ、（２３１伐均は
立下り検出回路、醜）は８進あるいは４進のカウンタ、
（ハ）はアンド回路であシ、立下シ検出回路（財）、カ
ウンタ（２４）およびアンド回路（ホ）にてカウンタ（
社）の動作タイミンクを制御するゲート回路が形成され
立下り検出回路□□□出力によってカウンタ（２′４出
力をう・シチ回路し７）にラッチするタイ三−Ｊ／）お
よび切換スイッチ（ロ））をＵＳＡＲＴ （１３１側（
ａ−ｃ側）に切換えルタイ＝ン’）を設定するようにな
っている。
以下、動作について第６図のタイムチト−トを用いて説
明する。いま、切換スイッチ（ロ）はａ−ｂ側に切換え
られており、第６図（ａ）に示す最初に受信される信号
（Ｖｃ ）け立下シ検出回路（２３１に入力され、同図
（ｂ）に示すように最初の立下りで立下り検出回路（２
３１出力（ＶＺυがＨレベルとなり、カウンタ（２４）
が動作しするとともにパルス発振器（２１）が動作して
それぞれ同図（ｃ） （ｄ）に示す出力（Ｌ＜）（Ｖｐ
）が得られる。アンド回路（社）は信号（Ｖｃ）とパル
ス発振器し１）から出力される基準パルス信号（Ｖｐ）
とカウンターの出力（ｖＪを入力としこれ等の論理積を
とるもので、アシド回路（ホ）出力（Ｖｉａ ）は同図
（ｅ）に示すようになり、カウンタ（２２に入力される
。カウンタ（２２ではこのアンド回路（２６）の出力Ｃ
Ｖｓａ）のパルス数をｔＪ’）：／トすることによって
送信機側ボーレートに比例するデータを出力する。但し
、実施例ではカウンタ（２４出力がＮであれば送信機側
ボーレートが最高ボーレート（９６００ボー）の１／Ｎ
であることを示してお６００ す、第６図の場合には、 ＝２４００ボーとなっている
。このカウンタ（２４出力は同図（ｆ）に示すように立
下り検出回路（２囚の出力（Ｖｔｓ）が■レベルとなる
タイ三シジでラッチ回路Ｑ力にラッチされ、このラツ子
回路〜υにラッチされたデータがヂコータレ４を介して
アナＯ′ｊスイッチ（１（ｌに入力され、この場合、２
４００ボーに対応する所定のり０゛リクパルス（Ｃｌ４
）がＵＳＡＲＴ Ｈに印加さ１する。
明する。いま、切換スイッチ（ロ）はａ−ｂ側に切換え
られており、第６図（ａ）に示す最初に受信される信号
（Ｖｃ ）け立下シ検出回路（２３１に入力され、同図
（ｂ）に示すように最初の立下りで立下り検出回路（２
３１出力（ＶＺυがＨレベルとなり、カウンタ（２４）
が動作しするとともにパルス発振器（２１）が動作して
それぞれ同図（ｃ） （ｄ）に示す出力（Ｌ＜）（Ｖｐ
）が得られる。アンド回路（社）は信号（Ｖｃ）とパル
ス発振器し１）から出力される基準パルス信号（Ｖｐ）
とカウンターの出力（ｖＪを入力としこれ等の論理積を
とるもので、アシド回路（ホ）出力（Ｖｉａ ）は同図
（ｅ）に示すようになり、カウンタ（２２に入力される
。カウンタ（２２ではこのアンド回路（２６）の出力Ｃ
Ｖｓａ）のパルス数をｔＪ’）：／トすることによって
送信機側ボーレートに比例するデータを出力する。但し
、実施例ではカウンタ（２４出力がＮであれば送信機側
ボーレートが最高ボーレート（９６００ボー）の１／Ｎ
であることを示してお６００ す、第６図の場合には、 ＝２４００ボーとなっている
。このカウンタ（２４出力は同図（ｆ）に示すように立
下り検出回路（２囚の出力（Ｖｔｓ）が■レベルとなる
タイ三シジでラッチ回路Ｑ力にラッチされ、このラツ子
回路〜υにラッチされたデータがヂコータレ４を介して
アナＯ′ｊスイッチ（１（ｌに入力され、この場合、２
４００ボーに対応する所定のり０゛リクパルス（Ｃｌ４
）がＵＳＡＲＴ Ｈに印加さ１する。
このとき、切換スイッチ（／！１１）はａ−ｃ側に切換
えられて、以後受信されるデータ信号はＩＪｂＡＲＴ（
ｌ場の受信端子（ＲｘＤ）に入力され、送信機側ボーレ
ートと等しいボーレート（２４００ボー）で信号処理が
行なわれデータの送受信が正常に行なわれる。なお、実
施例では送信機（１）から送出されるコード信号のうち
最初の適数個のヒツトが１１土１−ＯＪのくり返しとな
っている。また、パルス発振器（２］）、立下り検出回
路（２３）（社）、カウンタ（２４ＪはＣＰＵ （＋５
１から出力されるコント０−小信号（ＣＮＴ）によつ°
Ｃ送受信終了と同時に初期の状態にリセットされる。
えられて、以後受信されるデータ信号はＩＪｂＡＲＴ（
ｌ場の受信端子（ＲｘＤ）に入力され、送信機側ボーレ
ートと等しいボーレート（２４００ボー）で信号処理が
行なわれデータの送受信が正常に行なわれる。なお、実
施例では送信機（１）から送出されるコード信号のうち
最初の適数個のヒツトが１１土１−ＯＪのくり返しとな
っている。また、パルス発振器（２］）、立下り検出回
路（２３）（社）、カウンタ（２４ＪはＣＰＵ （＋５
１から出力されるコント０−小信号（ＣＮＴ）によつ°
Ｃ送受信終了と同時に初期の状態にリセットされる。
第７図はさらに他の実施例を示すもので、前述の第５図
実施例においてパルス発振器（７！Ｉ）として厳重ホー
レートに対するクロック周波数よりもはるかに高い高周
波数の基準パルス信号（Ｖｐ）を出力するものを用いた
ものであり、カウンタ（２噂出力は基準パルス信号（Ｖ
ｐ）の周波数と送信機側ホーレートに対応するり０ツク
周波数との比に相当するデータとなっている。したがっ
て、このデータをラッチ回路（２７Ｉにラッチし、う・
ソチ回路（２７ｊから読出されたデータにて基準パルス
信号（ｖｐ ）を分周する分周器し９）の分周比を設定
することにより、分周器い１）から送信機側ホーレート
に対応するクロック周波数をイｊするり０ツク（ＣＬ）
が出力されることになり、以後ＵＳＡＲＴ （１３１に
送信機側のクロックと同一周波数のり０ツク（ＣＬ）が
供給され、データが正常ｆ（送受信される。実施例にあ
ってｕカウンタ（２の出力をＮとした場合に分周器体）
）にて基準パルス信号（Ｖｐ）をいに分周することによ
って９０ツク（Ｃ１，）を形成するようになっている。
実施例においてパルス発振器（７！Ｉ）として厳重ホー
レートに対するクロック周波数よりもはるかに高い高周
波数の基準パルス信号（Ｖｐ）を出力するものを用いた
ものであり、カウンタ（２噂出力は基準パルス信号（Ｖ
ｐ）の周波数と送信機側ホーレートに対応するり０ツク
周波数との比に相当するデータとなっている。したがっ
て、このデータをラッチ回路（２７Ｉにラッチし、う・
ソチ回路（２７ｊから読出されたデータにて基準パルス
信号（ｖｐ ）を分周する分周器し９）の分周比を設定
することにより、分周器い１）から送信機側ホーレート
に対応するクロック周波数をイｊするり０ツク（ＣＬ）
が出力されることになり、以後ＵＳＡＲＴ （１３１に
送信機側のクロックと同一周波数のり０ツク（ＣＬ）が
供給され、データが正常ｆ（送受信される。実施例にあ
ってｕカウンタ（２の出力をＮとした場合に分周器体）
）にて基準パルス信号（Ｖｐ）をいに分周することによ
って９０ツク（Ｃ１，）を形成するようになっている。
第８図（ａ）〜（ｆ）はＨｉ１作を示すタイムチャート
である。
である。
以上のように第５図および第７図実施例にあっては基準
パルス信号（Ｖｐ）と最初に受信されたイｄ８（ＶＣ）
とをカウンタ（四にて比較し、カウンタ（ロ）出力とし
て送信機側ボーレートに対応するり０・νり周波数と基
準パルス信号ｆｆｐ）の周波数との比を得るようにして
送信機側ボーレートを識別するようになっているので、
第８図実施例のように信号（ｖｃ）をくり返して再生し
てボーレートを識別する必要がなく、識別速度が早くな
るという効果を有するものである。また、第７図実施例
にあっては、送信機側ボーレートが峰時変化あるいは温
度変化などによって予め設定された値（ｏｆｌｏｏ、
４８００．２４００、・・・・・・）よりも僅かにず
れた場合にあっても、受信機側ボーレートを追随させる
ことができるので、データの送受信を常に正常に行なう
ことができる上、カウンタ の出力を外部散り出すこと
によって送信機側の異常（ボーレートの変動）を他の装
置を用いることなく認知することができる本発明は−Ｆ
述のように送受信機間でシリアルデータよりなるデータ
信号を適宜設定されたボーレートで送受信するようにし
たデータ通信装置において、送信機から予め定められた
コード信号をデータ信号の送出に先立って最初に送出せ
しめ、最初に受信された信号が該コード信号であること
を前提として送信機側ボーレートを識別するボーレート
識別部と、データ信号を受信する信号処理回路のホーレ
ートを該送信機側ボーレートに一致させるボーレート設
定部とを受信機に設けたものであり、送信機側ボーレー
トを知ることなく、受信様側のポーレニ］・全自動的に
設定でき、ボーレートの切換操作が不要になるという利
点があり、第１図に示すようなデータ通信システムにお
いて、従来例のように各ボーレート毎に信号線を設ける
必碩がなく、またセンタ（ＣＴ）は端末器（’ｌ’＋
） ” （Ｔｎ ）側のボーレートを意識することなく
データ全受信することができるという効果がある。
パルス信号（Ｖｐ）と最初に受信されたイｄ８（ＶＣ）
とをカウンタ（四にて比較し、カウンタ（ロ）出力とし
て送信機側ボーレートに対応するり０・νり周波数と基
準パルス信号ｆｆｐ）の周波数との比を得るようにして
送信機側ボーレートを識別するようになっているので、
第８図実施例のように信号（ｖｃ）をくり返して再生し
てボーレートを識別する必要がなく、識別速度が早くな
るという効果を有するものである。また、第７図実施例
にあっては、送信機側ボーレートが峰時変化あるいは温
度変化などによって予め設定された値（ｏｆｌｏｏ、
４８００．２４００、・・・・・・）よりも僅かにず
れた場合にあっても、受信機側ボーレートを追随させる
ことができるので、データの送受信を常に正常に行なう
ことができる上、カウンタ の出力を外部散り出すこと
によって送信機側の異常（ボーレートの変動）を他の装
置を用いることなく認知することができる本発明は−Ｆ
述のように送受信機間でシリアルデータよりなるデータ
信号を適宜設定されたボーレートで送受信するようにし
たデータ通信装置において、送信機から予め定められた
コード信号をデータ信号の送出に先立って最初に送出せ
しめ、最初に受信された信号が該コード信号であること
を前提として送信機側ボーレートを識別するボーレート
識別部と、データ信号を受信する信号処理回路のホーレ
ートを該送信機側ボーレートに一致させるボーレート設
定部とを受信機に設けたものであり、送信機側ボーレー
トを知ることなく、受信様側のポーレニ］・全自動的に
設定でき、ボーレートの切換操作が不要になるという利
点があり、第１図に示すようなデータ通信システムにお
いて、従来例のように各ボーレート毎に信号線を設ける
必碩がなく、またセンタ（ＣＴ）は端末器（’ｌ’＋
） ” （Ｔｎ ）側のボーレートを意識することなく
データ全受信することができるという効果がある。
Ｍ１図はデータ通信システムの一例を示す図、第２図は
本発明の基本ｍ成を示すプ０゛νり図、第８図は同上の
一実施例を示すブロック回路図、第４図（ａ） ” （
ｄ）は同上の動作説明図、第５図は他の実施例のブロッ
ク回路図、第６図（ａ）〜（ｆ） Ｖｉ同上の動作説明
図、第７図はさらに他の実施例のブロック回路図、第８
図（ａ）〜（ｆ）は同上の動作説明図である（ｌ駆送イ
バ機、（２）は受信機、（３）はボーレートを哉ｙ３１
Ｊａｔｔ、ｆ＋））ｉボーレート設定部、（５）は信号
処理回路である０
本発明の基本ｍ成を示すプ０゛νり図、第８図は同上の
一実施例を示すブロック回路図、第４図（ａ） ” （
ｄ）は同上の動作説明図、第５図は他の実施例のブロッ
ク回路図、第６図（ａ）〜（ｆ） Ｖｉ同上の動作説明
図、第７図はさらに他の実施例のブロック回路図、第８
図（ａ）〜（ｆ）は同上の動作説明図である（ｌ駆送イ
バ機、（２）は受信機、（３）はボーレートを哉ｙ３１
Ｊａｔｔ、ｆ＋））ｉボーレート設定部、（５）は信号
処理回路である０
Claims (1)
- 【特許請求の範囲】 （１） 送受信機間でシリアルデータよシなるデータ
信号を適宜設定されたホーレートで送受信するようにし
たデータ通信装置において、送信機から予め定められた
コード信号をデータ信号の送出に先立って最初に送出せ
しめ、最初に受信された信号が該コード信号であること
を前提として送信機側ボーレート？ｒａｔ別するホーレ
ート識別部と、データ信号を受信する信号処理回路のボ
ーレートを該送信機側ボーレートに一致させるボーレー
ト設定部とを受信機に設けて成ることを特徴とするデー
タ通信装置。 （２）最初に受信された信号を保持するシフトレジスタ
と、シフトレジスタからくり返し読出された信号を複数
個の異なるボーレートに基いてそれぞれ再生して再生コ
ード信号を出力するコード再生部と、再生コード信号が
予め定められたコード信号と一致しているかどうかをチ
ェックして一致している場合にそのボーレートを送信側
ボーレートとして識別する識別部とでホーレート識別部
を形成して成ることを特徴とする特許請求の範囲第。 １項記載のデータ通信装置。 （８）送受信機間で設定し得る最高ボーレートに対応す
るり０ツク周波数の基準パルス信号を出力するパルス発
振器と、該基準パルス信号を最初に受信された信号のＨ
レベルあるいはＬレベル区間だけ計数するカウンタとで
ホーレート識別部を形成して成ることを特徴とする特許
請求の範＃ｌＩｉ第１項記載のデータ通信装置。 （４）送受信機間で設定し得る最高ボーレートよりも高
周波数の基準パルス信号を出力するパルス発振器と、該
基準パルス信号を受信された信号のＨレベルあるいはＬ
レベル区間だけ計数するカウンタと、カウンタ出力に基
いて送信側ボーレートを識別する識別部とでボーレート
識別部を形成して成ることを特徴とする特許請求の範囲
第１項記載のデータ通信装置◇
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57150876A JPS5940738A (ja) | 1982-08-31 | 1982-08-31 | デ−タ通信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57150876A JPS5940738A (ja) | 1982-08-31 | 1982-08-31 | デ−タ通信装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5940738A true JPS5940738A (ja) | 1984-03-06 |
Family
ID=15506302
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57150876A Pending JPS5940738A (ja) | 1982-08-31 | 1982-08-31 | デ−タ通信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5940738A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62134741A (ja) * | 1985-12-06 | 1987-06-17 | Panafacom Ltd | シリアル入力方式 |
-
1982
- 1982-08-31 JP JP57150876A patent/JPS5940738A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62134741A (ja) * | 1985-12-06 | 1987-06-17 | Panafacom Ltd | シリアル入力方式 |
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