JPS5933544U - カウンタ−読み込み回路 - Google Patents

カウンタ−読み込み回路

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JPS5933544U
JPS5933544U JP12499382U JP12499382U JPS5933544U JP S5933544 U JPS5933544 U JP S5933544U JP 12499382 U JP12499382 U JP 12499382U JP 12499382 U JP12499382 U JP 12499382U JP S5933544 U JPS5933544 U JP S5933544U
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JP
Japan
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counter
reading circuit
counter reading
microprocessor
contents
Prior art date
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Pending
Application number
JP12499382U
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English (en)
Inventor
輪島　博樹
Original Assignee
株式会社東芝
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Publication date
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Publication of JPS5933544U publication Critical patent/JPS5933544U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のマイクロプロセッサのプログラミングに
よる２度読み方式によるプログラムのフローチャート、
第２図は従来のラッチ回路を持つた読込み回路の構成図
、第３図は本考案の一実施例を示す回路構成図である。 １・・・カウンタ、２・・・バスドライバー、３・・・
マイクロプロセッサ、４・・・ラッチ回路、５．６・・
・タイミング発生回路、ａ・・・カウンターカウントア
ツプ信号、ｂ・・・カウンターカウントダウン信号、Ｃ
・・・マイクロプロセッサからのカウンター内容読み込
み信号、ｄ・・・マイクロプロセッサへの停止信号、ｅ
・・・割り込みタイミング信号、ｆ・・・ラッチタイミ
ング。

Claims (1)

    【実用新案登録請求の範囲】
  1. カウンターと、このカウンターの内容を読み込むマイク
    ロプロセッサと、前記カウンターの内容変化中、前記マ
    イクロプロセッサがカウンターの内容を読み込もうとし
    ている間マイクロプロセッサに停止信号を出力するタイ
    ミング発生回路とを具備してなるカウンター読み込み回
    路。
JP12499382U 1982-08-20 1982-08-20 カウンタ−読み込み回路 Pending JPS5933544U (ja)

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JP12499382U JPS5933544U (ja) 1982-08-20 1982-08-20 カウンタ−読み込み回路

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JPS5933544U true JPS5933544U (ja) 1984-03-01

Family

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JP12499382U Pending JPS5933544U (ja) 1982-08-20 1982-08-20 カウンタ−読み込み回路

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