JPS5923856U - デイスク装置のデ−タ転送制御回路 - Google Patents
デイスク装置のデ−タ転送制御回路Info
- Publication number
- JPS5923856U JPS5923856U JP11717282U JP11717282U JPS5923856U JP S5923856 U JPS5923856 U JP S5923856U JP 11717282 U JP11717282 U JP 11717282U JP 11717282 U JP11717282 U JP 11717282U JP S5923856 U JPS5923856 U JP S5923856U
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- JP
- Japan
- Prior art keywords
- disk device
- control circuit
- data transfer
- full
- transfer control
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案の一実施例を示す電気的構成図、第２図
はディスクの動作を示す図である。 １・・・演算制御装置、２・・・メモリ、３・・・ＦＩ
ＦＯレジスタ、４・・・ＦＩＦＯコントローラ、５・・
・ディスク制御回路、６・・・ディスク装置、ＤＢ１〜
ＤＢ、・・・バス。
はディスクの動作を示す図である。 １・・・演算制御装置、２・・・メモリ、３・・・ＦＩ
ＦＯレジスタ、４・・・ＦＩＦＯコントローラ、５・・
・ディスク制御回路、６・・・ディスク装置、ＤＢ１〜
ＤＢ、・・・バス。
Claims (1)
- 演算制御装置とディスク装置を接続して情報のやりとり
を行う場合において、演算制御装置とディスク装置間に
データを一時的に格納するＦＩＦＯ方式のレジスタと、
該レジスタに格納されているデータの情況に応じてフル
（ＦＵＬＬ）、プリフル（ＰＲＥ−ＦＵＬＬ）及びエン
プティ（ＥＭＰＴＹ）の３つのレベルの信号を出力する
制御回路を設け、該制御回路の出力に応じてディスク装
置と演算制御装置間のデータの転送を制御することがで
きるように１、たことを特徴とするディスク装置のデー
タ転送制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11717282U JPS5923856U (ja) | 1982-07-30 | 1982-07-30 | デイスク装置のデ−タ転送制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11717282U JPS5923856U (ja) | 1982-07-30 | 1982-07-30 | デイスク装置のデ−タ転送制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5923856U true JPS5923856U (ja) | 1984-02-14 |
Family
ID=30269830
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11717282U Pending JPS5923856U (ja) | 1982-07-30 | 1982-07-30 | デイスク装置のデ−タ転送制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5923856U (ja) |
-
1982
- 1982-07-30 JP JP11717282U patent/JPS5923856U/ja active Pending
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