JPS59211394A - Digital color encoder - Google Patents

Digital color encoder

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Publication number
JPS59211394A
JPS59211394A JP58085434A JP8543483A JPS59211394A JP S59211394 A JPS59211394 A JP S59211394A JP 58085434 A JP58085434 A JP 58085434A JP 8543483 A JP8543483 A JP 8543483A JP S59211394 A JPS59211394 A JP S59211394A
Authority
JP
Japan
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data
color
signal
output
rom
Prior art date
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Pending
Application number
JP58085434A
Other languages
Japanese (ja)
Inventor
Yoshimaru Maruno
芳丸 丸野
Katsutoshi Doi
土居 勝利
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Sony Corp
Original Assignee
Sony Corp
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Publication date
Application filed by Sony Corp filed Critical Sony Corp
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Publication of JPS59211394A publication Critical patent/JPS59211394A/en
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N9/00Details of colour television systems
    • H04N9/64Circuits for processing colour signals

Landscapes

  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Controls And Circuits For Display Device (AREA)

Abstract

PURPOSE:To form a composite color video signal by processing digitally a component data such as three primary color video data. CONSTITUTION:Primary color data R, G, B are applied from input terminals 1, 2, 3 and taken as address inputs to ROMs 11, 12, 13. A data converting table representing the corresponding between the address input and the output data is stored to each ROM. A luminance data Y is applied to a delay circuit 21 for time matching and color difference data R-Y and B-Y are applied to low pass filters 22 and 23 of digital constitution. An output of delay circuits 21, 22, 23 is applied to an ROM30 as an address input. Four data converting tables 31, 32, 33 and 34 are stored in the ROM30. The digital composite color video data is read at the output of the ROM30. The data is D/A-converted and applied to an adder 38 to which a burst signal and a synchronizing signal are applied, then the result is outputted via a low pass filter 41.

Description

【発明の詳細な説明】 [産業上の利用分野J この発明は、3原色のビデオデータのようなコンポーネ
ントデータをディジタル処理することによシコンポジッ
トカラービデオ信号を形成するようにしたディジタルカ
ラーエンコーダに関t−る。
Detailed Description of the Invention [Industrial Application Field J] The present invention relates to a digital color encoder that forms a composite color video signal by digitally processing component data such as video data of three primary colors. I'm concerned.

「背景技術とその問題点」 ビデオカメラの撮、像出力信号や、マイクロコンピュー
タから出力される表示データは、R,G。
"Background technology and its problems" Video camera capture and image output signals and display data output from microcomputers are R and G.

B(3原色信号)の形態を有している。R,G。B (three primary color signals). R,G.

B入力端子を持たないNTSCモニター受像機によって
、上述のカラー信号を表示するには、 NTSC方式の
コンポジット信号(複合カラービデオ信号)に変換する
必要がある。従来のアナログカラーエンコーダは、マト
リクス回路によって、R,G。
In order to display the above color signal on an NTSC monitor receiver that does not have a B input terminal, it is necessary to convert it to an NTSC system composite signal (composite color video signal). Conventional analog color encoders use matrix circuits to encode R, G, and R.G.

B信号から輝度信号Yと色差信号U、Vとを形成し、こ
の色差信号によりサブキャリアを直交2相変調して搬送
色信号を形成し1、輝度信号Yに対して搬送色信号を加
算することで、コンポジット信号を発生する構成とされ
ていた。
A luminance signal Y and color difference signals U and V are formed from the B signal, the subcarrier is orthogonally two-phase modulated by this color difference signal to form a carrier color signal, and the carrier color signal is added to the luminance signal Y. It was designed to generate a composite signal.

しかし、アナログカラーエンコーダでは、温度変化、経
年変化などに対して動作が不安定となったり、回路規模
が犬きぐなったり、IC化に不向きなどの問題点が生じ
る。これは、アナログカラーエンコーダで形成されたコ
ンポジット信号をディジタル化する場合でも同様である
However, analog color encoders have problems such as unstable operation due to changes in temperature and aging, a large circuit size, and unsuitability for IC implementation. This also applies when a composite signal formed by an analog color encoder is digitized.

そこで、ディジタル化された3原色データからディジタ
ル演算のみでコンポジット信号を形成することができる
ディジタルカラーエンコーダが提案されている。乙のデ
イジタル力ラーエンコーダは、R,G、Bの各信号をテ
イジタルデータに変換し、これらに所定の係数を乗じて
加算することによって輝度データYを形成し、この輝度
データYと3原色テータとを演算することによって色差
データU、Vを形成し、この色差データU、Vをディジ
タル変調して輝度データYに加算する構成のものである
。サンプリング周波数が4 fSCの場合、ディジタル
変調は、第1図に示すように、41      1  
          1個の直交する成分を(−U→−
−■→−2”−+22 ■)の順序でサンプリング周期で発生させることによっ
てなされる。サンプリング位相の0’、90°。
Therefore, a digital color encoder has been proposed that can form a composite signal from digitized three primary color data using only digital calculations. B's digital color encoder converts each R, G, and B signal into digital data, multiplies these by a predetermined coefficient, and adds them to form luminance data Y, and combines this luminance data Y with the three primary colors. The color difference data U and V are formed by calculating the data, and the color difference data U and V are digitally modulated and added to the luminance data Y. When the sampling frequency is 4 fSC, the digital modulation is 41 1 as shown in FIG.
One orthogonal component is (-U→-
-■→-2''-+22 ■) at the sampling period in the order of 0' and 90° of the sampling phase.

180°、270°の夫々とこれらの4個の成分とが対
応している。
These four components correspond to each of 180° and 270°.

しかしながら、輝度デー272色差データU。However, the luminance data 272 color difference data U.

■の形成などには、乗算回路を必要とし、回路規模が大
きくなる欠点があった。特に、マイクロコンピュータの
R,G、B出力のような場合には、各コンポーネントデ
ータが1ビツト又は2ビット程度であって、このような
データを処理するたンに、多くの演算回路を必要とする
ことは得策といえない。
Forming (2) requires a multiplication circuit, which has the disadvantage of increasing the circuit scale. In particular, in cases such as the R, G, and B outputs of a microcomputer, each component data is about 1 or 2 bits, and many arithmetic circuits are required to process such data. It is not a good idea to do so.

「発明の目的」 この発明は、回路構成が簡単で、  IC化したときに
高密度の実装が可能なディジタルカラーエンコーダの提
供を目的とするものである。
``Object of the Invention'' The object of the present invention is to provide a digital color encoder that has a simple circuit configuration and can be mounted at high density when integrated into an IC.

「発明の概要」 この発明は、サンシリング位相情報と変調位相とに対応
する重み伺は情報とによってコンポーネントデータを変
換するデータ変換テーブルが記憶されたメモリを備え、
このメモリに対してカラービデオデータのコンポーネン
トデータがアドレス入力とされ、メモリからコンポジッ
トデータを読出すようにしたディジタルカラーエンコー
ダである。
``Summary of the Invention'' The present invention includes a memory storing a data conversion table for converting component data based on sampling phase information and weighting information corresponding to a modulation phase.
This is a digital color encoder in which component data of color video data is input as an address to this memory, and composite data is read from the memory.

し実施例」 第2図を参照してこの発明の一実施例について説明する
。第2図において、1,2.3の夫々は、原色のカラー
データR,G、Bが供給される入力端子である。カラー
データR,G、Bは、各々4f のサンプリング周波数
でサンプリングされ、C 1サンプルが例えば3ビ7トに変換されたものである。
EMBODIMENT OF THE INVENTION An embodiment of the present invention will be described with reference to FIG. In FIG. 2, reference numerals 1, 2, and 3 are input terminals to which primary color data R, G, and B are supplied, respectively. The color data R, G, and B are each sampled at a sampling frequency of 4f, and each C1 sample is converted into, for example, 3 bits and 7 bits.

このカラーデータは、カラー撮像装置、マイクロコンピ
ュータなどのソースから発生したものである。
This color data is generated from a source such as a color imaging device or a microcomputer.

この原色のカラーデータがROM 11 、12 。The color data of this primary color is ROM 11, 12.

13のアドレス入力とされる。ROM 11には、アド
レス入力(R,G、B)と出力データ(輝度データY)
との対応を示すデータ変換テーブルが記憶されており、
同様に、ROM 12及びROM 13の夫々には、ア
ドレス入力(R,G、B)と出力データ(R−Yデータ
及びB−Yデータ)との対応を示すデータ変換テーブル
が記憶されている。輝度データY1色差データR,−Y
及びB−Yは、カラーデータR,G、Bの夫々に所定の
係数を乗じて加算したものである。
13 address inputs. ROM 11 contains address input (R, G, B) and output data (luminance data Y).
A data conversion table is stored that shows the correspondence with
Similarly, each of the ROM 12 and ROM 13 stores a data conversion table showing the correspondence between address inputs (R, G, B) and output data (RY data and BY data). Luminance data Y1 Color difference data R, -Y
and B-Y are obtained by multiplying each of the color data R, G, and B by a predetermined coefficient and adding them.

ROM 11から読出された輝度データYが時間合わせ
用の遅延回路21に供給され、ROM 12及び13か
ら読出された色差データR−Y及びB−Yが夫々ディジ
タルフィルタの構成のロー/(スフイルタ22及び23
に供給される。このロー・(スフイルタ〉2及び23は
、色差信号の帯域を例えば0.5MHzに制限するもの
で、ロー・くスフイルり22及び23で生じる遅延量を
遅延回路21が有している。
The luminance data Y read out from the ROM 11 is supplied to a delay circuit 21 for time adjustment, and the color difference data R-Y and B-Y read out from the ROMs 12 and 13 are supplied to the low/(screen filter 22) of the digital filter configuration. and 23
supplied to The low filters 2 and 23 limit the band of the color difference signal to, for example, 0.5 MHz, and the delay circuit 21 has the amount of delay caused by the low filters 22 and 23.

この遅延回路21゛、ロー・(スフイルり22及び23
の出力に現れる輝度データYと色差データR−Y及びB
−YとがROM 30にアドレス入力として供給される
。このROM 30には、4個のサンプリング位相とり
]応する4個のデータ変換テーブル31.32.33.
34が記憶されている。データ変換テーブル31は、サ
ンシリング位相が08のデータ変換テーブル32は、サ
ンシリング位相がので、データ変換テーブル33は、サ
ンプリング位相が180°の時の出力データ(Y−40
’)を発生するもので、データ変換テーブル34は、サ
ンV)を発生するものである。つ捷シ、これらのデータ
変換テーブル31〜34は、カラーデータRG、Bに変
調位相及びサンプリング位相に対応する重み伺は係数を
乗じた出力データを発生するものである。
This delay circuit 21', low filters 22 and 23
Luminance data Y and color difference data RY and B appearing in the output of
-Y is provided to ROM 30 as an address input. This ROM 30 has four sampling phases and four corresponding data conversion tables 31, 32, 33.
34 is stored. The data conversion table 31 has a sampling phase of 08, the data conversion table 32 has a sampling phase of 08, and the data conversion table 33 has output data (Y-40) when the sampling phase is 180°.
'), and the data conversion table 34 generates V). These data conversion tables 31 to 34 generate output data by multiplying the color data RG and B by weight coefficients corresponding to the modulation phase and the sampling phase.

ROM 30には、輝度データY1色差データR−Y及
びB−Yの他に端子35及び36からクロックパルスが
アドレス入力として供給される。端子35からのクロッ
クパルスは、第3図Aに示す周波数2f のもので、端
子36からのクロソクバC ルスは、第3図Bに示す周波数fscのものである。
The ROM 30 is supplied with clock pulses as address inputs from terminals 35 and 36 in addition to luminance data Y1 and color difference data RY and BY. The clock pulse from terminal 35 has a frequency 2f shown in FIG. 3A, and the clock pulse from terminal 36 has a frequency fsc shown in FIG. 3B.

これらのクロックパルスは、周波数4f、。のサンプリ
ングクロックと同期したものである。第3図に示すよう
に、これらのクロックパルスが共に低レベルの4 / 
4 fscの期間をT1とし、次の期間をT2とし、こ
の次の期間をT3とし、更に次の期間をT4とすると、
期間T1でデータ変換テーブル31が選択され、期間T
2でデータ変換テーブル32が選択され、期間T3でデ
ータ変換テーブル33が選択され、期間T4でデータ変
換テーブル34が選択される。この動作が繰り返される
ことによって。
These clock pulses have a frequency of 4f. It is synchronized with the sampling clock of As shown in Figure 3, these clock pulses are both low level 4/
4 If the fsc period is T1, the next period is T2, the next period is T3, and the next period is T4,
The data conversion table 31 is selected during the period T1, and the data conversion table 31 is selected during the period T1.
The data conversion table 32 is selected in period T2, the data conversion table 33 is selected in period T3, and the data conversion table 34 is selected in period T4. By repeating this action.

ROM 30の出力には、ディジタルコンポジ トカラ
ービデオデータが読出される。
Digital composite color video data is read out from the ROM 30.

このRolv! 30の出力データがD/Aコンバータ
37に供給され、アナログのコンポジソトカラニビデオ
信号に変換されて、加算器38に供給される。この加算
器38には、端子39及び40の夫夫からバースト信号
及び同期信号が供給され、加算器38の出力がローパス
フィルタ41を介して出力端子42に取り出される。こ
のローパスフィルタ41は、ナイキストフィルタである
。出力端子42には、例えばカラーモニタのビデオ入力
端子が接続される。
This Rolv! 30 output data is supplied to a D/A converter 37, converted into an analog composite video signal, and supplied to an adder 38. This adder 38 is supplied with a burst signal and a synchronization signal from terminals 39 and 40, and the output of the adder 38 is taken out to an output terminal 42 via a low-pass filter 41. This low-pass filter 41 is a Nyquist filter. For example, a video input terminal of a color monitor is connected to the output terminal 42.

カラーデータR,G、Bが夫々3ビツトの場合、ROM
11 、12 、13は、(29= 512 )のアド
レスのものとなる。まだ、輝度データYを4ビツト、色
差データを2ビツトとすると、ROM30のアドレスは
、10ビツトとなる。輝度データYのビット数を4ビツ
トとすると、充分な画像の表現を行なうことができる。
If color data R, G, B is 3 bits each, ROM
11, 12, and 13 are the addresses of (29=512). Assuming that the luminance data Y is 4 bits and the color difference data is 2 bits, the address of the ROM 30 will be 10 bits. If the number of bits of the luminance data Y is 4 bits, sufficient image expression can be achieved.

第4図を参照してこの発明の他の実施例について説明す
る。この他の実施例は、テレビゲーム。
Another embodiment of the invention will be described with reference to FIG. Another example is a video game.

マイクロコンピュータなどのように、カラーデータが1
ビツト又は2ビツトであって、帯域制限が不要な場合に
この発明を適用したものである。
Color data is stored only once, such as in microcomputers.
This invention is applied to the case where the bandwidth is 1 bit or 2 bits and no band limitation is required.

入力端子1.2.3の夫々から供給されるR2G、Bの
カラーデータがROM 50のアドレス入力とされる。
The R2G and B color data supplied from the input terminals 1, 2, and 3 are input to the address of the ROM 50.

ROM 50には、サンプリング位相が00゜90°、
180’、270’の夫々の出力データ(Y’+1  
  1    1 −U)(Y−−V)(Y−−U)(Y→−1v >を2
    2    2    2 R,G、Bのカラーデータに基いて発生するだめのデー
タ変換テーブル51.52.53.54が拡納され、ま
〆乙、同期信号及びバースト信号を発生するためのデー
タ変換テーブル55及び56も拡納されている。
ROM 50 has a sampling phase of 00°90°,
Each output data of 180' and 270'(Y'+1
1 1 -U) (Y--V) (Y--U) (Y→-1v > 2
2 2 2 Data conversion tables 51, 52, 53, and 54 generated based on R, G, and B color data have been expanded, and finally, data conversion tables for generating synchronization signals and burst signals. 55 and 56 have also been expanded.

ROM 50のアドレス入力としてカラーデータの他に
端子57及び58の夫々から2 fsc及びfscのク
ロックパルスが供給されると共に、端子59及び60か
ら同期信号及びバーストフラッグが供給される。この同
期信号の期間では、同期信号のデータ変換テーブル55
が選択され、バーストフラッグの期間では、バースト信
号のデータ変換テーブル56が選択される。これらの同
期信号及びバースト信号の期間では、2つのクロックパ
ルスによって各サンプリング位相の同期信号及びバース
ト信号のデータが順次R,OM 50がら読出される。
As address inputs to the ROM 50, in addition to color data, clock pulses of 2 fsc and fsc are supplied from terminals 57 and 58, respectively, and a synchronization signal and a burst flag are supplied from terminals 59 and 60. During this synchronization signal period, the synchronization signal data conversion table 55
is selected, and during the burst flag period, the burst signal data conversion table 56 is selected. During these synchronization signal and burst signal periods, the data of the synchronization signal and burst signal of each sampling phase is sequentially read out from the R, OM 50 by two clock pulses.

コンポジットカラービデオデータの読出しは、前述の一
実施例と同様にして行なわれる。
Reading of composite color video data is performed in the same manner as in the previous embodiment.

ROM 50から読出された同期信号及びバースト信号
を含むコンポジットカラービデオデータがD/A コン
バータ37によってアナログ信号に変換され、ローパス
フィルタ41を介して出力端子42に取シ出され1図示
せずも、カラーモニタに供給される。
Composite color video data including a synchronization signal and a burst signal read out from the ROM 50 is converted into an analog signal by a D/A converter 37, and outputted to an output terminal 42 via a low-pass filter 41. Supplied to a color monitor.

この発明の他の実施例では、R,G、Bのカラーデータ
を夫々1ビツトとすると、ROM 50は、7ビツト(
=128 )のアドレスのものとなる。
In another embodiment of the present invention, if R, G, and B color data are each 1 bit, the ROM 50 has 7 bits (
=128).

バイポーラトランジスタを用いたROMは、40〜60
〔μS〕で動作し、NTSC方式の場合のザンゾリング
周期(70μs)に充分追従することができる。
ROM using bipolar transistors has 40 to 60
It operates in [μs] and can sufficiently follow the Zanzo ring period (70 μs) in the case of the NTSC system.

「応用例」 この発明は、原色信号に限らず、輝度信号と2つの原色
信号(R,B)とが供給される場合などにも適用するこ
とができる。
"Application Example" The present invention is applicable not only to primary color signals but also to cases where a luminance signal and two primary color signals (R, B) are supplied.

まだ、メモリとしては、ROMに限らずRAMを用いて
マイクロプロセッサで演算することで形成されたテーブ
ルをこのRAMに書込むようにしても良い。
However, the memory is not limited to a ROM, but a RAM may be used to write a table formed by calculation by a microprocessor into the RAM.

「発明の効果」 この発明は、カラーエンコーダで必要とされる信号処理
を全てディジタル処理で行なうことができるので、アナ
ログ回路の構成のカラーエンコーダと比べて動作の安定
化2回路の小形化、 IC化を容易とできる利点がある
。また、この発明は、乗算回路などを用いるディジタル
カラーエンコーダと比べて、回路規模の小形化を図るこ
とができ、ローコストとできると共に、  IC化した
場合に高密度の実装が可能となる利点がある。特に、こ
の発明は、マイクロコンピュータなどの出力データのよ
うに、コンポーネント信号のビット数が少ない場合に使
用して効果的である。
"Effects of the Invention" This invention can perform all the signal processing required in a color encoder by digital processing, so compared to a color encoder with an analog circuit configuration, the present invention has stable operation, miniaturization of two circuits, and IC. It has the advantage of being easy to adapt. Furthermore, compared to digital color encoders that use multiplication circuits, this invention has the advantage of being able to reduce the circuit size and cost, as well as enabling high-density packaging when integrated circuits are used. . In particular, the present invention is effective when used when the number of bits of component signals is small, such as output data of a microcomputer.

第1図はコンポジット信号の形成の説明に用いる路線図
、第2図はこの発明の一実施例のブロック−図、第3図
はこの発明の一実施例の動作説明に用いるタイムチャー
ト、第4図はこの発明の他の実施例のブロック図である
Fig. 1 is a route diagram used to explain the formation of a composite signal, Fig. 2 is a block diagram of an embodiment of the present invention, Fig. 3 is a time chart used to explain the operation of an embodiment of the invention, and Fig. 4 is a route diagram used to explain the formation of a composite signal. The figure is a block diagram of another embodiment of the invention.

1.2.3  −・・3原色のカラーデータR,G。1.2.3 --- Color data of three primary colors R, G.

■3が夫々供給される入力端子、11,12,13゜3
0.50  ・・−・R玉。
■Input terminals to which 3 are respectively supplied, 11, 12, 13゜3
0.50...R ball.

代理人  杉 浦 正 知 第1図 第4図 第2図 第3図 ′、−T1.−+−■2中T3−+−T4−+  : 
 :  l  :  :+1111
Agent: Tomo Sugiura Figure 1, Figure 4, Figure 2, Figure 3', -T1. -+-■2 T3-+-T4-+:
:l : :+1111

Claims (1)

【特許請求の範囲】[Claims] サンプリング位相情報と変調位相とに対応する重み付は
情報とによってコンポーネントデータを変換するデータ
変換テーブルが記憶されたメモリを備え、このメモリに
対してカラービデオデータのコンポーネントデータがア
ドレス入力とされ、上記メモリからコンポジットデータ
を読出すようにしたディジタルカラーエンコーダ。
The weighting information corresponding to the sampling phase information and the modulation phase is provided with a memory in which a data conversion table for converting component data is stored, and the component data of the color video data is input as an address to this memory, and A digital color encoder that reads composite data from memory.
JP58085434A 1983-05-16 1983-05-16 Digital color encoder Pending JPS59211394A (en)

Priority Applications (1)

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JP58085434A JPS59211394A (en) 1983-05-16 1983-05-16 Digital color encoder

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JP58085434A JPS59211394A (en) 1983-05-16 1983-05-16 Digital color encoder

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JP (1) JPS59211394A (en)

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