JPS59165029U - リセツト回路 - Google Patents

リセツト回路

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Publication number
JPS59165029U
JPS59165029U JP5906183U JP5906183U JPS59165029U JP S59165029 U JPS59165029 U JP S59165029U JP 5906183 U JP5906183 U JP 5906183U JP 5906183 U JP5906183 U JP 5906183U JP S59165029 U JPS59165029 U JP S59165029U
Authority
JP
Japan
Prior art keywords
transistor
constant voltage
reset circuit
voltage element
power supply
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Pending
Application number
JP5906183U
Other languages
English (en)
Inventor
栗林　泰治
Original Assignee
日本ビクター株式会社
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Filing date
Publication date
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Priority to JP5906183U priority Critical patent/JPS59165029U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のリセット回路の回路図、第２図は第１図
に示した従来のリセット回路の動作を説明するための波
形図、第３図は本考案になるリセット回路の第１実施例
を示す回路図、第４−図は第３図に示したリセット回路
の動作を説明するための電圧波形図、第５図は本考案に
なるリセット回路の第２実施例を示す回路図、第６図は
本考案になるリセット回路の第３実施例を示す回路図、
第７図は本考案になるリセット回路の第４実施例を示す
回路図である。 １．２・・・電源入力端子、３・・・ＣＰＵ、　４．５
・・・電源端子、６・・・リセット端子、Ｑ、、　Ｑ２
．　Ｑ、・・・トランジスタ、Ｄ０〜Ｄ３・・・ツェナ
ーダイオード、Ｃ０゜Ｃ２・・・コンデンサ、Ｒ１−Ｒ
１４・・・抵抗器。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電源入力端子と、定電圧素子及び、前記定電圧素子の一
    端にベースを接続したトランジスタからなり前記定電圧
    素子と前記トランジスタのペースエミッタ間との間を電
    流が流れるように一端が前記電源入力端子に接続される
    定電圧源と、前記トランジスタのコレクタに接続された
    リセット端子と、前記定電圧素子の他端に接続されに第
    １の電源端子と、前記トランジスタのエミッタに接続さ
    れた第２の電源端子とからなるリセット回路において、
    前記電源入力端子を前記定電圧源と前記ト・ランジスタ
    保護用の抵抗器とを介して接地するように構成したリセ
    ット回路。
JP5906183U 1983-04-20 1983-04-20 リセツト回路 Pending JPS59165029U (ja)

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JP5906183U JPS59165029U (ja) 1983-04-20 1983-04-20 リセツト回路

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JP5906183U JPS59165029U (ja) 1983-04-20 1983-04-20 リセツト回路

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JPS59165029U true JPS59165029U (ja) 1984-11-06

Family

ID=30189321

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS54115749A (en) * 1978-03-01 1979-09-08 Toshiba Corp Source voltage monitor

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS54115749A (en) * 1978-03-01 1979-09-08 Toshiba Corp Source voltage monitor

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