JPS59155739U - パワトランジスタの保護回路 - Google Patents
パワトランジスタの保護回路Info
- Publication number
- JPS59155739U JPS59155739U JP5011883U JP5011883U JPS59155739U JP S59155739 U JPS59155739 U JP S59155739U JP 5011883 U JP5011883 U JP 5011883U JP 5011883 U JP5011883 U JP 5011883U JP S59155739 U JPS59155739 U JP S59155739U
- Authority
- JP
- Japan
- Prior art keywords
- power transistor
- protection circuit
- transistor protection
- bypass
- base
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Protection Of Static Devices (AREA)
- Fuses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来のパワトランジスタの保護回路の一例を示
す図、第２図は本考案の一実施例を示す回路図である。 Ｑ１〜Ｑ４・・・パワトランジスタ、Ｍ・・・直流サー
ボモータ、Ｂ１〜Ｂ４・・・ベース制御回路、ＦＵｌ・
・・速断ヒユーズ、Ｄ５〜Ｄｆｉ・・・バイパスダイオ
ード。
す図、第２図は本考案の一実施例を示す回路図である。 Ｑ１〜Ｑ４・・・パワトランジスタ、Ｍ・・・直流サー
ボモータ、Ｂ１〜Ｂ４・・・ベース制御回路、ＦＵｌ・
・・速断ヒユーズ、Ｄ５〜Ｄｆｉ・・・バイパスダイオ
ード。
Claims (1)
- パワトランジスタで構成される主回路に速断ヒユーズを
挿入すると共に、上記パワトランジスタのベース−エミ
ッタ間に所定値以上の電圧で導通してベース制御回路の
出力をバイパスするバイパス素子を接続したことを特徴
とするパワトランジスタの保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5011883U JPS59155739U (ja) | 1983-04-06 | 1983-04-06 | パワトランジスタの保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5011883U JPS59155739U (ja) | 1983-04-06 | 1983-04-06 | パワトランジスタの保護回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59155739U true JPS59155739U (ja) | 1984-10-19 |
Family
ID=30180596
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5011883U Pending JPS59155739U (ja) | 1983-04-06 | 1983-04-06 | パワトランジスタの保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59155739U (ja) |
-
1983
- 1983-04-06 JP JP5011883U patent/JPS59155739U/ja active Pending
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