JPS59147389A - ドツトマトリツクス表示装置 - Google Patents

ドツトマトリツクス表示装置

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JPS59147389A
JPS59147389A JP58021346A JP2134683A JPS59147389A JP S59147389 A JPS59147389 A JP S59147389A JP 58021346 A JP58021346 A JP 58021346A JP 2134683 A JP2134683 A JP 2134683A JP S59147389 A JPS59147389 A JP S59147389A
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JP
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dot matrix
circuit
display element
display device
matrix display
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JP58021346A
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伸太郎 橋本
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Sharp Corp
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Sharp Corp
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    • G09G3/3611—Control of matrices with row and column drivers
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    • G—PHYSICS
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 く技術分野〉 本発明はドツトマトリックス表示装置に関するものであ
り、特に、ドツト数が多く、画面の大きな液晶表示装置
に最適なものである。
〈発明の背景〉 液晶ドツトマトリックス表示装置は、液晶材料等の改良
によって、年々ドツト数の多いものが可能になってきて
いる。また、ゲスト・ホスト型、或いはツィステッド・
ネマティック型液晶表示装置に於て、透明電極を３色に
着色することによってカラー表示可能な液晶表示装置が
開発されているが、これらも又、全体のドツト数は非常
に多く、しかも端子ピッチが非常に細かい。
このようなドツト数の多い表示装置を用いる場合に問題
となるのは、その駆動回路との電気的・機械的接続方法
である。すなわち、ドツト数に対応して端子数も増え、
しかも端子ピッチが細かくなるため高い位置精度が要求
される。また、表示装置を小型機器に組み込む場合、接
続部の形状を如何に小さくするかが問題となる。
〈発明の目的〉 本発明は上記問題点を解消することを目的とするもので
ある。
〈実施例〉 第１図は本発明に係る表示装置を組み込んだ機器の構成
を示す図である。
１（はドツトマトリックス表示素子を駆動する回路を含
む回路基板であり、２はこの回路基板１に圧着接続され
る液晶表示素子である。回路基板１と液晶表示素子２は
、従来通り、ゼブラ・ゴム等のゴム・コネクタを用いて
圧着接続される。
３は表示すべき情報を記憶するＲＡＭを少なくとも含む
回路基板であり、機器として動作するための他の論理回
路等も含まれている。
この回路基板３と１との接続は、コネクタ４を介して行
われる。本発明によれば、このコネクタ４の信号線数は
非常に少なくでき、したがって、簡単に且つ少ないスペ
ースで接続することができる。
第２図は表示素子を駆動する制御回路を示したものであ
る。同図に於て、一点鎖線内１は第１図の１と同一で、
表示素子２及びその駆動回路を含む回路基板である。
５は表示すべき情報を記憶するＲＡＭ、６はＲＡＭ５の
内容を順次読み出し、回路基板１へ表示用信号を出力す
る表示情報制御回路である。この５と６は、第１図で示
した回路基板３内に含まれる。
７はシリアル入力パラレル出力の変換回路、８は排他的
論理和ゲート、９は電圧変換用バッファである。９の出
力がセグメント信号Ｓとなる。この７，８及び９は一個
のＬＳＩｌ０で構成されており、第２図の例では、４組
で液晶表示素子２の全ドツトを駆動している。
表示情報制御回路６より出力される信号は、各シリアル
・パラレル変換回路７．・・・へのデータ信号と液晶表
示素子２のバック・プレートに出力するコモン信ｇＨと
フレーム反転信５Ｊ　Ｆ　Ｒ及び電圧変換回路９へ出力
する電圧ＶＡ、ＶＢである。なお、ＲＡＭ５は表示すべ
きドツト・パターンをビット・イメージで記憶している
。
以上の説明で明らかなように、液晶表示素子のドツト数
が多くても、回路基板１へ出力する信号線数は非常に少
なくてすむ。
第３図はこの動作を説明するための信号波形図である。
ｈ＋＋ｈ２＋・・・、ｈｄはコモン信号Ｈ＋＋　”’を
作成するためのタイミング信号である。ｙはデータ信号
を各シリアル・パラレル変換回路７へ転送するタイミン
グ信号である。Ｈｌはコモン信号の一つであり、信号ｈ
ｌ、グ、ＦＲ及び電圧ＶＡ、ＶＭ。
ＶＢより作成される。ｙのタイミング期間中は誤点灯し
ないように、この期間、コモン信号にはＶＭの電圧が出
力される。
第４図はコモン信号発生−路であり、破線内に示す如く
、ｌ信号により非選択信号が挿入される（その他の部分
は周知であるため説明は省略する）０また、第５図は電
圧ＶＡ、ＶＭ、ＶＢの発生回路である。更に、第６図は
、第４図及び第５図に示す記９゛とＭＯ８回路記号との
対応関係を示すものでちる。
千７／２ｔ３ｆｅの叉砲列千示１乞つ？−為ろ。
この実施例は、液晶表示素子２０基板端子部付近にセグ
メント、駆動用ＬＳＩｌ０を直接ボンディングしたもの
である。ＬＳＩｌ０は第２図の１０と同一であり、外部
からは少ない端子で接続することができる。このＬＳＩ
ｌ０の端子ピンチと表示素子のセグメント端子ピッチを
合わせておくことによって非常に狭い領域でもボンディ
ングすることができる。
このようなセグメント駆動用ＬＳＩとして電荷結合素子
等を応用することができる。
く効　果〉 以上詳細に説明した本発明のドツトマトリックス表示装
置によれば、以下の効果を奏するものである。
（１）表示装置と表示制御回路との結線数が非常に少な
くなるため、位置合わせ等が簡単になり、確実に接続す
ることができる。
（２）接続のための部品、或いはスペースが小さくなり
、全体に小型化することができる。
【図面の簡単な説明】
第１図は本発明に係る表示装置を組み込んだ機器の構成
を示す図、第２図は同表示装置に於ける表示素子を駆動
する制御回路を示す図、第３図は同表示装置に於ける表
示動作を説明するための信号・波形図、第４図は第３図
に示すコモン信号Ｈ１の発生回路を示す図、第５図は第
２図乃至第４図に示す電圧ｖＡ、Ｖｈｉ、、ｖＢの発生
回路を示す図、第６図は第４図及び第５図に示す記号と
ＭＯ８回路記号との対応関係を示す図、第７図は他の実
施例を示す図である。 符号の説明 １：回路基板、２：液晶表示素子、３：回路基板、４：
コネクタ、５　：　ＲＡＭ、６　：表示情報制御回路、
７：シリアル・パラレル変換回路、８：排他的論理和ゲ
ート、９：電圧変換用バッファ、１０：ＬＳＩ。

Claims (2)

    【特許請求の範囲】
  1. （１）　　ドツトマトリックス表示素子と、その駆動回
    路とを同一基板」二に備えたものであって、上記駆動回
    路を上記ドットマ）　ＩＪックス表示素子の端子部付近
    に配置し、表示すべき情報を記憶するメモリより読み出
    した内容を上記駆動回路へシリアルに転送する表示情報
    制御回路を設けたことを特徴とするドツトマトリックス
    表示装置。
  2. （２）　　ドットマＩ−ＩＪソクス表示素子を駆動する
    駆動回路を集積回路により構成し、その端子ピッチと上
    記ドツトマトリックス表示素子の端子ピッチとを合わせ
    、」二記ドツトマトリックス表示素子の端子部付近に配
    置接続したことを特徴とする特許請求の範囲第（１）項
    に記載のドソトマ）ＩＪノクス表示装置０
JP58021346A 1983-02-10 1983-02-10 ドツトマトリツクス表示装置 Pending JPS59147389A (ja)

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