JPS5870683A - インタ−レス回路とその駆動方法 - Google Patents
インタ−レス回路とその駆動方法Info
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- JPS5870683A JPS5870683A JP56169144A JP16914481A JPS5870683A JP S5870683 A JPS5870683 A JP S5870683A JP 56169144 A JP56169144 A JP 56169144A JP 16914481 A JP16914481 A JP 16914481A JP S5870683 A JPS5870683 A JP S5870683A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N3/00—Scanning details of television systems; Combination thereof with generation of supply voltages
- H04N3/10—Scanning details of television systems; Combination thereof with generation of supply voltages by means not exclusively optical-mechanical
- H04N3/14—Scanning details of television systems; Combination thereof with generation of supply voltages by means not exclusively optical-mechanical by means of electrically scanned solid-state devices
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は撮像デバイスやディスブンイデバイスのイン
ターレース回路に関する。
ターレース回路に関する。
第１図は、従来ＤＭＯ８型撮濃デバイスの平面模式図で
ある。牛導体基板Ｑ受元側の主面Ｃ′ζｐＱ接合型のフ
ォトダイオード１が多数二久元的に配列形成されている
。フォトダイオードｌの列の一方側に近接して全１．ａ
＋＝号線２が設けられている。フォトダイオードｌと垂
直信号線２との間には走査線選択ゲート３が投げられて
おり、この走査線選択ゲート３の−＃電極は各水平行に
対応した走査線選択線４にそれぞれ接続されている。走
査線選択線４はインターレース回路５の各水平行に対応
した出力にそれぞれ接続さｎている。インターレース回
路５の入力と垂直シフトレジスタ６の出力とは各水平行
に対応して接続されている。垂直信号線２の一方の端部
に水平ゲート７の一方端がそれぞれ接続されている。水
平ゲート７の他方端は水平信号線８に共通接続されてい
る。水平信号線８は負荷抵抗９を介して直流屯源１０１
Ｃ接続后れている。水平信号線８と負荷抵抗９の接続点
に信号出力端子１１が設げられている。水平ゲート７の
制御ｔｔ極は水平シフトレンスタ１２の出力に順次接続
されている。
ある。牛導体基板Ｑ受元側の主面Ｃ′ζｐＱ接合型のフ
ォトダイオード１が多数二久元的に配列形成されている
。フォトダイオードｌの列の一方側に近接して全１．ａ
＋＝号線２が設けられている。フォトダイオードｌと垂
直信号線２との間には走査線選択ゲート３が投げられて
おり、この走査線選択ゲート３の−＃電極は各水平行に
対応した走査線選択線４にそれぞれ接続されている。走
査線選択線４はインターレース回路５の各水平行に対応
した出力にそれぞれ接続さｎている。インターレース回
路５の入力と垂直シフトレジスタ６の出力とは各水平行
に対応して接続されている。垂直信号線２の一方の端部
に水平ゲート７の一方端がそれぞれ接続されている。水
平ゲート７の他方端は水平信号線８に共通接続されてい
る。水平信号線８は負荷抵抗９を介して直流屯源１０１
Ｃ接続后れている。水平信号線８と負荷抵抗９の接続点
に信号出力端子１１が設げられている。水平ゲート７の
制御ｔｔ極は水平シフトレンスタ１２の出力に順次接続
されている。
この撮像デバイスは以下のよ５な撮像動作を行う。信号
電荷蓄積時に、入射光に反応してフォトダイオード１に
信号電荷が蓄積さルる。水平帰線期間ＩＫ順次走査線ｔ
４択するオンパルスが垂直シフトンジスタロよりインタ
ーレース回路５′ｔ−介して走査線選択線４に印加され
る。オンパルスが印加された走査線選択線４に接続され
た走査線選択ゲート３はオン状態になり、信号電荷はそ
れぞれフォトダイオードｌより垂直信号線２へ移されれ
る。走査線選択ゲート３がオフ状態になると、信号電荷
の次の蓄積が噴まる。水平有効期間においＣ１水平シフ
トンジスタ１２は順次オンパルスを水平ゲート７に供給
し、順次水平ゲート７をオン状態にする。この時垂直信
号線２上の信号電荷は水平ゲート７、水平信号線８、負
荷抵抗９を通って直流ｉｔ源ｌＯへ達する。信号電荷が
負荷抵抗９を流れるときに発生する電圧を信号出力端子
１１よりビデオ出力として取り出す。
電荷蓄積時に、入射光に反応してフォトダイオード１に
信号電荷が蓄積さルる。水平帰線期間ＩＫ順次走査線ｔ
４択するオンパルスが垂直シフトンジスタロよりインタ
ーレース回路５′ｔ−介して走査線選択線４に印加され
る。オンパルスが印加された走査線選択線４に接続され
た走査線選択ゲート３はオン状態になり、信号電荷はそ
れぞれフォトダイオードｌより垂直信号線２へ移されれ
る。走査線選択ゲート３がオフ状態になると、信号電荷
の次の蓄積が噴まる。水平有効期間においＣ１水平シフ
トンジスタ１２は順次オンパルスを水平ゲート７に供給
し、順次水平ゲート７をオン状態にする。この時垂直信
号線２上の信号電荷は水平ゲート７、水平信号線８、負
荷抵抗９を通って直流ｉｔ源ｌＯへ達する。信号電荷が
負荷抵抗９を流れるときに発生する電圧を信号出力端子
１１よりビデオ出力として取り出す。
標準的なビデオシステムでは、１フレームｔ２フイール
ドで構成するインターレースが行なわれている。こ几に
はフィールド蓄積モードとフレーム蓄積モードとがある
。定食線に鳩仄ｌ芹、２錠、・−１ｎ着・・−と番号を
つげる。フィールド蓄積モードでは、一方のフィールド
の時に１４と２９．３釜と４着、−（２ｎ−１）＠と２
ｎ番、・−というよ５に２本の走査線の信号ＩＥ循を合
わせて読み出し、他方のフィールドの時に１釜、２薯と
３謔、４１１Ｆと５箸、・・・２ｎ番と（２ｎ＋１）番
、・−という走査線の組み合わせ−で信号電荷を読み出
す。フレーム蓄積モードでは、一方のフィールドの時に
１番、３ＩＩ、・・・、（２ｎ ｌ）番、・・・とい
５ように奇数番目の走査線の信号電荷を読み出し、他方
のフィールドの時に２番、４＠、・・・、２ｎ＠、・・
・というように偶数番目の走査線の１＠号電荷を読み出
す。フィールド蓄積モードはフレーム蓄積モードに比較
して残像が少なく、動きの速い被写体を撮像するのに有
利である。フレーム蓄積モードでは走査線１本、１本を
独立に疏み出すために垂直解鍬度が優れている。
ドで構成するインターレースが行なわれている。こ几に
はフィールド蓄積モードとフレーム蓄積モードとがある
。定食線に鳩仄ｌ芹、２錠、・−１ｎ着・・−と番号を
つげる。フィールド蓄積モードでは、一方のフィールド
の時に１４と２９．３釜と４着、−（２ｎ−１）＠と２
ｎ番、・−というよ５に２本の走査線の信号ＩＥ循を合
わせて読み出し、他方のフィールドの時に１釜、２薯と
３謔、４１１Ｆと５箸、・・・２ｎ番と（２ｎ＋１）番
、・−という走査線の組み合わせ−で信号電荷を読み出
す。フレーム蓄積モードでは、一方のフィールドの時に
１番、３ＩＩ、・・・、（２ｎ ｌ）番、・・・とい
５ように奇数番目の走査線の信号電荷を読み出し、他方
のフィールドの時に２番、４＠、・・・、２ｎ＠、・・
・というように偶数番目の走査線の１＠号電荷を読み出
す。フィールド蓄積モードはフレーム蓄積モードに比較
して残像が少なく、動きの速い被写体を撮像するのに有
利である。フレーム蓄積モードでは走査線１本、１本を
独立に疏み出すために垂直解鍬度が優れている。
しかしながら、従来用いられてきたインターレース回路
では、フィールドＩＩｉ積モードとフレーム蓄積モード
を蘭単に切り替えることができないとい５欠点があ−）
た。
では、フィールドＩＩｉ積モードとフレーム蓄積モード
を蘭単に切り替えることができないとい５欠点があ−）
た。
この発明の目的は上記のような欠点を除去して、フィー
ルド蓄積モードとフレーム蓄積モードとを簡単に切り替
えることができるインターレース回路とその駆動方法を
提供することにある。
ルド蓄積モードとフレーム蓄積モードとを簡単に切り替
えることができるインターレース回路とその駆動方法を
提供することにある。
この発明によれば垂直シフトンジスタの各出力端に、第
１制御線で制御される第１ゲートの一方端と、第２制御
線で制御される第２ゲートの一方端と、第３制御線で制
御される第３ゲートの一方端とを接続し、各第１ゲート
の他方端と前凸己垂直シフトレジスタの１ビ、ト前の出
力端に接続されたｇｔｌ記第３ゲートの他方端とを接続
したものと、第２ゲートの他方端とが、この順序が轢り
返されるように順次走査線選択線に接続されていること
を特徴とするインターレース回路が侵らルる。ざらにこ
の発明によれば前記インターレース回路に６いて、一方
のフィールドの時に、第１制御線と第２制御線とにオン
パルスを、第３ｍ１Ｊｔ４１線にオフパルスを印加し、
１出方のフィールドのＩｉＫ、ｍ２ＩＩＩＩｌ＠ｌ繰と
第３′＠御線とにオンパルスを、第ｆｉｌｌ卿線シＣオ
フパルスを印加することを特徴とするインターレース回
路の駆動方法が得られる。さらにこの発明によれば前記
インターレース回路Ｋｇいて、一方のフィールドの時に
、第１制師線にオンパルスで、第２制御線と第３制御線
とにオフパルスを印加し、他方のフィールドの詩に、第
２制陣線ＶＣオンパルスを、第１１１ＪＩｌ線と第３制
御線とにオフパルスを印加することを特徴とするインタ
ーレース回路υｇ励方法が得られる。
１制御線で制御される第１ゲートの一方端と、第２制御
線で制御される第２ゲートの一方端と、第３制御線で制
御される第３ゲートの一方端とを接続し、各第１ゲート
の他方端と前凸己垂直シフトレジスタの１ビ、ト前の出
力端に接続されたｇｔｌ記第３ゲートの他方端とを接続
したものと、第２ゲートの他方端とが、この順序が轢り
返されるように順次走査線選択線に接続されていること
を特徴とするインターレース回路が侵らルる。ざらにこ
の発明によれば前記インターレース回路に６いて、一方
のフィールドの時に、第１制御線と第２制御線とにオン
パルスを、第３ｍ１Ｊｔ４１線にオフパルスを印加し、
１出方のフィールドのＩｉＫ、ｍ２ＩＩＩＩｌ＠ｌ繰と
第３′＠御線とにオンパルスを、第ｆｉｌｌ卿線シＣオ
フパルスを印加することを特徴とするインターレース回
路の駆動方法が得られる。さらにこの発明によれば前記
インターレース回路Ｋｇいて、一方のフィールドの時に
、第１制師線にオンパルスで、第２制御線と第３制御線
とにオフパルスを印加し、他方のフィールドの詩に、第
２制陣線ＶＣオンパルスを、第１１１ＪＩｌ線と第３制
御線とにオフパルスを印加することを特徴とするインタ
ーレース回路υｇ励方法が得られる。
以下この発明の実施例にもとづいて説明する。
第２図はこの発明の一実ｍ例のインターレース回路の平
面模式図である。図！、Ｃ２３いて第１図と同一記号は
同一構成要素を示す。垂直シフトレジスタ６ＯＮ個の出
力端に順次１静、２４、・−・、ｎ ’？Ｉｆ、・−・
Ｎ番と番号をつげる。２Ｎ個の走査線選択線４にも順次
ｌ＃、２＃、−・・、ｎ蓄、・・・、２Ｎ番と番号をつ
ける。垂直シフトレジスタ６のｎｉｌ目の出力端に、第
１′＠御線１３で制御されるｎ番目の第１グー）１４の
一方端と、第２呵御、！１１５で制御されるｎ４目の第
２ゲート１６の一方端と、第３制＃ｊＩｔ１７で制御さ
れるｎａＦ目の第３ゲート１８の一方端とが接続されて
いる。ｎ番目の第１ゲート１４の他方端と（ｎ−１）ｉ
目の第３ゲート１８の他方端とを接続したものと、（２
ｎｌ）第１目の走査）Ｊ＆選択線４とが接続されている
。ｎ ４’目の第２グー）１６の；出力端と２ｎｔ−目
の定食線遣択保４とが接続されている。
面模式図である。図！、Ｃ２３いて第１図と同一記号は
同一構成要素を示す。垂直シフトレジスタ６ＯＮ個の出
力端に順次１静、２４、・−・、ｎ ’？Ｉｆ、・−・
Ｎ番と番号をつげる。２Ｎ個の走査線選択線４にも順次
ｌ＃、２＃、−・・、ｎ蓄、・・・、２Ｎ番と番号をつ
ける。垂直シフトレジスタ６のｎｉｌ目の出力端に、第
１′＠御線１３で制御されるｎ番目の第１グー）１４の
一方端と、第２呵御、！１１５で制御されるｎ４目の第
２ゲート１６の一方端と、第３制＃ｊＩｔ１７で制御さ
れるｎａＦ目の第３ゲート１８の一方端とが接続されて
いる。ｎ番目の第１ゲート１４の他方端と（ｎ−１）ｉ
目の第３ゲート１８の他方端とを接続したものと、（２
ｎｌ）第１目の走査）Ｊ＆選択線４とが接続されている
。ｎ ４’目の第２グー）１６の；出力端と２ｎｔ−目
の定食線遣択保４とが接続されている。
このインターレース回路において、フィールド蓄積モー
ドでＬゴ、一方のフィールドの時に、第１ルリ却盪１３
と第２；伺伸線１５とにオンパルス金、り３３制御線１
７てオフパルスを印加する。この詩、丑１ばシフトレジ
スタ６のｎ番目の出力は（２ｎｌ）−目と２ｎ番目の走
査線選択線４へ伝わる。１方のフィールドの峙（（、第
２制御線１５と第３＠御４Ｍ１７とにオンパルスを、第
１制Ａ線１３にオフパルスを印加する。この時、垂直シ
フトレジスタ６のｎ番目の出刃苓・工２ｎ番目と（２ｎ
＋ｉ）ｉ＃目との走査線選択線４へ伝わる。
ドでＬゴ、一方のフィールドの時に、第１ルリ却盪１３
と第２；伺伸線１５とにオンパルス金、り３３制御線１
７てオフパルスを印加する。この詩、丑１ばシフトレジ
スタ６のｎ番目の出力は（２ｎｌ）−目と２ｎ番目の走
査線選択線４へ伝わる。１方のフィールドの峙（（、第
２制御線１５と第３＠御４Ｍ１７とにオンパルスを、第
１制Ａ線１３にオフパルスを印加する。この時、垂直シ
フトレジスタ６のｎ番目の出刃苓・工２ｎ番目と（２ｎ
＋ｉ）ｉ＃目との走査線選択線４へ伝わる。
フレーム蓄積モードでは、一方のフィールドの時に、第
１制御線１３・ζオンパルスを、第２制岬籾１５と第３
制御線エフとにオフパルスを印〃ｉするうこの時、垂直
シフトレジスタ６’ｔＱ ｎ ｉ 目の出力、よ（２ｎ
１）ｉ！目の走査線選択線４へ伝わる。
１制御線１３・ζオンパルスを、第２制岬籾１５と第３
制御線エフとにオフパルスを印〃ｉするうこの時、垂直
シフトレジスタ６’ｔＱ ｎ ｉ 目の出力、よ（２ｎ
１）ｉ！目の走査線選択線４へ伝わる。
１ｔｉｄ方のフィールドの時に、第２制御線１５にオン
パルス金、第１制御ｉ１１籾１３と第３制御線１７−と
にオフパルスを印加する。この吋、垂直シフトレジスタ
６のｎ番目の出力、ま２ｎ番目の走査線選択線４へ伝わ
る。
パルス金、第１制御ｉ１１籾１３と第３制御線１７−と
にオフパルスを印加する。この吋、垂直シフトレジスタ
６のｎ番目の出力、ま２ｎ番目の走査線選択線４へ伝わ
る。
上記、りように、このインターレース回路では、第１制
＃ＩＩ緑１３と第２制御線１５と第３ ＋１ａＪ御線１
７とに口」加するパルス全変更−ｒることンこよって、
６易にフィールド蓄積モードとフレーム蓄積モーｙを切
り替えることが可能である。この、瀘果、被写体や目ｉ
３に迩した蓄積モードを量率に選択できる撮像波−が実
現さｆＬる。
＃ＩＩ緑１３と第２制御線１５と第３ ＋１ａＪ御線１
７とに口」加するパルス全変更−ｒることンこよって、
６易にフィールド蓄積モードとフレーム蓄積モーｙを切
り替えることが可能である。この、瀘果、被写体や目ｉ
３に迩した蓄積モードを量率に選択できる撮像波−が実
現さｆＬる。
この発明はＭＯ８氾遁澹デバイスｌ’ｊ ７Ｊ）ってし
よなく、ＭＯ８＋ｃｃＤ 型撮像デバイスや固体ディ
スブンイデバイスしても応用できる。
よなく、ＭＯ８＋ｃｃＤ 型撮像デバイスや固体ディ
スブンイデバイスしても応用できる。
図面の藺半ン直ｄ明
第１凶はＭＯ８型通像チェイスの模式的平面図、第２図
はこの発明の一冥り例（Ｃよるインターンース回路模式
司平面図である。
はこの発明の一冥り例（Ｃよるインターンース回路模式
司平面図である。
４・−・走査線選択線、５・・・インターレース回路ｌ
路、６・・・垂直シフトレジスタ・、１３・・・４１制
＠１尿、ｌ ４・・・５ル１ゲート、１５−・・第２制
御線、１６・・・第２ゲート、１７・・・第３制御線、
１８・・・第３ゲート。
路、６・・・垂直シフトレジスタ・、１３・・・４１制
＠１尿、ｌ ４・・・５ル１ゲート、１５−・・第２制
御線、１６・・・第２ゲート、１７・・・第３制御線、
１８・・・第３ゲート。
第１（３
Claims (1)
- 【特許請求の範囲】 １、 ｇＩｉ：ｆシフトレジスタの各出力端に、第１
＠御線で制御される第１ゲートの一方端と、籐２制御蝋
で制御される第２ゲートの一方端と、第３制＃線で制御
される第３ゲートの一方端とｔ−接続し、各第１ゲート
の他方端と前記垂直シフトレジスタの１ビツト前の出力
端に接続された前記第３ゲートの偽万端とを接続したも
のと、第２ゲートの他方端とが、この順序が繰り返され
るように順次走査線選択線に＊統されていることｔ特徴
とするインターレース回路。 ２、 垂直シフトレジスタの各出力端に、第１制御似で
制御される第１ゲートの一方端と、５２−１ｍ縁で１−
一される４２ゲートの一方端と、第３制＃線で制御され
る第３ゲートの一方端とｔ−接続し、各第１ゲートの他
方端と前記垂直シフトレジスタの１ビ、ト前の出力端に
接続された前。 配薬３ゲートの他方端とを接続したものと、第２ゲート
の他方着とが、この順序が繰り返さｎるよ５に順次走査
線選択線に接続されているインターレース回路に宴いて
、一方のフィールドのｔｉ＃に、第１制費線と第２制−
伸線とにオフパルスを、第３ｆｉｄＪＷｌｌｉ１ｉ□こ
オフパルスを印７Ｊ１１．ｔ、、他方のフィールドの時
に、第２．１１！Ｉ ｍ線と第３制御程とにオンパルス
を、第一１＠−線にオフパルスを印刀目することを特徴
とするインターレース回路の駆一方法。 ３、 垂直シフトレジスタの各出力端に、渠１ ：ｍＪ
Ｊ）線で、ｄｌｌされる第１ゲートの一方端と、４２
制＃憾で制御さする第２ゲートの一方端と一第３ａＩＩ
Ｉ婦線で制御される。美３ゲートの一方端とを接続し、
各覇ｌゲートの他方端と前記垂直シフトレジスタのエビ
、ト面の出力−に接続さａたゆ１記ｇ３ゲートの偽万端
とを接続したものと、オニ２−グーＦの他方端とが、こ
の順序が操り返されるように頑次走査線適択に接続され
Ｃいるイン、ターレース回路において、一方のフィール
ドの時、ζ、第１制御線にオンパルスを、第２制御線と
第３制御４１Ｉ＆１と（でオフパルスを印刀目し、Ｔよ
方のフィーｋＦ（Ｄａに、第２制御線にオンパルスを。 ｇ１制姉線と−ｉ３制御線とにオフパルスを印加するこ
とを特徴とするインターレース回路の駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56169144A JPS5870683A (ja) | 1981-10-22 | 1981-10-22 | インタ−レス回路とその駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56169144A JPS5870683A (ja) | 1981-10-22 | 1981-10-22 | インタ−レス回路とその駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5870683A true JPS5870683A (ja) | 1983-04-27 |
| JPH0255992B2 JPH0255992B2 (ja) | 1990-11-28 |
Family
ID=15881096
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56169144A Granted JPS5870683A (ja) | 1981-10-22 | 1981-10-22 | インタ−レス回路とその駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5870683A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS626581A (ja) * | 1985-07-03 | 1987-01-13 | Fuji Photo Film Co Ltd | 固体撮像素子 |
| EP0565775A2 (en) * | 1992-04-13 | 1993-10-20 | Mitsubishi Denki Kabushiki Kaisha | Solid-state imaging device |
-
1981
- 1981-10-22 JP JP56169144A patent/JPS5870683A/ja active Granted
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS626581A (ja) * | 1985-07-03 | 1987-01-13 | Fuji Photo Film Co Ltd | 固体撮像素子 |
| JPH0547020B2 (ja) * | 1985-07-03 | 1993-07-15 | Fuji Photo Film Co Ltd | |
| EP0565775A2 (en) * | 1992-04-13 | 1993-10-20 | Mitsubishi Denki Kabushiki Kaisha | Solid-state imaging device |
| EP0565775A3 (ja) * | 1992-04-13 | 1994-03-30 | Mitsubishi Electric Corp | |
| US5444484A (en) * | 1992-04-13 | 1995-08-22 | Mitsubishi Denki Kabushiki Kaisha | Solid-state imaging device |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0255992B2 (ja) | 1990-11-28 |
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