JPS5868322A - 発振周波数補正装置 - Google Patents
発振周波数補正装置Info
- Publication number
- JPS5868322A JPS5868322A JP16681781A JP16681781A JPS5868322A JP S5868322 A JPS5868322 A JP S5868322A JP 16681781 A JP16681781 A JP 16681781A JP 16681781 A JP16681781 A JP 16681781A JP S5868322 A JPS5868322 A JP S5868322A
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- oscillation
- circuit
- output
- frequency divider
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000010355 oscillation Effects 0.000 title claims abstract description 77
- 239000002131 composite material Substances 0.000 abstract description 9
- 238000010586 diagram Methods 0.000 description 5
- 239000013078 crystal Substances 0.000 description 2
- 241000238876 Acari Species 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
Landscapes
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は電子時計などに用いて有効な発振周波数補正装
置に関するもので、特に基本発振回路の発振周波数の変
動に対して補正することによって。
置に関するもので、特に基本発振回路の発振周波数の変
動に対して補正することによって。
希望する周波数を得ることを目的とするものである。
従来、発振器、特に電子時計用の発振回路には一般に発
振周波数の安定な水晶発振回路が用いられる。しかし使
用条件により目的の発振周波数を得られない場合がある
。特に温度変化において発振周波数の変動は顕著である
。また、この変動を少なくするためには温度特性のよい
水晶および発振回路が必要である。
振周波数の安定な水晶発振回路が用いられる。しかし使
用条件により目的の発振周波数を得られない場合がある
。特に温度変化において発振周波数の変動は顕著である
。また、この変動を少なくするためには温度特性のよい
水晶および発振回路が必要である。
このような点に鑑み２本発明は変動に対して変動量をこ
まかく補正できる装置を提供するものである。
まかく補正できる装置を提供するものである。
以下９本発明を図示の実施例にもとづいて説明する。
第１図は本発明の一実施例のブロック構成図である。同
図において、１は基本発振回路、２は演算回路、３は第
１の分局器、４は第２の分周器であり、１０１は基本発
振出力、１０２は合成発振出力、１ｏ３は補正用出力、
１０４は加減出力。
図において、１は基本発振回路、２は演算回路、３は第
１の分局器、４は第２の分周器であり、１０１は基本発
振出力、１０２は合成発振出力、１ｏ３は補正用出力、
１０４は加減出力。
１０５は基準発振出力である。前記基本発振回路１は基
本波を発振する回路で、基本発振出力１０１全演算回路
２へ出力する。前記演算回路２は、前記基本発振回路１
の出力である基本発振出力１０１と前記第２の分周器４
の出力である補正用出力１０３を、前記第２の分周器４
の出力である加減出力１０４に従って、前記加減出力１
０４が論理゛１”の時に加算を、また論理゛０”の時に
減算を行ない１合成発振出力１０２を前記第１の分周器
３および前記第２の分周器４に出力する。第１の分周器
３は、前記演算回路２の合成発振出力１０２を分周し基
準発振出力１０６を出力する。
本波を発振する回路で、基本発振出力１０１全演算回路
２へ出力する。前記演算回路２は、前記基本発振回路１
の出力である基本発振出力１０１と前記第２の分周器４
の出力である補正用出力１０３を、前記第２の分周器４
の出力である加減出力１０４に従って、前記加減出力１
０４が論理゛１”の時に加算を、また論理゛０”の時に
減算を行ない１合成発振出力１０２を前記第１の分周器
３および前記第２の分周器４に出力する。第１の分周器
３は、前記演算回路２の合成発振出力１０２を分周し基
準発振出力１０６を出力する。
前記基準発振出力１０６は電子時計（ここでは図示せず
）の基準発振信号として用いられる。前記第２０分周器
４は前記演算回路２の合成発振出力１０２全分周する分
周器で、分周数を任意に設定することができ、補正用出
力１０３および加減出力１０４’ｉ前記演算回路２へ出
力する。
）の基準発振信号として用いられる。前記第２０分周器
４は前記演算回路２の合成発振出力１０２全分周する分
周器で、分周数を任意に設定することができ、補正用出
力１０３および加減出力１０４’ｉ前記演算回路２へ出
力する。
第２図は、前記第２の分周器４の詳細を示す構成図であ
る。同図において、４１は分周回路、４２は分周数入力
回路であり、前記分周回路４１は分周数を任意に設定で
きる分周回路であり、前記分周数入力回路４２は、前記
分周回路４１と接続され、任意の分周数を入力し、分周
回路４１に対して分周数を指定し、さらに、前記演算回
路２に対して加減算の指定を行なう加減出力１０４’ｊ
ｚ出カする回路である。
る。同図において、４１は分周回路、４２は分周数入力
回路であり、前記分周回路４１は分周数を任意に設定で
きる分周回路であり、前記分周数入力回路４２は、前記
分周回路４１と接続され、任意の分周数を入力し、分周
回路４１に対して分周数を指定し、さらに、前記演算回
路２に対して加減算の指定を行なう加減出力１０４’ｊ
ｚ出カする回路である。
第３図は、前記基本発撮出カ１ｏ１．補正用出力１０３
．加減量カッ０４１合成発振出カ１０２の波形例を示す
タイミング図である。
．加減量カッ０４１合成発振出カ１０２の波形例を示す
タイミング図である。
次に本実施例の動作を説明する。第１図において、基準
発振出力１０５に９周波数ＩＨｚの出力が必要であると
考える。基本発振回路１の基本発振出力１０１の発振周
波数をＮ Ｈｚとすると、演算回路２においてまったく
影響を受けなければ第１の分局器３において分周数はＮ
となる。ここで、前記基本発振出力１０１の発振周波数
が（Ｎ＋ｎ）Ｈｚと変動すると、基準発振出力１０６の
周波数は（１＋ Ｎ ） Ｈｚ となり、必要とする
周波数との間にｗ Ｈｚの変動が現われる。そこで、基
準発振出力１０５に現われるＮ Ｈｚの変動を消滅させ
るためには、第１の分局器３に入力される合成発振出力
１０２の周波数１ＮＨｚにすればよい。従って、基本発
振出力１０１の発振周波数（Ｎ ＋ ｎ ）Ｈｚと合成
発振出力１０２の周波数ＮＨｚの差であるｎＨｚを演算
回路２によって補正すればよい。そこで。
発振出力１０５に９周波数ＩＨｚの出力が必要であると
考える。基本発振回路１の基本発振出力１０１の発振周
波数をＮ Ｈｚとすると、演算回路２においてまったく
影響を受けなければ第１の分局器３において分周数はＮ
となる。ここで、前記基本発振出力１０１の発振周波数
が（Ｎ＋ｎ）Ｈｚと変動すると、基準発振出力１０６の
周波数は（１＋ Ｎ ） Ｈｚ となり、必要とする
周波数との間にｗ Ｈｚの変動が現われる。そこで、基
準発振出力１０５に現われるＮ Ｈｚの変動を消滅させ
るためには、第１の分局器３に入力される合成発振出力
１０２の周波数１ＮＨｚにすればよい。従って、基本発
振出力１０１の発振周波数（Ｎ ＋ ｎ ）Ｈｚと合成
発振出力１０２の周波数ＮＨｚの差であるｎＨｚを演算
回路２によって補正すればよい。そこで。
第２の分周器４において２合成発振出力１０２より演算
回路２に必要な補正用出力１０３と加減出力１０４ｆｉ
ｒ：生成する。すなわち、前記第２の分周器４において
、演算回路２に対してＮ Ｈｚ減算する信号を合成発振
出力１０２の周波数ＮＨｚより生成するために、第２の
分周器４の分周数ヲ翫に、また加算・減算の指定を減算
と設定する。一般に基本発振回路１の基本発振出力１０
１の発振周波数の変動分ｎＨｚは、あらゆる原因によっ
て変動するため、第２の分周器４は加算・減算の指定お
よび分周数を任意の値に設定できる分周器でなければな
らない。第２図に第２の分局器４の構成を示すが、前記
加算・減算の指定および分周数を任意の値に設定するた
めに、第２の分周器４は。
回路２に必要な補正用出力１０３と加減出力１０４ｆｉ
ｒ：生成する。すなわち、前記第２の分周器４において
、演算回路２に対してＮ Ｈｚ減算する信号を合成発振
出力１０２の周波数ＮＨｚより生成するために、第２の
分周器４の分周数ヲ翫に、また加算・減算の指定を減算
と設定する。一般に基本発振回路１の基本発振出力１０
１の発振周波数の変動分ｎＨｚは、あらゆる原因によっ
て変動するため、第２の分周器４は加算・減算の指定お
よび分周数を任意の値に設定できる分周器でなければな
らない。第２図に第２の分局器４の構成を示すが、前記
加算・減算の指定および分周数を任意の値に設定するた
めに、第２の分周器４は。
分局数を任意に設定できる分周回路４１と１分周数およ
び加算・減算の指定を入力できる分周数入力回路４２に
よって構成されている。第３図は演算回路２の入出力波
形の例を示したもので、加算もしくは減算され出力され
る合成発振波形は、第２の分局器４の補正用出力１０３
の周期と同じ周期となる。
び加算・減算の指定を入力できる分周数入力回路４２に
よって構成されている。第３図は演算回路２の入出力波
形の例を示したもので、加算もしくは減算され出力され
る合成発振波形は、第２の分局器４の補正用出力１０３
の周期と同じ周期となる。
実際の例として、第１の分周器３の出力である基準発振
出力１０６に接続された電子時計（図示せず）が１クロ
ツクで１秒を刻む時計とし、該時計が１ケ月間（３０日
とする）にに秒進む時、第２図の第２の分周器４の分周
数入力回路４２に指定する値は次のようになる。
出力１０６に接続された電子時計（図示せず）が１クロ
ツクで１秒を刻む時計とし、該時計が１ケ月間（３０日
とする）にに秒進む時、第２図の第２の分周器４の分周
数入力回路４２に指定する値は次のようになる。
１ケ月の基本発振回路１の発振数；
（６０Ｘ６０Ｘ２４Ｘ３０＋Ｋ）ＸＮ＝（２５９２００
０−１−Ｋ）ＸＮＮ回正正出力１０３発振数 ＨＫｘＮ
回 第２回分２器４の分周回路４１の分用数；（２５９２０
００Ｘ Ｎ ）÷（Ｋ Ｘ Ｎ ） ＝ ２５９２００
０ ÷に第２の分局器４の分周数入力回路の設定ビ１
分周数 ； ２５９２０００÷に１０）加減算の指定
； 減算 以上のように設定することによって発振周波数を効果的
に補正することができる。
０−１−Ｋ）ＸＮＮ回正正出力１０３発振数 ＨＫｘＮ
回 第２回分２器４の分周回路４１の分用数；（２５９２０
００Ｘ Ｎ ）÷（Ｋ Ｘ Ｎ ） ＝ ２５９２００
０ ÷に第２の分局器４の分周数入力回路の設定ビ１
分周数 ； ２５９２０００÷に１０）加減算の指定
； 減算 以上のように設定することによって発振周波数を効果的
に補正することができる。
次に、演算回路２において加算もしくは減算の一方だけ
の演算のみを用いて補正する例を説明する。減算のみを
用いる例として、基本発振回路１の発振周波数の最大変
動分だけ加算した周波数を基本発振回路１の発振周波数
に選ぶことによって減算のみで補正できる。加算のみを
用いる例として、基本発振回路１の発振周波数の最大変
動分だけ減算した周波数を基本発振回路１の発振周波数
に選ぶことによって加算のみで補正できる。さらに２両
者において、最大変動分を補正するために第２の分局器
４の分周数を、第２の分周器４の分、周数入力回路４２
にプリセットすることにより。
の演算のみを用いて補正する例を説明する。減算のみを
用いる例として、基本発振回路１の発振周波数の最大変
動分だけ加算した周波数を基本発振回路１の発振周波数
に選ぶことによって減算のみで補正できる。加算のみを
用いる例として、基本発振回路１の発振周波数の最大変
動分だけ減算した周波数を基本発振回路１の発振周波数
に選ぶことによって加算のみで補正できる。さらに２両
者において、最大変動分を補正するために第２の分局器
４の分周数を、第２の分周器４の分、周数入力回路４２
にプリセットすることにより。
実際の変動分のみを入力するだはで補正することができ
る。
る。
以上のように本発明は、演算回路と分周数を指定できる
分周器を用いることにより、簡単に基本発振回路の発振
周波数の変動を補正できる発振周波数補正装置を実現で
きるもので、従来のように基本発振回路に高価な発振素
子・発振回路を用いることなしに、その環境に応じた発
振周波数を補正できるという点において優れた効果が得
られるものである。
分周器を用いることにより、簡単に基本発振回路の発振
周波数の変動を補正できる発振周波数補正装置を実現で
きるもので、従来のように基本発振回路に高価な発振素
子・発振回路を用いることなしに、その環境に応じた発
振周波数を補正できるという点において優れた効果が得
られるものである。
第１図は本発明の一実施例のブロック構成図、第２図は
第１図における第２の分周器の詳細を示す構成図、第３
図は第１図および第２図における各部の出力波形の波形
例を示すタイミング図である。 １・・・・・・基本発振回路、２・・・・・・演算回路
、３・・・・・・第１の分周器、４・・・・・・第２の
分周器、４１・・・・・・分周回路、４２・・・・・・
分周数入力回路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名分
１ 図 第２図 １３図 □吋閃
第１図における第２の分周器の詳細を示す構成図、第３
図は第１図および第２図における各部の出力波形の波形
例を示すタイミング図である。 １・・・・・・基本発振回路、２・・・・・・演算回路
、３・・・・・・第１の分周器、４・・・・・・第２の
分周器、４１・・・・・・分周回路、４２・・・・・・
分周数入力回路。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名分
１ 図 第２図 １３図 □吋閃
Claims (1)
- 基本発振回路と、２つの発振波を加算および減算処理す
る演算回路と、該演算回路に接続され基本発振波を作る
第１の分局器と、前記演算回路に接続され発振周波数を
補正するための発振波を作る第２の分周器とを具備し、
前記基本発振回路と前記第２の分周器を前記演算回路の
入力側に接続し、基本発振回路の周波数に対して第２の
分周器の出力周波数だけ前記演算回路で周波数が補正さ
れて前記第１の分周器へ出力されるようにし、かつ前記
第２の分周器の分周数を任意の値に設定することにより
第１の分局器へ出力される周波数を補正するように構成
したことを特徴とする発振周波数補正装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16681781A JPS5868322A (ja) | 1981-10-19 | 1981-10-19 | 発振周波数補正装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16681781A JPS5868322A (ja) | 1981-10-19 | 1981-10-19 | 発振周波数補正装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5868322A true JPS5868322A (ja) | 1983-04-23 |
Family
ID=15838208
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16681781A Pending JPS5868322A (ja) | 1981-10-19 | 1981-10-19 | 発振周波数補正装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5868322A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5428561A (en) * | 1977-08-04 | 1979-03-03 | Fairchild Camera Instr Co | Circuit for adjusting signal mean frequency applied to output device |
-
1981
- 1981-10-19 JP JP16681781A patent/JPS5868322A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5428561A (en) * | 1977-08-04 | 1979-03-03 | Fairchild Camera Instr Co | Circuit for adjusting signal mean frequency applied to output device |
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