JPS5858905B2 - デンゲンイジヨウケンシユツカイロ - Google Patents
デンゲンイジヨウケンシユツカイロInfo
- Publication number
- JPS5858905B2 JPS5858905B2 JP7157575A JP7157575A JPS5858905B2 JP S5858905 B2 JPS5858905 B2 JP S5858905B2 JP 7157575 A JP7157575 A JP 7157575A JP 7157575 A JP7157575 A JP 7157575A JP S5858905 B2 JPS5858905 B2 JP S5858905B2
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- JP
- Japan
- Prior art keywords
- output
- circuit
- pulse
- voltage
- reference voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Protection Of Static Devices (AREA)
- Control Of Voltage And Current In General (AREA)
- Dc-Dc Converters (AREA)
- Power Conversion In General (AREA)
Description
【発明の詳細な説明】
本発明は、パルス幅変調方式スイッチングレギュレータ
の電源異常検出回路に関するものである。
の電源異常検出回路に関するものである。
従来、パルス幅変調方式スイッチングレギュレータの電
源異常検出回路としては、過電圧、不足電圧、過電流の
異常を検出するにとどまり、スイッチングレギュレータ
の開閉素子あるいは開閉素子駆動回路、整流回路等の異
常を検出する回路をもたず、これらの異常が生じた場合
、前記の検出回路により検出するようにしていたため、
特に、パルス幅変調方式スイッチングレギュレータを並
列運転する場合に異常を検出するまでには至らない場合
が生じたり、また異常のあるレギュレータを判別するの
が困難であった。
源異常検出回路としては、過電圧、不足電圧、過電流の
異常を検出するにとどまり、スイッチングレギュレータ
の開閉素子あるいは開閉素子駆動回路、整流回路等の異
常を検出する回路をもたず、これらの異常が生じた場合
、前記の検出回路により検出するようにしていたため、
特に、パルス幅変調方式スイッチングレギュレータを並
列運転する場合に異常を検出するまでには至らない場合
が生じたり、また異常のあるレギュレータを判別するの
が困難であった。
本発明の目的は、パルス幅変調方式スイッチングレギュ
レータの並列運転を行う電源装置に関して上記欠点を除
去し、各レギュレータそれ自身の異常すなわち開閉素子
あるいは開閉素子駆動回路、整流回路等の異常を検出し
て、異常の早期発見、異常レギュレータの判別を容易に
することにある。
レータの並列運転を行う電源装置に関して上記欠点を除
去し、各レギュレータそれ自身の異常すなわち開閉素子
あるいは開閉素子駆動回路、整流回路等の異常を検出し
て、異常の早期発見、異常レギュレータの判別を容易に
することにある。
パルス幅変調方式スイッチングレギュレータにおいて、
基準電圧と出力電流に応じて電圧を発生する出力電流検
出回路を具備し、更に前記電流検出回路の出力電圧を前
記基準電圧と比較しその結果増減させる制御回路を有す
る。
基準電圧と出力電流に応じて電圧を発生する出力電流検
出回路を具備し、更に前記電流検出回路の出力電圧を前
記基準電圧と比較しその結果増減させる制御回路を有す
る。
そして開閉素子駆動パルス幅は、前記制御回路出力信号
によりパルス幅変調され前記基準電圧に追随するように
出力電流を増減させる。
によりパルス幅変調され前記基準電圧に追随するように
出力電流を増減させる。
このような構成を有するレギュレータにおいて、本発明
は更にトリガパルスの後縁により開閉素子を駆動すると
同時に該信号によりセットされ、前記制御回路の出力パ
ルスでリセットされる双安定回路を具備し、該双安定回
路の出力が次のトリガパルスの開始時刻までセット状態
にある時、すなわちパルス幅が変調されないとき、異常
信号を送出するようにした異常検出回路を設けることを
特徴とする。
は更にトリガパルスの後縁により開閉素子を駆動すると
同時に該信号によりセットされ、前記制御回路の出力パ
ルスでリセットされる双安定回路を具備し、該双安定回
路の出力が次のトリガパルスの開始時刻までセット状態
にある時、すなわちパルス幅が変調されないとき、異常
信号を送出するようにした異常検出回路を設けることを
特徴とする。
前記構成を持つパルス幅変調方式スイッチングレギュレ
ータに於ては、開閉素子の駆動期間中に出力電流レベル
は、前記基準電圧のレベルに必ず到達する事を利用し出
力電流レベルが基準電圧のレベルに到達しない場合を電
源異常とするものである。
ータに於ては、開閉素子の駆動期間中に出力電流レベル
は、前記基準電圧のレベルに必ず到達する事を利用し出
力電流レベルが基準電圧のレベルに到達しない場合を電
源異常とするものである。
次に本発明の一実施例について図面を参照して説明する
。
。
第１図は本発明の第１の実施例の回路図であり、非安定
化直流電流Ｅｉは、開閉素子駆動回路１によって開閉さ
れる開閉素子２によりチョッパされる。
化直流電流Ｅｉは、開閉素子駆動回路１によって開閉さ
れる開閉素子２によりチョッパされる。
さらにチョッパされた電圧は電圧変換素子３により昇圧
または降圧され整流回路４により整流され、更に濾波回
路５によって平滑される。
または降圧され整流回路４により整流され、更に濾波回
路５によって平滑される。
これらの基本回路は周知である。
さらに電流検出素子６を出力側即ち直流側に挿入して出
力電流を検出する。
力電流を検出する。
基準電圧Ｖｃと前記電流検出素子６の出力とを誤差増幅
する誤差増幅器９及びトリガパルス発生回路１０から送
出されるトリガパルスを鋸歯状波発生回路１１を通して
基準となる鋸歯状波を発生させ、その鋸歯状波と誤差増
幅器９の差動出力とを比較する比較器１２及びその出力
パルスによってパルス幅を決定するパルス幅制御回路１
３から構成されたレギュレータは電流検出素子６の出力
即ち出力電流を基準電圧Ｖｃにより制御することにより
パルス幅変調され、出力特性としては定電流特性を示す
。
する誤差増幅器９及びトリガパルス発生回路１０から送
出されるトリガパルスを鋸歯状波発生回路１１を通して
基準となる鋸歯状波を発生させ、その鋸歯状波と誤差増
幅器９の差動出力とを比較する比較器１２及びその出力
パルスによってパルス幅を決定するパルス幅制御回路１
３から構成されたレギュレータは電流検出素子６の出力
即ち出力電流を基準電圧Ｖｃにより制御することにより
パルス幅変調され、出力特性としては定電流特性を示す
。
また基準電圧Ｖｃを定電圧用基準電圧を一方の入力とし
、レギュレータの出力電圧を他方の入力とする誤差増幅
器の差動出力とすることにより出力特性としては定電圧
特性を示す。
、レギュレータの出力電圧を他方の入力とする誤差増幅
器の差動出力とすることにより出力特性としては定電圧
特性を示す。
このように構成されたレギュレータへ本発明の電源異常
検出回路では、トリガパルス発生回路１０の出力パルス
の後縁によりセットされ、比較器１２の出力によってリ
セットされる双安定回路１４及びトリガパルスと前記双
安定回路１４の出力のＡＮＤ条件をとるＡＮＤゲート１
５及びアラーム状態を保持するアラーム保持回路１６を
附加する。
検出回路では、トリガパルス発生回路１０の出力パルス
の後縁によりセットされ、比較器１２の出力によってリ
セットされる双安定回路１４及びトリガパルスと前記双
安定回路１４の出力のＡＮＤ条件をとるＡＮＤゲート１
５及びアラーム状態を保持するアラーム保持回路１６を
附加する。
この電源異常検出回路の動作を第２図の動作波形をも参
照して説明する。
照して説明する。
まずトリガパルス発生回路１０が発生する繰返し一定の
パルスａの後縁によって双安定回路１４をセットすると
同時に開閉素子２の駆動を開始する。
パルスａの後縁によって双安定回路１４をセットすると
同時に開閉素子２の駆動を開始する。
また本実施例では、鋸歯状波発生回路１１に於て、トリ
ガパルスａに同期した第２図すの如き鋸歯状波を発生す
る。
ガパルスａに同期した第２図すの如き鋸歯状波を発生す
る。
誤差増幅器９は前記基準電圧Ｖｃと出力電流に基づく電
圧を発生する電流検出素子６の出力とを比較し、差動出
力Ｃを出力する。
圧を発生する電流検出素子６の出力とを比較し、差動出
力Ｃを出力する。
比較器１２では第２図に示されるように鋸歯状波すと誤
差増幅器９の差動出力Ｃとが比較され、前者が後者を越
えた瞬間にパルス幅制御回路１３に信号を送出し、開閉
素子２の駆動を停止する。
差増幅器９の差動出力Ｃとが比較され、前者が後者を越
えた瞬間にパルス幅制御回路１３に信号を送出し、開閉
素子２の駆動を停止する。
以上の様に本レギュレータに於ては出力電流を検出して
該出力と基準電圧Ｖｃの差動出力によりパルス幅を変調
する構成とすることにより、レギュレータが正常に動作
していれは必ず比較器１２は出力パルスを送出する。
該出力と基準電圧Ｖｃの差動出力によりパルス幅を変調
する構成とすることにより、レギュレータが正常に動作
していれは必ず比較器１２は出力パルスを送出する。
もし開閉素子あるいは開閉素子駆動回路、整流回路等が
異常となり、出力電流を検出し得なくなると、出力電流
が基準電圧Ｖｃのレベルまで到達し得ず、比較器１２は
出力パルスを送出しない。
異常となり、出力電流を検出し得なくなると、出力電流
が基準電圧Ｖｃのレベルまで到達し得ず、比較器１２は
出力パルスを送出しない。
従って比較器１２の出力により、リセットされる双安定
回路１４の出力ｅとトリガパルスａとのＡＮＤ出力出力
界常時にパルスを発生することになり、アラーム保持回
路１６がセットされ、アラーム信号出力ｇも送出する。
回路１４の出力ｅとトリガパルスａとのＡＮＤ出力出力
界常時にパルスを発生することになり、アラーム保持回
路１６がセットされ、アラーム信号出力ｇも送出する。
次に本発明の第２の実施例について第３図を参照して説
明する。
明する。
第１の実施例で述べたスイッチングレギュレータの基本
回路へ第２の実施例では電流検出素子１７を一次側脚ち
交流側に挿入して、出力電流を検出するようにしたもの
で、電流検出素子１７の出力を入力とする積分器１８と
基準電圧Ｖｃとを比較する比較器２２とトリがパルス発
生回路２０から送られてくるトリガパルスに同期し、前
記比較器２２の出力によって開閉素子駆動パルス幅を制
御するパルス幅制御回路２３から構成されたレギュレー
タは基準電圧Ｖｃに追随して、出力電流値を制御するよ
うパルス幅変調される。
回路へ第２の実施例では電流検出素子１７を一次側脚ち
交流側に挿入して、出力電流を検出するようにしたもの
で、電流検出素子１７の出力を入力とする積分器１８と
基準電圧Ｖｃとを比較する比較器２２とトリがパルス発
生回路２０から送られてくるトリガパルスに同期し、前
記比較器２２の出力によって開閉素子駆動パルス幅を制
御するパルス幅制御回路２３から構成されたレギュレー
タは基準電圧Ｖｃに追随して、出力電流値を制御するよ
うパルス幅変調される。
また基準電圧Ｖｃを定電圧用基準電圧の一方の入力とし
レギュレータの出力電圧を他方の入力とする誤差増幅器
の差動出力とすることにより出力特性としては定電圧特
性を示す。
レギュレータの出力電圧を他方の入力とする誤差増幅器
の差動出力とすることにより出力特性としては定電圧特
性を示す。
以上のように構成されたレギュレータへ本発明の電源異
常検出回路はトリガパルスの後縁によってセットされ、
比較器２２の出力によってリセットされる双安定回路２
４及びトリガパルスと双安定回路２４の出力のＡＮＤ条
件をとるＡＮＤゲー１２５及びアラーム状態を保持する
アラーム保持回路２６を附加する。
常検出回路はトリガパルスの後縁によってセットされ、
比較器２２の出力によってリセットされる双安定回路２
４及びトリガパルスと双安定回路２４の出力のＡＮＤ条
件をとるＡＮＤゲー１２５及びアラーム状態を保持する
アラーム保持回路２６を附加する。
この電源異常検出回路の動作を第４図の動作波形をも参
照して説明する。
照して説明する。
まずトリガパルスｈの後縁により双安定回路２４をセッ
トすると同時に開閉素子２の駆動を開始する。
トすると同時に開閉素子２の駆動を開始する。
また本実施例では開閉素子２を流れる電流を電流検出素
子１７によって第４図１の如く波形をそこなうことなく
検出し該出力ｉを積分器１８により積分する。
子１７によって第４図１の如く波形をそこなうことなく
検出し該出力ｉを積分器１８により積分する。
ところで、該積分器１８の出力には、基準電圧Ｖｃと比
較器２２により比較される。
較器２２により比較される。
そして比較器２２の出力は積分器出力ｋが基準電圧Ｖｃ
を越えた瞬間パルス幅制御回路２３に信号を送出し開閉
素子２の駆動を停止する。
を越えた瞬間パルス幅制御回路２３に信号を送出し開閉
素子２の駆動を停止する。
以上のように本しギュレークに於ては、出力電流レベル
が基準電圧Ｖｃに到達するまで開閉素子２を駆動するよ
う回路が構成されている故、レギュレータが正常に動作
していれば必ず比較器２２は出力パルスを送出する。
が基準電圧Ｖｃに到達するまで開閉素子２を駆動するよ
う回路が構成されている故、レギュレータが正常に動作
していれば必ず比較器２２は出力パルスを送出する。
しかも、もし開閉素子あるいは開閉素子、駆動回路、整
流回路等が異常となり出力電流を検出し得なくなると、
出力電流レベルは基準電圧Ｖｃに到達し得す比較器２２
は出力パルスを送出しない。
流回路等が異常となり出力電流を検出し得なくなると、
出力電流レベルは基準電圧Ｖｃに到達し得す比較器２２
は出力パルスを送出しない。
従って前記比較器２２の出力によりリセットされる双安
定回路２４の出力ｍとトリガパルスｈとのＡＮＤ出力に
は異常時にパルスを発生することになりアラーム保持回
路２６がセットされアラーム信号出力Ｐを送出する。
定回路２４の出力ｍとトリガパルスｈとのＡＮＤ出力に
は異常時にパルスを発生することになりアラーム保持回
路２６がセットされアラーム信号出力Ｐを送出する。
本発明の効果は以上説明したように、出力電流を検出し
てパルス幅変調を行うレギュレータに於て、パルス幅変
調の有無を検出して電源異常を検出する回路を構成する
ことにより特にパルス幅変調方式スイッチングレギュレ
ータの出力を共通電圧母線に接続し並列運転を行う電源
装置に於て、各レギュレータそれ自身の異常の早期検出
及び異常レギュレータの判別等の効果を有する。
てパルス幅変調を行うレギュレータに於て、パルス幅変
調の有無を検出して電源異常を検出する回路を構成する
ことにより特にパルス幅変調方式スイッチングレギュレ
ータの出力を共通電圧母線に接続し並列運転を行う電源
装置に於て、各レギュレータそれ自身の異常の早期検出
及び異常レギュレータの判別等の効果を有する。
第１図は本発明の第１の実施例の回路図、第２図は第１
図の第１の実施例を説明するための動作波形、第３図は
本発明の第２の実施例の回路図、第４図は第３図の第２
の実施例を説明するための動作波形である。 図において示された記号を以下に示す。 １・・・・・・開閉素子駆動回路、２・・・・・・開閉
素子、３・・・・・・電圧変換素子、４・・・・・・整
流回路、５・・・・・・濾波回路、６゜１７・・・・・
・電流検出素子、９・・・・・・誤差増幅器、１０゜２
０・・・・・・トリガパルス発生回路、１１・・・・・
・鋸歯状波発生回路、１２，２２・・・・・・比較器、
１３．２３・・・・・・パルス幅制御回路、１４．２４
・・・・・・双安定回路、１５，２５・・・・・・アン
ド回路、１６．２６・・・・・・アラーム保持回路、１
８・・・・・・積分器、ａ、ｈ・・・・・・トリガパル
ス、ｂ・・・・・・鋸歯状波、Ｃ・・・・・・差動出力
、ｄ、７・・・・・・開閉素子駆動パルス、ｅｌｍ・・
・・・・双安定回路出力、ｆ、ｎ・・・・・・ＡＮＤ出
力、ｇ、ｐ・・・・・・アラーム信号出力、ｋ・・・・
・・積分器出力、ｉ・・・・・・電流検出素子出力電流
、ｖｃ・・・・・・基準電圧。
図の第１の実施例を説明するための動作波形、第３図は
本発明の第２の実施例の回路図、第４図は第３図の第２
の実施例を説明するための動作波形である。 図において示された記号を以下に示す。 １・・・・・・開閉素子駆動回路、２・・・・・・開閉
素子、３・・・・・・電圧変換素子、４・・・・・・整
流回路、５・・・・・・濾波回路、６゜１７・・・・・
・電流検出素子、９・・・・・・誤差増幅器、１０゜２
０・・・・・・トリガパルス発生回路、１１・・・・・
・鋸歯状波発生回路、１２，２２・・・・・・比較器、
１３．２３・・・・・・パルス幅制御回路、１４．２４
・・・・・・双安定回路、１５，２５・・・・・・アン
ド回路、１６．２６・・・・・・アラーム保持回路、１
８・・・・・・積分器、ａ、ｈ・・・・・・トリガパル
ス、ｂ・・・・・・鋸歯状波、Ｃ・・・・・・差動出力
、ｄ、７・・・・・・開閉素子駆動パルス、ｅｌｍ・・
・・・・双安定回路出力、ｆ、ｎ・・・・・・ＡＮＤ出
力、ｇ、ｐ・・・・・・アラーム信号出力、ｋ・・・・
・・積分器出力、ｉ・・・・・・電流検出素子出力電流
、ｖｃ・・・・・・基準電圧。
Claims (1)
- １ 電源の出力電流に応じて電圧を発生する出力電流検
出手段と、電源の出力電圧に応じて変化する定電圧用基
準電圧に追随して出力電流を同時に増減せしめるように
、スイッチングレギュレータのパルス幅を制御する制御
回路とを備え、並列運転を可能にしたパルス幅変調方式
スイッチングレギュレータにおいて、トリガパルスの後
縁により開閉素子を駆動すると同時に該信号によりセッ
トされ、前記出力電流検出手段の出力電圧と前記基準電
圧とを入力とする比較器の出力パルスでリセットされる
双安定回路を具備し、該双安定回路が次のトリガパルス
の開始時刻までセット状態にあるとき、異常信号を送出
するようにしたことを特徴とする電源異常検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7157575A JPS5858905B2 (ja) | 1975-06-12 | 1975-06-12 | デンゲンイジヨウケンシユツカイロ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7157575A JPS5858905B2 (ja) | 1975-06-12 | 1975-06-12 | デンゲンイジヨウケンシユツカイロ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS51147744A JPS51147744A (en) | 1976-12-18 |
| JPS5858905B2 true JPS5858905B2 (ja) | 1983-12-27 |
Family
ID=13464626
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7157575A Expired JPS5858905B2 (ja) | 1975-06-12 | 1975-06-12 | デンゲンイジヨウケンシユツカイロ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5858905B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61175007U (ja) * | 1985-04-22 | 1986-10-31 |
-
1975
- 1975-06-12 JP JP7157575A patent/JPS5858905B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61175007U (ja) * | 1985-04-22 | 1986-10-31 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS51147744A (en) | 1976-12-18 |
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