JPS58529U - フエイルセイフ形レイトマルチプライヤ回路 - Google Patents

フエイルセイフ形レイトマルチプライヤ回路

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JPS58529U
JPS58529U JP9533881U JP9533881U JPS58529U JP S58529 U JPS58529 U JP S58529U JP 9533881 U JP9533881 U JP 9533881U JP 9533881 U JP9533881 U JP 9533881U JP S58529 U JPS58529 U JP S58529U
Authority
JP
Japan
Prior art keywords
circuit
fail
frequency
multiplier circuit
rate multiplier
Prior art date
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Application number
JP9533881U
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English (en)
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JPS6329301Y2 (ja
Inventor
一雄 岸本
宮原　正敏
Original Assignee
三菱電機株式会社
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Publication date
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  • Manipulation Of Pulses (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のフェイルセイフ形レイトマルチプライヤ
回路の回路図、第２図は第１図のフェイルセイフ形レイ
トマルチプライヤ回路の各部の信号波形図、第３図はこ
の考案のフエイ・ルセイフ形Ｌ／イトマルチプライヤ回
路の一実施例を示す回路図、第４図は第３図のフェイル
セイフ形レイトマルチプライヤ回路の各部の信号波形図
である。 １・・・・・・カウンタ、２・・・・・・微分回路、３
・・・・・・論理和回路、ｆ１〜ｆ３・・・・・・フリ
ップ・フロップ回路、Ａ□〜Ａ３・・・・・・アンドゲ
ート。なお、図中同一符号は同一または相当部分を示す
。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力の基本周波数より各分周パルスを得るためのカウン
    タ、その分周パルスを合成のため微分する順序回路によ
    る微分回路、この微分回路の出力の合成を行い、所定の
    周波数を得るための論理和回路から構成され、各回路の
    構成要素がオン故障、またはオフ故障しても上′記論理
    和回路の出力周波数は設定値以上にならないというフエ
    イ；レセイフ動作を行う事を特徴とするフェイルセイフ
    形レイトマルチプライヤ回路。
JP9533881U 1981-06-26 1981-06-26 フエイルセイフ形レイトマルチプライヤ回路 Granted JPS58529U (ja)

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JP9533881U JPS58529U (ja) 1981-06-26 1981-06-26 フエイルセイフ形レイトマルチプライヤ回路

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JP9533881U JPS58529U (ja) 1981-06-26 1981-06-26 フエイルセイフ形レイトマルチプライヤ回路

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JPS58529U true JPS58529U (ja) 1983-01-05
JPS6329301Y2 JPS6329301Y2 (ja) 1988-08-08

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ID=29890247

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4732592U (ja) * 1971-04-30 1972-12-12

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4732592U (ja) * 1971-04-30 1972-12-12

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JPS6329301Y2 (ja) 1988-08-08

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