JPS5847369A - 信号速度低減符号化方式 - Google Patents
信号速度低減符号化方式Info
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- JPS5847369A JPS5847369A JP14550281A JP14550281A JPS5847369A JP S5847369 A JPS5847369 A JP S5847369A JP 14550281 A JP14550281 A JP 14550281A JP 14550281 A JP14550281 A JP 14550281A JP S5847369 A JPS5847369 A JP S5847369A
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- JP
- Japan
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- signal
- variable length
- storage means
- memory
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はディジタル信号として記録された画像信号をそ
の本来の速度より低減し、時間をかけて伝送するための
符号化方式に関するものである０信号をその本来の速度
すなわちリアルタイムで伝送する必要がない場合、信号
源からの信号をゆっくり送出することにより発生する信
号を全く失うことなしに制限されたビットレイトで伝送
を行うことができる。このとき、伝送ビットレイトに反
比例して全ての信号の伝送に要する時間が長くなる。
の本来の速度より低減し、時間をかけて伝送するための
符号化方式に関するものである０信号をその本来の速度
すなわちリアルタイムで伝送する必要がない場合、信号
源からの信号をゆっくり送出することにより発生する信
号を全く失うことなしに制限されたビットレイトで伝送
を行うことができる。このとき、伝送ビットレイトに反
比例して全ての信号の伝送に要する時間が長くなる。
今、例えばディジタル・ビデオチーブレコーダ（ＶＴＲ
）に収録されたビデオ信号をそのまま遠隔地へ伝送しよ
うとすれば数十Ｍｂｐｓの伝送レイトを有する伝送路が
必要である０もし、リアルタイムの伝送が必要とされな
い場合、送信側のテープを通事ｔ９ゆつくり走行させ、
受信側でも同じ速度でテープを走行させることにより、
この間の伝送路の容量を低減することは理論的には可能
である。しかしながら、実際問題として、両ＶＴＲの走
行駆動の同期という問題がちｂためにこの方式の実現は
簡単ではない。さらに、巣に送受同期して信号速度を低
減しただけでは、伝送容量と所要伝送時間の積は変わら
ず、伝送コストの低減はさして期待できない。
）に収録されたビデオ信号をそのまま遠隔地へ伝送しよ
うとすれば数十Ｍｂｐｓの伝送レイトを有する伝送路が
必要である０もし、リアルタイムの伝送が必要とされな
い場合、送信側のテープを通事ｔ９ゆつくり走行させ、
受信側でも同じ速度でテープを走行させることにより、
この間の伝送路の容量を低減することは理論的には可能
である。しかしながら、実際問題として、両ＶＴＲの走
行駆動の同期という問題がちｂためにこの方式の実現は
簡単ではない。さらに、巣に送受同期して信号速度を低
減しただけでは、伝送容量と所要伝送時間の積は変わら
ず、伝送コストの低減はさして期待できない。
本発明は信号の伝送速度を低減する場合に、送受のメモ
リの同期の問題を解決し、同時に送るべき信号の冗長性
を効果的に除くことにより、能率的な低速度の信号伝送
を実現する信号速度低減符号化方式を提供するものであ
る。
リの同期の問題を解決し、同時に送るべき信号の冗長性
を効果的に除くことにより、能率的な低速度の信号伝送
を実現する信号速度低減符号化方式を提供するものであ
る。
以下図面により本発明の詳細な説明する。
第１図は本発明の実施例であって、１は送信側の長時間
メモリとしてのディジタルＶＴＲ％２は送信側の一時メ
モリとしてのディジタル画像メモリ、２ａはＶＴＲ１か
ら一時メモリ２への信号の転送を制御する泥めの制御線
、４け可変長符号化器、５は送信バッファメモリ、５ａ
はバッファメモリ５の状態によってバッファメモリ５へ
の入力タイミングを制御しまた必要に応じダミービット
の送出指令を送るための制御線、６はバッファメモリ５
の出力端子、７はディジタル伝送路である。８は受信側
のバッファメモリ入力端子、９は受信バッファメモリ、
９ｍは受信バッファメモリ９の出力タイミングを制御す
るための制御線、ｌＯは可変長符号の復号化器、１１は
受信側の一時メモリ、１２は受信側のディジタルＶＴＲ
Ｔ６る。
メモリとしてのディジタルＶＴＲ％２は送信側の一時メ
モリとしてのディジタル画像メモリ、２ａはＶＴＲ１か
ら一時メモリ２への信号の転送を制御する泥めの制御線
、４け可変長符号化器、５は送信バッファメモリ、５ａ
はバッファメモリ５の状態によってバッファメモリ５へ
の入力タイミングを制御しまた必要に応じダミービット
の送出指令を送るための制御線、６はバッファメモリ５
の出力端子、７はディジタル伝送路である。８は受信側
のバッファメモリ入力端子、９は受信バッファメモリ、
９ｍは受信バッファメモリ９の出力タイミングを制御す
るための制御線、ｌＯは可変長符号の復号化器、１１は
受信側の一時メモリ、１２は受信側のディジタルＶＴＲ
Ｔ６る。
ディジタルＶＴＲＩから送信側の一時メモリ２へは画面
単位（フィールド又はフレーム）で信号を転送すること
ができ、そのタイミングは一時メモリ２が空にならない
様に、かつ一時メモリ２でオーバーフローしないように
一時メモリ２から制御される。
単位（フィールド又はフレーム）で信号を転送すること
ができ、そのタイミングは一時メモリ２が空にならない
様に、かつ一時メモリ２でオーバーフローしないように
一時メモリ２から制御される。
一時メモリ２に蓄えられた信号はバッファメモリ５から
あとで説明するタイミング指令によっテ出力され、また
可変長符号化器４により可変長符号化される。表１は一
時メモリ２からの信号の値とその発生確率および各信号
値と対応させる可変長符号の一例を示す。このように発
生確率の高い信号値に短い符号を対応させるので総計的
に平均ビ、ト数は入力信号が要するピット数（この場合
、１６レベルすなわち４ビツト）より少なくなる。例え
ば、表１のような場合、ダミービットを用いなかったと
すれば、可変長符号を用いることにより２．８６ビ、ト
に減少させることができる。
あとで説明するタイミング指令によっテ出力され、また
可変長符号化器４により可変長符号化される。表１は一
時メモリ２からの信号の値とその発生確率および各信号
値と対応させる可変長符号の一例を示す。このように発
生確率の高い信号値に短い符号を対応させるので総計的
に平均ビ、ト数は入力信号が要するピット数（この場合
、１６レベルすなわち４ビツト）より少なくなる。例え
ば、表１のような場合、ダミービットを用いなかったと
すれば、可変長符号を用いることにより２．８６ビ、ト
に減少させることができる。
可変長符号化器４は、第２図にその構成例を示すように
、レベル検出部４０で入力信号のレベルが表１の１５段
階のとれに相当するかを検出し、その検出したレベルに
該尚する可変長符号を、予め表表 １ １の情報を書きこんである読出専用メモリ（ＲＯＭ）４
１から読み出して出力するように構成することができる
。ダミービットを出力する必要のあるときは、制御線５
ａからの指令を受けて、ＲＯＭ４１からダミービットを
出力する。
、レベル検出部４０で入力信号のレベルが表１の１５段
階のとれに相当するかを検出し、その検出したレベルに
該尚する可変長符号を、予め表表 １ １の情報を書きこんである読出専用メモリ（ＲＯＭ）４
１から読み出して出力するように構成することができる
。ダミービットを出力する必要のあるときは、制御線５
ａからの指令を受けて、ＲＯＭ４１からダミービットを
出力する。
可変長符号化器４からの出力信号に一定のピットレイト
でにないので、これを送信バッファメモリ５（容量：Ｌ
ビット）に一旦蓄えて、一定のピットレイトで順次伝送
路７に送出する。従って送信バッファメモリ５の中に残
留する信号ビット量は、時々刻々変化して計り１場合に
よってけあふれた９、空になったしすることが有９得る
。これらを防ぐために、バッファメモリ５の中の信号が
り、ピッ）（Ｌｌ＜Ｌ）に達すると、制御線５ａにより
一時メモリ２からの信号の転送を停止させ、この転送の
停止によってバッファメモリ５の中の信号量がＬ２ビｙ
） （Ｌ２＜Ｌｌ＜Ｌ）まで減少すると、この停止を
解除する。また、バッファメモリ５の中の信号がさらに
Ｌ３ビｙ ） （Ｌｌ＜Ｌ２）にまで減少すると、ダミ
ービット送出指令を制御線５ａを通して可変長符号化器
４へ送出しダミービットをノ（、ファメモリ５に印加す
る。このようにして送信）（。
でにないので、これを送信バッファメモリ５（容量：Ｌ
ビット）に一旦蓄えて、一定のピットレイトで順次伝送
路７に送出する。従って送信バッファメモリ５の中に残
留する信号ビット量は、時々刻々変化して計り１場合に
よってけあふれた９、空になったしすることが有９得る
。これらを防ぐために、バッファメモリ５の中の信号が
り、ピッ）（Ｌｌ＜Ｌ）に達すると、制御線５ａにより
一時メモリ２からの信号の転送を停止させ、この転送の
停止によってバッファメモリ５の中の信号量がＬ２ビｙ
） （Ｌ２＜Ｌｌ＜Ｌ）まで減少すると、この停止を
解除する。また、バッファメモリ５の中の信号がさらに
Ｌ３ビｙ ） （Ｌｌ＜Ｌ２）にまで減少すると、ダミ
ービット送出指令を制御線５ａを通して可変長符号化器
４へ送出しダミービットをノ（、ファメモリ５に印加す
る。このようにして送信）（。
ファメモリ５ではその出力ビツトレイトを常に一定に保
ちながら、かつ、その内容があふれたり空になるのを防
ぐ〇 ここで、Ｌｌは容量りの送信バッファメモリ５でオーバ
ーフローが起らないようにするためのものであるからＬ
に近い数値に設定する。Ｌ２［オーバーフローの危険が
なくかつ送信バッファメモリ５が空にもならないような
容量りのほぼ中間に設定する。Ｌ ａ ｕ 滲出信号が
なくなるのを防止するためのレベルであるから、はぼ０
に近いところに設定する。
ちながら、かつ、その内容があふれたり空になるのを防
ぐ〇 ここで、Ｌｌは容量りの送信バッファメモリ５でオーバ
ーフローが起らないようにするためのものであるからＬ
に近い数値に設定する。Ｌ２［オーバーフローの危険が
なくかつ送信バッファメモリ５が空にもならないような
容量りのほぼ中間に設定する。Ｌ ａ ｕ 滲出信号が
なくなるのを防止するためのレベルであるから、はぼ０
に近いところに設定する。
送信バッファメモリ５について、第３図の構成例をもと
に再度説明する。シフトレジスタ５０の信号量に応じて
前に説明したＬｌ、Ｌ２＋Ｌ３における制御信号が制御
線５ａを通して一時メモリ２または可変長符号化器４に
送出される。伝送路上の所望のピットレートの繰返し周
波数のパルスを発生するパルス発生器５１の出力によっ
て駆動されて、シフトレジスタ５０から一定のビットレ
ートの信号が伝送路７へ送出される。
に再度説明する。シフトレジスタ５０の信号量に応じて
前に説明したＬｌ、Ｌ２＋Ｌ３における制御信号が制御
線５ａを通して一時メモリ２または可変長符号化器４に
送出される。伝送路上の所望のピットレートの繰返し周
波数のパルスを発生するパルス発生器５１の出力によっ
て駆動されて、シフトレジスタ５０から一定のビットレ
ートの信号が伝送路７へ送出される。
受信側では送られてきた信号は、入力端子８を介して受
信バッファメモリ９に印加され、このとき受信バッファ
メモリ９は一定のビットレイトで送られて来る信号を一
定量蓄積して可変長復号化器１０に送出する。可変長復
号化器１０ハバッファメモリ９からの信号を表１の可変
長符号の単位に区切って通常の２進符号に復号し、これ
を受信側の一時メモリ１１に逐次転送する。一時メモリ
１１からは少なくとも一画面単位で逐次ＶＴＲ１２へ信
号を送出する。
信バッファメモリ９に印加され、このとき受信バッファ
メモリ９は一定のビットレイトで送られて来る信号を一
定量蓄積して可変長復号化器１０に送出する。可変長復
号化器１０ハバッファメモリ９からの信号を表１の可変
長符号の単位に区切って通常の２進符号に復号し、これ
を受信側の一時メモリ１１に逐次転送する。一時メモリ
１１からは少なくとも一画面単位で逐次ＶＴＲ１２へ信
号を送出する。
可変長復号化器１０の一構成例を第４図に示す。
表１の情報が予め書きこまれているＲＯＭｌ０−１の可
変長符号をバッファメモリ９からの信号をアドレスとし
て読み出すことにより、その可変長符号に相当する通常
の２進符号をＲＯＭ １４から一時メモリ１１へ出力す
ることができる。
変長符号をバッファメモリ９からの信号をアドレスとし
て読み出すことにより、その可変長符号に相当する通常
の２進符号をＲＯＭ １４から一時メモリ１１へ出力す
ることができる。
第５図は本発明の他の実施例であって、１は送信側の長
時間メモリとしてのディジタルＶＴＲ，２は送信側の一
時メモリとしてのディジタル画像メモ！Ｊ、２ａＨＶＴ
Ｒ１から一時メモリ２への信号の転送を制御するための
制御線、３ＩＩ′１入力信号レベルと予測信号とのレベ
ルの差をとるための予測誤差抽出回路、４Ｖｉ可変可変
長比器、５Ｆｉ送信バ、ファメモリ、５ａはバッファメ
モリ５の状態によってバッファメモリ５への入力タイミ
ングを制御しまた必要に応じダミービットの送出指令を
送るための制御線、６にバッファメモリ５の出力端子、
７はディジタル伝送路である。８１−を受信側のバッフ
ァメモリ９の入力端子、９は受信バッファメモリ、１０
ＩＩ′ｉ可変長符号の復号化器、１３Ｉ／′ｉ送信側か
ら送られてきた予測誤差に基づいて元の画信号を復元す
るための予測誤差積分回路、１ｌＶｉ受信側の一時メモ
リ、１２ハ受信側のＶＴＲである。
時間メモリとしてのディジタルＶＴＲ，２は送信側の一
時メモリとしてのディジタル画像メモ！Ｊ、２ａＨＶＴ
Ｒ１から一時メモリ２への信号の転送を制御するための
制御線、３ＩＩ′１入力信号レベルと予測信号とのレベ
ルの差をとるための予測誤差抽出回路、４Ｖｉ可変可変
長比器、５Ｆｉ送信バ、ファメモリ、５ａはバッファメ
モリ５の状態によってバッファメモリ５への入力タイミ
ングを制御しまた必要に応じダミービットの送出指令を
送るための制御線、６にバッファメモリ５の出力端子、
７はディジタル伝送路である。８１−を受信側のバッフ
ァメモリ９の入力端子、９は受信バッファメモリ、１０
ＩＩ′ｉ可変長符号の復号化器、１３Ｉ／′ｉ送信側か
ら送られてきた予測誤差に基づいて元の画信号を復元す
るための予測誤差積分回路、１ｌＶｉ受信側の一時メモ
リ、１２ハ受信側のＶＴＲである。
ディジタルＶＴＲＩから送信側の一時メモリ２へは画面
単位（フィールド又はフレーム）で信号を転送すること
ができ、そのタイミングは一時メモリ２が空にならない
ように、かつオーバーフローしないように一時メモリ２
によって制御される。
単位（フィールド又はフレーム）で信号を転送すること
ができ、そのタイミングは一時メモリ２が空にならない
ように、かつオーバーフローしないように一時メモリ２
によって制御される。
一時メモリ２に蓄えられた信号はバッファメモリ５から
後で説明するタイミング指令によって出力される。一時
メモリ２からの出力に、予測誤差抽出回路３に加えられ
る。予測誤差抽出回路３は、入力信号の値とその予測値
との差を抽出し、可変長符号化器４に送出する。可変長
符号化器４に予測誤差抽出回路３からの出力信号の値を
その発生確率に応じて符号化する。表２は予測誤差抽出
回路４からの信号の値とその発生確率および各信号値と
対応させる可変長符号の一例を示す。
後で説明するタイミング指令によって出力される。一時
メモリ２からの出力に、予測誤差抽出回路３に加えられ
る。予測誤差抽出回路３は、入力信号の値とその予測値
との差を抽出し、可変長符号化器４に送出する。可変長
符号化器４に予測誤差抽出回路３からの出力信号の値を
その発生確率に応じて符号化する。表２は予測誤差抽出
回路４からの信号の値とその発生確率および各信号値と
対応させる可変長符号の一例を示す。
表 ２
受信側は、予測誤差積分回路１３が、可変長復号化器１
０と一時メモリ１１との間に挿入されていることを除き
第１図の実施例と同一である。
０と一時メモリ１１との間に挿入されていることを除き
第１図の実施例と同一である。
予測誤差抽出回路３は、例えば第６図に示すように、引
算回路３−１と加算回路３−２と１フレーム遅延回路３
−３とから構成される。
算回路３−１と加算回路３−２と１フレーム遅延回路３
−３とから構成される。
予測誤差積分回路は、例えば第７図に示すように、加算
回路１３−１と１フレーム遅延回路１３−２とから構成
される。
回路１３−１と１フレーム遅延回路１３−２とから構成
される。
以上説明した如く、本発明によれば画像信号の通常の統
計的性質に沿った信号に対しては前述したように明らか
な伝送信号の削減効果があり、またその削減により受信
画像の品質が劣化するということは全く無い。
計的性質に沿った信号に対しては前述したように明らか
な伝送信号の削減効果があり、またその削減により受信
画像の品質が劣化するということは全く無い。
第１図は本発明の実施例を示すブロック図、第２図は第
１図の実施例に用いられる可変長符号化器の１例を示す
プロ、り図、第３図は第１図の実施例に用いられる送信
バッファメモリの１例を示すプロ、り図、第４図は第１
図の実施例に用いられる可変長復号化器の１例を示すブ
ロック図、第５図は本発明の他の実施例を示すブロック
図、第６図は第５図の実施例に用いられる予測誤差抽出
回路の１例を示すブロック図、第７図は第５図の実施例
に用いられる予測誤差積分回路の１例を示すブロック図
である。 特許出願人 −際電信電話株式会社 代理人 大塚 学 外１名 ３８２ η ｌ 図 第 ２ 閉 め ３ 閲 壺 ４ 関 第 ６ 図 も ７ 関
１図の実施例に用いられる可変長符号化器の１例を示す
プロ、り図、第３図は第１図の実施例に用いられる送信
バッファメモリの１例を示すプロ、り図、第４図は第１
図の実施例に用いられる可変長復号化器の１例を示すブ
ロック図、第５図は本発明の他の実施例を示すブロック
図、第６図は第５図の実施例に用いられる予測誤差抽出
回路の１例を示すブロック図、第７図は第５図の実施例
に用いられる予測誤差積分回路の１例を示すブロック図
である。 特許出願人 −際電信電話株式会社 代理人 大塚 学 外１名 ３８２ η ｌ 図 第 ２ 閉 め ３ 閲 壺 ４ 関 第 ６ 図 も ７ 関
Claims (2)
- （１）信号を蓄積する記憶手段と、該記憶手段からの読
み出し信号がとり得る各信号値の発生確率に対応してそ
の発生確率の高いものに少ないと、）の符号を割ｇ当て
るようにそれぞれ予め定められた複数の可変長符号のう
ちの一つを前記読み出し信号が前記記憶手段から読み出
されたときにその信号値に従って件数する可変長符号化
手段と、前記の作成された可変長符号を一時蓄積して前
記記憶手段からの読み出し速度よりも低い一定のビット
レートに変換して伝送路に送出するとともにその一時蓄
積の量が適正になるように前記記憶手段及び前記可変長
符号化手段を制御する・（ラフアメモリ手段とを備えた
信号速度低減符号化方式。 - （２）信号を蓄積する記憶手段と、該記憶手段からの読
み出し信号がとり得る各信号値とその予測信号との誤差
をとり出す誤差抽出手段と、前記誤差の発生確率に対応
してその発生確率の高いものに少ないビットの符号を割
り当てるようにそれぞれ予め定められた複数の可変長符
号のうちの一つを前記誤差が前記誤差抽出手段からとり
出されたときにその誤差に従って作成する可変長符号化
手段と、前記の作成された可変長符号を一時蓄積して前
記記憶手段からの読み出し速度よりも低い一定のビット
レートに変換して伝送路に送出するとともにその一時蓄
積の量が適正になるように前記記憶手段、前記誤差抽出
手段及び前記可変長符号化手段を制御するバッファメモ
リ手段とを備えた信号速度低減符号化方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14550281A JPS5847369A (ja) | 1981-09-17 | 1981-09-17 | 信号速度低減符号化方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14550281A JPS5847369A (ja) | 1981-09-17 | 1981-09-17 | 信号速度低減符号化方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5847369A true JPS5847369A (ja) | 1983-03-19 |
Family
ID=15386736
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14550281A Pending JPS5847369A (ja) | 1981-09-17 | 1981-09-17 | 信号速度低減符号化方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5847369A (ja) |
-
1981
- 1981-09-17 JP JP14550281A patent/JPS5847369A/ja active Pending
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