JPS5836005A - 増幅回路 - Google Patents

増幅回路

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Publication number
JPS5836005A
JPS5836005A JP56134000A JP13400081A JPS5836005A JP S5836005 A JPS5836005 A JP S5836005A JP 56134000 A JP56134000 A JP 56134000A JP 13400081 A JP13400081 A JP 13400081A JP S5836005 A JPS5836005 A JP S5836005A
Authority
JP
Japan
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output
amplifier
impedance converter
circuit
terminal
Prior art date
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Pending
Application number
JP56134000A
Other languages
English (en)
Inventor
Tetsuo Sato
哲雄 佐藤
Yasuo Kominami
小南　靖雄
Yoshiyuki Takizawa
滝沢　善行
Akira Namieno
波江野　章
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Pioneer Corp
Original Assignee
Hitachi Ltd
Pioneer Corp
Pioneer Electronic Corp
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Publication date
Application filed by Hitachi Ltd, Pioneer Corp, Pioneer Electronic Corp filed Critical Hitachi Ltd
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Priority to KR8203193A priority patent/KR900002089B1/ko
Priority to DE19823228785 priority patent/DE3228785A1/de
Priority to GB08223824A priority patent/GB2105542B/en
Priority to US06/409,051 priority patent/US4510458A/en
Publication of JPS5836005A publication Critical patent/JPS5836005A/ja
Pending legal-status Critical Current

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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03F—AMPLIFIERS
    • H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/45—Differential amplifiers
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03F—AMPLIFIERS
    • H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
    • H03F1/32—Modifications of amplifiers to reduce non-linear distortion
    • H03F1/3223—Modifications of amplifiers to reduce non-linear distortion using feed-forward

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Amplifiers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、各種電子機器に使用されろ増幅回路に関する
。
負帰還型の増幅回路には多種類あるが、そのうち演算増
幅器（以下ＯＰアンプという）な用いた増幅回路につい
ては一出力しか得られない。
ＯＰアンプの非反転入力端子に入力信号を印加し、出力
端子と反転入力端子との間に第１帰還抵抗を接続し、反
転入力端子と接地電位との間に第２帰還抵抗を接続する
ことによって、第１と第２の帰還抵抗圧よってＯＰアン
プの閉ループ電圧利得を設定するとともに、第１と第２
の帰還抵抗との共通接続点から高入力インピーダンス・
低出力インピーダンスのインピーダンス変換器（例えば
エミッタフォロワ回路）を介して他の出力（ｌ！号を得
る第１の方式、さらに非反転入力端子からインピーダン
ス変換器を介し℃他の出力信号を得る第２の方式が本発
明に先立って本発明者等によって検討された。
しかしながら、本発明者等の検討により上記両方式のい
ずれにおいてもエミッタツメロワ回路の如きインピーダ
ンス変換器を介して得られる他の出力信号は歪が大ぎい
ことが明らかとされた。
従って、本発明の目的とするところは低歪率の二つの出
力信号を得ろことができろ増幅回路を提供することにあ
る。
本発明の基本的特９に従っり施幅回路によればインピー
ダンス変換器の入力−出力経路はＯＰアンプの出力端子
と反転入力端子との間の負帰還ループ内に配置されてい
る。
底圧本発明の第１の実施例を第１図に付き説明する。
ＯＰアンプ１の非反転入力端子十には入力信号■ｉｎが
供給され、出力端子からは第１の出力信号■　　　が得
られる。また、出力端子には帰還抵ＯＵＴ＋ 抗ｒｔ、　、　Ｒ，によって構成された負帰還回路２が
接続されている。そして、負帰還回路２の出力端子には
、インピーダンス変換器３０入力端子が接続されている
。また、エミッタフォロワ回路形態のインピーダンス変
換器３の出力端子からは、第２の出力信号■。ＩＪＴ２
が得られると共に、この出力信号がＯＰアンプ１の反転
入力端子−に９帰還されるようＶＣなされている。
従って、前述の如（構成された増幅回路においては、Ｏ
Ｐアンプ１の出力端子から第１の出力信号■。ＵＴＩが
得られ、インピーダンス変換器３の出力端子から第２の
出力信号Ｖ。ＵＴ２が得られろ。（−かも、第１の出力
信号■。ＵＴＩがインピーダンス変換器３を介して負帰
還されているので、第２の出力信号■。ＵＴ２の歪が低
減される。
次に本発明の第２の実施例を第２図に付き説明する。な
お、本実施例においては、前記ＯＰアンプ１及びエミッ
タフォロワ回路形態のインピーダンス変換器３が集積回
路化（ＩＣ化）され、分圧回ｊ１２ｓ２がＩＣ外に外付
けになされている。このような零正回路２の外付けには
次のような理由がある。
即ち、抵抗Ｒ，、Ｒ，がＩＣ内部の牛導体拡散抵抗で構
成された場合ＶＣは、第１の出力信号■。ＵＴＩの変動
でＩＣ内のｐ　Ｎ接合の空乏層が変化する。
示の如く設けろことにより、低歪率の第２の出力信号が
得られる。
前述の如く構成された増幅回路において、１番端子から
入力信号■ｌｎがイ１（給されると、２番端子から第１
の出力信号■。ＵＴＩが得られ、５番端子から低歪率の
第２の出力信号■。ＵＴ２が得られる。
第３図は、第２図に示した本発明の第２の実施例を詳細
に示しだ回路図である。
定電流源Ｃ８，、ＰＮＰ差動トランジスタＱ　＋　ｐＱ
ｔ＋抵抗Ｒ，、Ｒ，、、Ｒ，を有する初段差動増幅回路
と、トランジスタＱ８．定電流負荷Ｃ８，。
ダイオードＤ、、Ｄ、、位相補償容量Ｃ１を有するＡ級
駆動増幅回路と、出力トランジスタＱ４゜Ｑｌｌを有す
るプツシ−プル出力回路によってＯＰアンプｌが構成さ
れている。
特ｆ、インピーダンス変換器３はＮＰＮトランジスタＱ
？　、Ｑｇ　、ＰＮＰ　）ランジスタＱａ　ｊＱ、ｏ。
定電、流源Ｃ８３，Ｃ８４によって構成されている。
従って、トランジスタＱ６＝　Ｑａのベース・エミッタ
間電圧の温度変化は互いに相殺され、トランジスタＱ　
７　ｐ　Ｑ　ｏのベース・エミッタ間電圧の温度変化は
互いに相殺されるので、インピーダンス変換器３の出力
ＩＩ流電圧の温度変化による変動が防止されることがで
きる。
さらに、出力信号■。ＵＴ□の正の半サイクルはインバ
ーティドダーリントン接続されたＰＮＰトランジスタＱ
６とＮＰＮ）ランジスタＱ８とが増幅動作を実行し一逆
に負の牛サイクルはインバーティドダーリントン接続さ
れｒ、＝ＮＰＮ）ランジスタＱ、とＰＮＰトランジスタ
ＱＯとが増幅動作を実行するため、ＮＰＮ出力トランジ
スタＱ、の電流増幅率とＰＮＰ出力トランジスタＱ０の
ｔ光増幅率との差に基づ（歪を低減することができた。
マタ、インピーダンス変換器３はプッシュプル動作を行
う出力トランジスタＱｓ　、Ｑｏを有するため出力電圧
Ｖ。ＵＴ□の発生に際して負荷駆動能力が向上した。
さらに、ｌ・ランジスタＱ、　、　Ｑ８およびＱ７　、
　Ｑ。
がそれぞわインバーティド・ダーリントン接続されてい
るため、インピーダンス変換器３の高入力インピーダン
ス特性がさらに向上した。
以」：説明したように、本発明を適用した増幅回路によ
れば一個の増幅回路で低歪率の二つの出力信号が得られ
るので、オーディオ機器等に使用する際に便利である。
しかも、回路構成が極めて簡単であることから、低コス
トの生産が可能になる。
【図面の簡単な説明】
図面は本発明の実施例な示すものであって、第１図は第
１の実施例を示す回路図、第２図は第２の実施例を示す
回路図、第３図は第２の実施例を詳細に示す回路図であ
る。 なお、図面に用いられる符号において、１・・・ＯＰア
ンプ、２・・・負＃ｉ）還回路、３・・・インピーダン
ス変換器、ＩＣ・・・集積回路である。 代理人　弁理士　　薄　１）利　室 第１図 畠　２　函 ｒ

Claims (1)

  1. 【特許請求の範囲】 １、演算増幅器（１）と負帰還回路（２）とを具備し−
    Ｃなり、上記演算増幅器（１）の非反転入力端子（＋に
    人力信号（Ｖｉｎ）を印加せしめることによって上記演
    算増幅器（１）の出力端子より第１の出力信号（■ｏＵ
    Ｔ１）を得るように構成され、上開第１の出力信号（■
    ＱＵＴ＋）か上記負帰還回路（２）を介して上記演算増
    幅器（１）の反転入力端子（−）に負帰還されろ如（構
    成された増幅回路において、インピーダンス変換器（３
    ）をさらに具備し′″Ｃなり、上記負帰還回路（２）の
    負帰還信号がインピーダンス変換器（３）を介して上記
    演算増幅器（１）の上記反転入力端子（−）に負帰還さ
    れる如（構成され、上記インピーダンス変換器（３）の
    出力端子より第２の出力信号（ＶＯＵＴ２　）を得るよ
    うに構成されたことを特徴とする増幅回路。 ２、上記増幅回路（１）と上記インピーダンス変換器（
    ３）とが集積回路内ＶＣ，構成され、」＝配置帰還回路
    （２）が上記集積回路外に設けられたことを特徴とする
    特許請求の範囲第１項記載の増幅回路。
JP56134000A 1981-08-28 1981-08-28 増幅回路 Pending JPS5836005A (ja)

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GB (1) GB2105542B (ja)

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GB2105542B (en) 1985-08-21
KR840001014A (ko) 1984-03-26
US4510458A (en) 1985-04-09
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