JPS5834184U - 表示回路 - Google Patents
表示回路Info
- Publication number
- JPS5834184U JPS5834184U JP12905881U JP12905881U JPS5834184U JP S5834184 U JPS5834184 U JP S5834184U JP 12905881 U JP12905881 U JP 12905881U JP 12905881 U JP12905881 U JP 12905881U JP S5834184 U JPS5834184 U JP S5834184U
- Authority
- JP
- Japan
- Prior art keywords
- display
- signal
- display information
- output port
- display mode
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Digital Computer Display Output (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案による表示回路の一実施徊を示す回路図
、第２図ａ”ｍおよび第３図ａ〜ｎは第１図に示す回路
の各部動作波形図である。 １・・・・・・波形整形回路、２・・・・・・中央演算
装置（ＣＰＵ）、３ａ、 ３ｂ・・・・・・シフトレ
ジスタ、４・・・・・・バーグラフ表示装置。 第２図 第３図
、第２図ａ”ｍおよび第３図ａ〜ｎは第１図に示す回路
の各部動作波形図である。 １・・・・・・波形整形回路、２・・・・・・中央演算
装置（ＣＰＵ）、３ａ、 ３ｂ・・・・・・シフトレ
ジスタ、４・・・・・・バーグラフ表示装置。 第２図 第３図
Claims (1)
- 第１出力ポートからシリアルパルス列のパルス数によっ
て表わされる表示情報を予め定められた更新周期に対応
して発生し、かつ前記表示情報の送出される直前に第２
出力ポートからクリア信号を発生するとともに、第３出
力ポートから表示モード制御信号を発生する中央演算装
置と、前記クリア信号によってリセットされるとともに
前記表示情報を構成するシリアルパルス列の各パルスに
よって前記表示モード制御信号をシフト入力として取り
込んで順次シフトするシフトレジスタ部と、−前記シフ
トレジスタ部の各出力によってそれぞれ駆動される表示
セグメントが複数個並設されたバーグラフ表示装置とを
備え、前記表示モード制御信号はバーグラフ表示モード
に於いては前記表示情報ノ送出期間に於いてすべてアク
ティブレベルとなり、ポイント表示モードに於いては前
記表示情報を構成するシリアルパルス列の第１パルスを
少なくとも含む連続した所定パルス期間のみアク−ティ
プレベルとなる信号によって構成された表示回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12905881U JPS5834184U (ja) | 1981-08-31 | 1981-08-31 | 表示回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12905881U JPS5834184U (ja) | 1981-08-31 | 1981-08-31 | 表示回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5834184U true JPS5834184U (ja) | 1983-03-05 |
| JPS6328466Y2 JPS6328466Y2 (ja) | 1988-08-01 |
Family
ID=29922736
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12905881U Granted JPS5834184U (ja) | 1981-08-31 | 1981-08-31 | 表示回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5834184U (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5476630U (ja) * | 1977-11-10 | 1979-05-31 | ||
| JPS5517436A (en) * | 1978-07-24 | 1980-02-06 | Seiko Epson Corp | Bar graph drive circuit |
-
1981
- 1981-08-31 JP JP12905881U patent/JPS5834184U/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5476630U (ja) * | 1977-11-10 | 1979-05-31 | ||
| JPS5517436A (en) * | 1978-07-24 | 1980-02-06 | Seiko Epson Corp | Bar graph drive circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6328466Y2 (ja) | 1988-08-01 |
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