JPH02113851U - - Google Patents
Info
- Publication number
- JPH02113851U JPH02113851U JP1928289U JP1928289U JPH02113851U JP H02113851 U JPH02113851 U JP H02113851U JP 1928289 U JP1928289 U JP 1928289U JP 1928289 U JP1928289 U JP 1928289U JP H02113851 U JPH02113851 U JP H02113851U
- Authority
- JP
- Japan
- Prior art keywords
- data
- length
- signal
- clocks
- detection circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 11
- 230000000873 masking effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
第１図は本考案に係るシリアルマーク検出回路
の一実施例を示す要部構成図、第２図は動作を説
明するためのタイムチヤート、第３図は光磁気デ
イスクメモリにおけるセクタのフオーマツトの一
例を示す説明図、第４図はセクタマークＳＭのフ
オーマツトを示す説明図、第５図はセクタマーク
ＳＭの検出原理を示す波形図である。 １１，１２，１３……データ長検出回路、１４
……第１のカウンタ、１５……第２のカウンタ、
１６……第３のカウンタ、１７……第４のカウン
タ、１８，１９，３１……ゲート、２０……順序
ゲート回路、３０……マジヨリテイ回路。
の一実施例を示す要部構成図、第２図は動作を説
明するためのタイムチヤート、第３図は光磁気デ
イスクメモリにおけるセクタのフオーマツトの一
例を示す説明図、第４図はセクタマークＳＭのフ
オーマツトを示す説明図、第５図はセクタマーク
ＳＭの検出原理を示す波形図である。 １１，１２，１３……データ長検出回路、１４
……第１のカウンタ、１５……第２のカウンタ、
１６……第３のカウンタ、１７……第４のカウン
タ、１８，１９，３１……ゲート、２０……順序
ゲート回路、３０……マジヨリテイ回路。
Claims (1)
- 【実用新案登録請求の範囲】 ５データクロツクの長さを有する２つのデータ
と、３データクロツクの長さを有する３つのデー
タとが、それぞれ所定の間隔で配列された信号パ
ターンを検出するシリアルマーク検出回路におい
て、 印加される信号の中から５データクロツクの長
さ、３データクロツクの長さおよびデータのない
７データクロツクの長さのデータをそれぞれ検出
する３組のデータ長検出回路と、 前記検出された５データクロツク長の信号によ
りカウント動作を開始し、５データクロツクの発
生間隔に対応したときに同期パルス信号を発生す
る第１のカウンタと、 前記データ長検出回路で検出された３データク
ロツク長の信号によりカウント動作を開始し、所
定のデータクロツクをカウントしたときに同期パ
ルス信号を発生する第２のカウンタと、 前記データ長検出回路で検出された３データク
ロツク長の信号によりカウント動作を開始し、所
定のデータクロツクをカウントしたときに同期パ
ルス信号を発生する第３のカウンタと、 前記データ長検出回路で検出された３データク
ロツク長の信号によりカウント動作を開始し、所
定のデータクロツクをカウントしたときに同期パ
ルス信号を発生する第４のカウンタと、 前記第３のカウンタへの３データクロツク入力
を制御するゲートと、 前記第４のカウンタへの３データクロツク入力
を制御するゲートと、 前記データ長検出回路で検出された３データク
ロツクおよび７データクロツク長の信号を受け、
前記第３および第４のカウンタへの３データクロ
ツク入力をマスクするための信号を発生する前記
各ゲートに与える順序ゲート回路と、 前記データ長検出回路の５データクロツク長の
信号と、前記第１ないし第４の各カウンタの出力
とを入力パルス信号として、一定数以上同時にパ
ルス信号が入力されたときに目的とする信号パタ
ーンの検出出力を発生するマジヨリテイ回路 を具備したことを特徴とするシリアルマーク検
出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1928289U JPH02113851U (ja) | 1989-02-21 | 1989-02-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1928289U JPH02113851U (ja) | 1989-02-21 | 1989-02-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02113851U true JPH02113851U (ja) | 1990-09-12 |
Family
ID=31234654
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1928289U Pending JPH02113851U (ja) | 1989-02-21 | 1989-02-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02113851U (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005302292A (ja) * | 2005-06-20 | 2005-10-27 | Fujitsu Ltd | サーボ信号検出方法 |
-
1989
- 1989-02-21 JP JP1928289U patent/JPH02113851U/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005302292A (ja) * | 2005-06-20 | 2005-10-27 | Fujitsu Ltd | サーボ信号検出方法 |
| JP4496367B2 (ja) * | 2005-06-20 | 2010-07-07 | 富士通マイクロエレクトロニクス株式会社 | サーボ信号検出方法 |
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