JPH0265261U - - Google Patents

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JPH0265261U
JPH0265261U JP14409188U JP14409188U JPH0265261U JP H0265261 U JPH0265261 U JP H0265261U JP 14409188 U JP14409188 U JP 14409188U JP 14409188 U JP14409188 U JP 14409188U JP H0265261 U JPH0265261 U JP H0265261U
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JP
Japan
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signal
test
circuit
delay
outputs
Prior art date
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JP14409188U
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Description

【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図は第1図に示す実施例の動作を説明するた
めのタイミングチヤート、第3図は従来の磁気デ
イスク媒体検査装置のテストシーケンス発生回路
のブロツク図、第4図は第3図に示す従来の回路
の動作を説明するためのタイミングチヤート、第
5図は第3図に示す従来のテストシーケンス回路
での磁気デイスク媒体からの読出信号の波形図で
ある。 1……ライトタイミング発生回路、2……ライ
トデイレー回路、3……OR回路、4……テスト
タイミング発生回路、5……テストデイレー回路
、6……AND回路、a……スタート信号、b…
…ライトタイミング信号、c……ライトデイレー
信号、d……ライトゲート信号、e……テストタ
イミング信号、f……テストデイレー信号、g…
…テストゲート信号。

Claims (1)

    【実用新案登録請求の範囲】
  1. スタート信号に同期してパルス巾が磁気デイス
    ク媒体の1回転の時間であるライトタイミング信
    号を出力するライトタイミング発生回路と、該ラ
    イトタイミング信号を入力し、磁気デイスク媒体
    に基準信号を書込むための定電流回路の応答遅れ
    の時間だけ遅らせてライトデイレー信号を出力す
    るライトデイレー回路と、該ライトデイレー信号
    と前記ライトタイミング信号の論理和をとつてラ
    イトゲート信号を出力するOR回路と、該ライト
    ゲート信号の立上がりに同期してパルス巾が前記
    磁気デイスク媒体の1回転の時間であるテストタ
    イミング信号を出力するテストタイミング発生回
    路と、該テストタイミング信号を入力し、前記基
    準信号の書込みの終了で生ずる信号の乱れが減少
    するまでの時間だけ遅れたテストデイレー信号を
    出力するテストデイレー回路と、該テストデイレ
    ー信号と前記テストタイミング信号の論理積をと
    つてテストゲート信号を出力するAND回路とを
    含むことを特徴とする磁気デイスク媒体検査装置
    のテストシーケンス発生回路。
JP14409188U 1988-11-02 1988-11-02 Pending JPH0265261U (ja)

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JP14409188U JPH0265261U (ja) 1988-11-02 1988-11-02

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JP14409188U JPH0265261U (ja) 1988-11-02 1988-11-02

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JPH0265261U true JPH0265261U (ja) 1990-05-16

Family

ID=31411488

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14409188U Pending JPH0265261U (ja) 1988-11-02 1988-11-02

Country Status (1)

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JP (1) JPH0265261U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04345972A (ja) * 1991-05-24 1992-12-01 Nec Corp 磁気ディスク検査装置

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH04345972A (ja) * 1991-05-24 1992-12-01 Nec Corp 磁気ディスク検査装置

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