JPS58192338A - 半導体装置及びその製造方法 - Google Patents

半導体装置及びその製造方法

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JPS58192338A
JPS58192338A JP57075353A JP7535382A JPS58192338A JP S58192338 A JPS58192338 A JP S58192338A JP 57075353 A JP57075353 A JP 57075353A JP 7535382 A JP7535382 A JP 7535382A JP S58192338 A JPS58192338 A JP S58192338A
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JP
Japan
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film
pad
etching
sio2
etching rate
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JP57075353A
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English (en)
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Shigeru Shimada
茂 島田
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Hitachi Ltd
Original Assignee
Hitachi Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は半導体装置及びその製造方法に関するものであ
る。
ホットエレクトロ/によるvthシフト(シきい値電圧
の変動)はパッジページ日ノ膜に依存性がある。例えば
、プラスチック用バッシベーシヲン膜としてプラズマ析
出法による窒化シリコン膜を使用する場合、上記vth
シフトは大きくなり、望ましくない。このため、本発明
者は、上記窒化シリコン膜に代わるパッジページ1ノ膜
としてプラズマ析出法による酸化シリコン膜(以下、P
−8iQと称する)を検討した。しかし、このP−8i
QはVthシフトが小さくて特性的には良好であるが、
そのエツチング速度又は時間、及びその被着時の膜厚に
ばらつきがあり、しかもウェットエツチングを行なうと
下地のポンディングパッド(アルミニウム)がヒaツク
部分(パッド面に存在する小突起)からエツチングされ
て小孔が生じ、この小孔から下地のリンガラス膜のリン
が上方へ溶出し、パッド腐食を引起す原因となることが
判明した。
従って、本発明の目的は、Vthシフトを小さくすると
共に、パッジベージ璽ン膜を効率良く安定に加工し、し
かも下地のパッドを有効に保護することKある。
以下、本発明の実施例を図面について詳細に説明する。
本実施例によるパッド構造及びその作成方法をその作成
プロセスに沿って説明すると、まず第1図のように、半
導体基板lの一生面に設けたフィールドS i Q、膜
2上にリンガ2ス膜3を形成し、更に全面に真空蒸着技
術で付着したアルミニウムをフォトエツチングでパター
ニングしてアルミニウムのポンディングパッド4(及び
その配線)を形成する。
次いで第2図のように、アルミニウムパッド40表面を
特に陽極酸化技術で酸化して薄い酸化アルミニウム被膜
5を形成する。勿論、この被膜はパッド4に連なるアル
ミニウム配線の表面にも形成される。前述の陽極酸化ア
ルミニウム被膜は、フォトエツチング前に、アルミニウ
ム全面に形成してもよい。
次いで第3図のように、プラズマ析出法によりP−8i
O膜6を全面に成長させ、しかる後、第4図のように1
フオトレジスト7をマスクとしてP−8iO膜6をエツ
チングし、ボンディング領域8を形成する。この場合、
パッド4表面の酸化物411115はP−8iQ膜6よ
り充分にエツチング速度が小さいために、P−8iOエ
ツチング時にパッド4を保護する働きがある。従って、
P−8iOエツチングにウェットエツチングを適用して
も、P−8iO膜6のみな選択的にエツチングできるこ
とになり、下地のパッド4は既述した如くにエクチされ
ることはなく、パッドの損傷及びリン溶出によるパッド
腐食が生じることはない。しかも、P−8iO膜6の成
長時の膜厚にばらつきがあったり、そのエツチング速度
にばらつきが生じても、従来困難であったウエットエッ
チングが可能となり、安定にP−8iQを加工できる。
ウェットエツチングによりて、ボンディング領域80周
辺段差が緩やかとなり、後記のワイヤポンディフグを行
ない易くなる。
次いで51g5図のように、ボンディング領域8に露出
している酸化物11115のみをエツチング(エッチャ
ントはスルファミン酸でよい)し、パッド4の表面を露
出させる。
次いで第6図のように、ボンディングワイヤ9をボンデ
ィング領域8のパッド4上に圧着せしめ。
ワイヤポンディフグを行なう。
なお、本実施例では、上記した顕著な結果が得られるの
は、酸化物被膜5の耐エツチング性(ストッパ作用)に
よるためである。この被H5によって、P−8iQ膜6
は膜厚にばらつきがあってもオーバーエツチングするこ
とが可能であり、従って安定で効率良い加工が実現でき
、パッド保護も同時に図ることができる。また、ファイ
ナルパッジベージ廖ン膜としてP−8iQ を用いてい
るので、V□シフトによる特性劣化を防止し得ることは
勿論である。
なお、上記の実施例において、酸化物波1m!5はパッ
ド4の上面にのみ存在していてもよい。また、他の処理
法によって、パッド40表面には酸化アルミニウム以外
の同様の性質を有する表面被膜を形成することができる
【図面の簡単な説明】
第1図、第2図、第3図、第4図、第5図及び第6図は
本発明の実施例による構造をその製造プロセス願に説明
するための各断面図でアル。 4・・・アルミニウムパッド、5・・・酸化物被膜、6
・・・P−8io fls  s・・・ボンディング領
域、9・・・ボンディングワイヤ。 代理人 弁理士  薄 1)利 幸・ 第1図 J 第3図 第  4 図 第  5  図 第  6  図

Claims (1)

  1. 【特許請求の範囲】 16  ボンディング領域を残してポンディングパッド
    がパッジベージ曹y J[Kよって被覆されている半導
    体装置において、前記ボンディング領域周辺の前記ポン
    ディングパッドの表面に、前記パフシベーシ謬ン膜より
    も充分にエツチング速度の小さい被膜が形成されている
    ことを特徴とする半導体装置。 2、半導体基体上にポンディングパッドを形成すル工程
    と;このポンディングパッドの少なくとも上面に、その
    上に被着するパッジページ1ン膜よりも充分にエツチン
    グ速度の小さい豪農を形成する工程と;この被膜上を含
    む全面に前記パッジページ1ン膜を被着する工程と;こ
    のパッシペーシーン膜のうちボンディング領域の部分を
    エツチングで除去する工程と;この除去部分における前
    記被膜の露出部分を除去する工程とを有することを特徴
    とする半導体装置の製造方法。
JP57075353A 1982-05-07 1982-05-07 半導体装置及びその製造方法 Pending JPS58192338A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7919864B2 (en) 2003-10-13 2011-04-05 Stmicroelectronics S.A. Forming of the last metallization level of an integrated circuit

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7919864B2 (en) 2003-10-13 2011-04-05 Stmicroelectronics S.A. Forming of the last metallization level of an integrated circuit

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