JPS58176951A - 半導体素子のはんだ電極形成方法 - Google Patents
半導体素子のはんだ電極形成方法Info
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- H01L2924/10157—Shape being other than a cuboid at the active surface
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
不発8Aは、半導体系子へはんた電憔倉形成格せる方法
に係り、特に牛専捧ウェハの状態で、仮督灯したはんだ
箔と半導体ウェハ會し−サ光線等で溶融切町して、ぺし
′ット金^′wL億膜′\はんた電憔倉一括形成さぜゐ
方法に関するものである。
に係り、特に牛専捧ウェハの状態で、仮督灯したはんだ
箔と半導体ウェハ會し−サ光線等で溶融切町して、ぺし
′ット金^′wL億膜′\はんた電憔倉一括形成さぜゐ
方法に関するものである。
従米半導体木子へはんた11/L極を形成ちぜる方法と
して、第1図(a)に示すように、表1tI保繰膜2a
。
して、第1図(a)に示すように、表1tI保繰膜2a
。
2b、で複数個のペレット形状に分離し金属電極膜3を
形成させた半纏体ウェハ1を、(b)に示すように7ラ
ツクスを用いて#Mはんだ浴櫓4に浸漬して引き上り、
(C)に示すようにはんだ電極5a、5b倉形成させて
いた。
形成させた半纏体ウェハ1を、(b)に示すように7ラ
ツクスを用いて#Mはんだ浴櫓4に浸漬して引き上り、
(C)に示すようにはんだ電極5a、5b倉形成させて
いた。
しかしながら従来方法では、半導体ウェハ1fr11i
I+温のはんだ険に浸漬するため割nが発生したり、フ
ランクス倉便用yるので洗浄工程が不可欠でかつ11雑
なため歩笛りが悪く、また浸漬方法で倚るはんだ電懐5
a、5bは、厚さや形状が不均一であることから第2図
(a)の如く組立てる時にペレット6が不安定になった
り、はんだ電極5a、5bを溶融して導電リード7に接
合すると、(b)の如く類いて接合さt′L舟性歪性不
良党するなと多くの問題があった。
I+温のはんだ険に浸漬するため割nが発生したり、フ
ランクス倉便用yるので洗浄工程が不可欠でかつ11雑
なため歩笛りが悪く、また浸漬方法で倚るはんだ電懐5
a、5bは、厚さや形状が不均一であることから第2図
(a)の如く組立てる時にペレット6が不安定になった
り、はんだ電極5a、5bを溶融して導電リード7に接
合すると、(b)の如く類いて接合さt′L舟性歪性不
良党するなと多くの問題があった。
本発明の目ロジは、フランクス會用いないで牛4体ウェ
ハ両囲の抜叙1−のペレット形状の金属電極膜に、均一
でかつ所定量のはんた電極’に一括形成させ、安価でか
つ尚夕餉りの牛4S+累子會得心ことが出来るはんだ電
極形成方法全提供することにある。
ハ両囲の抜叙1−のペレット形状の金属電極膜に、均一
でかつ所定量のはんた電極’に一括形成させ、安価でか
つ尚夕餉りの牛4S+累子會得心ことが出来るはんだ電
極形成方法全提供することにある。
本発明は、フラックスを用いないで半導体ウェハにはん
だ電極を形成させる方法として、還元性雰囲気中で半導
体ウェハに所定量のはんだ箔を仮付けし、レーザ光線の
熱工不ルキーで溶融切断して半導体ウェハの状態で複数
個のペレット形状の金属電&膜に均一でかつ所定量のは
んだ電極e 一括形成させることを%黴とするものであ
る。半導体ウェハにはんだ箔を仮付けする状態は、はん
だ箔の原形を保てる限界までの温度に加熱することでる
る。
だ電極を形成させる方法として、還元性雰囲気中で半導
体ウェハに所定量のはんだ箔を仮付けし、レーザ光線の
熱工不ルキーで溶融切断して半導体ウェハの状態で複数
個のペレット形状の金属電&膜に均一でかつ所定量のは
んだ電極e 一括形成させることを%黴とするものであ
る。半導体ウェハにはんだ箔を仮付けする状態は、はん
だ箔の原形を保てる限界までの温度に加熱することでる
る。
以下、本発明の一実施例を第3図〜第6図により説明す
る。
る。
第3図は、本発明ではんだ電極を形成する半導体ウェハ
の構造図で、(匈は半導体ウェハの平面図、(b)は縦
断面図でるる。
の構造図で、(匈は半導体ウェハの平面図、(b)は縦
断面図でるる。
半導体ウェハ1の表層11oは、表向保讃膜2g、2b
で複数個のペレット形状に分離し表面に金属電極膜3を
形成させである。はんだ電極を形成させる部分は金属電
極M3ii+でめり、表面保賎膜2a、2bFiはんだ
が付かないガラス材、8+O*mlを用いている。
で複数個のペレット形状に分離し表面に金属電極膜3を
形成させである。はんだ電極を形成させる部分は金属電
極M3ii+でめり、表面保賎膜2a、2bFiはんだ
が付かないガラス材、8+O*mlを用いている。
第4凶は、半導体ウェハにはんだ電極を形成させる方法
の構成図である− あらかじめガラス、5I02膜2 a 、 2 b テ
llffl(mのペレット形状に分離した表向に金^電
極膜3例えばN I、 Cr N+ ’Ag JI
I!を有する半導体ウェハの上下に、はんだ箔8(例え
ばPb−5−8n−1,596Agはんだ)、はんだ箔
8を半導体ウェハlの金属を極膜3に密層が出来かつ半
導体ウェハ1のそりを平担に修正するための突起9at
−有し次セラミック治具9の唄に塔載させ、さらに上部
より半導体ウェハのそり修正が可能な荷重板10を載せ
、還元性雰囲気中、例えば水素カスt′流し込んだ雰囲
気中で、はんだ箔8の原形を保てる限界までの温度(例
えf″iPb −5% Sn −1,5SAgはんだの
固相温1i296C)に加熱して金属電極膜3に仮付け
してほんだ電憔會固定させる。
の構成図である− あらかじめガラス、5I02膜2 a 、 2 b テ
llffl(mのペレット形状に分離した表向に金^電
極膜3例えばN I、 Cr N+ ’Ag JI
I!を有する半導体ウェハの上下に、はんだ箔8(例え
ばPb−5−8n−1,596Agはんだ)、はんだ箔
8を半導体ウェハlの金属を極膜3に密層が出来かつ半
導体ウェハ1のそりを平担に修正するための突起9at
−有し次セラミック治具9の唄に塔載させ、さらに上部
より半導体ウェハのそり修正が可能な荷重板10を載せ
、還元性雰囲気中、例えば水素カスt′流し込んだ雰囲
気中で、はんだ箔8の原形を保てる限界までの温度(例
えf″iPb −5% Sn −1,5SAgはんだの
固相温1i296C)に加熱して金属電極膜3に仮付け
してほんだ電憔會固定させる。
第5図は、第4図の方法で半導体ウェハ1に仮付は固定
したはんだ箔8と半導体ウニノ・1をペレット形状に分
割する方法すなわち半導体素子のはんだ電&を形成させ
る方法の説明図である。
したはんだ箔8と半導体ウニノ・1をペレット形状に分
割する方法すなわち半導体素子のはんだ電&を形成させ
る方法の説明図である。
半導体ウェハ1のペレット形状表面の金属電極膜3に仮
付は固定したはんだ箔8を、レーザ光線11等の熱エネ
ルギーで、まず半導体ウニノS1の上下側のはんだ箔8
と8+O@膜2bを溶融切断し、ついで上側のはんだ箔
8とガラス材2とを1半導体ウェハ1の一部までの切込
み121.12bが入る程度に溶融切断することにより
、半導体ウェハの状態で、ペレット形状の金属電極膜3
@に均一厚さで一定量のはんだ電極を一括形成させるこ
とが出来、さらに半導体ウェハ1のレーザ光線での切込
み12m、12bに沿って分割すると、はんだ電&5a
、5b を形成させた半導体素子が得ら扛る。
付は固定したはんだ箔8を、レーザ光線11等の熱エネ
ルギーで、まず半導体ウニノS1の上下側のはんだ箔8
と8+O@膜2bを溶融切断し、ついで上側のはんだ箔
8とガラス材2とを1半導体ウェハ1の一部までの切込
み121.12bが入る程度に溶融切断することにより
、半導体ウェハの状態で、ペレット形状の金属電極膜3
@に均一厚さで一定量のはんだ電極を一括形成させるこ
とが出来、さらに半導体ウェハ1のレーザ光線での切込
み12m、12bに沿って分割すると、はんだ電&5a
、5b を形成させた半導体素子が得ら扛る。
また、第6図(a)に示すように、半導体ウェハ1に仮
付は固定したはんだ箔8のみをあらかじめレーザ″/l
、線で溶融切断し、水素カス雰囲気中で溶融分離させて
から(b)に示すように半導体ウェハ1をレーザ光線で
更に溶融切断することによっても同じ卑さで一定量のは
んだ電極5a、5t)t”、半導体素子に形成させるこ
とが出来る。
付は固定したはんだ箔8のみをあらかじめレーザ″/l
、線で溶融切断し、水素カス雰囲気中で溶融分離させて
から(b)に示すように半導体ウェハ1をレーザ光線で
更に溶融切断することによっても同じ卑さで一定量のは
んだ電極5a、5t)t”、半導体素子に形成させるこ
とが出来る。
本発明に1扛ば、フラックスを用いないので複雑なフシ
ックス洗浄工程が不必要となり、また半導体ウェハのは
んだ浴浸漬での割nもなく、半導体ウェハの状態でペレ
ット形状の金S電極膜に、均一厚さでかう一定量のはん
だ電極を一括形成することが出来、促って安価に高歩留
りの半尋体累子tS易に得ることが出来、しいては半導
体素子組立時の傾き不良も発生せず、さらに高歩wυで
信頼性の^い半導体装置が得らする。
ックス洗浄工程が不必要となり、また半導体ウェハのは
んだ浴浸漬での割nもなく、半導体ウェハの状態でペレ
ット形状の金S電極膜に、均一厚さでかう一定量のはん
だ電極を一括形成することが出来、促って安価に高歩留
りの半尋体累子tS易に得ることが出来、しいては半導
体素子組立時の傾き不良も発生せず、さらに高歩wυで
信頼性の^い半導体装置が得らする。
第1図tag米法を示しており(a)は半導体ウェハの
部分縦1iIT1図、(b)fiはんた浴授漬縦断向図
、(C)ははんだ′#L極形成恢の半導体ウェハの縦断
囲図、第2図(a)は征米伝によって得たペレットの半
24俸菓子組立前の縦断面図、第2図(b)は組立後の
縦−11図、第3図本発明で用いる半導体ウェー・倉示
しており(a)は半導体ウェハの部分面図、(b)は半
導体ウェハの部分縦断開図、第4図は本発明の一工程を
示し半導体ウェハ、はんだ箔、突起r8兵、荷ム板金型
ねた状態金示す縦断面図、第5図は本発明の一工程を示
しレーザ光切断状態の縦断面図、第6図は本発明の真な
る実施例を示しており(旬にレーザ光切1air後の半
導体ウェハ縦Wr向図、(b)ははんだ溶P#iA後し
−サ光線切断の鰍断叩図である。 1・・・半導体ウェハ、2a、2b・・・表面保映膜、
3・・・金属電極膜、5a、5b・・・はんた篭憔、6
・・・ペレット、7・・・導電リード、8・・・はんだ
箔、9・・・突起冶具、9a・・・突起、lO・・・荷
重板、11・・、・レーザ光線、12a、12b・ u
−981m部。
部分縦1iIT1図、(b)fiはんた浴授漬縦断向図
、(C)ははんだ′#L極形成恢の半導体ウェハの縦断
囲図、第2図(a)は征米伝によって得たペレットの半
24俸菓子組立前の縦断面図、第2図(b)は組立後の
縦−11図、第3図本発明で用いる半導体ウェー・倉示
しており(a)は半導体ウェハの部分面図、(b)は半
導体ウェハの部分縦断開図、第4図は本発明の一工程を
示し半導体ウェハ、はんだ箔、突起r8兵、荷ム板金型
ねた状態金示す縦断面図、第5図は本発明の一工程を示
しレーザ光切断状態の縦断面図、第6図は本発明の真な
る実施例を示しており(旬にレーザ光切1air後の半
導体ウェハ縦Wr向図、(b)ははんだ溶P#iA後し
−サ光線切断の鰍断叩図である。 1・・・半導体ウェハ、2a、2b・・・表面保映膜、
3・・・金属電極膜、5a、5b・・・はんた篭憔、6
・・・ペレット、7・・・導電リード、8・・・はんだ
箔、9・・・突起冶具、9a・・・突起、lO・・・荷
重板、11・・、・レーザ光線、12a、12b・ u
−981m部。
Claims (1)
- 【特許請求の範囲】 1、片面または肉面が、表l110保護膜で複数個のペ
レット形状に分離さBX表面が金属電極膜からなる半導
体ウェハにはんた電憔會形成さぜる方法において、任意
杉林のはんた箔r片面または両面に塔載し、該はんだ箔
の形状が変形しない温度に加熱して前記半導体ウェハに
仮付は固定し友恢、一方ま几は両方よりレーザ光線等の
熱エネルギー源で該仮付けはんだ箔と両組半導体ウェハ
を溶融切断して、前記半導体ウェハの複数個のペレット
金属電極膜へ均一な厚さと所定量のはんだ電極會一括形
成させることを%黴とする半導体素子のはんだ電極形成
方法。 2.1111記半導体ウェハに仮付けし几はんだ箔のみ
會し−ザ光融等で溶融切断した置、該はんだ箔tfF!
融温屓に加熱し分離させてから半導体ウェハtレーfl
i等の熱エネルギー源で複数イーのペレット形状に溶融
切11rして分割する特許請求範囲の第1項記載の半導
体系子のけんだ電憔形成方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57058153A JPS58176951A (ja) | 1982-04-09 | 1982-04-09 | 半導体素子のはんだ電極形成方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57058153A JPS58176951A (ja) | 1982-04-09 | 1982-04-09 | 半導体素子のはんだ電極形成方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58176951A true JPS58176951A (ja) | 1983-10-17 |
Family
ID=13076041
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57058153A Pending JPS58176951A (ja) | 1982-04-09 | 1982-04-09 | 半導体素子のはんだ電極形成方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58176951A (ja) |
-
1982
- 1982-04-09 JP JP57058153A patent/JPS58176951A/ja active Pending
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