JPS58170011A - 半導体装置用部材の製造方法 - Google Patents

半導体装置用部材の製造方法

Info

Publication number
JPS58170011A
JPS58170011A JP5311582A JP5311582A JPS58170011A JP S58170011 A JPS58170011 A JP S58170011A JP 5311582 A JP5311582 A JP 5311582A JP 5311582 A JP5311582 A JP 5311582A JP S58170011 A JPS58170011 A JP S58170011A
Authority
JP
Japan
Prior art keywords
shutter
wafer
target
atoms
brought
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP5311582A
Other languages
English (en)
Inventor
Minoru Inoue
実 井上
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP5311582A priority Critical patent/JPS58170011A/ja
Publication of JPS58170011A publication Critical patent/JPS58170011A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/0237Materials
    • H01L21/02373Group 14 semiconducting materials
    • H01L21/02381Silicon, silicon germanium, germanium
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02612Formation types
    • H01L21/02617Deposition types
    • H01L21/02631Physical deposition at reduced pressure, e.g. MBE, sputtering, evaporation

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Physics & Mathematics (AREA)
  • Power Engineering (AREA)
  • Chemical & Material Sciences (AREA)
  • Materials Engineering (AREA)
  • Physical Vapour Deposition (AREA)
  • Electrodes Of Semiconductors (AREA)
  • Physical Deposition Of Substances That Are Components Of Semiconductor Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (1)  発明の技術公費 本発明は、スパッタ成長装置を用いた半導体装置用部材
の製造方法に係り、特に、半導体装置用電極・配線、及
び、表面保纒膜郷の形成方法に関する。
(2)技術の背景 スパッタ成長装置とは、低真空の容器内!1フルノンイ
オン(ムr+ )等の電離イオンをアルミニウム(ムl
)、二酸化ケイ素(810,)等のターゲットに衝突さ
せ、誘出したこれらの物質の原子を、上記の真空容器内
に設置された例えば牛導体装蟹用基板(以下ウェーハと
いう。)#の表面に堆積・成長させる装置をいい、スパ
ッタ用ガスの導入口と真空排気口とを持つ真空容器と、
一般に貴電位が与えられ、冷却されているターゲット支
持台と接地電位に保持されているウェーハ支持台と、上
記のウェーハ上に堆積・成長させられる原子の量を制御
するシャッターとよりなる。
(8)  従来技術と問題点 この装置を使用して製造しうる半導体装置用部材の主た
るものは、数ノ々−セントの硅素及び鋼を含むアルミニ
ウム(ムt)、高融点金属、モリゾデンシリサイr (
MO8I、)に代表される高融点金属の硅化物等の金属
材料からなる配線・電極と、二酸化’yイ素(siol
)、窒化ケイ素(81sNa)、酸化窒化ケイg (8
1xOyNt)等の絶縁物からなる層間絶縁或いは表面
保護膜1ある。又、スパッタ用ガスとしてはアルノン(
ムr)ガスが一般に使用され、ターゲツト材は堆積物に
したがって選択される。
tなわち、スノ々ツタ用ガスにアルノン(ムr> ヲ用
いてターゲット支持台に直流負電圧を印加し、アルミニ
ウム(AI)、或いは1 elk 81を含むアル電合
金をターゲツト材に用いれば、アルミニウム(ム/) 
、1%s1を含むアル建合金勢の金属材料を堆積・成長
させることが1きる。一方、−一ゲット支持台に、直流
負電圧にラジオ周波数の交流電圧を重畳した電圧を印加
し、二酸化ケイ素(siol)、窒化ケイ素(811N
4)を−一ダクト材に用いれば、I   二酸化ケイ素
(810,)勢の誘電体材料を堆積・成? 長させることができる。又、酸化窒化ケイ素郷の誘電体
材料を堆積・成長させるには、ムrガスに適娼な分圧の
窪素(N1)ガスを加えた混合ガスをスノ々ツタ用ガス
に、二酸化ケイ素(810,)をターゲツト材に夫々用
いればよい。
そして、その堆積・成長速度は、アルノン(ムr)ガス
の流量、容器の内圧、印加される電圧、供給される電流
の値岬によって決定され、堆積物の種IIIIl!によ
りて各々最適条件がある。従来技術においては、容器内
圧が最適値であり、供給電力が可及的に大きいことが、
大きな堆積・成長速度を実現する要件と考えられている
。しかし、この高い成長速度なつる条件、すなわち、供
給される電力が大きいこと、ターゲツト材をスパックす
るアルノンイオン(ムr + )の量が多いこと、した
がって誘出される原子の量が多いという条件の下におい
てウェーハとその上に堆積されるアルミニウム(^l)
、二酸化ケイ素(flio、)勢との界面近傍のウェー
ハ内に欠陥を誘起することが避け―い欠点となっている
(4)  発明の目的 本発明の目的は、前記スパッタ成長装置を使用して、ウ
ェーハに欠陥を発生することなく牛導体装置用部材を製
造する方法を提供することにある。
(5)  発明の構成 本出願の発明の構成は、ガスの導入口と真空排気口とを
有する真空容器内に設置され、接地電位に保持される基
板支持台と、該支持台に対面してy置されており、冷却
され、負電位が自力[1されうるターゲット支持台と、
前記二つの支持台の間に位置し、面積が制御可能な複数
の開口を有するシャッターとを偏えたスパッタ成長装置
を使用して、前記シャッターを閉じた状mv前記ターゲ
ット支持台に配設されたターゲット表面の汚染を除去す
る工程と前記シャッターに接地電位または正電位を与え
且つ前記シャッターを開けた状態で基板支持台に配設さ
れた被処理基板にスフツタ成長させて前記被処理基板に
膜を形成する工程と、所望の厚さの膜が形成された時点
1前記シヤツターを閉じる工程とからなることにある。
本発明の発明者は、ウェーI・上にこのような欠陥が生
じる原因は、主としてアルノン(Ar)原子がイオン化
する除虫じる電子がウェーノ・表面に衝突することにあ
り、又、上記の電子がイオン化する前のアルノン(Ar
)原子に衝突することによ一シて放出される!線やムt
プラズマからの紫外光がウェー八表面に照射されること
にあり、これを防ぐには、何らかの手段を用いてこの電
子を捕捉してそれ自身がウェーノーに衝突することをl
止し、または!線が発生することや紫外光の入射を阻止
すればよいとの着想を得た。そして、本発明の発明者は
、ターゲットとウェーノ・との間に電子捕捉用のグリッ
ド状またはスリット状の電極を設けることとし、この電
極とシャッターとを兼用させることにより、上記の着想
を工業的に異体化した。
そして、このジャツー−に接地、又は、正電位を印加す
るすなわち、この電子捕捉用シャッターに電子捕捉に最
適の電圧を印加することにより、可及的に多くの電子を
、これらがウェー/%に衝突する前に捕捉し、かつ、x
IIの発生も伽力紐止することとしたもの!ある。
(6)  発明の実施例 以下、図面を参照しつつ、本出願の一実施例に係る半導
体装置用部材の製造方法について説明し、本発明の構成
と特有の効果とを明らかにする。−例として、スノぞツ
タ用ガスにブルゾン(ムr)ガス、ターゲツト材に19
6の81を含むアルZ合金(AI−1%St)を用いて
、シリコンウェーハ上に81を含んだアルミニラ・ム薄
膜を堆積・成長させる場合について述べる。
第1図参照 図において、1は真空容器1あり、2及び3は、夫々ガ
スの導入及び排気口〒あり、4はウェーハ支持台1あり
、5はターゲット支持台であり、6はグリッド状シャッ
ターである。第2因はシャッター6が開の状態(、)と
閉の状III (b)を示す。
真空容器1において、最初、シャッター6を閉の状態(
第2図(b))にし、ウェーハ支持台4を接地電位とし
、ターゲット支持台6に直流貴電圧を1  印加するこ
とによってブルゾンイオン(ムr”)をスパッタさせ、
ターゲツト材であるシリコンを含むアル1=ウム例えば
l581−ムIを構成する夫々の原子、アルミニウム(
ムz>トシリコy(81)とを誘出させると供にターゲ
ツト材表面に付看した水分及び吸着ガスを取り除く、所
萌プレスパツタを行なう。ターゲツト材表面の水分及び
教書ガスが除去された頃、 グリッド状シャッターに接
地、又は、正電圧を印加し、シャッター6を開の状−(
第2図(a))にすることにより、ア5s−tン(^r
)原子がイオン化する除虫じる電子が上記のグリッド状
シャッター6で捕捉される。さらに浮遊電子が少にとも
ないI線の放出量が減少する。これと同時にウェーハ支
持台4に配設されたシリコンウェーハ上にはムr+をス
ノ々ツタさせることにより誘出したムIと818子が堆
積し、81を含んだA/IIが形成される。このとき、
グリッド状シャッターに印加される正電圧の値が大きい
と電子捕捉効果は大きくなるが、ウェーハ支持台とター
ゲット支持台との間の電界強度のプロファイルが複雑に
変形されて、アルミニウム(ムl)とかシリコン(Sl
)勢の飛行経路が複雑な影響な受ける恐れがあるの!、
(イ)堆積される物質の原子量と、←)容器や/9ツド
状シャッターの幾何学的形状、f→ガス圧等との相関関
係において、最適値が存在することが確認された。
この後、81を含んだAZ膜が所望の膜厚になった時、
シャッター6を閉の状態(第2図(b))にし、該B1
を含んだムl膜がそれ以上堆積するのを纏断する。
(7)発明の詳細 な説明せるとおり、本発明によれば、ウェーハに欠陥を
発生することなくウェーハ上に堆積物を堆積しうる半導
体装置用部材の製造方法を提供することができる。
【図面の簡単な説明】
第1図は、本発明に係るスパッタ成長装置を模式的に表
わしたものである。第2図はシャッターの開及び閉の状
態を示す模式図である。 l・・・真空容器、2・・・ガス導入口、3・・・真空
排気口、4・・・ウェーハ支持台、5・・・ターゲット
支持台、6・・・グリッド状シャッター。

Claims (1)

    【特許請求の範囲】
  1. ガスの導入口と真空排気口とを有する真空容器内に設置
    され、接地電位に保持される基板支持台と、し支持台に
    対面して設置されており、冷却され、狛電位が印加され
    うるターゲット支持台と、前配二つの支持台の間に位置
    し、面積が制御可能な複数の開口を有するシャッターと
    を備えたスパッタ成長装置を使用して、前記シャッター
    を閉じた状態〒前記ターゲット支持台に配設されたター
    ゲット表面の汚染を除去する工程と前記シャッターに接
    地電位または正電位を与え且つ前記シャッターを開けた
    状態で基板支持台に配設された被処理基板にスパッタ成
    長させて前記被処理基板に膜を形成する工程と、所望の
    厚さの膜が形成された時点f前1i−シャッターを閉じ
    る工程とからなることを特徴とする半導体装置用部材の
    製造方法0
JP5311582A 1982-03-31 1982-03-31 半導体装置用部材の製造方法 Pending JPS58170011A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP5311582A JPS58170011A (ja) 1982-03-31 1982-03-31 半導体装置用部材の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP5311582A JPS58170011A (ja) 1982-03-31 1982-03-31 半導体装置用部材の製造方法

Publications (1)

Publication Number Publication Date
JPS58170011A true JPS58170011A (ja) 1983-10-06

Family

ID=12933796

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5311582A Pending JPS58170011A (ja) 1982-03-31 1982-03-31 半導体装置用部材の製造方法

Country Status (1)

Country Link
JP (1) JPS58170011A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2011007832A1 (ja) * 2009-07-17 2011-01-20 株式会社アルバック 成膜装置

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2011007832A1 (ja) * 2009-07-17 2011-01-20 株式会社アルバック 成膜装置
CN102471875A (zh) * 2009-07-17 2012-05-23 株式会社爱发科 成膜装置

Similar Documents

Publication Publication Date Title
TW460601B (en) Copper sputtering target
TW405188B (en) UHV-compatible in-situ pre-metallization clean and metallization of semiconductor wafers
JPH06220627A (ja) 成膜装置
JP4344019B2 (ja) イオン化スパッタ方法
JPH06346223A (ja) コリメータを有するpvdチャンバの洗浄
JPS61218134A (ja) 薄膜形成装置および薄膜形成方法
TW201237204A (en) RF impedance matching network with secondary DC input
JPH0737887A (ja) 配線形成方法,配線修復方法,及び配線パターン変更方法
JPH10330932A (ja) スパッタリング装置
JP2001007041A (ja) イオン注入装置の汚染された表面を除去する装置および方法
JP3301408B2 (ja) 半導体製造装置のパーティクル除去装置及びパーティクルの除去方法
Tselev et al. Features of the film-growth conditions by cross-beam pulsed-laser deposition
US5922180A (en) Sputtering apparatus for forming a conductive film in a contact hole of a high aspect ratio
JPS58170011A (ja) 半導体装置用部材の製造方法
JPH11293468A (ja) プラズマcvd装置およびそのクリーニング方法
JP3659653B2 (ja) 基板上に層を設ける方法およびこれに使用するスパッタリング装置
JPH0892764A (ja) スパッタ装置
JP3273827B2 (ja) 半導体装置およびその製造方法
JPS63107118A (ja) イオンビ−ム装置
JP5265309B2 (ja) スパッタリング方法
JP4130278B2 (ja) 半導体装置の製造方法
JPS61174725A (ja) 薄膜形成装置
JP3949205B2 (ja) マグネトロンカソードを備えたメタル配線スパッタ装置
JP2744505B2 (ja) シリコンスパッタリング装置
JPH11509049A (ja) 高アスペクト比を有するコンタクトホールに平坦な配線膜及びプラグを形成する改善された成膜装置及び成膜方法