JPS58164025U - エラ−制御回路 - Google Patents
エラ−制御回路Info
- Publication number
- JPS58164025U JPS58164025U JP5848782U JP5848782U JPS58164025U JP S58164025 U JPS58164025 U JP S58164025U JP 5848782 U JP5848782 U JP 5848782U JP 5848782 U JP5848782 U JP 5848782U JP S58164025 U JPS58164025 U JP S58164025U
- Authority
- JP
- Japan
- Prior art keywords
- control unit
- circuit
- input
- output
- error
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は、従来の入出カル制御装置のエラー制御回路の
ブロック図、第2図は、本考案の一実施例を示す入出力
制御装置のエラー制御回路図である。 1:入出力制御装置、2:インタフェイス制御部1.3
:入出力チャネル、4:プロセッサ、5:プロセッサ、
6:リセット信号、7:フリップフロップ、8:起動、
停止回路、9:制御記憶装置、1′0:入出力装置、1
1:フリップフロップ、12:入出力制御部。
ブロック図、第2図は、本考案の一実施例を示す入出力
制御装置のエラー制御回路図である。 1:入出力制御装置、2:インタフェイス制御部1.3
:入出力チャネル、4:プロセッサ、5:プロセッサ、
6:リセット信号、7:フリップフロップ、8:起動、
停止回路、9:制御記憶装置、1′0:入出力装置、1
1:フリップフロップ、12:入出力制御部。
Claims (1)
- 電子計算機の入出力チャネルに接続された入出力制御装
置内のインタフェイス制御部のエラー制御回路において
、インクフェイス制御部で、エラーが発生した場合、イ
ンクフェイス制御部の動作を停止させる回路と、入出力
チャネルからリセット信号が出力されたことを記憶して
おく回路と、入出力制御装置内でインタフェイス制御部
のエラー処理が終了したことを記憶しておく回路と、イ
ンタフェイス制御部を起動する回路を有し、インタフェ
イス制御部でエラーが発生したとき、インタフェイス制
御部を停止させ、入出力チャネルからのリセット信号が
出力されたことと、インクフェイズ制御部のエラー処理
j(終了したことの両方の条件により、インクフェイス
制御回路を起動することを特徴とするエラー制御回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5848782U JPS58164025U (ja) | 1982-04-23 | 1982-04-23 | エラ−制御回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5848782U JPS58164025U (ja) | 1982-04-23 | 1982-04-23 | エラ−制御回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58164025U true JPS58164025U (ja) | 1983-11-01 |
Family
ID=30068875
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5848782U Pending JPS58164025U (ja) | 1982-04-23 | 1982-04-23 | エラ−制御回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58164025U (ja) |
-
1982
- 1982-04-23 JP JP5848782U patent/JPS58164025U/ja active Pending
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