JPS58159281A - 電子ユニツト - Google Patents
電子ユニツトInfo
- Publication number
- JPS58159281A JPS58159281A JP57043835A JP4383582A JPS58159281A JP S58159281 A JPS58159281 A JP S58159281A JP 57043835 A JP57043835 A JP 57043835A JP 4383582 A JP4383582 A JP 4383582A JP S58159281 A JPS58159281 A JP S58159281A
- Authority
- JP
- Japan
- Prior art keywords
- rom
- connector
- pack
- conducting
- terminals
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C5/00—Details of stores covered by group G11C11/00
Landscapes
- Read Only Memory (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は電子式卓上側IE411(以下電卓と称す)等
の電子alIgsに使用するROMバッタの如き電子ユ
ニツ)Kかかわるものであり、更に拝しくけ簡単な構造
で組立作業性にもすぐれ良電子ユニットにかかわるもの
である。
の電子alIgsに使用するROMバッタの如き電子ユ
ニツ)Kかかわるものであり、更に拝しくけ簡単な構造
で組立作業性にもすぐれ良電子ユニットにかかわるもの
である。
従来の電子ユニット、例えばROMパックにおいては、
一般にROMチップはプリント配11基板上に・・ンダ
付けで固定されて外輪ケースに収納され、上記ROMの
信号線は上記外輪ケースのm−に設けられた多数の金属
接点等からなるコネクターに引き出されてい皮。そして
上記のROMバッタは、電子機器本体側の開口部に設け
られた多数の接点より構成されるコネクタ一部に、上記
ROMバック側のコネクタ一部を電気的に接合させるこ
とにより *艶させていたものである。
一般にROMチップはプリント配11基板上に・・ンダ
付けで固定されて外輪ケースに収納され、上記ROMの
信号線は上記外輪ケースのm−に設けられた多数の金属
接点等からなるコネクターに引き出されてい皮。そして
上記のROMバッタは、電子機器本体側の開口部に設け
られた多数の接点より構成されるコネクタ一部に、上記
ROMバック側のコネクタ一部を電気的に接合させるこ
とにより *艶させていたものである。
上述の如き構造の従来のROMパックにおいては、プリ
ント基板等の部品が必要となる為、部品点数も多く、形
状も大きくなる等の欠点があった。
ント基板等の部品が必要となる為、部品点数も多く、形
状も大きくなる等の欠点があった。
更に、豪数個のROMチップを一個のROMパックに収
納する場合、プリント板の面積も一層大きくなる欠点が
めった。
納する場合、プリント板の面積も一層大きくなる欠点が
めった。
本発明は上記の点K11lみてなされたものでおる。
以丁に図面とともに*発明によるROMパックにつ(・
て説明を行なう。
て説明を行なう。
第1−ムは本発明を適用したROMバッタの分解斜視図
と第1図BFiROMバッタの#l視図でるる。第1図
においてl#iROMバック筐体(以下筐体と称す)で
あり、上記筐体1内にリードオンリーメモリーI(OM
Iを路Eし込む。その俵、f(OM lの両@面に引
き出されたビン(端子)Ia上に導電コネクター2(本
実施例でFi1対)を賂とし込むGここで導電コネクタ
ーとU、g2図に示す如く、長手方向に対して画11f
lfOKal電部2bと絶縁部2aを交互に重ね合わせ
た弾性を有するコネクターである。再び、Mi図により
112明すれば、上記導電コネクター2を路とし込んだ
上に更にリードオンリーメモリーROM lを落とし込
み、更KRQM2の側面に引き出されたビン(端子)I
m)上に導電コネクター3を落とし込む。その後、RO
Mバッタ量体4(以下1体と称す)を上記筐体1に同着
して、ROMパック5【構成する。尚上記自体4は上記
導電コネクター6の−SをROMバンク5の一面に央出
させる杉状を有するO R0M l及びROM lは筺体1によって位置決めを
竹なうことが可能である為、例えば第1図で示すROM
lのビン夏aとROMIのビン鳳すは上記導電コネク
ター2によって電気的に接続される。ここで第1図にお
いて、6はROMパック5を電子機器本体(図享せず)
に装着する筐体1と一体となった保合ツメであるが、係
合手段としてはネジ、鍔等他の手段を用いてよいもので
める0第6図#′i第1図Bの断面を示す。筐体1に藩
とし7込まれたROMIとROMIの各々のビンlt、
Ib間は一対の導電コネクタ−2で電気的に接続さJし
て(・る。更にROMIのビンI′bは導電コネクター
6によって、筐体1と蓋体4から形成されるROMハッ
クの外面に4t!出されている。
と第1図BFiROMバッタの#l視図でるる。第1図
においてl#iROMバック筐体(以下筐体と称す)で
あり、上記筐体1内にリードオンリーメモリーI(OM
Iを路Eし込む。その俵、f(OM lの両@面に引
き出されたビン(端子)Ia上に導電コネクター2(本
実施例でFi1対)を賂とし込むGここで導電コネクタ
ーとU、g2図に示す如く、長手方向に対して画11f
lfOKal電部2bと絶縁部2aを交互に重ね合わせ
た弾性を有するコネクターである。再び、Mi図により
112明すれば、上記導電コネクター2を路とし込んだ
上に更にリードオンリーメモリーROM lを落とし込
み、更KRQM2の側面に引き出されたビン(端子)I
m)上に導電コネクター3を落とし込む。その後、RO
Mバッタ量体4(以下1体と称す)を上記筐体1に同着
して、ROMパック5【構成する。尚上記自体4は上記
導電コネクター6の−SをROMバンク5の一面に央出
させる杉状を有するO R0M l及びROM lは筺体1によって位置決めを
竹なうことが可能である為、例えば第1図で示すROM
lのビン夏aとROMIのビン鳳すは上記導電コネク
ター2によって電気的に接続される。ここで第1図にお
いて、6はROMパック5を電子機器本体(図享せず)
に装着する筐体1と一体となった保合ツメであるが、係
合手段としてはネジ、鍔等他の手段を用いてよいもので
める0第6図#′i第1図Bの断面を示す。筐体1に藩
とし7込まれたROMIとROMIの各々のビンlt、
Ib間は一対の導電コネクタ−2で電気的に接続さJし
て(・る。更にROMIのビンI′bは導電コネクター
6によって、筐体1と蓋体4から形成されるROMハッ
クの外面に4t!出されている。
上記実施例のROMバッタを電子機器本体のl(OMパ
ック順付IflKfi着することにより、本体側プリン
ト配線基板上に設けられたパターン等に上記導電コネク
ター6【圧接して電気的接続な得る。
ック順付IflKfi着することにより、本体側プリン
ト配線基板上に設けられたパターン等に上記導電コネク
ター6【圧接して電気的接続な得る。
第4図は本発明によるROMパックの他の実施flJを
示ず。筐体6にROM lとROM Itを落とし込み
、谷)tOMのビンIa、8閣は導電コネクター7によ
り電気的に接続しているOR0M置のビン8tiROM
、(ツク外向に導き出されている09tlj会体【示
す0 上dピ夾施例のROMパックを電子機器本体のROMパ
ック取付部に装着することにより、本体側プリント配線
基板−ヒに設けられた)(ターン号に上記ROMIのビ
ン8を圧接して電気的接続を得る、。
示ず。筐体6にROM lとROM Itを落とし込み
、谷)tOMのビンIa、8閣は導電コネクター7によ
り電気的に接続しているOR0M置のビン8tiROM
、(ツク外向に導き出されている09tlj会体【示
す0 上dピ夾施例のROMパックを電子機器本体のROMパ
ック取付部に装着することにより、本体側プリント配線
基板−ヒに設けられた)(ターン号に上記ROMIのビ
ン8を圧接して電気的接続を得る、。
第5図は上記実施例におけるROM I及びROMIの
ピン配置の1例を示す図で、ROM Iのビン11−1
,1a−2,Ia−5,”・”はFIOMIのビンl
b−1。
ピン配置の1例を示す図で、ROM Iのビン11−1
,1a−2,Ia−5,”・”はFIOMIのビンl
b−1。
Ib−2,厘b−6,・・・・に対応しており、導電コ
ネクターで接続されるO RoM I においてIa−1はNOピン、Ia−2は
チップセレクトピンであり、ROMgにおいて鳳b−1
はチップセレクトビン、鳳b−2はN Oヒンテ1)
%l。
ネクターで接続されるO RoM I においてIa−1はNOピン、Ia−2は
チップセレクトピンであり、ROMgにおいて鳳b−1
はチップセレクトビン、鳳b−2はN Oヒンテ1)
%l。
従ってビン−1に信号を入力するとROM Mの情報が
銃み出される。またビン−2に信号【入力すると)(O
M lの情報が読み出される。上述の方法により)IO
Mの数i12 mに限らず、複数個のものを接続するこ
とが口]総でめる0更にl(OMと同杉状のダミーを用
いることにより、例えばROM3個用の筐体を2個用、
1個用として使用することも角層である。
銃み出される。またビン−2に信号【入力すると)(O
M lの情報が読み出される。上述の方法により)IO
Mの数i12 mに限らず、複数個のものを接続するこ
とが口]総でめる0更にl(OMと同杉状のダミーを用
いることにより、例えばROM3個用の筐体を2個用、
1個用として使用することも角層である。
以上に説明したように本発明による電子ユニットを用い
ることにより、簡単な構造て、組立作業性もよく、安価
な電子ユニットを得ることができる。
ることにより、簡単な構造て、組立作業性もよく、安価
な電子ユニットを得ることができる。
第1因Aは本発明を適用し九ROMバッタの一夫M列の
分解廁視図、第1図BFiROMパックの、1I−1視
図、第2凶はROMバッタに使用する導電コネクターの
一例を示す斜視図、第6図はROMバンクの鵬面図、第
4図は他の実施例によるROMベッタリ断向図、第5図
はROMチップのビン配置−をボす為の図である。 ここで1・・・1・筐体、2.3−II・・・導電コネ
クター、51111ellll f(OMバッタ、6・
・・・・筺体、/・―・−導電コネクターである。 η3(財) 方4園 ¥5閲
分解廁視図、第1図BFiROMパックの、1I−1視
図、第2凶はROMバッタに使用する導電コネクターの
一例を示す斜視図、第6図はROMバンクの鵬面図、第
4図は他の実施例によるROMベッタリ断向図、第5図
はROMチップのビン配置−をボす為の図である。 ここで1・・・1・筐体、2.3−II・・・導電コネ
クター、51111ellll f(OMバッタ、6・
・・・・筺体、/・―・−導電コネクターである。 η3(財) 方4園 ¥5閲
Claims (1)
- (1)筺体に端子を有する電子部材の複数を配置し、上
記複数の電子部材の端子間を導電部と非尋電藻を積層し
て構成し九導電コネクターで接続させて造る電子ユニッ
ト 電子エエット 載の電子ユニット
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57043835A JPS58159281A (ja) | 1982-03-18 | 1982-03-18 | 電子ユニツト |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57043835A JPS58159281A (ja) | 1982-03-18 | 1982-03-18 | 電子ユニツト |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58159281A true JPS58159281A (ja) | 1983-09-21 |
Family
ID=12674800
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57043835A Pending JPS58159281A (ja) | 1982-03-18 | 1982-03-18 | 電子ユニツト |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58159281A (ja) |
-
1982
- 1982-03-18 JP JP57043835A patent/JPS58159281A/ja active Pending
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