JPS58112336A - 化合物半導体装置の電極形成法 - Google Patents
化合物半導体装置の電極形成法Info
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- JPS58112336A JPS58112336A JP21229481A JP21229481A JPS58112336A JP S58112336 A JPS58112336 A JP S58112336A JP 21229481 A JP21229481 A JP 21229481A JP 21229481 A JP21229481 A JP 21229481A JP S58112336 A JPS58112336 A JP S58112336A
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/283—Deposition of conductive or insulating materials for electrodes conducting electric current
- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
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- H01L21/28575—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising AIIIBV compounds
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、化゛合物半導体装置の裏面電極形成法に関
するものでる名、以下、この種の半導体装置の一例とし
てs GaAs S/Bットキパリャ型電界効果トラン
ジスタ(GaAs MB2 PET ) の場合につ
いて説明する。
するものでる名、以下、この種の半導体装置の一例とし
てs GaAs S/Bットキパリャ型電界効果トラン
ジスタ(GaAs MB2 PET ) の場合につ
いて説明する。
GaAs MB8 FETは、絶縁性GaAs基板(O
rドープ)の上に動作層をエピタキシャル成長したウェ
ハを用いる。この動作層上にソース、ドレイン及びゲー
ト電極をつくり込んでトランジスタな形成し、その厚み
は、基板を含んだ素子の厚み約150μmに対し、せい
ぜい1戸程度である。
rドープ)の上に動作層をエピタキシャル成長したウェ
ハを用いる。この動作層上にソース、ドレイン及びゲー
ト電極をつくり込んでトランジスタな形成し、その厚み
は、基板を含んだ素子の厚み約150μmに対し、せい
ぜい1戸程度である。
この様なプレーナ型のGaAs半導体装置を所定のパッ
ケージ又はチップキャリヤ等に固定収納するには、通常
半田を用いる。Si半導体装置の場合には、ダイボンド
する面に通常金メツキ仕上げを施し、λu−8i共晶合
金にて固定する。ところが、GaAs等の化合物半導体
の場合は、GaAsと直接共晶する半田が無いので、^
u−5n’jたはAu−Ge共晶半田(°プリフォーム
)を用いるのが一般的である。
ケージ又はチップキャリヤ等に固定収納するには、通常
半田を用いる。Si半導体装置の場合には、ダイボンド
する面に通常金メツキ仕上げを施し、λu−8i共晶合
金にて固定する。ところが、GaAs等の化合物半導体
の場合は、GaAsと直接共晶する半田が無いので、^
u−5n’jたはAu−Ge共晶半田(°プリフォーム
)を用いるのが一般的である。
その場合、化合物半導体素子のダイボンド面には、Cr
/Au等の多層金属膜を蒸着法、スパッタ法等で形成す
る。表面をAuで仕上げるのは、酸化物をつくらず、半
田との濡れ性に優れているからであるが、ム薄膜を形成
したのち、実際ダイボンドするまでの工程、例えばウェ
ハインラインチェック。
/Au等の多層金属膜を蒸着法、スパッタ法等で形成す
る。表面をAuで仕上げるのは、酸化物をつくらず、半
田との濡れ性に優れているからであるが、ム薄膜を形成
したのち、実際ダイボンドするまでの工程、例えばウェ
ハインラインチェック。
オートテスト、スクライビング、ダイス選別等複数の工
程を経る内に、汚染される機会が多い、そのために、ダ
イボンドがうまく行かない場合が69、信頼性低下の一
原因となっていた。特に、ダイス(ペレット)状になっ
て汚染された場合、洗浄がむずかしく、弗素せざるをえ
ない場合もあった。そこで、発明者等は、裏面メタ2イ
ズを共晶プリフォームと同一組成の薄膜で形成すること
を提案した。そして、この提案した構造は、Gaksと
合金化するに必要な温度で熱処理しないことを特徴とし
ている。この内、ムu−9n共晶合金膜は。
程を経る内に、汚染される機会が多い、そのために、ダ
イボンドがうまく行かない場合が69、信頼性低下の一
原因となっていた。特に、ダイス(ペレット)状になっ
て汚染された場合、洗浄がむずかしく、弗素せざるをえ
ない場合もあった。そこで、発明者等は、裏面メタ2イ
ズを共晶プリフォームと同一組成の薄膜で形成すること
を提案した。そして、この提案した構造は、Gaksと
合金化するに必要な温度で熱処理しないことを特徴とし
ている。この内、ムu−9n共晶合金膜は。
Au−GeにくらべGIIAI K対する接着力がや\
弱い欠点があった。そこで、龜ムSに対して接着力が比
較的優れているNiをま−ず300− Wooλ蒸着し
たのち。
弱い欠点があった。そこで、龜ムSに対して接着力が比
較的優れているNiをま−ず300− Wooλ蒸着し
たのち。
Au−8n共晶膜を2000〜3000 i蒸着してい
た。ところが、その場合でも裏面膜が剥離する場合があ
った。一方、Au−伽は、GaAsに対する接着力がN
iよシ強い長所を持っているが、融点が370℃とかな
シ為<、ダイボンド時における熱劣化を防ぐのに手ぎわ
良く作業しなければならない、化合物中導体素子、中で
%GaAs MFJ8 PETの様にショットキバリヤ
を有するものは特に熱劣化し易く、使用できなかった。
た。ところが、その場合でも裏面膜が剥離する場合があ
った。一方、Au−伽は、GaAsに対する接着力がN
iよシ強い長所を持っているが、融点が370℃とかな
シ為<、ダイボンド時における熱劣化を防ぐのに手ぎわ
良く作業しなければならない、化合物中導体素子、中で
%GaAs MFJ8 PETの様にショットキバリヤ
を有するものは特に熱劣化し易く、使用できなかった。
その点、Au−8n共晶合金は融点がAu−Geにくら
べて90℃も低いので、好都合である・そこでこの発明
は、裏面メタライズ膜としてAu。
べて90℃も低いので、好都合である・そこでこの発明
は、裏面メタライズ膜としてAu。
8n膜の方が好ましい有用性に加えて、Au−Geの接
着力の強さを組み合わせ、裏面電極としてAu−Ge膜
Au″8n共晶合金膜を用いることを提案するもので
ある。緬・(ト)の膜厚はGaAsに対する接着力が確
保できる程度でよく、300〜500 A 、 Au−
8nは従来通#)2000〜3000 Aは必要である
。
着力の強さを組み合わせ、裏面電極としてAu−Ge膜
Au″8n共晶合金膜を用いることを提案するもので
ある。緬・(ト)の膜厚はGaAsに対する接着力が確
保できる程度でよく、300〜500 A 、 Au−
8nは従来通#)2000〜3000 Aは必要である
。
このような積層共晶合金膜を用いることによって、熱劣
化をおこさせないで接着力の強いダイボンドが可能にな
シ、実用的価値が一段と高くなった。
化をおこさせないで接着力の強いダイボンドが可能にな
シ、実用的価値が一段と高くなった。
GaAs基板にAu−Geまたはム・8n共晶膜を形成
するということは、オーミックコンタクトをとる方法と
して公知であるが、本発明は次の点で異なる。
するということは、オーミックコンタクトをとる方法と
して公知であるが、本発明は次の点で異なる。
つtル、一般に上記金属膜は(nAsに対するオー゛イ
ック材として用いられるので、GaAsとの合金化処理
が含まれる。したがって、最終的には(31,Aj、A
u。
ック材として用いられるので、GaAsとの合金化処理
が含まれる。したがって、最終的には(31,Aj、A
u。
Ge(8n)その他を含む複雑な合金となっている。
本発明は、逆にこの熱処理を含まないことを特徴として
いる。すなわち、Au−Ge膜とAu・8n膜を基板を
加熱することなく順次付着した後、不活性ガス中で熱処
理を全く行なわないことを特徴としている。なぜなら、
目的がプリフォーム材との濡れ性を改善することである
から、熱処理してしまうと、ダイボンドするためのAu
−8n共晶プリフオームと全くなじまなくなってグイボ
ンドできない。
いる。すなわち、Au−Ge膜とAu・8n膜を基板を
加熱することなく順次付着した後、不活性ガス中で熱処
理を全く行なわないことを特徴としている。なぜなら、
目的がプリフォーム材との濡れ性を改善することである
から、熱処理してしまうと、ダイボンドするためのAu
−8n共晶プリフオームと全くなじまなくなってグイボ
ンドできない。
これは、Geが表面に偏析するからである。また、熱処
理すると、罰面にポールアップ現象がおこる。
理すると、罰面にポールアップ現象がおこる。
つま夛、各金属元素が偏析して表面がでこぼこになる。
裏面がこの様になったダイスを観察又は組立てる場合、
顕微鏡の像が暗くなってよく見えないということはよく
経験されることであって、作業性が着しく阻害されるこ
とは明らか1である。さらに、Au−Ge eAu−8
nの組成が一定の共晶合金でなければならない点も特徴
である。オーミック材としては、上記ポールアップ現象
を防ぐために、Niなどの異種金属を含ませるのが通例
である。
顕微鏡の像が暗くなってよく見えないということはよく
経験されることであって、作業性が着しく阻害されるこ
とは明らか1である。さらに、Au−Ge eAu−8
nの組成が一定の共晶合金でなければならない点も特徴
である。オーミック材としては、上記ポールアップ現象
を防ぐために、Niなどの異種金属を含ませるのが通例
である。
この発明のようにんlkとAu・8nを付着し九ままの
状態だと、Au−8n共晶合金は280℃で急激にとけ
、同時に同温度のAu5n共晶プリフオームと一瞬の内
にまじシあって、強固な接着が可能となる。
状態だと、Au−8n共晶合金は280℃で急激にとけ
、同時に同温度のAu5n共晶プリフオームと一瞬の内
にまじシあって、強固な接着が可能となる。
すなわち、どちらかの加・an共晶合金が多少汚染され
ていても、上記現象により接着されるので、充分な強度
が確保できるのである。
ていても、上記現象により接着されるので、充分な強度
が確保できるのである。
以上、GaAs Mgs FBTの裏面電極形成につい
て説明してきたが、この発明はGaAs以外の他の化合
物半導体装置の裏面電極形成に適用できる。
て説明してきたが、この発明はGaAs以外の他の化合
物半導体装置の裏面電極形成に適用できる。
代理人 葛野信−
手続補正書(自発)
特許庁長官殿
1、事件の表示 特願財4811−gH!111
4号2、発明の名称 化合物半導体装置の電極形成法 3、補1−1:、をする者 6、 補正の対象 明細書の発明の詳細な説明の欄 6、補正の内容 明細書第8頁第4行目に「発案」とあるのを「廃棄」と
訂正する。
4号2、発明の名称 化合物半導体装置の電極形成法 3、補1−1:、をする者 6、 補正の対象 明細書の発明の詳細な説明の欄 6、補正の内容 明細書第8頁第4行目に「発案」とあるのを「廃棄」と
訂正する。
以上
Claims (2)
- (1)化合物半導体基板上に熱処理を全く行なわないA
u−Ge共晶合金膜及び人U・8n共晶合金膜を順次積
層し、王妃半導体基板を支持体に共晶半iで固定するた
めの電極を形成することを特徴とする化合物半導体装置
の電極形成法。 - (2)化合物半導体基板はGaAsからなる特許請求の
範囲第1項記載の化合物半導体装置の電極形成法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21229481A JPS58112336A (ja) | 1981-12-25 | 1981-12-25 | 化合物半導体装置の電極形成法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21229481A JPS58112336A (ja) | 1981-12-25 | 1981-12-25 | 化合物半導体装置の電極形成法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58112336A true JPS58112336A (ja) | 1983-07-04 |
JPS6337497B2 JPS6337497B2 (ja) | 1988-07-26 |
Family
ID=16620197
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP21229481A Granted JPS58112336A (ja) | 1981-12-25 | 1981-12-25 | 化合物半導体装置の電極形成法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58112336A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5187560A (en) * | 1989-11-28 | 1993-02-16 | Sumitomo Electric Industries, Ltd. | Ohmic electrode for n-type cubic boron nitride and the process for manufacturing the same |
US5240877A (en) * | 1989-11-28 | 1993-08-31 | Sumitomo Electric Industries, Ltd. | Process for manufacturing an ohmic electrode for n-type cubic boron nitride |
US5288456A (en) * | 1993-02-23 | 1994-02-22 | International Business Machines Corporation | Compound with room temperature electrical resistivity comparable to that of elemental copper |
-
1981
- 1981-12-25 JP JP21229481A patent/JPS58112336A/ja active Granted
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5187560A (en) * | 1989-11-28 | 1993-02-16 | Sumitomo Electric Industries, Ltd. | Ohmic electrode for n-type cubic boron nitride and the process for manufacturing the same |
US5240877A (en) * | 1989-11-28 | 1993-08-31 | Sumitomo Electric Industries, Ltd. | Process for manufacturing an ohmic electrode for n-type cubic boron nitride |
US5288456A (en) * | 1993-02-23 | 1994-02-22 | International Business Machines Corporation | Compound with room temperature electrical resistivity comparable to that of elemental copper |
US5330592A (en) * | 1993-02-23 | 1994-07-19 | International Business Machines Corporation | Process of deposition and solid state reaction for making alloyed highly conductive copper germanide |
Also Published As
Publication number | Publication date |
---|---|
JPS6337497B2 (ja) | 1988-07-26 |
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