JPS58101524A - 電子スイツチ回路 - Google Patents
電子スイツチ回路Info
- Publication number
- JPS58101524A JPS58101524A JP20044581A JP20044581A JPS58101524A JP S58101524 A JPS58101524 A JP S58101524A JP 20044581 A JP20044581 A JP 20044581A JP 20044581 A JP20044581 A JP 20044581A JP S58101524 A JPS58101524 A JP S58101524A
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- JP
- Japan
- Prior art keywords
- voltage
- transistor
- signal
- output
- base
- Prior art date
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- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/60—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
- H03K17/62—Switching arrangements with several input- output-terminals, e.g. multiplexers, distributors
Landscapes
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
従来ビデオのノイズ除去等様々なアナログ回路に用いら
れる電子スイッチ回路には第１図のような回路形式のも
のがある。同回路中、ＥＲ，Ｅｌ。
れる電子スイッチ回路には第１図のような回路形式のも
のがある。同回路中、ＥＲ，Ｅｌ。
Ｅ２は直流電圧、ｖｌ、ｖ２は入力交流信号である。
ｎｐｎ）ランジスタ対Ｑ４．Ｑ２は差動回路を形成し、
ダイオード接続体Ｑ３はＱｌ、Ｑ２ と同特性のトラン
ジスタのベース、コレクタを短絡したものである。又、
ｎｐｎトランジスタＱ４．Ｑ６およびダイオード接続体
Ｑ６は、前記トランジスタＱ１゜Ｑ２．Ｑ３と同様な構
成である。
ダイオード接続体Ｑ３はＱｌ、Ｑ２ と同特性のトラン
ジスタのベース、コレクタを短絡したものである。又、
ｎｐｎトランジスタＱ４．Ｑ６およびダイオード接続体
Ｑ６は、前記トランジスタＱ１゜Ｑ２．Ｑ３と同様な構
成である。
今、ｖｌの入力信号を出力端からとり出そうとするとき
は、前記直流電圧Ｅ１は前記トランジスタ対Ｑ４．Ｑ２
を完全にスイッチングさせるのに十分低い電圧とし、一
方、前記直流電圧Ｅ２はＱ４゜Ｑ６を完全にスイッチン
グさせるのに十分高い電圧とする。これにより、前記ト
ランジスタ対のうちの各１方のトランジスタＱ１１Ｑ４
はオン、また、各他方のトランジスタＱ２．Ｑ６はオフ
となり、ダイオードＱ３は導通、ダイオードＱ６は非導
通となる。この結果、出力トランジスタＱ７のベースに
は、ｖｌの入力信号が前記ダイオードＱ３を介して現わ
れる。
は、前記直流電圧Ｅ１は前記トランジスタ対Ｑ４．Ｑ２
を完全にスイッチングさせるのに十分低い電圧とし、一
方、前記直流電圧Ｅ２はＱ４゜Ｑ６を完全にスイッチン
グさせるのに十分高い電圧とする。これにより、前記ト
ランジスタ対のうちの各１方のトランジスタＱ１１Ｑ４
はオン、また、各他方のトランジスタＱ２．Ｑ６はオフ
となり、ダイオードＱ３は導通、ダイオードＱ６は非導
通となる。この結果、出力トランジスタＱ７のベースに
は、ｖｌの入力信号が前記ダイオードＱ３を介して現わ
れる。
一方、前記直流電圧Ｅ１．Ｅ２と同じく直流電圧（バイ
アス）ＥＲの電圧関係を逆にすればそれぞれトランジス
タＱ２．Ｑ５およびダイオードＱ６がオン、それぞれト
ランジスタＱ１．Ｑ４、およびダイオードＱ６がオフと
なり、ｖ２の入力信号が前記ダイオードＱ６を介して前
記出力トランジスタＱ７のベースに現われる。そして、
この信号は同トランジスタＱ７の工ばツタホロワ出力ｖ
０としてとり出される。
アス）ＥＲの電圧関係を逆にすればそれぞれトランジス
タＱ２．Ｑ５およびダイオードＱ６がオン、それぞれト
ランジスタＱ１．Ｑ４、およびダイオードＱ６がオフと
なり、ｖ２の入力信号が前記ダイオードＱ６を介して前
記出力トランジスタＱ７のベースに現われる。そして、
この信号は同トランジスタＱ７の工ばツタホロワ出力ｖ
０としてとり出される。
ここで、Ｖ、の入力信号を出力する場合について考える
。出力トランジスタＱ７のベース直流電圧をｖ０′とす
ると。
。出力トランジスタＱ７のベース直流電圧をｖ０′とす
ると。
ｖＯ”” ＥＲ−ｖＢＥｌ ＋ｖＢＥ３ ””
（Ｄｖ０′の電圧をバイアス電圧ＥＲと同じにするには
、■式よりｖＢＥ、＝ｖＢＥ３の関係を満足すればよい
。この関係は前記トランジスタ対Ｑ１．Ｑ２の共通エミ
ッタ結合点に接続されている定電流源の電流を１０とす
ると、前記トランジスタおよびダイオードＱ１．Ｑ３に
流れる電流を夫々１０／２に設定すれば実現でき、この
ときｖ０′二ＥＲとなる。
（Ｄｖ０′の電圧をバイアス電圧ＥＲと同じにするには
、■式よりｖＢＥ、＝ｖＢＥ３の関係を満足すればよい
。この関係は前記トランジスタ対Ｑ１．Ｑ２の共通エミ
ッタ結合点に接続されている定電流源の電流を１０とす
ると、前記トランジスタおよびダイオードＱ１．Ｑ３に
流れる電流を夫々１０／２に設定すれば実現でき、この
ときｖ０′二ＥＲとなる。
この回路形式であれば、直流電圧Ｅ１．Ｅ２の電圧にか
かわらず出力ｖ０′の直流電圧は一定である。
かわらず出力ｖ０′の直流電圧は一定である。
また、前述のように、トランジスタおよびダイオードＱ
１．Ｑ３に流れる電流を夏。／／２にするためには、前
記ダイオードＱ３の側の回路の抵抗Ｒ１は０式のように
選定する必要がある。
１．Ｑ３に流れる電流を夏。／／２にするためには、前
記ダイオードＱ３の側の回路の抵抗Ｒ１は０式のように
選定する必要がある。
Ｒ４＝２（Ｖｃｃ−ＥＲ）／Ｉ０ ・・・・・・
■次に、交流信号に関して、ｖ０′の交流信号成分をｖ
０′とすると、■式が成立する。
■次に、交流信号に関して、ｖ０′の交流信号成分をｖ
０′とすると、■式が成立する。
Ｒ１
■式より、Ｒ１が、” ｅｌ”ｅ３）にくらべて、非常
に大きければ、ｖｏ′−ｖ、となるが０式よりＲ１には
他の回路定数から決まってくる制限があるのであまり大
きくはできない。それ故、従来の回路では出力信号の損
失が大きいという欠点がある。
に大きければ、ｖｏ′−ｖ、となるが０式よりＲ１には
他の回路定数から決まってくる制限があるのであまり大
きくはできない。それ故、従来の回路では出力信号の損
失が大きいという欠点がある。
本発明は能動負荷を用いることによって、上述の従来回
路の欠点を除去し、交流信号損失の少ないスイッチ回路
を提供するものである。以下本発明の実施例について説
明する第２図に本発明の実施例回路図を示す。
路の欠点を除去し、交流信号損失の少ないスイッチ回路
を提供するものである。以下本発明の実施例について説
明する第２図に本発明の実施例回路図を示す。
第１図で示す従来の回路の抵抗Ｒ１のかわりに、第２図
の回路では抵抗ＲとＰ！Ｉｐ）ランジスタＱ８を用いる
ことにより、定電流源を構成している。
の回路では抵抗ＲとＰ！Ｉｐ）ランジスタＱ８を用いる
ことにより、定電流源を構成している。
上記トランジスタＱ８のベース直流電圧ＥＢにより、同
トランジスタＱ８のコレクタ電流をＩ。／２に設定して
いる。
トランジスタＱ８のコレクタ電流をＩ。／２に設定して
いる。
この場合も、ｖｌ の入力信号をとり出す条件は前記設
定と同様とする。したがって、この回路でトランジスタ
およびダイオードＱ１．Ｑ３のそれぞれの工ばツタ電流
はともにＩ０／２であり、ｖ０′＝ＥＨとなり、出力ト
ランジスタＱ７のベース点に入力信号のバイアス電圧Ｅ
Ｈを再生している。又。
定と同様とする。したがって、この回路でトランジスタ
およびダイオードＱ１．Ｑ３のそれぞれの工ばツタ電流
はともにＩ０／２であり、ｖ０′＝ＥＨとなり、出力ト
ランジスタＱ７のベース点に入力信号のバイアス電圧Ｅ
Ｈを再生している。又。
交流信号成分に関しては、前記トランジスタＱ８のコレ
クタ出力インピーダンスをＲ８とすると。
クタ出力インピーダンスをＲ８とすると。
次の０式が成り立つ。
（ただし！。：Ｑ１１Ｑ３のエミッタ抵抗）すなわち、
この回路によれば、Ｒｏ ）２ ｒ 、が容易に実現さ
れる。したがって、この０式から明らかなように、交流
信号成分の損失が少ないことがわかる。
この回路によれば、Ｒｏ ）２ ｒ 、が容易に実現さ
れる。したがって、この０式から明らかなように、交流
信号成分の損失が少ないことがわかる。
従来の方式と本発明の方式の出力損失の比較の一例を示
す。Ｖｃｃ＝ｅｓＶ、ＥＲ＝３Ｖ ＩＯ＝２ｍＡとす
ると、 従来方式・・・・・・ｖ０＝０．９７６ｖ１本方式 …
…１）０＝０．９９９７）１となり本発明を用いること
により明らかに損失の少ない出力が得られる。
す。Ｖｃｃ＝ｅｓＶ、ＥＲ＝３Ｖ ＩＯ＝２ｍＡとす
ると、 従来方式・・・・・・ｖ０＝０．９７６ｖ１本方式 …
…１）０＝０．９９９７）１となり本発明を用いること
により明らかに損失の少ない出力が得られる。
以上のように、本発明のごとく抵抗を定電流源に置きか
えることによって簡単に損失の少ないスイッチ回路が実
現できる。
えることによって簡単に損失の少ないスイッチ回路が実
現できる。
第１図は従来の電子スイッチ回路図、第２図は本発明の
一実施例を示す電子スイッチ回路図である。 ＱＱＱＱ ・・・・・・トランジスタ、Ｑ３．Ｑ６１
１ ２１ ４１ ５ ・・・・・・トランジスタのベースコレクタ接合短絡の
ダイオード、Ｑ７ ・・・・・・出力トランジスタ、Ｒ
・・・・・・・・抵抗、Ｑ８・・・・・・トランジスタ
。
一実施例を示す電子スイッチ回路図である。 ＱＱＱＱ ・・・・・・トランジスタ、Ｑ３．Ｑ６１
１ ２１ ４１ ５ ・・・・・・トランジスタのベースコレクタ接合短絡の
ダイオード、Ｑ７ ・・・・・・出力トランジスタ、Ｒ
・・・・・・・・抵抗、Ｑ８・・・・・・トランジスタ
。
Claims (1)
- 【特許請求の範囲】 ２組のエミッタ共通結合の差動トランジスタ対を並列に
有し、それぞれの組の一方のベースに交流信号を入力し
て、他方のトランジスタのベースに印加する直流電圧に
応じて前記交流信号のどちらか一方を共通エミッタから
それぞれダイオードを介して出力トランジスタ側に出力
するにあたり。 前記それぞれのダイオードのアノード側を共通の定電流
源を介して回路電源側に接続したことを特徴とする電子
スイッチ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20044581A JPS58101524A (ja) | 1981-12-11 | 1981-12-11 | 電子スイツチ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20044581A JPS58101524A (ja) | 1981-12-11 | 1981-12-11 | 電子スイツチ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58101524A true JPS58101524A (ja) | 1983-06-16 |
Family
ID=16424412
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20044581A Pending JPS58101524A (ja) | 1981-12-11 | 1981-12-11 | 電子スイツチ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58101524A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6090937U (ja) * | 1983-11-28 | 1985-06-21 | 東光株式会社 | スイツチ回路 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5487466A (en) * | 1977-12-23 | 1979-07-11 | Matsushita Electric Ind Co Ltd | Signal change-over circuit |
| JPS5637729A (en) * | 1979-09-05 | 1981-04-11 | Hitachi Ltd | Analog multiplexer |
-
1981
- 1981-12-11 JP JP20044581A patent/JPS58101524A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5487466A (en) * | 1977-12-23 | 1979-07-11 | Matsushita Electric Ind Co Ltd | Signal change-over circuit |
| JPS5637729A (en) * | 1979-09-05 | 1981-04-11 | Hitachi Ltd | Analog multiplexer |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6090937U (ja) * | 1983-11-28 | 1985-06-21 | 東光株式会社 | スイツチ回路 |
| JPH0326687Y2 (ja) * | 1983-11-28 | 1991-06-10 |
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