JPH11261921A - 撮像装置 - Google Patents
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- JPH11261921A JPH11261921A JP10058162A JP5816298A JPH11261921A JP H11261921 A JPH11261921 A JP H11261921A JP 10058162 A JP10058162 A JP 10058162A JP 5816298 A JP5816298 A JP 5816298A JP H11261921 A JPH11261921 A JP H11261921A
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Abstract
(57)【要約】
【課題】 第１および第２のフィールドにおける飽和信
号レベルの差および折り返し歪みをなくし、演算精度や
ＬＳＩのゲート規模およびパワーを増大させないような
ＡＧＣ変調回路を提供する。 【解決手段】 ＣＣＤ素子１から読出した信号をＡＧＣ
アンプ３で増幅した後、Ａ／Ｄ変換器４によりディジタ
ル信号に変換し、感度の高いＹｅＣｙラインの信号電荷
を第１フィールド期間に読出し、感度の低いＧｒＭｇラ
インの信号電荷を第２フィールド期間に読出し、第１フ
ィールド期間でＡＧＣアンプ３のゲインを第２フィール
ド期間のそれに対してある比率だけ露出制御部１０によ
って設定するようにしたものである。
号レベルの差および折り返し歪みをなくし、演算精度や
ＬＳＩのゲート規模およびパワーを増大させないような
ＡＧＣ変調回路を提供する。 【解決手段】 ＣＣＤ素子１から読出した信号をＡＧＣ
アンプ３で増幅した後、Ａ／Ｄ変換器４によりディジタ
ル信号に変換し、感度の高いＹｅＣｙラインの信号電荷
を第１フィールド期間に読出し、感度の低いＧｒＭｇラ
インの信号電荷を第２フィールド期間に読出し、第１フ
ィールド期間でＡＧＣアンプ３のゲインを第２フィール
ド期間のそれに対してある比率だけ露出制御部１０によ
って設定するようにしたものである。
Description
【０００１】
【発明の属する技術分野】この発明はＡＧＣ変調回路に
関し、特に、イエロー（Ｙｅ），シアン（Ｃｙ），グリ
ーン（Ｇｒ），マゼンタ（Ｍｇ）の４種類の補色フィル
タが配列されたインターレース・スキャン型ＣＣＤ素子
を用いたようなスチルカメラに関する。
関し、特に、イエロー（Ｙｅ），シアン（Ｃｙ），グリ
ーン（Ｇｒ），マゼンタ（Ｍｇ）の４種類の補色フィル
タが配列されたインターレース・スキャン型ＣＣＤ素子
を用いたようなスチルカメラに関する。
【０００２】
【従来の技術】インターレース・スキャン型ＣＣＤは、
プログレッシブ・スキャン型ＣＣＤと区別され、後者は
垂直画素数対垂直ＣＣＤビット数が１：１であるのに対
して、前者は２：１となっているため、前者から垂直解
像度の高い画像を得るには、たとえば「フルフレームス
チルカメラの露光制御方法」１９９４年テレビジョン学
会年次大会ｐ１１５〜１１６に記載されているように、
メカニカルシャッタを使用して奇数ラインと偶数ライン
とを別々のフィールドで読出すことが知られている。こ
の一方で、両ＣＣＤが同一画素数の場合、インターレー
ス・スキャン型の方が垂直ＣＣＤのビット数が少ないた
め、開口率を大きくできるなどの利点がある。
プログレッシブ・スキャン型ＣＣＤと区別され、後者は
垂直画素数対垂直ＣＣＤビット数が１：１であるのに対
して、前者は２：１となっているため、前者から垂直解
像度の高い画像を得るには、たとえば「フルフレームス
チルカメラの露光制御方法」１９９４年テレビジョン学
会年次大会ｐ１１５〜１１６に記載されているように、
メカニカルシャッタを使用して奇数ラインと偶数ライン
とを別々のフィールドで読出すことが知られている。こ
の一方で、両ＣＣＤが同一画素数の場合、インターレー
ス・スキャン型の方が垂直ＣＣＤのビット数が少ないた
め、開口率を大きくできるなどの利点がある。
【０００３】図４は補色フィルタの配列を示す図であ
り、図５は従来のインターレース・スキャン型ＣＣＤ撮
像素子を用いたスチルカメラの輝度信号を作成するまで
の信号処理ブロック図である。なお、図５においては、
レンズおよびメカニカルシャッタを省略している。
り、図５は従来のインターレース・スキャン型ＣＣＤ撮
像素子を用いたスチルカメラの輝度信号を作成するまで
の信号処理ブロック図である。なお、図５においては、
レンズおよびメカニカルシャッタを省略している。
【０００４】ＣＣＤ素子１の出力信号は相関２重サンプ
リング回路（以下、ＣＤＳ回路と称する）２でノイズが
低減され、ＡＧＣアンプ３に与えられる。ＡＧＣアンプ
３は露出制御部６からの制御信号によりその利得が制御
される。ＡＧＣアンプ３で増幅されたＣＣＤ素子１から
の信号はＡ／Ｄ変換器４によってディジタルデータに変
換された後、Ｙ作成回路５に入力される。Ｙ作成回路５
においては、アドレス（ｘ，ｙ）におけるディジタルデ
ータをＤ（ｘ，ｙ）と表わすと、アドレス（ｘ，ｙ）に
おける輝度信号は、 Ｙ（ｘ，ｙ）＝Ｄ（ｘ，ｙ）＋Ｄ（ｘ＋１，ｙ）＋Ｄ
（ｘ，ｙ＋１）＋Ｄ（ｘ＋１，ｙ＋１） のように隣接する４データの加算により作成される。こ
のとき、Ｙに占める４つの色フィルタの重みは等しく、
次式で示される。
リング回路（以下、ＣＤＳ回路と称する）２でノイズが
低減され、ＡＧＣアンプ３に与えられる。ＡＧＣアンプ
３は露出制御部６からの制御信号によりその利得が制御
される。ＡＧＣアンプ３で増幅されたＣＣＤ素子１から
の信号はＡ／Ｄ変換器４によってディジタルデータに変
換された後、Ｙ作成回路５に入力される。Ｙ作成回路５
においては、アドレス（ｘ，ｙ）におけるディジタルデ
ータをＤ（ｘ，ｙ）と表わすと、アドレス（ｘ，ｙ）に
おける輝度信号は、 Ｙ（ｘ，ｙ）＝Ｄ（ｘ，ｙ）＋Ｄ（ｘ＋１，ｙ）＋Ｄ
（ｘ，ｙ＋１）＋Ｄ（ｘ＋１，ｙ＋１） のように隣接する４データの加算により作成される。こ
のとき、Ｙに占める４つの色フィルタの重みは等しく、
次式で示される。
【０００５】Ｙ＝Ｙｅ＋Ｃｙ＋Ｇｒ＋Ｍｇ 次に、このＹ信号は露出制御部６に入力される。この露
出制御部６はたとえばマイクロコンピュータなどによっ
て構成され、画面内のＹ信号平均値が所定値になるよう
にフレーム露光に適用する絞り値およびシャッタスピー
ドを制御する。
出制御部６はたとえばマイクロコンピュータなどによっ
て構成され、画面内のＹ信号平均値が所定値になるよう
にフレーム露光に適用する絞り値およびシャッタスピー
ドを制御する。
【０００６】ＡＧＣアンプ３のゲインは、十分な露出が
得られる場合にはＣＣＤ素子１の飽和レベルの最小値が
Ａ／Ｄ変換器４のフルスケールに一致するように露出制
御部６によって設定される。露出が不十分となるような
低照度では、不足している分だけＡＧＣアンプ３のゲイ
ンが高く設定される。いずれにおいても、ゲインはフレ
ーム露光前の数回のプリ露光により得られた結果に基づ
いて露出制御部６が設定する。
得られる場合にはＣＣＤ素子１の飽和レベルの最小値が
Ａ／Ｄ変換器４のフルスケールに一致するように露出制
御部６によって設定される。露出が不十分となるような
低照度では、不足している分だけＡＧＣアンプ３のゲイ
ンが高く設定される。いずれにおいても、ゲインはフレ
ーム露光前の数回のプリ露光により得られた結果に基づ
いて露出制御部６が設定する。
【０００７】ＣＣＤ素子１の出力信号の一部が飽和レベ
ルに達している場合、第１フィールドと第２フィールド
の飽和レベルに段差が生じ、第２フィールドに読出され
る信号の飽和レベルは第１フィールドのそれよりも通常
２０％程度低下する。
ルに達している場合、第１フィールドと第２フィールド
の飽和レベルに段差が生じ、第２フィールドに読出され
る信号の飽和レベルは第１フィールドのそれよりも通常
２０％程度低下する。
【０００８】これは、ＣＣＤ素子１の構造上原理的に発
生するものであり、露光時にセンサに蓄えられた電荷が
飽和信号量に達している場合、センサから垂直ＣＣＤに
転送するまでの期間に電荷が基板に放出されるためであ
る。
生するものであり、露光時にセンサに蓄えられた電荷が
飽和信号量に達している場合、センサから垂直ＣＣＤに
転送するまでの期間に電荷が基板に放出されるためであ
る。
【０００９】上述のごとく、ＡＧＣアンプ３のゲイン
は、第２フィールドでのＣＣＤ素子１の飽和レベルがＡ
／Ｄ変換器４のフルスケールに一致するように設定され
るため、第１フィールドの飽和点付近の信号はＡ／Ｄ変
換時にクリップされてしまう第１の問題点がある。
は、第２フィールドでのＣＣＤ素子１の飽和レベルがＡ
／Ｄ変換器４のフルスケールに一致するように設定され
るため、第１フィールドの飽和点付近の信号はＡ／Ｄ変
換時にクリップされてしまう第１の問題点がある。
【００１０】このクリップ現象について図６および図７
を参照して説明する。図６および図７は垂直傾斜波形が
得られる場合のフレーム露光終了後のＣＣＤ素子１の出
力信号を実線で示す図であり、図６では第１フィールド
にＭｇＧｒラインを、第２フィールドにＹｅＣｙライン
をそれぞれ読出すものとする。図７では反対に第１フィ
ールドにＹｅＣｙラインを、第２フィールドにＭｇＧｒ
ラインをそれぞれ読出すものとする。
を参照して説明する。図６および図７は垂直傾斜波形が
得られる場合のフレーム露光終了後のＣＣＤ素子１の出
力信号を実線で示す図であり、図６では第１フィールド
にＭｇＧｒラインを、第２フィールドにＹｅＣｙライン
をそれぞれ読出すものとする。図７では反対に第１フィ
ールドにＹｅＣｙラインを、第２フィールドにＭｇＧｒ
ラインをそれぞれ読出すものとする。
【００１１】第１および第２フィールドのＣＣＤ出力信
号の飽和レベルをＶＳ１，ＶＳ２とすると、前述の飽和
レベルの段差により、 ＶＳ１≒１．２ＶＳ２ となる。前述のＡＧＣアンプ３のゲイン設定により、Ａ
／Ｄ変換器４のフルスケール＝ＶＳ２とされるので、第
１フィールドに読出す信号は図６に示す一点鎖線の位置
でクリップされる。すなわち図６の場合はＭｇＧｒの、
図７の場合はＹｅＣｙの、ダイナミックレンジが約２０
％失われる。
号の飽和レベルをＶＳ１，ＶＳ２とすると、前述の飽和
レベルの段差により、 ＶＳ１≒１．２ＶＳ２ となる。前述のＡＧＣアンプ３のゲイン設定により、Ａ
／Ｄ変換器４のフルスケール＝ＶＳ２とされるので、第
１フィールドに読出す信号は図６に示す一点鎖線の位置
でクリップされる。すなわち図６の場合はＭｇＧｒの、
図７の場合はＹｅＣｙの、ダイナミックレンジが約２０
％失われる。
【００１２】次に、図８に示したような補色フィルタの
分光特性図から各ラインにおける水平加算信号Ｙｅ＋Ｃ
ｙ，Ｍｇ＋Ｇｒは図９に示す分光特性になる。２つの特
性曲線の全可視光域４００〜７００ｎｍに対する積分値
の比ｍは概ね次式で表わされる。
分光特性図から各ラインにおける水平加算信号Ｙｅ＋Ｃ
ｙ，Ｍｇ＋Ｇｒは図９に示す分光特性になる。２つの特
性曲線の全可視光域４００〜７００ｎｍに対する積分値
の比ｍは概ね次式で表わされる。
【００１３】ｍ＝∫（Ｙｅ＋Ｃｙ）ｄλ／∫（Ｍｇ＋Ｇ
ｒ）ｄλ≒１．２ したがって、Ｙ信号が２ライン周期で約２０％変調され
ることになり、折返し歪みが発生するため、垂直解像度
は劣化し、実際の撮影画像では斜線にギザが現われる。
ｒ）ｄλ≒１．２ したがって、Ｙ信号が２ライン周期で約２０％変調され
ることになり、折返し歪みが発生するため、垂直解像度
は劣化し、実際の撮影画像では斜線にギザが現われる。
【００１４】図１０は従来例の他の例を示すブロック図
である。この図１０に示した例はオーム社発行「エレク
トロニクス」１９９８年１月号ｐ２９で発表された例で
ある。すなわち、前述の図５に示したＡ／Ｄ変換器４と
Ｙ作成回路５との間に乗算回路８が配置され、セレクタ
７によってラインごとにＹｅＣｙゲインと、ＧｒＭｇゲ
インの異なる係数が切換えられ、その係数とＡ／Ｄ変換
器４の出力とが乗算器８によって乗算される。
である。この図１０に示した例はオーム社発行「エレク
トロニクス」１９９８年１月号ｐ２９で発表された例で
ある。すなわち、前述の図５に示したＡ／Ｄ変換器４と
Ｙ作成回路５との間に乗算回路８が配置され、セレクタ
７によってラインごとにＹｅＣｙゲインと、ＧｒＭｇゲ
インの異なる係数が切換えられ、その係数とＡ／Ｄ変換
器４の出力とが乗算器８によって乗算される。
【００１５】
【発明が解決しようとする課題】図１０に示した例で
は、乗算器８としてディジタル乗算器を用いる必要があ
り、その演算精度またはＬＳＩのゲート規模やパワーが
増大してしまうというトレードオフ関係にある問題が残
る。また、この例でも前述の第１フィールドの飽和点付
近の信号がＡ／Ｄ変換器４によってＡ／Ｄ変換するとき
にクリップされてしまうという問題点が残る。
は、乗算器８としてディジタル乗算器を用いる必要があ
り、その演算精度またはＬＳＩのゲート規模やパワーが
増大してしまうというトレードオフ関係にある問題が残
る。また、この例でも前述の第１フィールドの飽和点付
近の信号がＡ／Ｄ変換器４によってＡ／Ｄ変換するとき
にクリップされてしまうという問題点が残る。
【００１６】それゆに、この発明の主たる目的は、上述
の２つの問題点を解消し、演算精度やＬＳＩのゲート規
模およびパワーを増大させないようなＡＧＣ変調回路を
提供することである。
の２つの問題点を解消し、演算精度やＬＳＩのゲート規
模およびパワーを増大させないようなＡＧＣ変調回路を
提供することである。
【００１７】
【課題を解決するための手段】請求項１に係る発明は、
各画素に対してＹｅ，Ｃｙ，Ｇｒ，Ｍｇの４種類の補色
の色フィルタが配列されたインターレース・スキャン型
ＣＣＤ撮像素子から、メカニカルシャッタを用いて全画
素を独立して読出し、読出した信号をＡＧＣアンプによ
って増幅した後、Ａ／Ｄ変換器によりディジタル信号に
変換するスチルカメラにおいて、メカニカルシャッタを
閉じた後、感度の高いラインの信号電荷を第１フィール
ド期間に読出し、感度の低いラインの信号電荷を第２フ
ィールド期間に読出し、第１のフィールド期間のＡＧＣ
アンプゲインを第２のフィールド期間のそれに対してあ
る比率だけ低く設定するように制御する制御手段を備え
て構成される。
各画素に対してＹｅ，Ｃｙ，Ｇｒ，Ｍｇの４種類の補色
の色フィルタが配列されたインターレース・スキャン型
ＣＣＤ撮像素子から、メカニカルシャッタを用いて全画
素を独立して読出し、読出した信号をＡＧＣアンプによ
って増幅した後、Ａ／Ｄ変換器によりディジタル信号に
変換するスチルカメラにおいて、メカニカルシャッタを
閉じた後、感度の高いラインの信号電荷を第１フィール
ド期間に読出し、感度の低いラインの信号電荷を第２フ
ィールド期間に読出し、第１のフィールド期間のＡＧＣ
アンプゲインを第２のフィールド期間のそれに対してあ
る比率だけ低く設定するように制御する制御手段を備え
て構成される。
【００１８】請求項２に係る発明では、請求項１の制御
手段は、第１および第２のフィールドごとにＡ／Ｄ変換
器から出力されたディジタル信号を積分し、それぞれの
フィールドごとの積分値の比を求めて比率を設定する。
手段は、第１および第２のフィールドごとにＡ／Ｄ変換
器から出力されたディジタル信号を積分し、それぞれの
フィールドごとの積分値の比を求めて比率を設定する。
【００１９】請求項３に係る発明では、第１のフィール
ド期間でＹｅ，Ｃｙラインの信号電荷を読出し、第２の
フィールド期間でＧｒ，Ｍｇラインの信号電荷を読出
す。
ド期間でＹｅ，Ｃｙラインの信号電荷を読出し、第２の
フィールド期間でＧｒ，Ｍｇラインの信号電荷を読出
す。
【００２０】
【発明の実施の形態】図１はこの発明の一実施形態のブ
ロック図である。図１において、ＣＣＤ素子１〜Ｙ作成
回路５の構成は前述の図５と同じであり、ＡＧＣアンプ
３を制御する露出制御部１０のみが異なっている。ま
た、図１０に示した従来例では、Ａ／Ｄ変換器４の後段
の乗算器８にＹ信号作成用としてＹｅＣｙラインと、Ｍ
ｇＧｒラインに異なる係数を掛けるようにしたが、この
例では、たとえばマイクロコンピュータによって構成さ
れた露出制御部１０によってＡＧＣアンプ３に異なる係
数を掛けるようにしている。
ロック図である。図１において、ＣＣＤ素子１〜Ｙ作成
回路５の構成は前述の図５と同じであり、ＡＧＣアンプ
３を制御する露出制御部１０のみが異なっている。ま
た、図１０に示した従来例では、Ａ／Ｄ変換器４の後段
の乗算器８にＹ信号作成用としてＹｅＣｙラインと、Ｍ
ｇＧｒラインに異なる係数を掛けるようにしたが、この
例では、たとえばマイクロコンピュータによって構成さ
れた露出制御部１０によってＡＧＣアンプ３に異なる係
数を掛けるようにしている。
【００２１】図２は、この発明の一実施形態における、
フレーム露光後のＣＣＤ素子１の出力信号を示す図であ
り、図７と同様に垂直傾斜波形を想定したうえで、第１
フィールドにＹｅＣｙラインを、第２フィールドにＭｇ
Ｇｒラインをそれぞれ読出すものとする。ここでＣＣＤ
素子１の出力信号を実線で示す。
フレーム露光後のＣＣＤ素子１の出力信号を示す図であ
り、図７と同様に垂直傾斜波形を想定したうえで、第１
フィールドにＹｅＣｙラインを、第２フィールドにＭｇ
Ｇｒラインをそれぞれ読出すものとする。ここでＣＣＤ
素子１の出力信号を実線で示す。
【００２２】いま仮に、フィールド間の飽和レベル比Ｓ
（＝ＶＳ１／ＶＳ２）と感度比ｍとが Ｓ＝ｍ＝１．２ という前提で考える。
（＝ＶＳ１／ＶＳ２）と感度比ｍとが Ｓ＝ｍ＝１．２ という前提で考える。
【００２３】露出制御部１０は、図示の第１フィールド
パルスに同期してフィールドによってＡＧＣアンプ３の
ゲインを切換える。つまり、同ゲインを第１フィールド
に１／１．２倍、第２フィールドに１倍に設定する。こ
の結果、ＡＧＣアンプ３の出力信号は図２の一点鎖線で
示すように、第１フィールドの傾斜および飽和レベルを
第２フィールドのそれらに完全に一致させることができ
るので、従来例で述べたダイナミックレンジの損失およ
び折り返し歪みという２つの問題とも１００％解決でき
る。
パルスに同期してフィールドによってＡＧＣアンプ３の
ゲインを切換える。つまり、同ゲインを第１フィールド
に１／１．２倍、第２フィールドに１倍に設定する。こ
の結果、ＡＧＣアンプ３の出力信号は図２の一点鎖線で
示すように、第１フィールドの傾斜および飽和レベルを
第２フィールドのそれらに完全に一致させることができ
るので、従来例で述べたダイナミックレンジの損失およ
び折り返し歪みという２つの問題とも１００％解決でき
る。
【００２４】実際のＣＣＤ素子１についてのＳ、ｍはそ
れぞればらつきを生じるため、ばらつきに左右されず、
過不足なく正確に補正するためにＳまたはｍをスチルカ
メラ製造時に実測する方法もある。たとえば、ｍについ
てはライトボックスを適正露出で撮像した非飽和出力デ
ータをもとに計算する。Ｓについてはライトボックスを
最大露出で撮像して得られる全画面飽和したデータをも
とに計算する。実測したＳ、ｍからのＡＧＣアンプ３の
フィールド間ゲイン比、つまりＡＧＣ変調度を設定する
場合の方法は、ダイナミックレンジと折り返し歪み除去
との優先度などを考慮して設定すればよい。
れぞればらつきを生じるため、ばらつきに左右されず、
過不足なく正確に補正するためにＳまたはｍをスチルカ
メラ製造時に実測する方法もある。たとえば、ｍについ
てはライトボックスを適正露出で撮像した非飽和出力デ
ータをもとに計算する。Ｓについてはライトボックスを
最大露出で撮像して得られる全画面飽和したデータをも
とに計算する。実測したＳ、ｍからのＡＧＣアンプ３の
フィールド間ゲイン比、つまりＡＧＣ変調度を設定する
場合の方法は、ダイナミックレンジと折り返し歪み除去
との優先度などを考慮して設定すればよい。
【００２５】図３はこの発明の他の実施の形態のブロッ
ク図である。この実施の形態は、図１０に示したように
設計段階でライン間の感度比ｍを計算するのではなく、
ユーザが実際に使用するときにライン間の感度比ｍと飽
和レベル比ＳをＡＧＣアンプ３に設定するようにしたも
のである。このために、Ａ／Ｄ変換器４の出力にはＡＥ
積分回路１１が設けられる。ＡＥ積分回路１１は、Ａ／
Ｄ変換器４の出力に基づいて輝度信号を生成するととも
に、第１フィールドおよび第２フィールドのそれぞれに
対応した信号が入力されると、各フィールドごとに積分
演算を行ない、ライン間の感度比ｍと飽和レベル比Ｓを
演算し、露出制御部６がその感度比ｍと飽和レベル比Ｓ
をＡＧＣアンプ３に設定する。この設定動作は、電源ス
イッチをオンしたときあるいはキャリブレーションキー
を設けてそのキーが操作されたときに設定するようにす
ればよい。
ク図である。この実施の形態は、図１０に示したように
設計段階でライン間の感度比ｍを計算するのではなく、
ユーザが実際に使用するときにライン間の感度比ｍと飽
和レベル比ＳをＡＧＣアンプ３に設定するようにしたも
のである。このために、Ａ／Ｄ変換器４の出力にはＡＥ
積分回路１１が設けられる。ＡＥ積分回路１１は、Ａ／
Ｄ変換器４の出力に基づいて輝度信号を生成するととも
に、第１フィールドおよび第２フィールドのそれぞれに
対応した信号が入力されると、各フィールドごとに積分
演算を行ない、ライン間の感度比ｍと飽和レベル比Ｓを
演算し、露出制御部６がその感度比ｍと飽和レベル比Ｓ
をＡＧＣアンプ３に設定する。この設定動作は、電源ス
イッチをオンしたときあるいはキャリブレーションキー
を設けてそのキーが操作されたときに設定するようにす
ればよい。
【００２６】
【発明の効果】以上のように、この発明によれば、感度
の高いラインの信号電荷を第１フィールド期間に読出
し、感度の低いラインの信号電荷を第２フィールド期間
に読出すとき、第１のフィールド期間のＡＧＣアンプの
ゲインを第２フィールド期間のそれに対してある比率だ
け低く設定するようにしたので、演算精度やＬＳＩのゲ
ート規模およびパワーを増大させることはなく、ダイナ
ミックレンジ増加と折り返し歪み除去とを実現できる。
の高いラインの信号電荷を第１フィールド期間に読出
し、感度の低いラインの信号電荷を第２フィールド期間
に読出すとき、第１のフィールド期間のＡＧＣアンプの
ゲインを第２フィールド期間のそれに対してある比率だ
け低く設定するようにしたので、演算精度やＬＳＩのゲ
ート規模およびパワーを増大させることはなく、ダイナ
ミックレンジ増加と折り返し歪み除去とを実現できる。
【図１】この発明の一実施形態の信号処理ブロック図で
ある。
ある。
【図２】この発明の一実施形態におけるフレーム露光後
のＣＣＤ素子１の出力信号を示す図である。
のＣＣＤ素子１の出力信号を示す図である。
【図３】この発明の他の実施形態のブロック図である。
【図４】補色フィルタの配列を示す図である。
【図５】従来のインターレース・スキャン型ＣＣＤ撮像
素子を用いたスチールカメラの輝度信号を作成するまで
の信号処理ブロック図である。
素子を用いたスチールカメラの輝度信号を作成するまで
の信号処理ブロック図である。
【図６】垂直傾斜波形が得られる場合のフレームの露光
終了後の第１フィールドにＭｇＧｒラインを、第２フィ
ールドにＹｅＣｙラインを読出したときのＣＣＤ素子１
の出力信号を示す図である。
終了後の第１フィールドにＭｇＧｒラインを、第２フィ
ールドにＹｅＣｙラインを読出したときのＣＣＤ素子１
の出力信号を示す図である。
【図７】同様にして、第１フィールドにＹｅＣｙライン
を、第２フィールドにＭｇＧｒラインを読出したときの
ＣＣＤ素子１の出力信号を示す図である。
を、第２フィールドにＭｇＧｒラインを読出したときの
ＣＣＤ素子１の出力信号を示す図である。
【図８】図４に示した補色フィルタの分光特性図であ
る。
る。
【図９】各ラインから得られる水平加算信号の分光特性
図である。
図である。
【図１０】従来例の他の例を示すブロック図である。
１ ＣＣＤ素子 ２ ＣＤＳ回路 ３ ＡＧＣアンプ ４ Ａ／Ｄ変換器 ６，１０ 露出制御部 １１ ＡＥ積分回路
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成１１年２月５日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】発明の名称
【補正方法】変更
【補正内容】
【発明の名称】 撮像装置
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正内容】
【特許請求の範囲】
Claims (3)
- 【請求項１】 各画素に対してＹｅ，Ｃｙ，Ｇｒ，Ｍｇ
の４種類の補色の色フィルタが配列されたインターレー
ススキャン型ＣＣＤ撮像素子から、メカニカルシャッタ
を用いて全画素を独立して読出し、読出した信号をＡＧ
Ｃアンプによって増幅した後、Ａ／Ｄ変換器によりディ
ジタル信号に変換するスチルカメラにおいて、 前記メカニカルシャッタを閉じた後、感度の高いライン
の信号電荷を第１フィールド期間に読出し、感度の低い
ラインの信号電荷を第２フィールド期間に読出し、前記
第１のフィールド期間の前記ＡＧＣアンプのゲインを前
記第２のフィールド期間のそれに対してある比率だけ低
く設定するように制御する制御手段を備えたことを特徴
とする、ＡＧＣ変調回路。 - 【請求項２】 前記制御手段は、前記第１および第２の
フィールドごとに、前記Ａ／Ｄ変換器から出力されたデ
ィジタル信号を積分し、それぞれのフィールドごとの積
分値の比を求めて前記比率を設定することを特徴とす
る、請求項１に記載のＡＧＣ変調回路。 - 【請求項３】 前記第１のフィールド期間でＹｅ，Ｃｙ
ラインの信号電荷を読出し、 前記第２のフィールド期間でＧｒ，Ｍｇラインの信号電
荷を読出すことを特徴とする、請求項１または２に記載
のＡＧＣ変調回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP05816298A JP3540593B2 (ja) | 1998-03-10 | 1998-03-10 | 撮像装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP05816298A JP3540593B2 (ja) | 1998-03-10 | 1998-03-10 | 撮像装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11261921A true JPH11261921A (ja) | 1999-09-24 |
| JP3540593B2 JP3540593B2 (ja) | 2004-07-07 |
Family
ID=13076307
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP05816298A Expired - Fee Related JP3540593B2 (ja) | 1998-03-10 | 1998-03-10 | 撮像装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3540593B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8045059B2 (en) | 2006-02-08 | 2011-10-25 | Samsung Electronics Co., Ltd. | Gain control circuit and method of controlling gain |
| JP2016158940A (ja) * | 2015-03-03 | 2016-09-05 | オリンパス株式会社 | 撮像装置及びその作動方法 |
-
1998
- 1998-03-10 JP JP05816298A patent/JP3540593B2/ja not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8045059B2 (en) | 2006-02-08 | 2011-10-25 | Samsung Electronics Co., Ltd. | Gain control circuit and method of controlling gain |
| JP2016158940A (ja) * | 2015-03-03 | 2016-09-05 | オリンパス株式会社 | 撮像装置及びその作動方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3540593B2 (ja) | 2004-07-07 |
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