JPH11134189A - メモリカ−ドと認証デ−タ作成装置とメモリカ−ド装置 - Google Patents
メモリカ−ドと認証デ−タ作成装置とメモリカ−ド装置Info
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- JPH11134189A JPH11134189A JP9298446A JP29844697A JPH11134189A JP H11134189 A JPH11134189 A JP H11134189A JP 9298446 A JP9298446 A JP 9298446A JP 29844697 A JP29844697 A JP 29844697A JP H11134189 A JPH11134189 A JP H11134189A
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Abstract
(57)【要約】
【課題】 アプリケ−ションプログラムを実行する前に
メモリカ−ドの真偽をチェックできるメモリカ−ド装置
と、その真偽のチェックに用いる認証デ−タを作成して
メモリカ−ドに格納する認証デ−タ作成装置とを提供す
る。 【解決手段】 アプリケ−ションプログラム２からラン
ダムに読み出されたアドレスとそのアドレスに格納され
たデ−タとを秘密キ−８により暗号化した認証デ−タ９
をメモリカ−ド５に格納し、メモリカ−ド５から認証デ
−タ９を読み出して秘密キ−８により復号化し、復号化
されたアドレスに基づきアプリケ−ションプログラム２
から読み出したデ−タと復号化されたデ−タとを比較し
てメモリカ−ド５の真偽をチェックする。
メモリカ−ドの真偽をチェックできるメモリカ−ド装置
と、その真偽のチェックに用いる認証デ−タを作成して
メモリカ−ドに格納する認証デ−タ作成装置とを提供す
る。 【解決手段】 アプリケ−ションプログラム２からラン
ダムに読み出されたアドレスとそのアドレスに格納され
たデ−タとを秘密キ−８により暗号化した認証デ−タ９
をメモリカ−ド５に格納し、メモリカ−ド５から認証デ
−タ９を読み出して秘密キ−８により復号化し、復号化
されたアドレスに基づきアプリケ−ションプログラム２
から読み出したデ−タと復号化されたデ−タとを比較し
てメモリカ−ド５の真偽をチェックする。
Description
【０００１】
【発明の属する技術分野】本発明は電子商取引に使用さ
れる携帯型電子機器等のメモリカ−ドを使用するメモリ
カ−ド装置と、そのメモリカ−ドに格納する認証デ−タ
を作成する認証デ−タ作成装置とに関する。
れる携帯型電子機器等のメモリカ−ドを使用するメモリ
カ−ド装置と、そのメモリカ−ドに格納する認証デ−タ
を作成する認証デ−タ作成装置とに関する。
【０００２】
【従来の技術】従来、メモリカ−ド装置、例えば、電子
商取引に使用される携帯型電子機器では、アプリケ−シ
ョンプログラムが格納されてあるメモリカ−ドをメモリ
カ−ド装置に挿入すると、アプリケ−ションプログラム
が即、実行される。
商取引に使用される携帯型電子機器では、アプリケ−シ
ョンプログラムが格納されてあるメモリカ−ドをメモリ
カ−ド装置に挿入すると、アプリケ−ションプログラム
が即、実行される。
【０００３】
【発明が解決しようとする課題】従来のメモリカ−ド装
置にあっては、メモリカ−ドの真偽をチェックする機能
が設けてないので、メモリカ−ドがメモリカ−ド装置に
挿入されると、たとえ不正なアプリケ−ションプログラ
ムが実装してあっても実行されてしまい、電子商取引の
内容が書き替えられてしまう恐れがあるという問題点が
あった。
置にあっては、メモリカ−ドの真偽をチェックする機能
が設けてないので、メモリカ−ドがメモリカ−ド装置に
挿入されると、たとえ不正なアプリケ−ションプログラ
ムが実装してあっても実行されてしまい、電子商取引の
内容が書き替えられてしまう恐れがあるという問題点が
あった。
【０００４】本発明はアプリケ−ションプログラムを実
行する前にメモリカ−ドの真偽をチェックできるメモリ
カ−ド装置と、その真偽のチェックに用いる認証デ−タ
を作成してメモリカ−ドに格納する認証デ−タ作成装置
とを提供することを目的としている。
行する前にメモリカ−ドの真偽をチェックできるメモリ
カ−ド装置と、その真偽のチェックに用いる認証デ−タ
を作成してメモリカ−ドに格納する認証デ−タ作成装置
とを提供することを目的としている。
【０００５】
【課題を解決するための手段】上記目的を達成するため
に本発明は、アプリケ−ションプログラムからランダム
に読み出されたアドレスと該アドレスに格納されたデ−
タとを秘密キ−により暗号化した認証デ−タをメモリカ
−ドに格納する認証デ−タ作成装置と、メモリカ−ドか
ら認証デ−タを読み出して秘密キ−により復号化し、復
号化されたアドレスに基づきアプリケ−ションプログラ
ムから読み出したデ−タと復号化されたデ−タとを比較
してメモリカ−ドの真偽をチェックするメモリカ−ド装
置とを備える。
に本発明は、アプリケ−ションプログラムからランダム
に読み出されたアドレスと該アドレスに格納されたデ−
タとを秘密キ−により暗号化した認証デ−タをメモリカ
−ドに格納する認証デ−タ作成装置と、メモリカ−ドか
ら認証デ−タを読み出して秘密キ−により復号化し、復
号化されたアドレスに基づきアプリケ−ションプログラ
ムから読み出したデ−タと復号化されたデ−タとを比較
してメモリカ−ドの真偽をチェックするメモリカ−ド装
置とを備える。
【０００６】
【発明の実施の形態】本発明の実施の形態について図面
を参照しながら説明する。尚、各図面に共通な要素には
同一符号を付す。第１の実施の形態 図２はメモリカ−ドライタの構成を示すブロック図であ
る。メモリカ−ドライタ１は、後述するメモリカ−ド装
置で実行されるアプリケ−ションプログラム２（以後Ａ
Ｐ２と記す）を格納した媒体３（以後ＡＰ媒体３と記
す）を挿抜するＡＰ用Ｉ／Ｏスロット４と、メモリカ−
ド５を挿抜するメモリカ−ド接続用Ｉ／Ｏスロット６
と、書き込み開始スイッチ７とを有する。
を参照しながら説明する。尚、各図面に共通な要素には
同一符号を付す。第１の実施の形態 図２はメモリカ−ドライタの構成を示すブロック図であ
る。メモリカ−ドライタ１は、後述するメモリカ−ド装
置で実行されるアプリケ−ションプログラム２（以後Ａ
Ｐ２と記す）を格納した媒体３（以後ＡＰ媒体３と記
す）を挿抜するＡＰ用Ｉ／Ｏスロット４と、メモリカ−
ド５を挿抜するメモリカ−ド接続用Ｉ／Ｏスロット６
と、書き込み開始スイッチ７とを有する。
【０００７】ＡＰ媒体３、メモリカ−ド５はＡＰ用Ｉ／
Ｏスロット４、メモリカ−ド接続用Ｉ／Ｏスロット６に
設けられた図示せぬコネクタに挿抜する端子部３ａ、５
ａを有する。
Ｏスロット４、メモリカ−ド接続用Ｉ／Ｏスロット６に
設けられた図示せぬコネクタに挿抜する端子部３ａ、５
ａを有する。
【０００８】メモリカ−ドライタ１には、ＡＰ２の実行
コ−ドから、例えば１ＫＢ（キロバイト）程度のアドレ
スとデ−タとのセットをランダムに選択し、そのセット
デ−タを秘密キ−８（以後秘密ＫＥＹ８と記す）を用い
て暗号化し、認証デ−タ９としてメモリカ−ド５に格納
する認証デ−タ作成手段１０と、ＡＰ２をメモリカ−ド
５に書き込むＡＰ書き込み手段１１とを内蔵している。
コ−ドから、例えば１ＫＢ（キロバイト）程度のアドレ
スとデ−タとのセットをランダムに選択し、そのセット
デ−タを秘密キ−８（以後秘密ＫＥＹ８と記す）を用い
て暗号化し、認証デ−タ９としてメモリカ−ド５に格納
する認証デ−タ作成手段１０と、ＡＰ２をメモリカ−ド
５に書き込むＡＰ書き込み手段１１とを内蔵している。
【０００９】具体的には、図示せぬメモリに格納してあ
る認証デ−タ作成プログラム、ＡＰ書き込みプログラム
をＣＰＵ１２が実行することによって各手段を達成す
る。
る認証デ−タ作成プログラム、ＡＰ書き込みプログラム
をＣＰＵ１２が実行することによって各手段を達成す
る。
【００１０】アドレスとデ−タとのセットをランダムに
選択するには、例えば、乱数を発生させ、その乱数でア
ドレスを構成してデ−タを選択するプログラムを認証デ
−タ作成プログラムに含ませておく。
選択するには、例えば、乱数を発生させ、その乱数でア
ドレスを構成してデ−タを選択するプログラムを認証デ
−タ作成プログラムに含ませておく。
【００１１】図３はメモリカ−ド装置の外観斜視図、図
４は図３に示したメモリカ−ド装置に搭載される制御ブ
ロック図である。メモリカ−ド装置１３、例えば、電子
商取引に使用される携帯型電子機器は、表面に操作キ−
群１４、表示部１５を備えてある。側面には矢印Ａ−Ｂ
方向にメモリカ−ド５を挿抜する際に用いるメモリカ−
ド挿入口１６及びメモリカ−ド挿入口１６に挿入した際
メモリカ−ド５をロックする矢印Ｃ−Ｄ方向に移動自在
なスライダ１７を有する。
４は図３に示したメモリカ−ド装置に搭載される制御ブ
ロック図である。メモリカ−ド装置１３、例えば、電子
商取引に使用される携帯型電子機器は、表面に操作キ−
群１４、表示部１５を備えてある。側面には矢印Ａ−Ｂ
方向にメモリカ−ド５を挿抜する際に用いるメモリカ−
ド挿入口１６及びメモリカ−ド挿入口１６に挿入した際
メモリカ−ド５をロックする矢印Ｃ−Ｄ方向に移動自在
なスライダ１７を有する。
【００１２】操作キ−群１４には電源ボタン１４ａ、リ
セットボタン１４ｂ、テンキ−等があり、表示部１５に
は操作に伴うメッセ−ジが表示される。
セットボタン１４ｂ、テンキ−等があり、表示部１５に
は操作に伴うメッセ−ジが表示される。
【００１３】メモリカ−ド装置１３の内部には、メモリ
カ−ド挿入口１６から挿入されるメモリカ−ド５と並行
になるように、破線で示す基板１８が搭載してある。基
板１８には、図４に示すように、中央処理装置１９（以
後ＣＰＵ１９と記す）、ＲＯＭ２０、ＲＡＭ２１、バッ
テリ−２２等が搭載されてある。バッテリ−２２はＣＰ
Ｕ１９、ＲＯＭ２０、ＲＡＭ２１にライン２３を通じて
電力を供給し、ＣＰＵ１９はＲＯＭ２０、ＲＡＭ２１と
バスライン２４で接続されている。
カ−ド挿入口１６から挿入されるメモリカ−ド５と並行
になるように、破線で示す基板１８が搭載してある。基
板１８には、図４に示すように、中央処理装置１９（以
後ＣＰＵ１９と記す）、ＲＯＭ２０、ＲＡＭ２１、バッ
テリ−２２等が搭載されてある。バッテリ−２２はＣＰ
Ｕ１９、ＲＯＭ２０、ＲＡＭ２１にライン２３を通じて
電力を供給し、ＣＰＵ１９はＲＯＭ２０、ＲＡＭ２１と
バスライン２４で接続されている。
【００１４】ＲＯＭ２０には制御プログラム２０ａ、認
証プログラム２０ｂ、秘密キ−８（以後秘密ＫＥＹ８と
記す）が格納してあり、ＲＡＭ２１はメモリカ−ド５か
ら読み込まれたＡＰ２の格納や各種処理時のデ−タ格納
に用いられる。秘密ＫＥＹ８はメモリカ−ド５の認証デ
−タ９を復号化する際に用いられるもので外部からの読
み出しに対しプロテクトされてある。
証プログラム２０ｂ、秘密キ−８（以後秘密ＫＥＹ８と
記す）が格納してあり、ＲＡＭ２１はメモリカ−ド５か
ら読み込まれたＡＰ２の格納や各種処理時のデ−タ格納
に用いられる。秘密ＫＥＹ８はメモリカ−ド５の認証デ
−タ９を復号化する際に用いられるもので外部からの読
み出しに対しプロテクトされてある。
【００１５】ＣＰＵ１９は認証プログラム２０ｂを実行
することによりメモリカ−ド認証手段２６となり、メモ
リカ−ド５が真の場合には表示部１５に「ＡＰの実行に
移る」旨のメッセ−ジを表示するとともに、ＲＡＭ２１
にメモリカ−ド５が真であることを示す認証ＯＫフラグ
デ−タ２１ａをセットする。
することによりメモリカ−ド認証手段２６となり、メモ
リカ−ド５が真の場合には表示部１５に「ＡＰの実行に
移る」旨のメッセ−ジを表示するとともに、ＲＡＭ２１
にメモリカ−ド５が真であることを示す認証ＯＫフラグ
デ−タ２１ａをセットする。
【００１６】また、ＣＰＵ１９は制御プログラム２０ａ
を実行することによりタイマ手段２５、低電力消費モ−
ド切替手段２７、カ−ド実装チェック手段２８、カ−ド
引き抜きチェック手段２９等になる。
を実行することによりタイマ手段２５、低電力消費モ−
ド切替手段２７、カ−ド実装チェック手段２８、カ−ド
引き抜きチェック手段２９等になる。
【００１７】低電力消費モ−ド切替手段２７はタイマ手
段２５を用い、待ち状態が予め決められた時間経過する
と、ＣＰＵ１９をホ−ルド状態に切り替え、無駄な電力
消費を抑える。カ−ド実装チェック手段２８はメモリカ
−ド５の端子部５ａが差し込まれるコネクタの状況を表
すレジスタの内容をタイマ手段２５を用い、例えば１秒
割り込みで確認する。
段２５を用い、待ち状態が予め決められた時間経過する
と、ＣＰＵ１９をホ−ルド状態に切り替え、無駄な電力
消費を抑える。カ−ド実装チェック手段２８はメモリカ
−ド５の端子部５ａが差し込まれるコネクタの状況を表
すレジスタの内容をタイマ手段２５を用い、例えば１秒
割り込みで確認する。
【００１８】また、スライダ１７を矢印Ｄ方向に移動さ
せると、マスク不可能な割り込み信号（ＮＭＩ）がＣＰ
Ｕ１９に送られ、カ−ド引き抜きチェック手段２９がＲ
ＡＭ２１の認証ＯＫフラグデ−タ２１ａをクリアする。
せると、マスク不可能な割り込み信号（ＮＭＩ）がＣＰ
Ｕ１９に送られ、カ−ド引き抜きチェック手段２９がＲ
ＡＭ２１の認証ＯＫフラグデ−タ２１ａをクリアする。
【００１９】次に動作について説明する。先ず、図５を
参照してメモリカ−ドライタ１の動作について説明す
る。ＡＰ２を格納したＡＰ媒体３、何も書き込まれてい
ないメモリカ−ド５を、それぞれ、ＡＰ用Ｉ／Ｏスロッ
ト４、メモリカ−ド接続用Ｉ／Ｏスロット６に挿入し、
書き込み開始スイッチ７を押下する。
参照してメモリカ−ドライタ１の動作について説明す
る。ＡＰ２を格納したＡＰ媒体３、何も書き込まれてい
ないメモリカ−ド５を、それぞれ、ＡＰ用Ｉ／Ｏスロッ
ト４、メモリカ−ド接続用Ｉ／Ｏスロット６に挿入し、
書き込み開始スイッチ７を押下する。
【００２０】ＣＰＵ１２はＡＰ書き込み手段１１として
ＡＰ媒体３からＡＰ２を読み込み、メモリカ−ド５に書
き込む。
ＡＰ媒体３からＡＰ２を読み込み、メモリカ−ド５に書
き込む。
【００２１】次に、ＣＰＵ１２は認証デ−タ作成手段１
０としてＡＰ２からアドレスとデ−タとのセット２ａを
ランダムに選択し、そのセットデ−タ２ａを秘密ＫＥＹ
８を用いて暗号化し、認証デ−タ９としてメモリカ−ド
５に書き込む。
０としてＡＰ２からアドレスとデ−タとのセット２ａを
ランダムに選択し、そのセットデ−タ２ａを秘密ＫＥＹ
８を用いて暗号化し、認証デ−タ９としてメモリカ−ド
５に書き込む。
【００２２】次に、図１、図６を参照してメモリカ−ド
認証動作について説明する。図１は第１の実施の形態に
よるメモリカ−ド認証動作の説明図（１）、図６は第１
の実施の形態によるリセットボタン押下後の動作を示す
フロ−チャ−ト（１）である。メモリカ−ド５の端子部
５ａをメモリカ−ド装置１３のメモリカ−ド挿入口１６
から矢印Ａ方向へ挿入する。端子部５ａはメモリカ−ド
装置１３の内部に設けられた図示せぬコネクタに差し込
まれる。
認証動作について説明する。図１は第１の実施の形態に
よるメモリカ−ド認証動作の説明図（１）、図６は第１
の実施の形態によるリセットボタン押下後の動作を示す
フロ−チャ−ト（１）である。メモリカ−ド５の端子部
５ａをメモリカ−ド装置１３のメモリカ−ド挿入口１６
から矢印Ａ方向へ挿入する。端子部５ａはメモリカ−ド
装置１３の内部に設けられた図示せぬコネクタに差し込
まれる。
【００２３】メモリカ−ド５には、メモリカ−ドライタ
１によりＡＰ２、認証デ−タ９が格納されてある。リセ
ットボタン１４ｂが押下されると、ステップＳ1 でＣＰ
Ｕ１９は制御プログラム２０ａに基づきメモリカ−ド装
置１３を初期化する。初期化によって、ＲＡＭ２１の認
証ＯＫフラグデ−タ２１ａもクリアされる。
１によりＡＰ２、認証デ−タ９が格納されてある。リセ
ットボタン１４ｂが押下されると、ステップＳ1 でＣＰ
Ｕ１９は制御プログラム２０ａに基づきメモリカ−ド装
置１３を初期化する。初期化によって、ＲＡＭ２１の認
証ＯＫフラグデ−タ２１ａもクリアされる。
【００２４】ステップＳ2 でＣＰＵ１９はメモリカ−ド
認証手段２６として、図１に示すように、メモリカ−ド
５からＡＰ２を読み出し、ＲＡＭ２１に格納する。ステ
ップＳ3 でメモリカ−ド５から認証デ−タ９を読み出
し、秘密ＫＥＹ８を用いて復号化し、復号デ−タとして
ＲＡＭ２１に格納する。
認証手段２６として、図１に示すように、メモリカ−ド
５からＡＰ２を読み出し、ＲＡＭ２１に格納する。ステ
ップＳ3 でメモリカ−ド５から認証デ−タ９を読み出
し、秘密ＫＥＹ８を用いて復号化し、復号デ−タとして
ＲＡＭ２１に格納する。
【００２５】ステップＳ4 で復号デ−タのアドレスに基
づいてＲＡＭ２１に格納してあるＡＰ２からデ−タを読
み出す。即ち、ＣＰＵ１９は復号デ−タのアドレスを図
示せぬプログラムカウンタに入力し、ＲＡＭ２１に格納
してあるＡＰ２からデ−タを読み出す。
づいてＲＡＭ２１に格納してあるＡＰ２からデ−タを読
み出す。即ち、ＣＰＵ１９は復号デ−タのアドレスを図
示せぬプログラムカウンタに入力し、ＲＡＭ２１に格納
してあるＡＰ２からデ−タを読み出す。
【００２６】ステップＳ5 でＡＰ２から読み出したデ−
タと復号デ−タのデ−タとを比較する。即ち、ＣＰＵ１
９はＡＰ２から読み出したデ−タと復号デ−タのデ−タ
とを図示せぬ演算部のレジスタにセットして比較する。
ステップＳ6 で一致ならばステップＳ7 に分岐し、否な
らばステップＳ9 に分岐する。
タと復号デ−タのデ−タとを比較する。即ち、ＣＰＵ１
９はＡＰ２から読み出したデ−タと復号デ−タのデ−タ
とを図示せぬ演算部のレジスタにセットして比較する。
ステップＳ6 で一致ならばステップＳ7 に分岐し、否な
らばステップＳ9 に分岐する。
【００２７】ステップＳ7 で比較するデ−タが未だ有る
か否かをチェックし、有ればステップＳ5 に分岐し、否
ならばステップＳ8 に分岐する。ステップＳ8 でＣＰＵ
１９は表示部１５に「ＡＰの実行に移る」旨のメッセ−
ジを表示するとともに、ＲＡＭ２１に認証ＯＫフラグデ
−タ２１ａをセットし、メモリカ−ド認証動作を終了す
る。
か否かをチェックし、有ればステップＳ5 に分岐し、否
ならばステップＳ8 に分岐する。ステップＳ8 でＣＰＵ
１９は表示部１５に「ＡＰの実行に移る」旨のメッセ−
ジを表示するとともに、ＲＡＭ２１に認証ＯＫフラグデ
−タ２１ａをセットし、メモリカ−ド認証動作を終了す
る。
【００２８】ステップＳ9 でＣＰＵ１９は表示部１５に
「メモリカ−ドは不正である」旨のメッセ−ジを表示し
てメモリカ−ド認証動作を終了する。
「メモリカ−ドは不正である」旨のメッセ−ジを表示し
てメモリカ−ド認証動作を終了する。
【００２９】次に図７を参照して電源ボタン押下後の動
作を説明する。図７は第１の実施の形態による電源ボタ
ン押下後の動作を示すフロ−チャ−ト（１）である。電
源ボタン１４ａが押下されると、ステップＳ10でＣＰＵ
１９はメモリカ−ド認証手段２６として、ＲＡＭ２１の
認証ＯＫフラグデ−タ２１ａがセットされているか否か
をチェックし、セットされていればステップＳ11に分岐
し、否ならばステップＳ12に分岐する。
作を説明する。図７は第１の実施の形態による電源ボタ
ン押下後の動作を示すフロ−チャ−ト（１）である。電
源ボタン１４ａが押下されると、ステップＳ10でＣＰＵ
１９はメモリカ−ド認証手段２６として、ＲＡＭ２１の
認証ＯＫフラグデ−タ２１ａがセットされているか否か
をチェックし、セットされていればステップＳ11に分岐
し、否ならばステップＳ12に分岐する。
【００３０】ステップＳ11でＣＰＵ１９は表示部１５に
「ＡＰの実行に移る」旨のメッセ−ジを表示し、メモリ
カ−ド認証動作を終了する。ステップＳ12でＣＰＵ１９
は表示部１５に「メモリカ−ドは不正である」旨のメッ
セ−ジを表示し、メモリカ−ド認証動作を終了する。
「ＡＰの実行に移る」旨のメッセ−ジを表示し、メモリ
カ−ド認証動作を終了する。ステップＳ12でＣＰＵ１９
は表示部１５に「メモリカ−ドは不正である」旨のメッ
セ−ジを表示し、メモリカ−ド認証動作を終了する。
【００３１】次に図８を参照してカ−ド引き抜き後の動
作を説明する。メモリカ−ド認証動作は終了してＲＡＭ
２１に認証ＯＫフラグデ−タ２１ａがセットされてい
る。メモリカ−ド５を引き抜くためにスライダ１７を矢
印Ｄ方向に移動させると、ステップＳ20でＣＰＵ１９は
カ−ド引き抜きチェック手段２９としてマスク不可能な
割り込み信号（ＮＭＩ）が発生したか否かをセンスして
おり、発生ならばステップＳ21に分岐する。ステップＳ
21でＲＡＭ２１の認証ＯＫフラグデ−タ２１ａをクリア
するとともに表示部１５に「認証ＯＫフラグデ−タをク
リアした」旨のメッセ−ジを表示して処理を終了する。
従って、次回ＡＰを実行させるには、リセットボタン１
４ｂを押下しなければならない。
作を説明する。メモリカ−ド認証動作は終了してＲＡＭ
２１に認証ＯＫフラグデ−タ２１ａがセットされてい
る。メモリカ−ド５を引き抜くためにスライダ１７を矢
印Ｄ方向に移動させると、ステップＳ20でＣＰＵ１９は
カ−ド引き抜きチェック手段２９としてマスク不可能な
割り込み信号（ＮＭＩ）が発生したか否かをセンスして
おり、発生ならばステップＳ21に分岐する。ステップＳ
21でＲＡＭ２１の認証ＯＫフラグデ−タ２１ａをクリア
するとともに表示部１５に「認証ＯＫフラグデ−タをク
リアした」旨のメッセ−ジを表示して処理を終了する。
従って、次回ＡＰを実行させるには、リセットボタン１
４ｂを押下しなければならない。
【００３２】第１の実施の形態によれば、メモリカ−ド
ライタを装置ベンダ−から信頼できるユ−ザ（システム
ベンダ−、ソフトハウス等）に提供、管理させることで
ユ−ザライタブルでしかも、セキュリティを持ったメモ
リカ−ドの提供が可能なシステムを実現できる。
ライタを装置ベンダ−から信頼できるユ−ザ（システム
ベンダ−、ソフトハウス等）に提供、管理させることで
ユ−ザライタブルでしかも、セキュリティを持ったメモ
リカ−ドの提供が可能なシステムを実現できる。
【００３３】また、ＡＰの実行コ−ドのアドレスとデ−
タとからなるセットデ−タを暗号化して認証デ−タを作
成してメモリカ−ドに格納し、メモリカ−ド装置で認証
デ−タを復号化し、ＡＰと比較してメモリカ−ドの真偽
をチェックできるようにしたので、不正なＡＰが実行さ
れる恐れはなくなる。
タとからなるセットデ−タを暗号化して認証デ−タを作
成してメモリカ−ドに格納し、メモリカ−ド装置で認証
デ−タを復号化し、ＡＰと比較してメモリカ−ドの真偽
をチェックできるようにしたので、不正なＡＰが実行さ
れる恐れはなくなる。
【００３４】また、メモリカ−ド装置にＡＰに関する情
報が実装されていなくともメモリカ−ドの真偽がチェッ
クできるので、ＡＰのバ−ジョンアップ等の変更が生じ
ても、メモリカ−ド装置側では何の変更も伴わず、変更
後のメモリカ−ドの真偽をチェックできる。
報が実装されていなくともメモリカ−ドの真偽がチェッ
クできるので、ＡＰのバ−ジョンアップ等の変更が生じ
ても、メモリカ−ド装置側では何の変更も伴わず、変更
後のメモリカ−ドの真偽をチェックできる。
【００３５】また、リセットボタン押下に伴うメモリカ
−ドの真偽チェックで真と判定されれば、以後、電源ボ
タン押下に伴う認証ＯＫフラグデ−タのチェックでメモ
リカ−ドの真偽チェックを行えるので、真偽チェックに
要する時間を短縮できる。
−ドの真偽チェックで真と判定されれば、以後、電源ボ
タン押下に伴う認証ＯＫフラグデ−タのチェックでメモ
リカ−ドの真偽チェックを行えるので、真偽チェックに
要する時間を短縮できる。
【００３６】また、メモリカ−ド装置からメモリカ−ド
が引き抜かれた場合、認証ＯＫフラグデ−タをクリアす
るようにしたことにより、その後、偽造メモリカ−ドを
メモリカ−ド装置に実装し、電源ボタンを押下しても
「メモリカ−ドは不正である」旨のメッセ−ジを表示さ
れるので、偽造メモリカ−ドの使用を防止できる。
が引き抜かれた場合、認証ＯＫフラグデ−タをクリアす
るようにしたことにより、その後、偽造メモリカ−ドを
メモリカ−ド装置に実装し、電源ボタンを押下しても
「メモリカ−ドは不正である」旨のメッセ−ジを表示さ
れるので、偽造メモリカ−ドの使用を防止できる。
【００３７】第２の実施の形態 第２の実施の形態が第１の実施の形態と異なるところ
は、電源ボタンがリセットボタンをも兼ねている点と、
メモリカ−ド認証手段がＲＡＭ２１に認証ＯＫフラグデ
−タ２１ａをセットしない点である。
は、電源ボタンがリセットボタンをも兼ねている点と、
メモリカ−ド認証手段がＲＡＭ２１に認証ＯＫフラグデ
−タ２１ａをセットしない点である。
【００３８】図９は第２の実施の形態によるフロ−チャ
−トである。第１の実施の形態のメモリカ−ド認証動作
と異なるところは、電源ボタン１４ａが押下される毎
に、ＣＰＵ１９はリセットされ、ステップＳ1 でメモリ
カ−ド装置１３を初期化する点と、ステップＳ8 でＲＡ
Ｍ２１に認証ＯＫフラグデ−タ２１ａをセットしない点
である。
−トである。第１の実施の形態のメモリカ−ド認証動作
と異なるところは、電源ボタン１４ａが押下される毎
に、ＣＰＵ１９はリセットされ、ステップＳ1 でメモリ
カ−ド装置１３を初期化する点と、ステップＳ8 でＲＡ
Ｍ２１に認証ＯＫフラグデ−タ２１ａをセットしない点
である。
【００３９】第２の実施の形態によれば、メモリカ−ド
装置を立ち上げる（電源ボタンを押下する）毎に、ＣＰ
Ｕはメモリカ−ドの認証動作を行うので、第１の実施の
形態による認証ＯＫフラグデ−タセットに比べてセキュ
リティが向上し、不正なアプリケ−ションプログラムが
実行される恐れはなくなる。
装置を立ち上げる（電源ボタンを押下する）毎に、ＣＰ
Ｕはメモリカ−ドの認証動作を行うので、第１の実施の
形態による認証ＯＫフラグデ−タセットに比べてセキュ
リティが向上し、不正なアプリケ−ションプログラムが
実行される恐れはなくなる。
【００４０】第３の実施の形態 第３の実施の形態が第１の実施の形態と異なるところ
は、リセットボタン押下により開始されるメモリカ−ド
の認証動作である。即ち、認証動作によりメモリカ−ド
が真であれば、ＲＡＭ２１に認証ＯＫフラグデ−タ２１
ａをセットするとともに、メモリカ−ド２の認証デ−タ
をクリア（例えば認証デ−タに有効ビット、無効ビット
を立てるようにしておきメモリカ−ドが真であれば無効
ビットを立てる）にする点である。
は、リセットボタン押下により開始されるメモリカ−ド
の認証動作である。即ち、認証動作によりメモリカ−ド
が真であれば、ＲＡＭ２１に認証ＯＫフラグデ−タ２１
ａをセットするとともに、メモリカ−ド２の認証デ−タ
をクリア（例えば認証デ−タに有効ビット、無効ビット
を立てるようにしておきメモリカ−ドが真であれば無効
ビットを立てる）にする点である。
【００４１】動作については第１の実施の形態と同じで
あるから省略する。
あるから省略する。
【００４２】第３の実施の形態によれば、ＡＰ認証後、
メモリカ−ドの認証デ−タをクリアすることにより、一
度認証されたメモリカ−ド（又は、その不正コピ−）を
他のメモリカ−ド装置で再利用することを不可能にし、
さらに、メモリカ−ド装置に実装されて出荷されたメモ
リカ−ドからの読み出しを不可能にし、偽造メモリカ−
ドの製造を防止させることができる。
メモリカ−ドの認証デ−タをクリアすることにより、一
度認証されたメモリカ−ド（又は、その不正コピ−）を
他のメモリカ−ド装置で再利用することを不可能にし、
さらに、メモリカ−ド装置に実装されて出荷されたメモ
リカ−ドからの読み出しを不可能にし、偽造メモリカ−
ドの製造を防止させることができる。
【００４３】第４の実施の形態 第４の実施の形態が第１の実施の形態と異なるところ
は、メモリカ−ドライタ１により認証デ−タ９を作成す
る際、秘密ＫＥＹを用いてアドレスを認証アドレスに暗
号化するとともにデ−タを認証ハッシュ値に変換する。
は、メモリカ−ドライタ１により認証デ−タ９を作成す
る際、秘密ＫＥＹを用いてアドレスを認証アドレスに暗
号化するとともにデ−タを認証ハッシュ値に変換する。
【００４４】メモリカ−ド装置１３では、秘密ＫＥＹを
用いて認証アドレスを復号化し、復号化されたアドレス
に基づいてＡＰからデ−タを読み出し、秘密ＫＥＹを用
いてデ−タから比較ハッシュ値を求め、認証ハッシュ値
と比較してメモリカ−ドの真偽をチェックする。
用いて認証アドレスを復号化し、復号化されたアドレス
に基づいてＡＰからデ−タを読み出し、秘密ＫＥＹを用
いてデ−タから比較ハッシュ値を求め、認証ハッシュ値
と比較してメモリカ−ドの真偽をチェックする。
【００４５】図１０は第４の実施の形態によるメモリカ
−ドライタの動作を示す説明図である。先ず、図２に示
したように、ＡＰ２を格納したＡＰ媒体３、何も書き込
まれていないメモリカ−ド５を、それぞれ、ＡＰ用Ｉ／
Ｏスロット４、メモリカ−ド接続用Ｉ／Ｏスロット６に
挿入し、書き込み開始スイッチ７を押下する。
−ドライタの動作を示す説明図である。先ず、図２に示
したように、ＡＰ２を格納したＡＰ媒体３、何も書き込
まれていないメモリカ−ド５を、それぞれ、ＡＰ用Ｉ／
Ｏスロット４、メモリカ−ド接続用Ｉ／Ｏスロット６に
挿入し、書き込み開始スイッチ７を押下する。
【００４６】ＣＰＵ１２はＡＰ書き込み手段１１とし
て、図１０に示すように、ＡＰ媒体３からＡＰ２を読み
込み、メモリカ−ド５に書き込む。
て、図１０に示すように、ＡＰ媒体３からＡＰ２を読み
込み、メモリカ−ド５に書き込む。
【００４７】次に、ＣＰＵ１２は認証デ−タ作成手段１
０として、読み込んだＡＰ２からアドレスとデ−タとの
セットデ−タ２ａをランダムに選択し、そのセットデ−
タ２ａと秘密ＫＥＹ３０とを用いて認証デ−タ９を作成
し、メモリカ−ド５に書き込む。
０として、読み込んだＡＰ２からアドレスとデ−タとの
セットデ−タ２ａをランダムに選択し、そのセットデ−
タ２ａと秘密ＫＥＹ３０とを用いて認証デ−タ９を作成
し、メモリカ−ド５に書き込む。
【００４８】セットデ−タ２ａのうち、アドレスは秘密
ＫＥＹ３０を用いて暗号化され、認証アドレス９ａとし
てメモリカ−ド５に書き込まれる。同様に、デ−タは秘
密ＫＥＹ３０を用いてハッシュ値に変換され、認証ハッ
シュ値９ｂとしてメモリカ−ド５に書き込まれる。
ＫＥＹ３０を用いて暗号化され、認証アドレス９ａとし
てメモリカ−ド５に書き込まれる。同様に、デ−タは秘
密ＫＥＹ３０を用いてハッシュ値に変換され、認証ハッ
シュ値９ｂとしてメモリカ−ド５に書き込まれる。
【００４９】図１１は第４の実施の形態によるメモリカ
−ド認証動作の説明図、図１２は第４の実施の形態によ
るリセットボタン押下後の動作を示すフロ−チャ−ト
（２）である。
−ド認証動作の説明図、図１２は第４の実施の形態によ
るリセットボタン押下後の動作を示すフロ−チャ−ト
（２）である。
【００５０】メモリカ−ド５には、メモリカ−ドライタ
１によりＡＰ２、認証デ−タ９が格納されてある。リセ
ットボタン１４ｂが押下されると、ステップＳ1 でＣＰ
Ｕ１９は制御プログラム２０ａに基づきメモリカ−ド装
置１３を初期化する。初期化によって、ＲＡＭ２１の認
証ＯＫフラグデ−タ２１ａもクリアされる。
１によりＡＰ２、認証デ−タ９が格納されてある。リセ
ットボタン１４ｂが押下されると、ステップＳ1 でＣＰ
Ｕ１９は制御プログラム２０ａに基づきメモリカ−ド装
置１３を初期化する。初期化によって、ＲＡＭ２１の認
証ＯＫフラグデ−タ２１ａもクリアされる。
【００５１】ステップＳ2 でＣＰＵ１９はメモリカ−ド
認証手段２６として、図１１に示すように、メモリカ−
ド５からＡＰ２を読み出し、ＲＡＭ２１に格納する。ス
テップＳ3 でメモリカ−ド５から認証アドレス９ａを読
み出し、秘密ＫＥＹ３０を用いて復号化し、復号アドレ
ス３１としてＲＡＭ２１に格納する。
認証手段２６として、図１１に示すように、メモリカ−
ド５からＡＰ２を読み出し、ＲＡＭ２１に格納する。ス
テップＳ3 でメモリカ−ド５から認証アドレス９ａを読
み出し、秘密ＫＥＹ３０を用いて復号化し、復号アドレ
ス３１としてＲＡＭ２１に格納する。
【００５２】ステップＳ4 で復号アドレス３１に基づい
てＲＡＭ２１に格納してあるＡＰ２からデ−タを読み出
し、デ−タ群３２としてＲＡＭ２１に格納する。即ち、
ＣＰＵ１９は復号化されたアドレスを順に図示せぬプロ
グラムカウンタに入力し、ＲＡＭ２１に格納してあるＡ
Ｐ２からデ−タを読み出す。
てＲＡＭ２１に格納してあるＡＰ２からデ−タを読み出
し、デ−タ群３２としてＲＡＭ２１に格納する。即ち、
ＣＰＵ１９は復号化されたアドレスを順に図示せぬプロ
グラムカウンタに入力し、ＲＡＭ２１に格納してあるＡ
Ｐ２からデ−タを読み出す。
【００５３】ステップＳ5 で秘密ＫＥＹ３０を用いてデ
−タ群３２からハッシュ値を算出し、比較ハッシュ値３
３としてＲＡＭ２１に格納する。ステップＳ6 でメモリ
カ−ド５の認証ハッシュ値９ｂと比較ハッシュ値３３と
を比較する。即ち、ＣＰＵ１９は認証ハッシュ値９ｂと
比較ハッシュ値３３とをＲＡＭ２１から図示せぬ演算部
のレジスタにセットして比較する。ステップＳ7 で一致
ならばステップＳ8 に分岐し、否ならばステップＳ10に
分岐する。
−タ群３２からハッシュ値を算出し、比較ハッシュ値３
３としてＲＡＭ２１に格納する。ステップＳ6 でメモリ
カ−ド５の認証ハッシュ値９ｂと比較ハッシュ値３３と
を比較する。即ち、ＣＰＵ１９は認証ハッシュ値９ｂと
比較ハッシュ値３３とをＲＡＭ２１から図示せぬ演算部
のレジスタにセットして比較する。ステップＳ7 で一致
ならばステップＳ8 に分岐し、否ならばステップＳ10に
分岐する。
【００５４】ステップＳ8 でＣＰＵ１９は表示部１５に
「ＡＰの実行に移る」旨のメッセ−ジを表示するととも
に、ＲＡＭ２１に認証ＯＫフラグデ−タ２１ａをセット
し、メモリカ−ド認証動作を終了する。
「ＡＰの実行に移る」旨のメッセ−ジを表示するととも
に、ＲＡＭ２１に認証ＯＫフラグデ−タ２１ａをセット
し、メモリカ−ド認証動作を終了する。
【００５５】ステップＳ9 でＣＰＵ１９は表示部１５に
「メモリカ−ドは不正である」旨のメッセ−ジを表示し
てメモリカ−ド認証動作を終了する。
「メモリカ−ドは不正である」旨のメッセ−ジを表示し
てメモリカ−ド認証動作を終了する。
【００５６】第４の実施の形態によれば、デ−タは最後
のハッシュ値を認証ハッシュ値としてメモリカ−ドに格
納されるようにしたので、第１の実施の形態に比べてメ
モリカ−ドに実装する認証デ−タのサイズを大幅に小さ
くすることができる。
のハッシュ値を認証ハッシュ値としてメモリカ−ドに格
納されるようにしたので、第１の実施の形態に比べてメ
モリカ−ドに実装する認証デ−タのサイズを大幅に小さ
くすることができる。
【００５７】
【発明の効果】本発明は、以上説明したように構成され
ているので以下に記載される効果を奏する。アプリケ−
ションプログラムと暗号化した認証デ−タとを格納した
メモリカ−ドをメモリカ−ド装置に実装し、認証デ−タ
を復号化して得られたアドレスによりアプリケ−ション
プログラムから読み出したデ−タ、あるいは読み出して
処理したデ−タと、認証デ−タから得られたデ−タと比
較してメモリカ−ドの真偽をチェックするようにしたこ
とにより、不正なアプリケ−ションプログラムを実装し
たメモリカ−ドがメモリカ−ド装置に挿入されても実行
されないので、電子商取引の内容等が書き替えられてし
まう恐れがなくなる。
ているので以下に記載される効果を奏する。アプリケ−
ションプログラムと暗号化した認証デ−タとを格納した
メモリカ−ドをメモリカ−ド装置に実装し、認証デ−タ
を復号化して得られたアドレスによりアプリケ−ション
プログラムから読み出したデ−タ、あるいは読み出して
処理したデ−タと、認証デ−タから得られたデ−タと比
較してメモリカ−ドの真偽をチェックするようにしたこ
とにより、不正なアプリケ−ションプログラムを実装し
たメモリカ−ドがメモリカ−ド装置に挿入されても実行
されないので、電子商取引の内容等が書き替えられてし
まう恐れがなくなる。
【図１】メモリカ−ド認証動作の説明図（１）である。
【図２】メモリカ−ドライタの構成を示すブロック図で
ある。
ある。
【図３】メモリカ−ド装置の外観斜視図である。
【図４】メモリカ−ド装置に搭載される制御ブロック図
である。
である。
【図５】メモリカ−ドライタの動作を示す説明図（１）
である。
である。
【図６】リセットボタン押下後の動作を示すフロ−チャ
−ト（１）である。
−ト（１）である。
【図７】電源ボタン押下後の動作を示すフロ−チャ−ト
（１）である。
（１）である。
【図８】カ−ド引き抜き後の動作を示すフロ−チャ−ト
である。
である。
【図９】電源ボタン押下後の動作を示すフロ−チャ−ト
（２）である。
（２）である。
【図１０】メモリカ−ドライタの動作を示す説明図
（２）である。
（２）である。
【図１１】メモリカ−ド認証動作の説明図（２）であ
る。
る。
【図１２】リセットボタン押下後の動作を示すフロ−チ
ャ−ト（２）である。
ャ−ト（２）である。
１ メモリカ−ドライタ ３ ＡＰ媒体 ５ メモリカ−ド ８、３０ 秘密ＫＥＹ １２、１９ ＣＰＵ １３ メモリカ−ド装置 ２０ ＲＯＭ ２１ ＲＡＭ
Claims (10)
- 【請求項１】 メモリカ−ド装置に実装されるアプリケ
−ションプログラムを格納したメモリカ−ドにおいて、 メモリカ−ドの真偽チェックに用いる暗号化された認証
デ−タを格納していることを特徴としたメモリカ−ド。 - 【請求項２】 請求項１に記載したメモリカ−ドの認証
デ−タを作成する認証デ−タ作成装置であって、 上記アプリケ−ションプログラムからランダムに読み出
されたアドレスと該アドレスに格納されたデ−タとを秘
密キ−により暗号化した認証デ−タを上記メモリカ−ド
に格納することを特徴とした認証デ−タ作成装置。 - 【請求項３】 上記秘密キ−は、ランダムに読み出され
た上記アドレスを認証アドレスに暗号化するとともに該
アドレスに格納されたデ−タを認証ハッシュ値に変換す
る請求項２記載の認証デ−タ作成装置。 - 【請求項４】 メモリカ−ドに格納されるアプリケ−シ
ョンプログラムからランダムに読み出されたアドレスと
該アドレスに格納されたデ−タとを秘密キ−により暗号
化した認証デ−タを格納したメモリカ−ドを実装するメ
モリカ−ド装置であって、 上記メモリカ−ドから認証デ−タを読み出して上記秘密
キ−により復号化し、復号化されたアドレスに基づき上
記アプリケ−ションプログラムから読み出したデ−タと
復号化されたデ−タとを比較してメモリカ−ドの真偽を
チェックすることを特徴とするメモリカ−ド装置。 - 【請求項５】 上記認証デ−タは、ランダムに読み出さ
れた上記アドレスを上記秘密キ−により暗号化した認証
アドレスと、該アドレスに格納されたデ−タを上記秘密
キ−により変換した認証ハッシュ値とからなり、認証ア
ドレスを上記秘密キ−により復号化するとともに復号化
されたアドレスに基づき上記アプリケ−ションプログラ
ムから読み出されたデ−タを比較ハッシュ値に変換し、
該比較ハッシュ値と上記認証ハッシュ値とを比較してメ
モリカ−ドの真偽をチェックする請求項４記載のメモリ
カ−ド装置。 - 【請求項６】 リセットボタンの押下により上記メモリ
カ−ドの真偽の認証処理を行い、該メモリカ−ドが真の
場合には装置のメモリに認証ＯＫフラグデ−タをセット
し、以後、電源ボタン押下により上記認証ＯＫフラグデ
−タのセット状態をチェックし、セットならば該メモリ
カ−ドを真と認証する請求項４記載、又は請求項５記載
のメモリカ−ド装置。 - 【請求項７】 リセットボタンの押下により上記メモリ
カ−ドの真偽の認証処理を行い、該メモリカ−ドが真の
場合には装置のメモリに認証ＯＫフラグデ−タをセット
するとともにメモリカ−ドの認証デ−タをクリアし、以
後、電源ボタン押下により上記認証ＯＫフラグデ−タの
セット状態をチェックし、セットならば該メモリカ−ド
を真と認証する請求項４記載、又は請求項５記載のメモ
リカ−ド装置。 - 【請求項８】 電源ボタンを押下する毎に上記メモリカ
−ドの真偽の認証処理を行う請求項４記載のメモリカ−
ド装置。 - 【請求項９】 待ち状態が予め決められた時間経過する
と、装置を低消費電力モ−ドに切り替える請求項４記
載、又は請求項５記載のメモリカ−ド装置。 - 【請求項１０】 上記メモリカ−ドが装置から抜去され
た場合には装置のメモリにセットされた上記認証フラグ
をクリアする請求項４記載、又は請求項５記載のメモリ
カ−ド装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29844697A JP3793629B2 (ja) | 1997-10-30 | 1997-10-30 | メモリカードとメモリカード装置 |
| US09/182,183 US6336585B1 (en) | 1997-10-30 | 1998-10-30 | Memory card insertion type electronic equipment and apparatus for writing to the memory card |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29844697A JP3793629B2 (ja) | 1997-10-30 | 1997-10-30 | メモリカードとメモリカード装置 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2005306963A Division JP2006065885A (ja) | 2005-10-21 | 2005-10-21 | メモリカード装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11134189A true JPH11134189A (ja) | 1999-05-21 |
| JP3793629B2 JP3793629B2 (ja) | 2006-07-05 |
Family
ID=17859825
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29844697A Expired - Fee Related JP3793629B2 (ja) | 1997-10-30 | 1997-10-30 | メモリカードとメモリカード装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6336585B1 (ja) |
| JP (1) | JP3793629B2 (ja) |
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| JP2003501759A (ja) * | 1999-06-03 | 2003-01-14 | ジェムプリュス | 端末の追加のチップカード内に保存されたプログラムの事前検査方法 |
| JP2008541211A (ja) * | 2005-05-05 | 2008-11-20 | サーティコム コーポレーション | ファームウェアへの認証の追加実装 |
| JP2009059105A (ja) * | 2007-08-30 | 2009-03-19 | Konica Minolta Business Technologies Inc | 情報処理装置およびプログラム |
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| JP2001209531A (ja) * | 2000-01-25 | 2001-08-03 | Nintendo Co Ltd | 半導体記憶装置およびプログラム判別システム |
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| KR100904339B1 (ko) * | 2001-03-19 | 2009-06-23 | 소니 가부시끼 가이샤 | 네트워크 시스템 |
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