JPH11122407A - 画像処理装置 - Google Patents
画像処理装置Info
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- JPH11122407A JPH11122407A JP9303600A JP30360097A JPH11122407A JP H11122407 A JPH11122407 A JP H11122407A JP 9303600 A JP9303600 A JP 9303600A JP 30360097 A JP30360097 A JP 30360097A JP H11122407 A JPH11122407 A JP H11122407A
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Abstract
(57)【要約】
【課題】 ユニット間の信号線の数を大幅に減少させる
ことによって、画像読み取りの高精度化およびカラー
化、さらには装置の小型化および低価格化とを可能にし
た画像処理装置を提供することを目的とする。 【解決手段】 原稿画像からの反射光を電気信号に変換
する光電変換素子１と、前記光電変換素子１からの信号
をアナログ的に処理するアナログ処理手段２とアナログ
処理された信号を複数ビットの量子化した信号に変換す
るＡ／Ｄ変換手段３と複数ビットのパラレル信号をシリ
アル信号に変換する手段８とを搭載した第一のユニット
５と、シリアル信号をパラレル信号に変換する手段９と
デジタル的に画像処理するデジタル画像処理手段４とを
搭載した第二のユニット６を備え、第一のユニットと第
二のユニット間の信号線を少なくするように構成する。
ことによって、画像読み取りの高精度化およびカラー
化、さらには装置の小型化および低価格化とを可能にし
た画像処理装置を提供することを目的とする。 【解決手段】 原稿画像からの反射光を電気信号に変換
する光電変換素子１と、前記光電変換素子１からの信号
をアナログ的に処理するアナログ処理手段２とアナログ
処理された信号を複数ビットの量子化した信号に変換す
るＡ／Ｄ変換手段３と複数ビットのパラレル信号をシリ
アル信号に変換する手段８とを搭載した第一のユニット
５と、シリアル信号をパラレル信号に変換する手段９と
デジタル的に画像処理するデジタル画像処理手段４とを
搭載した第二のユニット６を備え、第一のユニットと第
二のユニット間の信号線を少なくするように構成する。
Description
【０００１】
【発明の属する技術分野】本発明は、スキャナー、電子
写真複写機、ファクシミリ等の画像処理装置に関し、特
に原稿画像信号をデジタル信号に変換して処理する画像
処理装置に関するものである。
写真複写機、ファクシミリ等の画像処理装置に関し、特
に原稿画像信号をデジタル信号に変換して処理する画像
処理装置に関するものである。
【０００２】
【従来の技術】近年の画像処理装置ではデジタル化が進
み、原稿から読み取った画像信号をデジタル信号に変換
して処理するのが一般的である。従来のデジタル処理方
式の画像処理装置においては、原稿画像からの反射光を
ＣＣＤで読み取って、読み取った画像信号をＣＣＤの近
傍に配置されたＡ／Ｄ（アナログ／デジタル）変換器
で、ノイズにも強くて処理し易い形のデジタル画像信号
に変換した後、デジタル処理基板上に伝達してシェーデ
ィング補正等のデジタル画像処理を施していた。このよ
うな従来の画像処理装置においては、ＣＣＤが搭載され
たセンサー基板とデジタル処理基板とは通常別個のユニ
ット構造となっており、両者間は、デジタル基板におい
て生成したＣＣＤラインセンサを駆動する信号をセンサ
ー基板に伝送する信号線と、センサー基板上のＡ／Ｄ変
換器で処理されたデジタル画像信号をデジタル基板に伝
送する信号線とが一緒に纏められた状態で接続されてい
る。しかし、画像読み取りの高精度化やカラー化と、装
置の小型化や低価格化の要求の高まりに応じて、センサ
ー基板とデジタル処理基板との間に接続されている上記
各種の信号線の数も極めて多くなり、且つ、複雑に込み
合った状態とならざるを得ないのが現状であり、小型化
や低価格化を疎外する原因になっていた。さらには、多
数の信号線が複雑に入り組む結果、線間によるクロスト
ークの影響により画像信号にゴーストが発生する等の不
具合が発生し、これを防止する方法として従来、ＣＣＤ
ラインセンサを駆動する信号線とデジタル画像信号を出
力する信号線とを極力引き離した状態で実装する方法が
提案されている（特開平２−２２６９５５号公報）。
み、原稿から読み取った画像信号をデジタル信号に変換
して処理するのが一般的である。従来のデジタル処理方
式の画像処理装置においては、原稿画像からの反射光を
ＣＣＤで読み取って、読み取った画像信号をＣＣＤの近
傍に配置されたＡ／Ｄ（アナログ／デジタル）変換器
で、ノイズにも強くて処理し易い形のデジタル画像信号
に変換した後、デジタル処理基板上に伝達してシェーデ
ィング補正等のデジタル画像処理を施していた。このよ
うな従来の画像処理装置においては、ＣＣＤが搭載され
たセンサー基板とデジタル処理基板とは通常別個のユニ
ット構造となっており、両者間は、デジタル基板におい
て生成したＣＣＤラインセンサを駆動する信号をセンサ
ー基板に伝送する信号線と、センサー基板上のＡ／Ｄ変
換器で処理されたデジタル画像信号をデジタル基板に伝
送する信号線とが一緒に纏められた状態で接続されてい
る。しかし、画像読み取りの高精度化やカラー化と、装
置の小型化や低価格化の要求の高まりに応じて、センサ
ー基板とデジタル処理基板との間に接続されている上記
各種の信号線の数も極めて多くなり、且つ、複雑に込み
合った状態とならざるを得ないのが現状であり、小型化
や低価格化を疎外する原因になっていた。さらには、多
数の信号線が複雑に入り組む結果、線間によるクロスト
ークの影響により画像信号にゴーストが発生する等の不
具合が発生し、これを防止する方法として従来、ＣＣＤ
ラインセンサを駆動する信号線とデジタル画像信号を出
力する信号線とを極力引き離した状態で実装する方法が
提案されている（特開平２−２２６９５５号公報）。
【０００３】
【発明が解決しようとする課題】しかしながら、上述し
たような従来のＣＣＤラインセンサを駆動する信号線と
デジタル画像信号を出力する信号線とを分離して伝達す
る方法では、クロストークの影響は防止し得ても、信号
線そのものの数を減少させる効果が得られないため、小
型化や低価格化の疎外原因を除去し得るものではなかっ
た。また、今後画像読み取りの高精度化に伴い高ビット
の量子化が進めば、さらに信号線の数が増え、信号線間
の十分な離間距離が得られずクロストークの影響の防止
効果も望めない。本発明は上述したような従来の画像処
理装置に関する諸問題を解決するためになされたもので
あって、ユニット間の信号線の数や部品点数を減少し、
しかもＣＣＤラインセンサ周りの構成を簡単にすること
によって、装置の小型化と低価格化を図りながら、信号
線間のクロストークの影響を排除した画像処理装置を提
供することを目的としている。
たような従来のＣＣＤラインセンサを駆動する信号線と
デジタル画像信号を出力する信号線とを分離して伝達す
る方法では、クロストークの影響は防止し得ても、信号
線そのものの数を減少させる効果が得られないため、小
型化や低価格化の疎外原因を除去し得るものではなかっ
た。また、今後画像読み取りの高精度化に伴い高ビット
の量子化が進めば、さらに信号線の数が増え、信号線間
の十分な離間距離が得られずクロストークの影響の防止
効果も望めない。本発明は上述したような従来の画像処
理装置に関する諸問題を解決するためになされたもので
あって、ユニット間の信号線の数や部品点数を減少し、
しかもＣＣＤラインセンサ周りの構成を簡単にすること
によって、装置の小型化と低価格化を図りながら、信号
線間のクロストークの影響を排除した画像処理装置を提
供することを目的としている。
【０００４】
【課題を解決するための手段】上記目的を達成する為、
第１の請求項の画像処理装置は、原稿画像からの反射光
を電気信号に変換する光電変換素子、前記光電変換素子
からの信号をアナログ的に処理するアナログ処理手段、
アナログ処理手段によって処理された信号を複数ビット
の量子化した信号に変換するＡ／Ｄ変換手段、変換した
デジタル信号をシリアル信号に変換する手段とを搭載し
た第一のユニットと、前記第一のユニットから供給され
たシリアル信号をパラレル信号に変換する手段と前記Ａ
／Ｄ変換手段で変換された複数ビットの量子化信号をデ
ジタル的に画像処理するデジタル画像処理手段を搭載し
た第二のユニットを備えたことを特徴とする。請求項２
記載の画像処理装置では、前記請求項１記載の画像処理
装置において、前記第一のユニットと前記第二のユニッ
トとの間をカラー信号に対応して各色信号毎にシリアル
信号に変換して伝達することを特徴とする。請求項３記
載の画像処理装置では、前記請求項１または請求項２記
載の画像処理装置において、前記第一のユニットと前記
第二のユニットとの間の信号のうち所要の信号を同軸ケ
ーブルによって伝達するように構成したことを特徴とす
る。
第１の請求項の画像処理装置は、原稿画像からの反射光
を電気信号に変換する光電変換素子、前記光電変換素子
からの信号をアナログ的に処理するアナログ処理手段、
アナログ処理手段によって処理された信号を複数ビット
の量子化した信号に変換するＡ／Ｄ変換手段、変換した
デジタル信号をシリアル信号に変換する手段とを搭載し
た第一のユニットと、前記第一のユニットから供給され
たシリアル信号をパラレル信号に変換する手段と前記Ａ
／Ｄ変換手段で変換された複数ビットの量子化信号をデ
ジタル的に画像処理するデジタル画像処理手段を搭載し
た第二のユニットを備えたことを特徴とする。請求項２
記載の画像処理装置では、前記請求項１記載の画像処理
装置において、前記第一のユニットと前記第二のユニッ
トとの間をカラー信号に対応して各色信号毎にシリアル
信号に変換して伝達することを特徴とする。請求項３記
載の画像処理装置では、前記請求項１または請求項２記
載の画像処理装置において、前記第一のユニットと前記
第二のユニットとの間の信号のうち所要の信号を同軸ケ
ーブルによって伝達するように構成したことを特徴とす
る。
【０００５】
【作用】請求項１の発明は、アナログ処理手段とＡ／Ｄ
変換手段とを搭載する第一のユニットと、デジタル画像
処理手段を搭載する第二のユニットとの間の信号伝達を
シリアル信号で行うように構成したので、ビット数が増
加しても基板間の信号線の数と部品点数を減少させ、基
板のレイアウトと装置の構成を簡単にすることが出来
る。請求項２の発明は、前記請求項１のように構成され
た画像処理装置の発明に加えて、第一のユニットと第二
のユニットとの間の信号伝達をカラー対応の各色信号毎
にシリアル信号で行うように構成したので、カラーの画
像処理装置においても基板間の信号線の数と部品点数を
減少させ、基板のレイアウトと装置の構成を簡単にする
ことが出来る。請求項３の発明は、前記請求項１または
請求項２のように構成された画像処理装置の発明に加え
て、第一のユニットと第二のユニットとの間の信号伝達
手段として同軸ケーブルを使用するように構成したの
で、高速にシリアル信号を伝送しても不要放射を抑圧す
ることが出来る。
変換手段とを搭載する第一のユニットと、デジタル画像
処理手段を搭載する第二のユニットとの間の信号伝達を
シリアル信号で行うように構成したので、ビット数が増
加しても基板間の信号線の数と部品点数を減少させ、基
板のレイアウトと装置の構成を簡単にすることが出来
る。請求項２の発明は、前記請求項１のように構成され
た画像処理装置の発明に加えて、第一のユニットと第二
のユニットとの間の信号伝達をカラー対応の各色信号毎
にシリアル信号で行うように構成したので、カラーの画
像処理装置においても基板間の信号線の数と部品点数を
減少させ、基板のレイアウトと装置の構成を簡単にする
ことが出来る。請求項３の発明は、前記請求項１または
請求項２のように構成された画像処理装置の発明に加え
て、第一のユニットと第二のユニットとの間の信号伝達
手段として同軸ケーブルを使用するように構成したの
で、高速にシリアル信号を伝送しても不要放射を抑圧す
ることが出来る。
【０００６】
【発明の実施の形態】以下、図示した実施の形態に基づ
いて本発明を詳細に説明する。図１は本発明に係る画像
処理装置のスキャナー等の要部の構成例を示す図であ
る。図１において、コンタクトガラス１１上に載置され
た原稿１２は、露光用の光源１３により光を照射され、
原稿画像の反射光は、照射部分直下に位置する第一反射
ミラー１４、第二反射ミラー１６および第三反射ミラー
１７を介して集光レンズ１９に導かれ、この集光レンズ
１９によってＣＣＤ等の光電変換素子１に結像されて原
稿画像に応じた電気信号に変換される。原稿読み取りに
際しては、前記光源１３および第一反射ミラー１４等で
構成される第一キャリッジ１５と、第二反射ミラー１６
および第三反射ミラー１７等で構成される第二キャリッ
ジ１８とは、図示を省略したステッピングモータによっ
て例えば速度比２：１の走査スピードで副走査方向Ａに
移動され、原稿面上の画像を順次読み取る。コンタクト
ガラス１１の左端部に配置した基準白板２０は、光源１
３の照射光量のバラツキや、光電変換素子１の経年変化
による感度のバラツキ等を補正するために、第一キャリ
ッジ１５がホームポジションに位置する際、基準白板２
０からの反射光によるＣＣＤ出力信号レベルが所定値に
なるように校正するために設置されている。符号５は第
一のユニットとしてのセンサー基板であって、光電変換
素子１と、光電変換素子１にて読み取ったアナログ信号
を処理するアナログ処理部と、このアナログ信号を所定
ビットの量子化したデジタル信号に変換するＡ／Ｄ変換
回路３と、後述するようにパラレルのデジタル信号をシ
リアル信号に変換するパラレル／シリアル変換手段が備
えられている。第一のユニットでは上述したように原稿
から読み取り、各種ミラーを介してＣＣＤ等の光電変換
素子１に導かれた原稿画像をＡ／Ｄ変換回路３によって
量子化し、さらにこのデジタル信号をシリアル信号に変
換した後、接続ケーブル７を介して第二のユニット６に
伝達する。第二のユニット６は、受け取ったシリアル・
デジタル信号を元のパラレル信号に変換する手段と、シ
ェーディング補正等の処理を施す手段とを備えたデジタ
ル処理基板であり、処理された信号は、次の処理回路に
伝達される。
いて本発明を詳細に説明する。図１は本発明に係る画像
処理装置のスキャナー等の要部の構成例を示す図であ
る。図１において、コンタクトガラス１１上に載置され
た原稿１２は、露光用の光源１３により光を照射され、
原稿画像の反射光は、照射部分直下に位置する第一反射
ミラー１４、第二反射ミラー１６および第三反射ミラー
１７を介して集光レンズ１９に導かれ、この集光レンズ
１９によってＣＣＤ等の光電変換素子１に結像されて原
稿画像に応じた電気信号に変換される。原稿読み取りに
際しては、前記光源１３および第一反射ミラー１４等で
構成される第一キャリッジ１５と、第二反射ミラー１６
および第三反射ミラー１７等で構成される第二キャリッ
ジ１８とは、図示を省略したステッピングモータによっ
て例えば速度比２：１の走査スピードで副走査方向Ａに
移動され、原稿面上の画像を順次読み取る。コンタクト
ガラス１１の左端部に配置した基準白板２０は、光源１
３の照射光量のバラツキや、光電変換素子１の経年変化
による感度のバラツキ等を補正するために、第一キャリ
ッジ１５がホームポジションに位置する際、基準白板２
０からの反射光によるＣＣＤ出力信号レベルが所定値に
なるように校正するために設置されている。符号５は第
一のユニットとしてのセンサー基板であって、光電変換
素子１と、光電変換素子１にて読み取ったアナログ信号
を処理するアナログ処理部と、このアナログ信号を所定
ビットの量子化したデジタル信号に変換するＡ／Ｄ変換
回路３と、後述するようにパラレルのデジタル信号をシ
リアル信号に変換するパラレル／シリアル変換手段が備
えられている。第一のユニットでは上述したように原稿
から読み取り、各種ミラーを介してＣＣＤ等の光電変換
素子１に導かれた原稿画像をＡ／Ｄ変換回路３によって
量子化し、さらにこのデジタル信号をシリアル信号に変
換した後、接続ケーブル７を介して第二のユニット６に
伝達する。第二のユニット６は、受け取ったシリアル・
デジタル信号を元のパラレル信号に変換する手段と、シ
ェーディング補正等の処理を施す手段とを備えたデジタ
ル処理基板であり、処理された信号は、次の処理回路に
伝達される。
【０００７】図２は、本発明の実施例において使用する
光電変換素子１の例として３ライン型カラーＣＣＤセン
サー１の構成を示した図である。分解色ＲＧＢの各色の
フィルタをコーティングした縮小型ＣＣＤを並べた構成
になっており、Ｒ−ＣＣＤ２１、Ｇ−ＣＣＤ２２および
Ｂ−ＣＣＤ２３は、それぞれ赤フィルタ、緑フィルタ、
および黒フィルタをコーティングしたＣＣＤを示してい
る。また、Ｒ−ＣＣＤ２１、Ｇ−ＣＣＤ２２およびＢ−
ＣＣＤ２３は、主走査方向のドット位置が同じく、副走
査方向にそれぞれ一定間隔ずれた配置になっている。従
って、各色の出力信号が副走査方向に異なった時間タイ
ミングにて出力されるので、これを揃えるためにライン
メモリ等を使ったタイミング補正が必要である。図３は
上述した、３ライン型カラーＣＣＤセンサー１の内部構
成例を示した要部のブロック図である。Ｒ−ＣＣＤ２
１、Ｇ−ＣＣＤ２２およびＢ−ＣＣＤ２３は、それぞれ
偶数画素と奇数画素に分かれて２列のレジスタを持ち、
駆動パルスに同期して、画像信号ＶＲＥ、ＶＲＯ、ＶＧ
Ｅ、ＶＧＯ、ＶＢＥおよびＶＢＯが独立して出力され
る。
光電変換素子１の例として３ライン型カラーＣＣＤセン
サー１の構成を示した図である。分解色ＲＧＢの各色の
フィルタをコーティングした縮小型ＣＣＤを並べた構成
になっており、Ｒ−ＣＣＤ２１、Ｇ−ＣＣＤ２２および
Ｂ−ＣＣＤ２３は、それぞれ赤フィルタ、緑フィルタ、
および黒フィルタをコーティングしたＣＣＤを示してい
る。また、Ｒ−ＣＣＤ２１、Ｇ−ＣＣＤ２２およびＢ−
ＣＣＤ２３は、主走査方向のドット位置が同じく、副走
査方向にそれぞれ一定間隔ずれた配置になっている。従
って、各色の出力信号が副走査方向に異なった時間タイ
ミングにて出力されるので、これを揃えるためにライン
メモリ等を使ったタイミング補正が必要である。図３は
上述した、３ライン型カラーＣＣＤセンサー１の内部構
成例を示した要部のブロック図である。Ｒ−ＣＣＤ２
１、Ｇ−ＣＣＤ２２およびＢ−ＣＣＤ２３は、それぞれ
偶数画素と奇数画素に分かれて２列のレジスタを持ち、
駆動パルスに同期して、画像信号ＶＲＥ、ＶＲＯ、ＶＧ
Ｅ、ＶＧＯ、ＶＢＥおよびＶＢＯが独立して出力され
る。
【０００８】図４は、図１における３ライン型カラーＣ
ＣＤセンサー１、センサー基板（第一のユニット）５、
およびデジタル処理基板６（第二のユニット）の回路構
成を示したブロック図であり、図１を併用しながら説明
すると、原稿１２に光源１３から光が照射されると、原
稿１２からの反射光は第一キャリッジ１５、第二キャリ
ッジ１８を通り、集光レンズ１９にて３ライン型カラー
ＣＣＤセンサー１の受光面上に結像する。さらに、第一
キャリッジ１５と第二キャリッジ１８との副走査方向Ａ
への移動に連れて、原稿上の画像が１ライン毎に読み取
られ、３ライン型カラーＣＣＤセンサー１によって光電
変換される。
ＣＤセンサー１、センサー基板（第一のユニット）５、
およびデジタル処理基板６（第二のユニット）の回路構
成を示したブロック図であり、図１を併用しながら説明
すると、原稿１２に光源１３から光が照射されると、原
稿１２からの反射光は第一キャリッジ１５、第二キャリ
ッジ１８を通り、集光レンズ１９にて３ライン型カラー
ＣＣＤセンサー１の受光面上に結像する。さらに、第一
キャリッジ１５と第二キャリッジ１８との副走査方向Ａ
への移動に連れて、原稿上の画像が１ライン毎に読み取
られ、３ライン型カラーＣＣＤセンサー１によって光電
変換される。
【０００９】次に、駆動パルスに同期して３ライン型カ
ラーＣＣＤセンサー１から画像信号ＶＲＥ、ＶＲＯ、Ｖ
ＧＥ、ＶＧＯ、ＶＢＥ、ＶＢＯが出力され、センサー基
板５に伝達される。センサー基板５上では、プリアンプ
回路２ａ、サンプルホールド回路２ｂ、黒レベル補正回
路２ｃおよび増幅回路２ｄ等から構成されたアナログ処
理部２の初段のプリアンプ回路２ａにより各色毎に奇数
および偶数画素の出力を一定レベルに調整した上、交互
に出力し、画像信号としてＶＲ、ＶＧ、ＶＢを得る。そ
の際、プリアンプ回路２ａの出力信号中に含まれるリセ
ットノイズの除去を行っている。次に、サンプルホール
ド回路２ｂにおいて画像信号ＶＲ、ＶＧ、ＶＢをサンプ
ルパルスによりサンプリングし、保持することによって
それぞれ連続したアナログ信号が導出される。さらに、
画像信号ＶＲ、ＶＧ、ＶＢは黒レベル補正回路２ｃによ
ってＣＣＤの暗出力のレベルを補正された後、増幅回路
２ｄによって一定のレベルまで増幅され、Ａ／Ｄ変換回
路３に伝達される。Ａ／Ｄ変換回路３では、受け取った
画像信号ＶＲ、ＶＧ、ＶＢを各々８ビットのデジタル信
号に量子化する。従って、この時点での画像信号ＶＲ、
ＶＧ、ＶＢの信号線の数は、８本×３の合計２４本に達
している。そこで、センサー基板５上に備えたパラレル
・シリアル変換器８により、各色信号毎にパラレル信号
をシリアル信号に変換することによって、各色信号を１
本の信号線にて伝送し、２４本必要であった信号線を３
本の接続ケーブル７によって次の段のデジタル処理基板
６に伝送することができるようにする。なお、シリアル
信号を駆動する駆動クロックは、従来の読み取り速度を
維持するためには、量子化されたビット数に相当する倍
数の周波数で駆動することが必要であり、例えば８ビッ
トであれば８倍の周波数で駆動される。このことは後述
するデジタル処理部６のシリアル・パラレル変換器９に
関しても同様であり、センサー基板５のパラレル・シリ
アル変換器８と同期して駆動される。
ラーＣＣＤセンサー１から画像信号ＶＲＥ、ＶＲＯ、Ｖ
ＧＥ、ＶＧＯ、ＶＢＥ、ＶＢＯが出力され、センサー基
板５に伝達される。センサー基板５上では、プリアンプ
回路２ａ、サンプルホールド回路２ｂ、黒レベル補正回
路２ｃおよび増幅回路２ｄ等から構成されたアナログ処
理部２の初段のプリアンプ回路２ａにより各色毎に奇数
および偶数画素の出力を一定レベルに調整した上、交互
に出力し、画像信号としてＶＲ、ＶＧ、ＶＢを得る。そ
の際、プリアンプ回路２ａの出力信号中に含まれるリセ
ットノイズの除去を行っている。次に、サンプルホール
ド回路２ｂにおいて画像信号ＶＲ、ＶＧ、ＶＢをサンプ
ルパルスによりサンプリングし、保持することによって
それぞれ連続したアナログ信号が導出される。さらに、
画像信号ＶＲ、ＶＧ、ＶＢは黒レベル補正回路２ｃによ
ってＣＣＤの暗出力のレベルを補正された後、増幅回路
２ｄによって一定のレベルまで増幅され、Ａ／Ｄ変換回
路３に伝達される。Ａ／Ｄ変換回路３では、受け取った
画像信号ＶＲ、ＶＧ、ＶＢを各々８ビットのデジタル信
号に量子化する。従って、この時点での画像信号ＶＲ、
ＶＧ、ＶＢの信号線の数は、８本×３の合計２４本に達
している。そこで、センサー基板５上に備えたパラレル
・シリアル変換器８により、各色信号毎にパラレル信号
をシリアル信号に変換することによって、各色信号を１
本の信号線にて伝送し、２４本必要であった信号線を３
本の接続ケーブル７によって次の段のデジタル処理基板
６に伝送することができるようにする。なお、シリアル
信号を駆動する駆動クロックは、従来の読み取り速度を
維持するためには、量子化されたビット数に相当する倍
数の周波数で駆動することが必要であり、例えば８ビッ
トであれば８倍の周波数で駆動される。このことは後述
するデジタル処理部６のシリアル・パラレル変換器９に
関しても同様であり、センサー基板５のパラレル・シリ
アル変換器８と同期して駆動される。
【００１０】次に、デジタル処理基板６側では、受信し
たシリアル信号をシリアル・パラレル変換器９でパラレ
ル信号に変換する。即ち、前記センサー基板５のＡ／Ｄ
変換回路３によって量子化したビット数と同数のパラレ
ルビットのデジタル信号に戻して、次段のデジタル画像
処理部４に伝達する。デジタル画像処理部４は、シェー
ディング補正回路４ａ、およびライン間補正用メモリ４
ｂ等によって構成されている。なお、原稿画像の読み取
りに先立って、シェーディング補正のために光源１３に
より照射された基準白板２０の反射光が３ライン型カラ
ーＣＣＤセンサ１によって読み込まれ、そのデータがシ
ェーディング補正回路４ａのメモリ部に予め記憶されて
おり、これを用いて原稿画像の主走査方向１ライン毎の
読み取りに際して、シェーディング補正回路４ａによっ
てＣＣＤ感度のバラツキや照射系の配光ムラが補正され
る。その後、図２の説明において述べたように、Ｒ−Ｃ
ＣＤ２１、Ｇ−ＣＣＤ２２およびＢ−ＣＣＤ２３の出力
タイミングずれを補正するために、ライン間補正用メモ
リ４ｂが備えられており、これによって各色信号が同一
タイミングにて外部に出力される。また、タイミングジ
ェネレータ１０は、各回路のタイミング信号を発生する
ものであり、上述した３ライン型カラーＣＣＤセンサー
１、プリアンプ回路２ａ、サンプルホールド回路２ｂ、
黒レベル補正回路２ｃ、Ａ／Ｄ変換回路３、パラレルシ
リアル変換器８、シリアルパラレル変換器９、シェーデ
ィング補正回路４ａおよびライン間補正用メモリ４ｂ等
にタイミング信号を与えている。
たシリアル信号をシリアル・パラレル変換器９でパラレ
ル信号に変換する。即ち、前記センサー基板５のＡ／Ｄ
変換回路３によって量子化したビット数と同数のパラレ
ルビットのデジタル信号に戻して、次段のデジタル画像
処理部４に伝達する。デジタル画像処理部４は、シェー
ディング補正回路４ａ、およびライン間補正用メモリ４
ｂ等によって構成されている。なお、原稿画像の読み取
りに先立って、シェーディング補正のために光源１３に
より照射された基準白板２０の反射光が３ライン型カラ
ーＣＣＤセンサ１によって読み込まれ、そのデータがシ
ェーディング補正回路４ａのメモリ部に予め記憶されて
おり、これを用いて原稿画像の主走査方向１ライン毎の
読み取りに際して、シェーディング補正回路４ａによっ
てＣＣＤ感度のバラツキや照射系の配光ムラが補正され
る。その後、図２の説明において述べたように、Ｒ−Ｃ
ＣＤ２１、Ｇ−ＣＣＤ２２およびＢ−ＣＣＤ２３の出力
タイミングずれを補正するために、ライン間補正用メモ
リ４ｂが備えられており、これによって各色信号が同一
タイミングにて外部に出力される。また、タイミングジ
ェネレータ１０は、各回路のタイミング信号を発生する
ものであり、上述した３ライン型カラーＣＣＤセンサー
１、プリアンプ回路２ａ、サンプルホールド回路２ｂ、
黒レベル補正回路２ｃ、Ａ／Ｄ変換回路３、パラレルシ
リアル変換器８、シリアルパラレル変換器９、シェーデ
ィング補正回路４ａおよびライン間補正用メモリ４ｂ等
にタイミング信号を与えている。
【００１１】図５は、３ライン型カラーＣＣＤセンサー
１からの画像信号の１組（ＶＲＥ、ＶＲＯ、またはＶＧ
Ｅ、ＶＧＯ、またはＶＢＥ、ＶＢＯ）の出力波形に関す
るタイミング図である。図４の各回路を参照しながら説
明すると、図５の最上段の波形はセンサー基板５上に備
えたプリアンプ回路２ａの出力の一例を示すものであ
り、３ライン型カラーＣＣＤセンサー１の奇数および偶
数画素の出力を一定レベルに合わせた上、交互に出力し
た画像信号の一つ（ＶＲ、またはＶＧ、またはＶＢ）で
ある。図５の二段目の信号波形は、上記プリアンプ回路
２ａの出力をサンプルホールドした結果を示す図であ
り、図示したようにサンプルホールド回路２ｂによって
画像信号（ＶＲ、またはＶＧ、またはＶＢ）をサンプリ
ングし、保持することによって連続したアナログ信号が
得られる。この出力は３ライン型カラーＣＣＤセンサー
１の出力レベルである図５最上段の波形の出力レベル
ａ、ｂ、ｃ、ｄおよびｅに対応したレベルを出力する。
１からの画像信号の１組（ＶＲＥ、ＶＲＯ、またはＶＧ
Ｅ、ＶＧＯ、またはＶＢＥ、ＶＢＯ）の出力波形に関す
るタイミング図である。図４の各回路を参照しながら説
明すると、図５の最上段の波形はセンサー基板５上に備
えたプリアンプ回路２ａの出力の一例を示すものであ
り、３ライン型カラーＣＣＤセンサー１の奇数および偶
数画素の出力を一定レベルに合わせた上、交互に出力し
た画像信号の一つ（ＶＲ、またはＶＧ、またはＶＢ）で
ある。図５の二段目の信号波形は、上記プリアンプ回路
２ａの出力をサンプルホールドした結果を示す図であ
り、図示したようにサンプルホールド回路２ｂによって
画像信号（ＶＲ、またはＶＧ、またはＶＢ）をサンプリ
ングし、保持することによって連続したアナログ信号が
得られる。この出力は３ライン型カラーＣＣＤセンサー
１の出力レベルである図５最上段の波形の出力レベル
ａ、ｂ、ｃ、ｄおよびｅに対応したレベルを出力する。
【００１２】図５三段目の波形はＡ／Ｄ変換後の波形で
あり、Ａ／Ｄ変換回路３によってデジタル信号に量子化
された様子を示している。例えば、Ｏ０［７．．０］の
出力は、サンプルホールド後の出力レベルａの波形を量
子化し、Ｏ０７〜Ｏ００の８ビット信号で示した状態で
ある。また、図５最下段の波形は、シリアル変換後の波
形を示し、Ａ／Ｄ変換後の量子化された８ビットのデジ
タル信号Ｏ０７〜Ｏ００をシリアルに出力する様子を示
している。ここで、従来の読み取り速度を維持するため
には、シリアル信号を駆動する駆動クロックは８倍の周
波数で駆動することが必要であることは上述したとおり
である。なお、上記の説明では、ＣＣＤセンサとして３
ライン型カラーＣＣＤセンサー１を使用した例を示した
が、本発明の実施に際してはこの例に限らず、白黒画像
処理装置の１ライン型ＣＣＤセンサーであってもよい。
また、センサー基板５とデジタル処理基板６を接続する
接続ケーブル７として同軸ケーブルを採用すれば、それ
ぞれの信号線からの不要放射が抑えられ、同時に外部か
らの雑音信号の影響を軽減することができるので、さら
にクロストークの影響を少なくすることが可能となり、
さらには高速にシリアル信号の伝送を行うことが可能と
なる。
あり、Ａ／Ｄ変換回路３によってデジタル信号に量子化
された様子を示している。例えば、Ｏ０［７．．０］の
出力は、サンプルホールド後の出力レベルａの波形を量
子化し、Ｏ０７〜Ｏ００の８ビット信号で示した状態で
ある。また、図５最下段の波形は、シリアル変換後の波
形を示し、Ａ／Ｄ変換後の量子化された８ビットのデジ
タル信号Ｏ０７〜Ｏ００をシリアルに出力する様子を示
している。ここで、従来の読み取り速度を維持するため
には、シリアル信号を駆動する駆動クロックは８倍の周
波数で駆動することが必要であることは上述したとおり
である。なお、上記の説明では、ＣＣＤセンサとして３
ライン型カラーＣＣＤセンサー１を使用した例を示した
が、本発明の実施に際してはこの例に限らず、白黒画像
処理装置の１ライン型ＣＣＤセンサーであってもよい。
また、センサー基板５とデジタル処理基板６を接続する
接続ケーブル７として同軸ケーブルを採用すれば、それ
ぞれの信号線からの不要放射が抑えられ、同時に外部か
らの雑音信号の影響を軽減することができるので、さら
にクロストークの影響を少なくすることが可能となり、
さらには高速にシリアル信号の伝送を行うことが可能と
なる。
【００１３】
【発明の効果】以上説明したように、請求項１の発明に
よれば、アナログ処理手段とＡ／Ｄ変換手段とを搭載す
る第一のユニットと、デジタル画像処理手段を搭載する
第二のユニットとの間の信号伝達をシリアル信号で行う
ように構成したので、基板間の信号線の数と部品点数を
減少させ、基板のレイアウトと装置の構成を簡単にする
ことが可能となり、画像読み取りの高精度化と、装置の
小型化および低価格化とに対応した画像処理装置を提供
することが出来る。請求項２の発明によれば、前記請求
項１の画像処理装置の発明に加えて、第一ユニットと第
二ユニットとの間の信号伝達をカラー対応の各色毎にシ
リアル信号で行うように構成したので、カラー対応の画
像処理装置においても同様に基板間の信号線の数と部品
点数を減少させ、基板のレイアウトと装置の構成を簡単
にすることにより、画像読み取りの高精度化やカラー化
と、装置の小型化および低価格化とに対応した画像処理
装置を提供することが出来る。請求項３の発明によれ
ば、前記請求項１または請求項２の画像処理装置の発明
に加えて、第一ユニットと第二ユニットとの間の信号伝
達に同軸ケーブルを使用したので、不要信号の放射と進
入を共に逓減し、高速信号伝達に適した画像処理装置を
提供することが出来る。
よれば、アナログ処理手段とＡ／Ｄ変換手段とを搭載す
る第一のユニットと、デジタル画像処理手段を搭載する
第二のユニットとの間の信号伝達をシリアル信号で行う
ように構成したので、基板間の信号線の数と部品点数を
減少させ、基板のレイアウトと装置の構成を簡単にする
ことが可能となり、画像読み取りの高精度化と、装置の
小型化および低価格化とに対応した画像処理装置を提供
することが出来る。請求項２の発明によれば、前記請求
項１の画像処理装置の発明に加えて、第一ユニットと第
二ユニットとの間の信号伝達をカラー対応の各色毎にシ
リアル信号で行うように構成したので、カラー対応の画
像処理装置においても同様に基板間の信号線の数と部品
点数を減少させ、基板のレイアウトと装置の構成を簡単
にすることにより、画像読み取りの高精度化やカラー化
と、装置の小型化および低価格化とに対応した画像処理
装置を提供することが出来る。請求項３の発明によれ
ば、前記請求項１または請求項２の画像処理装置の発明
に加えて、第一ユニットと第二ユニットとの間の信号伝
達に同軸ケーブルを使用したので、不要信号の放射と進
入を共に逓減し、高速信号伝達に適した画像処理装置を
提供することが出来る。
【図１】本発明の実施の形態例を示す画像処理装置の要
部構成を説明する説明図である。
部構成を説明する説明図である。
【図２】本発明の実施の形態例において使用する３ライ
ン型カラーＣＣＤセンサーの要部構成例を説明する図で
ある。
ン型カラーＣＣＤセンサーの要部構成例を説明する図で
ある。
【図３】本発明の実施の形態例において使用する３ライ
ン型カラーＣＣＤセンサーの内部構成例を示す図であ
る。
ン型カラーＣＣＤセンサーの内部構成例を示す図であ
る。
【図４】本発明の実施の形態例を示す画像処理装置の要
部の回路構成例を示す説明図である。
部の回路構成例を示す説明図である。
【図５】本発明の実施の形態例におけるＣＣＤセンサー
からの画像信号をシリアル信号で処理する様子を説明す
る図である。
からの画像信号をシリアル信号で処理する様子を説明す
る図である。
１ 光電変換素子、または３ライン型カラーＣＣＤセン
サー、２ アナログ処理部、２ａ プリアンプ回路、
２ｂ サンプルホールド回路、２ｃ 黒レベル補正回
路、２ｄ 増幅回路、３ Ａ／Ｄ変換回路、４ デジ
タル画像処理部、４ａ シェーディング補正回路、４ｂ
ライン間補正用メモリ、５ センサー基板（第一のユ
ニット）、６ デジタル処理基板（第二のユニット）、
７ 接続ケーブル、８ パラレルシリアル変換器、
９ シリアルパラレル変換器、１０タイミングジェネ
レータ、２０ 基準白板
サー、２ アナログ処理部、２ａ プリアンプ回路、
２ｂ サンプルホールド回路、２ｃ 黒レベル補正回
路、２ｄ 増幅回路、３ Ａ／Ｄ変換回路、４ デジ
タル画像処理部、４ａ シェーディング補正回路、４ｂ
ライン間補正用メモリ、５ センサー基板（第一のユ
ニット）、６ デジタル処理基板（第二のユニット）、
７ 接続ケーブル、８ パラレルシリアル変換器、
９ シリアルパラレル変換器、１０タイミングジェネ
レータ、２０ 基準白板
Claims (3)
- 【請求項１】 原稿画像からの反射光を電気信号に変換
する光電変換素子と、前記光電変換素子からの信号をア
ナログ的に処理するアナログ処理手段と、アナログ処理
手段によって処理された信号を複数ビットの量子化した
信号に変換するＡ／Ｄ変換手段と、Ａ／Ｄ変換手段が変
換したデジタル信号をシリアル信号に変換する手段と、
を搭載した第一のユニットと、 前記第一のユニットから供給されたシリアル信号をパラ
レル信号に変換する手段と、前記Ａ／Ｄ変換手段で変換
された複数ビットの量子化信号をデジタル的に画像処理
するデジタル画像処理手段と、を搭載した第二のユニッ
トと、を備えたことを特徴とする画像処理装置。 - 【請求項２】 前記請求項１記載の画像処理装置におい
て、前記第一のユニットと前記第二のユニットとの間を
カラー信号に対応して各色毎にシリアル信号に変換して
伝達することを特徴とする画像処理装置。 - 【請求項３】 前記請求項１または請求項２記載の画像
処理装置において、前記第一のユニットと前記第二のユ
ニットとの間の信号を同軸ケーブルによって伝達するよ
うに構成したことを特徴とする画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9303600A JPH11122407A (ja) | 1997-10-17 | 1997-10-17 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9303600A JPH11122407A (ja) | 1997-10-17 | 1997-10-17 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11122407A true JPH11122407A (ja) | 1999-04-30 |
Family
ID=17922959
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9303600A Pending JPH11122407A (ja) | 1997-10-17 | 1997-10-17 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11122407A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008078796A (ja) * | 2006-09-19 | 2008-04-03 | Ricoh Co Ltd | 読み取り信号処理装置、画像読み取り装置、及び画像形成装置 |
-
1997
- 1997-10-17 JP JP9303600A patent/JPH11122407A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008078796A (ja) * | 2006-09-19 | 2008-04-03 | Ricoh Co Ltd | 読み取り信号処理装置、画像読み取り装置、及び画像形成装置 |
| EP1903804A3 (en) * | 2006-09-19 | 2012-04-04 | Ricoh Company, Ltd. | Read signal processor, image reading apparatus, and image forming apparatus |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20041119 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20041129 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20050322 |