JPH10255417A - データ記憶媒体、それを有するデータ記憶装置およびサーボ・バースト中にバイナリ・サーボ・データを表す方法 - Google Patents
データ記憶媒体、それを有するデータ記憶装置およびサーボ・バースト中にバイナリ・サーボ・データを表す方法Info
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- JPH10255417A JPH10255417A JP10036892A JP3689298A JPH10255417A JP H10255417 A JPH10255417 A JP H10255417A JP 10036892 A JP10036892 A JP 10036892A JP 3689298 A JP3689298 A JP 3689298A JP H10255417 A JPH10255417 A JP H10255417A
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- Moving Of The Head To Find And Align With The Track (AREA)
Abstract
(57)【要約】 （修正有）
【課題】 記憶装置の記憶媒体上に含まれるサーボ・バ
ースト中へバイナリ・サーボ・データを書き込む方法及
び装置を提供する。 【解決手段】 バイナリ・サーボ情報はトラック番号、
シリンダ番号、ヘッド番号、セクタ番号、インデックス
及び／又はＳＩＤ等の情報を識別するトラックを含む。
バーストはｔn個のタイム・スロット(ｔo〜ｔ7）を含
み、各スロットがサーボ・バースト周波数の１周期を有
し、書き込まれるサーボ・データはバイナリ・データの
Ｘ個のビットを有する。サーボ・データの各「１」ビッ
トは変移を含むスロット（ｔo,ｔ3〜ｔ6）として表さ
れ、各「０」ビットは空の、すなわちヌル・スロット
（ｔ1,ｔ2,ｔ7）として表される。この方法で、デジタ
ル・サーボ・データを表現する高いビット効率方式を実
現する。
ースト中へバイナリ・サーボ・データを書き込む方法及
び装置を提供する。 【解決手段】 バイナリ・サーボ情報はトラック番号、
シリンダ番号、ヘッド番号、セクタ番号、インデックス
及び／又はＳＩＤ等の情報を識別するトラックを含む。
バーストはｔn個のタイム・スロット(ｔo〜ｔ7）を含
み、各スロットがサーボ・バースト周波数の１周期を有
し、書き込まれるサーボ・データはバイナリ・データの
Ｘ個のビットを有する。サーボ・データの各「１」ビッ
トは変移を含むスロット（ｔo,ｔ3〜ｔ6）として表さ
れ、各「０」ビットは空の、すなわちヌル・スロット
（ｔ1,ｔ2,ｔ7）として表される。この方法で、デジタ
ル・サーボ・データを表現する高いビット効率方式を実
現する。
Description
【０００１】
【発明の属する技術分野】本発明は、一般的には磁気デ
ィスク・ドライブ等のデータ記憶装置に関し、特に、サ
ーボ・バースト中のデジタル・サーボ情報をコード化す
るための方法及び装置に関する。
ィスク・ドライブ等のデータ記憶装置に関し、特に、サ
ーボ・バースト中のデジタル・サーボ情報をコード化す
るための方法及び装置に関する。
【０００２】
【従来の技術】データ記憶装置は周知であり、例えば、
光及び磁気のディスク・ドライブ並びに磁気テープ・ド
ライブが含まれる。通常、データは、ディスクやテープ
等の動いている記憶媒体上に形成された複数のトラック
として構成される。ディスク・ドライブでは、これらの
トラックが渦巻状若しくは同心状の配置を有するものが
ある。磁気テープ・ドライブでは、トラックは平行で磁
気テープの長さ方向に設けられる。データは、変換器を
用いてデータ・トラックへ書き込まれそしてデータ・ト
ラックから読み取られる。変換器は、変換器アセンブリ
によりトラック近傍に支持されている。変換器アセンブ
リは、サーボ・システムの制御下でトラックに対して位
置決め可能であり、変換器はデータ・チャネルへ電気的
に接続され、さらにデータ・チャネルは、インタフェー
スを介してホストへ接続される。データ・チャネルは、
媒体へ書き込むためにホストからの情報を受け取りかつ
処理する。データ・チャネルはさらに、変換器アセンブ
リによりデータ記憶表面から検出される情報を受け取
り、そしてホストへ転送するためにその情報を処理す
る。サーボ制御、データ記憶媒体の動き、及びデータ・
アクセス等のデータ記憶装置の機能は、マイクロコント
ローラにより制御される。
光及び磁気のディスク・ドライブ並びに磁気テープ・ド
ライブが含まれる。通常、データは、ディスクやテープ
等の動いている記憶媒体上に形成された複数のトラック
として構成される。ディスク・ドライブでは、これらの
トラックが渦巻状若しくは同心状の配置を有するものが
ある。磁気テープ・ドライブでは、トラックは平行で磁
気テープの長さ方向に設けられる。データは、変換器を
用いてデータ・トラックへ書き込まれそしてデータ・ト
ラックから読み取られる。変換器は、変換器アセンブリ
によりトラック近傍に支持されている。変換器アセンブ
リは、サーボ・システムの制御下でトラックに対して位
置決め可能であり、変換器はデータ・チャネルへ電気的
に接続され、さらにデータ・チャネルは、インタフェー
スを介してホストへ接続される。データ・チャネルは、
媒体へ書き込むためにホストからの情報を受け取りかつ
処理する。データ・チャネルはさらに、変換器アセンブ
リによりデータ記憶表面から検出される情報を受け取
り、そしてホストへ転送するためにその情報を処理す
る。サーボ制御、データ記憶媒体の動き、及びデータ・
アクセス等のデータ記憶装置の機能は、マイクロコント
ローラにより制御される。
【０００３】ディスク・ドライブ設計において続けられ
ている挑戦は、記憶媒体のデータ容量を増すことであ
る。このためには、トラック同士の間隔を小さくするこ
と及び各トラック内のビット密度を緻密にすることが要
求される。トラック間隔が小さくなるほど、所望するト
ラックとデータ・セクタを位置決めするために、より正
確なサーボ・システムを構築する必要がある。汎用的な
記憶装置におけるサーボ・システムは、データ・トラッ
クに対してヘッドを正確に位置決めするために、データ
記憶表面上に書き込まれたサーボ情報に依存する。通
常、この情報は、３つのタイプの情報を含み、データ・
トラック間にまたがり配置されたサーボ領域すなわちサ
ーボ・セクタを有する。３つのタイプの情報とは、セク
タ識別子すなわちＳＩＤ、バイナリ（binary）位置情
報、及びアナログ位置エラー検知（ＰＥＳ）バースト・
パターンである。それは、インデックスを含むこともあ
る。
ている挑戦は、記憶媒体のデータ容量を増すことであ
る。このためには、トラック同士の間隔を小さくするこ
と及び各トラック内のビット密度を緻密にすることが要
求される。トラック間隔が小さくなるほど、所望するト
ラックとデータ・セクタを位置決めするために、より正
確なサーボ・システムを構築する必要がある。汎用的な
記憶装置におけるサーボ・システムは、データ・トラッ
クに対してヘッドを正確に位置決めするために、データ
記憶表面上に書き込まれたサーボ情報に依存する。通
常、この情報は、３つのタイプの情報を含み、データ・
トラック間にまたがり配置されたサーボ領域すなわちサ
ーボ・セクタを有する。３つのタイプの情報とは、セク
タ識別子すなわちＳＩＤ、バイナリ（binary）位置情
報、及びアナログ位置エラー検知（ＰＥＳ）バースト・
パターンである。それは、インデックスを含むこともあ
る。
【０００４】ＳＩＤは、例えば、ビット若しくは双ビッ
トからなる個別のパターンであり、サーボ・セクタの開
始を示す。ＳＩＤの前には、繰り返し自動利得制御（Ａ
ＧＣ）フィールドが置かれており、これらのフィールド
と共に、その後に続くサーボ情報に対して読取り／書込
みチャネルを同期させかつ利得を調整する。通常、ＳＩ
Ｄは、マイクロコントローラへ接続されたパターン検出
器を用いて変換器信号から抽出される。
トからなる個別のパターンであり、サーボ・セクタの開
始を示す。ＳＩＤの前には、繰り返し自動利得制御（Ａ
ＧＣ）フィールドが置かれており、これらのフィールド
と共に、その後に続くサーボ情報に対して読取り／書込
みチャネルを同期させかつ利得を調整する。通常、ＳＩ
Ｄは、マイクロコントローラへ接続されたパターン検出
器を用いて変換器信号から抽出される。
【０００５】バイナリ位置情報は、シーク・オペレーシ
ョン中に変換器の大まかな径方向位置決定のために用い
られる。バイナリ位置情報は、径方向位置決定のために
用いられるシリンダ番号、各データ記憶表面を個別に識
別するためのヘッド番号、及びヘッドの円周方向での位
置を確認するために用いられるセクタ番号を含むことが
ある。これらのデータのうち幾つか又は全てがコード化
されている場合がある。例えば、シリンダー番号が、ト
ラックからトラックへ１ビットだけ変化するグレイ・コ
ード・パターンを用いてコード化される。さらに、サー
ボ・フィールドの占有場所を低減するために、同じトラ
ック上の幾つかの隣り合うサーボ・セクタの間で情報が
分割されることがある。例えば、現在使用されている実
施態様では、トラック識別子が、最上位、中間位、及び
最下位のビットを有する。各サーボ・セクタは、最下位
ビットを含む。さらに、奇数セクタ毎に中間位ビットを
含み、そして偶数セクタ毎に最高位ビットを含む。同様
の方式で、ヘッド番号及びセクタ番号を表すビットを数
個のセクタへ分散させることにより、ヘッド番号の１ビ
ット及びセクタ番号の１又は複数のビットがｎ個の隣り
合うサーボ・セクタの各々へ書き込まれるようにする。
ヘッド番号及びセクタ番号は、径方向へは変化せずかつ
小さいので、コード化せずにディスクへ書き込むことが
できる。
ョン中に変換器の大まかな径方向位置決定のために用い
られる。バイナリ位置情報は、径方向位置決定のために
用いられるシリンダ番号、各データ記憶表面を個別に識
別するためのヘッド番号、及びヘッドの円周方向での位
置を確認するために用いられるセクタ番号を含むことが
ある。これらのデータのうち幾つか又は全てがコード化
されている場合がある。例えば、シリンダー番号が、ト
ラックからトラックへ１ビットだけ変化するグレイ・コ
ード・パターンを用いてコード化される。さらに、サー
ボ・フィールドの占有場所を低減するために、同じトラ
ック上の幾つかの隣り合うサーボ・セクタの間で情報が
分割されることがある。例えば、現在使用されている実
施態様では、トラック識別子が、最上位、中間位、及び
最下位のビットを有する。各サーボ・セクタは、最下位
ビットを含む。さらに、奇数セクタ毎に中間位ビットを
含み、そして偶数セクタ毎に最高位ビットを含む。同様
の方式で、ヘッド番号及びセクタ番号を表すビットを数
個のセクタへ分散させることにより、ヘッド番号の１ビ
ット及びセクタ番号の１又は複数のビットがｎ個の隣り
合うサーボ・セクタの各々へ書き込まれるようにする。
ヘッド番号及びセクタ番号は、径方向へは変化せずかつ
小さいので、コード化せずにディスクへ書き込むことが
できる。
【０００６】バイナリ・サーボ情報は、デジタル復調回
路によりアナログ変換器読取り信号から抽出される。必
要であれば復号化（デコード）論理も用いる。通常、復
調回路は、ピーク検出回路又は部分応答最大尤度（ＰＲ
ＭＬ）チャネルを有する。
路によりアナログ変換器読取り信号から抽出される。必
要であれば復号化（デコード）論理も用いる。通常、復
調回路は、ピーク検出回路又は部分応答最大尤度（ＰＲ
ＭＬ）チャネルを有する。
【０００７】ＰＥＳフィールドは、データ・トラックに
対して所定の形態で配置された複数の径方向繰り返しバ
ースト・パターンを有する。各バーストは、所定の周波
数の複数の径方向向き変移を含む。所定の周波数は、検
知される変換器信号に寄与する。変換器信号が復調され
るとき、ＰＥＳ信号が発生され、その大きさはトラック
中央からの変換器の変位に比例して変化する。ＰＥＳ
は、一般に、ピークホールド回路若しくは面積積分回路
を用いて作成される。ピークホールド回路は、信号振幅
の正確な計測を得るために、各バースト・フィールドに
おける最小数の変移を少なくとも必要とする。面積積分
回路は、各バースト・フィールド内に同じ数の変移が与
えられた場合に最もよく機能する。
対して所定の形態で配置された複数の径方向繰り返しバ
ースト・パターンを有する。各バーストは、所定の周波
数の複数の径方向向き変移を含む。所定の周波数は、検
知される変換器信号に寄与する。変換器信号が復調され
るとき、ＰＥＳ信号が発生され、その大きさはトラック
中央からの変換器の変位に比例して変化する。ＰＥＳ
は、一般に、ピークホールド回路若しくは面積積分回路
を用いて作成される。ピークホールド回路は、信号振幅
の正確な計測を得るために、各バースト・フィールドに
おける最小数の変移を少なくとも必要とする。面積積分
回路は、各バースト・フィールド内に同じ数の変移が与
えられた場合に最もよく機能する。
【０００８】サーボ位置決めシステムの正確さは、与え
られるサーボ情報の周波数と共に増す。しかしながら、
設けられる各サーボ・セクタは、ユーザ・データのため
に使用可能な記憶空間の量を減らしてしまう。従って、
各サーボ・セクタにより占められる円周方向の占有場所
を低減することが望ましい。これを実現する一つの手法
は、バイナリ・サーボ情報と信号フィールド内のバース
ト・パターンとを組み合わせることである。データは、
ＰＥＳ信号の発生に悪影響を及ぼさない方法で表されな
ければならない。すなわち、ピークホールド検知のため
のバースト・フィールド内での最小数の変化と、積分検
知のための比較的一定数のバースト毎の変化とを実現す
る必要がある。
られるサーボ情報の周波数と共に増す。しかしながら、
設けられる各サーボ・セクタは、ユーザ・データのため
に使用可能な記憶空間の量を減らしてしまう。従って、
各サーボ・セクタにより占められる円周方向の占有場所
を低減することが望ましい。これを実現する一つの手法
は、バイナリ・サーボ情報と信号フィールド内のバース
ト・パターンとを組み合わせることである。データは、
ＰＥＳ信号の発生に悪影響を及ぼさない方法で表されな
ければならない。すなわち、ピークホールド検知のため
のバースト・フィールド内での最小数の変化と、積分検
知のための比較的一定数のバースト毎の変化とを実現す
る必要がある。
【０００９】IBM Technical Disclosure Bulletin Vol.
33, No. 3Bに掲載の「Quad BurstServo Needing No Sy
nc ID and Having Added Information」(1990年8月発
行)では、情報をＰＥＳフィールドへコード化する方法
を開示しており、それは、バースト変移の位置を変調す
る。この手法は、同じ零クロス点を維持することによ
り、バースト・パターンの基本周波数が変化しないこと
を保証する。「１」と「０」は、零クロス点についての
幅又は正弦成分を変化させることにより区別される。す
なわち、１２０度の幅が「１」を表し、６０度の幅が
「０」を表す。この手法は、サーボ・バースト中の低周
波フラックス変移を用いることを必要とし、このこと
は、高周波パターンよりも多くの占有場所を費やすこと
になる。さらに、現在のディスク・ドライブにおけるカ
ストマー・データは高周波で書き込まれ、そしてサーボ
・データ検出（例えばフィルタ）で用いられるデータ・
チャネルの幾つかの構成要素を介して渡される。従っ
て、データ周波数とサーボ周波数との間の不一致を軽減
することが望ましいため、この手法では実用性がない。
33, No. 3Bに掲載の「Quad BurstServo Needing No Sy
nc ID and Having Added Information」(1990年8月発
行)では、情報をＰＥＳフィールドへコード化する方法
を開示しており、それは、バースト変移の位置を変調す
る。この手法は、同じ零クロス点を維持することによ
り、バースト・パターンの基本周波数が変化しないこと
を保証する。「１」と「０」は、零クロス点についての
幅又は正弦成分を変化させることにより区別される。す
なわち、１２０度の幅が「１」を表し、６０度の幅が
「０」を表す。この手法は、サーボ・バースト中の低周
波フラックス変移を用いることを必要とし、このこと
は、高周波パターンよりも多くの占有場所を費やすこと
になる。さらに、現在のディスク・ドライブにおけるカ
ストマー・データは高周波で書き込まれ、そしてサーボ
・データ検出（例えばフィルタ）で用いられるデータ・
チャネルの幾つかの構成要素を介して渡される。従っ
て、データ周波数とサーボ周波数との間の不一致を軽減
することが望ましいため、この手法では実用性がない。
【００１０】Andresenによる米国特許第4,195,320号で
は、１０進トラック・アドレスを固定長のＡ及びＢのサ
ーボ・バースト領域へコード化する方法が開示されてい
る。当該特許に開示の方法では、ＰＥＳバーストを復調
するために積分回路を用いるため、各バースト・フィー
ルド中で同数の「１」及び「０」を維持することに関連
する。トラック・アドレスの１０進数字は、フラグ間の
時間として表される。すなわち、各数字は、その数字に
等しい数のデータ・クロック変移（「０１０１...」）
の個数により表され、そして、バースト・フィールド内
の「１」及び「０」が偶数個となることを維持するため
に選択された２つの相補的区切りフィールド（「０１１
００」及び「１００１１」）のいずれかによって他のコ
ード化数字から区別される。例えば、十進アドレス「１
４５」は、十進数字「１」を表す１個のクロック変移
「１」と、区切りフィールド「０１１００」と、十進数
字「４」を表す４個のクロック変移「１０１０」と、区
切りフィールド「１００１１」と、十進数字「５」を表
す５個のクロック変移「１０１０１」と、区切りフィー
ルド「１００１１」とにより表される。可変の「エネル
ギー・バランス」フィールドが、コード化されたデータ
の後に設けられることにより、一定のバースト・サイズ
を維持しかつバースト・フィールド内の「１」及び
「０」が偶数個であることを保証する。コード化された
シーケンス全体は、さらに、個別の相補的開始フラグ及
び終了フラグ（「１１０００」及び「００１１１」）に
より区切られる。当該特許の方法は、空間の効率的利用
の点が欠けており、この問題点は区切りフィールドが必
要であることに関係する。
は、１０進トラック・アドレスを固定長のＡ及びＢのサ
ーボ・バースト領域へコード化する方法が開示されてい
る。当該特許に開示の方法では、ＰＥＳバーストを復調
するために積分回路を用いるため、各バースト・フィー
ルド中で同数の「１」及び「０」を維持することに関連
する。トラック・アドレスの１０進数字は、フラグ間の
時間として表される。すなわち、各数字は、その数字に
等しい数のデータ・クロック変移（「０１０１...」）
の個数により表され、そして、バースト・フィールド内
の「１」及び「０」が偶数個となることを維持するため
に選択された２つの相補的区切りフィールド（「０１１
００」及び「１００１１」）のいずれかによって他のコ
ード化数字から区別される。例えば、十進アドレス「１
４５」は、十進数字「１」を表す１個のクロック変移
「１」と、区切りフィールド「０１１００」と、十進数
字「４」を表す４個のクロック変移「１０１０」と、区
切りフィールド「１００１１」と、十進数字「５」を表
す５個のクロック変移「１０１０１」と、区切りフィー
ルド「１００１１」とにより表される。可変の「エネル
ギー・バランス」フィールドが、コード化されたデータ
の後に設けられることにより、一定のバースト・サイズ
を維持しかつバースト・フィールド内の「１」及び
「０」が偶数個であることを保証する。コード化された
シーケンス全体は、さらに、個別の相補的開始フラグ及
び終了フラグ（「１１０００」及び「００１１１」）に
より区切られる。当該特許の方法は、空間の効率的利用
の点が欠けており、この問題点は区切りフィールドが必
要であることに関係する。
【００１１】サーボ・バースト中のｎビットのシリンダ
・アドレス・コードをコード化するための、より効率的
な方法は、Yatakeらによる特願平第4-302864号に開示さ
れている。シリンダ・アドレスのｎ個のビットの各々
が、３つのタイム・スロットにより表される。すなわ
ち、「０」が「１１０」により表され、「１」が「１０
１」により表される。第１のタイム・スロットは常に正
に向かうパルスを含み、それは規則的データ・クロック
を与え、そしてピークホールド検出回路により用いられ
ることによりバーストからＰＥＳ信号を発生させる。上
記米国特許よりも空間効率はよいけれども、この位相変
調手法はなお、デジタル・サーボ・データの１ビットを
表すために３つの変移を必要とするという重大な欠点を
含んでいる。
・アドレス・コードをコード化するための、より効率的
な方法は、Yatakeらによる特願平第4-302864号に開示さ
れている。シリンダ・アドレスのｎ個のビットの各々
が、３つのタイム・スロットにより表される。すなわ
ち、「０」が「１１０」により表され、「１」が「１０
１」により表される。第１のタイム・スロットは常に正
に向かうパルスを含み、それは規則的データ・クロック
を与え、そしてピークホールド検出回路により用いられ
ることによりバーストからＰＥＳ信号を発生させる。上
記米国特許よりも空間効率はよいけれども、この位相変
調手法はなお、デジタル・サーボ・データの１ビットを
表すために３つの変移を必要とするという重大な欠点を
含んでいる。
【００１２】
【発明が解決しようとする課題】以上のように、ＰＥＳ
信号の発生に悪影響を及ぼすことなく、サーボ・バース
ト・フィールド内のデジタル・サーボ・データを表す高
効率の方式が、必要とされている。
信号の発生に悪影響を及ぼすことなく、サーボ・バース
ト・フィールド内のデジタル・サーボ・データを表す高
効率の方式が、必要とされている。
【００１３】
【課題を解決するための手段】従って、バイナリ・サー
ボ・データを、記憶装置の記憶媒体上に格納されたサー
ボ・バーストへ書き込むための方法及び装置が開示され
た。バイナリ・サーボ情報は、トラック番号、シリンダ
番号、ヘッド番号、セクタ番号、及び／又はＳＩＤ等の
トラック識別情報を含むことができる。この情報は、部
分的にコード化されるか又は完全にコード化されるかし
てバースト中に表すことができる。バーストはＴ個のタ
イム・スロットを含み、各スロットはサーボ・バースト
周波数の１サイクル又は１／２サイクルを有し、書き込
まれるサーボ・データはＸビットのバイナリ・データを
有する。サーボ・データの各「１」ビットは、変移を含
むスロットとして表され、各「０」ビットは、空すなわ
ちヌル・スロットとして表される。このようにして本発
明は、デジタル・サーボ・データを表すために高いビッ
ト効率の方式を提供する。
ボ・データを、記憶装置の記憶媒体上に格納されたサー
ボ・バーストへ書き込むための方法及び装置が開示され
た。バイナリ・サーボ情報は、トラック番号、シリンダ
番号、ヘッド番号、セクタ番号、及び／又はＳＩＤ等の
トラック識別情報を含むことができる。この情報は、部
分的にコード化されるか又は完全にコード化されるかし
てバースト中に表すことができる。バーストはＴ個のタ
イム・スロットを含み、各スロットはサーボ・バースト
周波数の１サイクル又は１／２サイクルを有し、書き込
まれるサーボ・データはＸビットのバイナリ・データを
有する。サーボ・データの各「１」ビットは、変移を含
むスロットとして表され、各「０」ビットは、空すなわ
ちヌル・スロットとして表される。このようにして本発
明は、デジタル・サーボ・データを表すために高いビッ
ト効率の方式を提供する。
【００１４】本発明の特定の実施例では、正確なピーク
ホールド検出のために必要なバースト毎にしきい値数だ
けの変移の数を保証するような方式でバイナリ・サーボ
情報を書き込むことにより、高品質のＰＥＳ信号が確保
される。これは、例えば、バースト毎にしきい値数だけ
の変移を実現するために選択されたコード化方式を用い
て、書込み前にバイナリデータをコード化することによ
り実現される。別の方法として、差Ｔ−Ｘ（バースト・
タイム・スロットの個数からバイナリ・サーボ・データ
のビット数を引いた差）がしきい値数よりも小さい場
合、バイナリ・データがさらに小さい部分に分割され、
各部分は、同じデータ・トラックに沿った異なるサーボ
・セクタへ書き込まれる。バイナリ・データは、バース
ト・タイム・スロットの個数からバイナリ・サーボ・デ
ータ部分のビット数を引いたものがしきい値数を超えな
いように分割される。これにより、少なくともバースト
毎にしきい値数だけの変移の数を確保する。
ホールド検出のために必要なバースト毎にしきい値数だ
けの変移の数を保証するような方式でバイナリ・サーボ
情報を書き込むことにより、高品質のＰＥＳ信号が確保
される。これは、例えば、バースト毎にしきい値数だけ
の変移を実現するために選択されたコード化方式を用い
て、書込み前にバイナリデータをコード化することによ
り実現される。別の方法として、差Ｔ−Ｘ（バースト・
タイム・スロットの個数からバイナリ・サーボ・データ
のビット数を引いた差）がしきい値数よりも小さい場
合、バイナリ・データがさらに小さい部分に分割され、
各部分は、同じデータ・トラックに沿った異なるサーボ
・セクタへ書き込まれる。バイナリ・データは、バース
ト・タイム・スロットの個数からバイナリ・サーボ・デ
ータ部分のビット数を引いたものがしきい値数を超えな
いように分割される。これにより、少なくともバースト
毎にしきい値数だけの変移の数を確保する。
【００１５】別の実施例においては、正確な積分検出が
できるようにバースト毎に一定数の又は実質的に一定数
の明確な変移を設けるべくデータがコード化される。例
えば、コード化されるデジタル・サーボ情報が、複数の
可能な値をもつバイナリ・ワードを有すると想定する。
この実施例によれば、各ワードは、Ｎ個の「１」とＭ個
の「０」からなる個別のパターンとしてコード化され
る。「１」は、変移含有スロットとしてバースト中に表
され、「０」は、空スロットとして表される。この手法
は、バースト毎の一定数の変移を確保する。さらに、こ
の手法は、必要な個別ワードの数を与える一方、データ
を表すために喪失されるべきタイム・スロットの数を最
小とする。なぜなら、この手法に従って個別に表すこと
ができるワードの数は（Ｎ＋Ｍ）！／Ｎ！Ｍ！であり、
Ｎ個の変移が保証されるからである。別の方法として、
整合性を確保するために、データがその「１」の補数と
共に書き込まれてもよい。
できるようにバースト毎に一定数の又は実質的に一定数
の明確な変移を設けるべくデータがコード化される。例
えば、コード化されるデジタル・サーボ情報が、複数の
可能な値をもつバイナリ・ワードを有すると想定する。
この実施例によれば、各ワードは、Ｎ個の「１」とＭ個
の「０」からなる個別のパターンとしてコード化され
る。「１」は、変移含有スロットとしてバースト中に表
され、「０」は、空スロットとして表される。この手法
は、バースト毎の一定数の変移を確保する。さらに、こ
の手法は、必要な個別ワードの数を与える一方、データ
を表すために喪失されるべきタイム・スロットの数を最
小とする。なぜなら、この手法に従って個別に表すこと
ができるワードの数は（Ｎ＋Ｍ）！／Ｎ！Ｍ！であり、
Ｎ個の変移が保証されるからである。別の方法として、
整合性を確保するために、データがその「１」の補数と
共に書き込まれてもよい。
【００１６】サーボ領域により消費される占有場所の量
が、バイナリ・データの信頼性よりも格段に少い場合
は、データを表すために単一変移ではなく双ビットを用
いることにより、堅固性が強化できる。すなわち、各サ
ーボ・データ・ビットは、サーボ・バーストの２つのタ
イム・スロットを用いて表され、「１」のビットは双ビ
ットとして表され、そして「０」のビットは１又２個の
空タイム・スロットとして表される。
が、バイナリ・データの信頼性よりも格段に少い場合
は、データを表すために単一変移ではなく双ビットを用
いることにより、堅固性が強化できる。すなわち、各サ
ーボ・データ・ビットは、サーボ・バーストの２つのタ
イム・スロットを用いて表され、「１」のビットは双ビ
ットとして表され、そして「０」のビットは１又２個の
空タイム・スロットとして表される。
【００１７】
【発明の実施の形態】図１は、本発明の実施するために
適した記憶装置を示す。この装置は、セクタ・サーボ及
びゾーン・ビット記録を有する固定ブロック・アーキテ
クチャによりフォーマットされたディスク・ドライブで
ある。ディスク・ドライブ１０２は、データ記憶媒体又
はディスク１０４、アクチュエータ・アーム１０６、デ
ータ記録変換器１０８（記録ヘッドとも称される）、ボ
イス・コイル・モータ１１０、サーボ電子回路１１２、
読取り／書込み電子回路１１３、インタフェース電子回
路１１４、フォーマッター電子回路１１５、マイクロプ
ロセッサ１１６及び関連する不揮発性記憶装置すなわち
ＲＯＭ１２２、並びに揮発性記憶装置すなわちＲＡＭ１
１７を含む。マイクロプロセッサ１１６は、好適には、
ＲＯＭ１２２及び非ユーザ・データ用に確保されたディ
スク１０４の領域１５５に記憶された制御マイクロコー
ドを実行することによりディスク・ドライブ電子回路に
対する制御を行う。オペレーション中、制御マイクロコ
ードは、ＲＯＭ１２２及びディスク領域１５５からＲＡ
Ｍ１１７等の一時記憶装置へロードされることにより、
マイクロプロセッサ１１６により実行される。記憶ディ
スク１０４はさらに、回転中心１１１を含み、ヘッド位
置決定の目的のために、１組の径方向に間隔を空けたト
ラックへと分割される。それらの１つが符号１１８で示
されている。トラックは、径方向に多数のゾーンへとグ
ループ化される。それらのうち３つが、符号１５１、１
５２及び１５３で示されている。データは、ディスク全
面上でのビット密度を最大とするために各ゾーンにおい
て異なるデータ割合で記録される。ディスクは複数のサ
ーボ・セクタ１２０を含み、これは、一般的に径方向に
トラックを横切って延びている。これらは、後にさらに
詳細に説明する。各トラックは、符号１２１で示す。各
ゾーン内では、トラックが、円周方向に多数のデータ・
セクタ１５４に分割される。好適には、データ容量を増
すためにデータ・セクタはセクタＩＤフィールドを含ま
ない。このことは、Hetslerらによる米国特許第5,523,9
03号に開示されている。「固定ブロック・アーキテクチ
ャ」の通常の意味において、全てのデータ・セクタは実
質的に同じ大きさ、例えば、５１２バイトのデータの大
きさである。しかしながら、本発明は、可変長アーキテ
クチャへも容易に適応できることを注記する。トラック
毎のデータ・セクタの数は、ゾーンからゾーンへと変化
する。その結果、データ・セクタのいくつかは、サーボ
・セクタにより分割される。ディスク・ドライブが複数
のヘッドを有する場合、全ての面上の同じ半径に位置す
る１組のトラックは「シリンダ」と称される。
適した記憶装置を示す。この装置は、セクタ・サーボ及
びゾーン・ビット記録を有する固定ブロック・アーキテ
クチャによりフォーマットされたディスク・ドライブで
ある。ディスク・ドライブ１０２は、データ記憶媒体又
はディスク１０４、アクチュエータ・アーム１０６、デ
ータ記録変換器１０８（記録ヘッドとも称される）、ボ
イス・コイル・モータ１１０、サーボ電子回路１１２、
読取り／書込み電子回路１１３、インタフェース電子回
路１１４、フォーマッター電子回路１１５、マイクロプ
ロセッサ１１６及び関連する不揮発性記憶装置すなわち
ＲＯＭ１２２、並びに揮発性記憶装置すなわちＲＡＭ１
１７を含む。マイクロプロセッサ１１６は、好適には、
ＲＯＭ１２２及び非ユーザ・データ用に確保されたディ
スク１０４の領域１５５に記憶された制御マイクロコー
ドを実行することによりディスク・ドライブ電子回路に
対する制御を行う。オペレーション中、制御マイクロコ
ードは、ＲＯＭ１２２及びディスク領域１５５からＲＡ
Ｍ１１７等の一時記憶装置へロードされることにより、
マイクロプロセッサ１１６により実行される。記憶ディ
スク１０４はさらに、回転中心１１１を含み、ヘッド位
置決定の目的のために、１組の径方向に間隔を空けたト
ラックへと分割される。それらの１つが符号１１８で示
されている。トラックは、径方向に多数のゾーンへとグ
ループ化される。それらのうち３つが、符号１５１、１
５２及び１５３で示されている。データは、ディスク全
面上でのビット密度を最大とするために各ゾーンにおい
て異なるデータ割合で記録される。ディスクは複数のサ
ーボ・セクタ１２０を含み、これは、一般的に径方向に
トラックを横切って延びている。これらは、後にさらに
詳細に説明する。各トラックは、符号１２１で示す。各
ゾーン内では、トラックが、円周方向に多数のデータ・
セクタ１５４に分割される。好適には、データ容量を増
すためにデータ・セクタはセクタＩＤフィールドを含ま
ない。このことは、Hetslerらによる米国特許第5,523,9
03号に開示されている。「固定ブロック・アーキテクチ
ャ」の通常の意味において、全てのデータ・セクタは実
質的に同じ大きさ、例えば、５１２バイトのデータの大
きさである。しかしながら、本発明は、可変長アーキテ
クチャへも容易に適応できることを注記する。トラック
毎のデータ・セクタの数は、ゾーンからゾーンへと変化
する。その結果、データ・セクタのいくつかは、サーボ
・セクタにより分割される。ディスク・ドライブが複数
のヘッドを有する場合、全ての面上の同じ半径に位置す
る１組のトラックは「シリンダ」と称される。
【００１８】読取り／書込み（R/W）電子回路１１３が
変換器１０８から信号を受け取り、サーボ情報をサーボ
電子回路１１２へ渡し、データ信号をフォーマッター電
子回路１１５へ渡す。サーボ電子回路１１２は、サーボ
情報を用いて符号１４０で示す電流を発生することによ
りボイス・コイル・モータ１１０を駆動し、記録変換器
１０８の位置決めを行う。サーボ電子回路１１２はま
た、そのパターンからデジタル情報を抽出するための検
出回路を含むが、これについては後述する。インタフェ
ース電子回路１１４は、インタフェース１６２を通して
ホスト・システム（図示せず）との間でデータおよびコ
マンド情報を渡しつつ情報伝達する。インタフェース電
子回路１１４はさらに、インタフェース１６４を通して
フォーマッター電子回路１１５との間で情報伝達する。
マイクロプロセッサ１１６は、インタフェース１７０を
通して他の種々の電子回路との間で情報伝達する。
変換器１０８から信号を受け取り、サーボ情報をサーボ
電子回路１１２へ渡し、データ信号をフォーマッター電
子回路１１５へ渡す。サーボ電子回路１１２は、サーボ
情報を用いて符号１４０で示す電流を発生することによ
りボイス・コイル・モータ１１０を駆動し、記録変換器
１０８の位置決めを行う。サーボ電子回路１１２はま
た、そのパターンからデジタル情報を抽出するための検
出回路を含むが、これについては後述する。インタフェ
ース電子回路１１４は、インタフェース１６２を通して
ホスト・システム（図示せず）との間でデータおよびコ
マンド情報を渡しつつ情報伝達する。インタフェース電
子回路１１４はさらに、インタフェース１６４を通して
フォーマッター電子回路１１５との間で情報伝達する。
マイクロプロセッサ１１６は、インタフェース１７０を
通して他の種々の電子回路との間で情報伝達する。
【００１９】ディスク・ドライブ１０２のオペレーショ
ンにおいて、インタフェース電子回路１１４は、インタ
フェース１６２を通してデータ・セクタに対する読取り
又は書込みのための要求を受け取る。フォーマッター電
子回路１１５は、要求されたデータ・セクタのリスト
を、インタフェース電子回路１１４から論理ブロック・
アドレスの形式で受け取り、それらを物理アドレスすな
わちゾーン番号、シリンダ番号、ヘッド番号及びセクタ
番号へ変換する。これらは、所望されたデータ・セクタ
の場所を個別に識別するものである。ゾーン、ヘッド及
びシリンダの情報は、サーボ電子回路１１２へ渡され、
適切なシリンダ上の適切なデータ・セクタの上方に記録
ヘッド１０８を位置付けすることを担う。サーボ電子回
路１１２へ与えられたシリンダ番号が、記録ヘッド１０
８が現在位置するトラック番号と同じでない場合、サー
ボ電子回路１１２は、先ず、記録ヘッド１０８を適切な
シリンダの上方へ再配置させるためにシーク・オペレー
ションを実行する。シーク・オペレーションは、所望さ
れたトラックを識別するためにサーボ・セクタ中の粗い
デジタル位置情報を用いる。例えば、シリンダ番号及び
ヘッド番号である。
ンにおいて、インタフェース電子回路１１４は、インタ
フェース１６２を通してデータ・セクタに対する読取り
又は書込みのための要求を受け取る。フォーマッター電
子回路１１５は、要求されたデータ・セクタのリスト
を、インタフェース電子回路１１４から論理ブロック・
アドレスの形式で受け取り、それらを物理アドレスすな
わちゾーン番号、シリンダ番号、ヘッド番号及びセクタ
番号へ変換する。これらは、所望されたデータ・セクタ
の場所を個別に識別するものである。ゾーン、ヘッド及
びシリンダの情報は、サーボ電子回路１１２へ渡され、
適切なシリンダ上の適切なデータ・セクタの上方に記録
ヘッド１０８を位置付けすることを担う。サーボ電子回
路１１２へ与えられたシリンダ番号が、記録ヘッド１０
８が現在位置するトラック番号と同じでない場合、サー
ボ電子回路１１２は、先ず、記録ヘッド１０８を適切な
シリンダの上方へ再配置させるためにシーク・オペレー
ションを実行する。シーク・オペレーションは、所望さ
れたトラックを識別するためにサーボ・セクタ中の粗い
デジタル位置情報を用いる。例えば、シリンダ番号及び
ヘッド番号である。
【００２０】サーボ電子回路１１２がヘッド１０８を適
切なシリンダの上方へ配置させたならば、変換器は、バ
ースト・パターンにより与えられた微細位置決めサーボ
情報を用いてトラック追随モードでそのシリンダ上に維
持される。所望されたデータ・セクタは、それらのＩＤ
フィールドを読み取ることによりその場所を示される。
別の方法として、ヘッダレス又はＮｏＩＤ(ＩＢＭ Ｃ
ｏｒｐ.の米国およびその他の国における商標)アーキテ
クチャを採用するディスク・ドライブにおいては、サー
ボ電子回路１１２が、所望されたデータ・セクタの場所
指定を行いそれを識別するためにセクタ演算の実行を開
始する。これは、米国特許第5,500,848号に記載のよう
に、各サーボ・セクタを識別するために用いられる。概
略的にいえば、開始データ・セクタが、インデックス・
マークからのオフセットにより識別される。トラック・
フォーマットは推定で知られているので、インデックス
を通過してからのデータ・セクタの数は、サーボ・セク
タ・カウントから決定される。そして、適切なデータ領
域への正確なオフセットを決定することができる。
切なシリンダの上方へ配置させたならば、変換器は、バ
ースト・パターンにより与えられた微細位置決めサーボ
情報を用いてトラック追随モードでそのシリンダ上に維
持される。所望されたデータ・セクタは、それらのＩＤ
フィールドを読み取ることによりその場所を示される。
別の方法として、ヘッダレス又はＮｏＩＤ(ＩＢＭ Ｃ
ｏｒｐ.の米国およびその他の国における商標)アーキテ
クチャを採用するディスク・ドライブにおいては、サー
ボ電子回路１１２が、所望されたデータ・セクタの場所
指定を行いそれを識別するためにセクタ演算の実行を開
始する。これは、米国特許第5,500,848号に記載のよう
に、各サーボ・セクタを識別するために用いられる。概
略的にいえば、開始データ・セクタが、インデックス・
マークからのオフセットにより識別される。トラック・
フォーマットは推定で知られているので、インデックス
を通過してからのデータ・セクタの数は、サーボ・セク
タ・カウントから決定される。そして、適切なデータ領
域への正確なオフセットを決定することができる。
【００２１】図２は、従来技術によるサーボ・セクタを
示す。それは、円周方向にＡＧＣフィールド２０２、Ｓ
ＩＤ２０４、シリンダ番号を表すグレイ・コード２０
６、ヘッド番号及びセクタ番号２０８、並びに、方形の
サーボ・バースト・パターンＡ〜Ｄ２１０、２１２、２
１４、２１６を含む。サーボ・セクタは、径方向に拡が
る２本のデータ・トラックＴｒｋn及びＴｒｋn+1を有す
る。半トラック位置Ｔｒｋn+0.5も示されている。汎用
的な方形バースト・パターンによれば、Ａ及びＣのバー
ストは、各トラック中央に沿った共通の境界を共有する
のに対し、Ｂ及びＤのバーストは、各半トラック位置に
おいて共通の境界を共有する。
示す。それは、円周方向にＡＧＣフィールド２０２、Ｓ
ＩＤ２０４、シリンダ番号を表すグレイ・コード２０
６、ヘッド番号及びセクタ番号２０８、並びに、方形の
サーボ・バースト・パターンＡ〜Ｄ２１０、２１２、２
１４、２１６を含む。サーボ・セクタは、径方向に拡が
る２本のデータ・トラックＴｒｋn及びＴｒｋn+1を有す
る。半トラック位置Ｔｒｋn+0.5も示されている。汎用
的な方形バースト・パターンによれば、Ａ及びＣのバー
ストは、各トラック中央に沿った共通の境界を共有する
のに対し、Ｂ及びＤのバーストは、各半トラック位置に
おいて共通の境界を共有する。
【００２２】図３（Ａ）は、図２のＡバースト２１０の
拡大図である。バースト２１０は、バーストＢ〜Ｄ２１
２、２１４、２１６の代表的なものでもあるが、複数の
タイム・スロットｔ0〜ｔnを含み、各々が変移を含んで
いる。図示のために８個のタイム・スロットだけが示さ
れているが、実際のスロット数は、バースト・フィール
ドの円周方向の長さとバースト変移が記録される周波数
とにより決定される。一般的に、変移は「１」として表
されるが、その実際の形態は、使用される記憶媒体の型
式により変わるであろう。例えば磁気記憶装置では、各
変移は磁束反転となる。
拡大図である。バースト２１０は、バーストＢ〜Ｄ２１
２、２１４、２１６の代表的なものでもあるが、複数の
タイム・スロットｔ0〜ｔnを含み、各々が変移を含んで
いる。図示のために８個のタイム・スロットだけが示さ
れているが、実際のスロット数は、バースト・フィール
ドの円周方向の長さとバースト変移が記録される周波数
とにより決定される。一般的に、変移は「１」として表
されるが、その実際の形態は、使用される記憶媒体の型
式により変わるであろう。例えば磁気記憶装置では、各
変移は磁束反転となる。
【００２３】図３（Ａ）には、Ａバースト２１０と径方
向で並んだ変換器３０２も示されている。変換器３０２
がバースト・パターン２１０上を通過すると、図３
（Ｂ）の検知信号３０４が発生される。バースト・パタ
ーン２１０の各変移により、変換器信号３０４に対応す
るピーク３０６、３０８が生じる。これらのピークのタ
イミングが、バースト変移と同じ周波数をもつ参照クロ
ック３０５と関係付けて示されている。このクロック３
０５は、サーボ情報の周波数及び位相に適合させるため
に可変周波数発振器を調整するべく、ＡＧＣフィールド
及びＳＩＤを用いて得ることができる。別の方法とし
て、高周波を、ＡＧＣフィールドのガイダンスに適合す
る位相へ分周してもよい。図示のように、ヘッドが径方
向でバースト２１０と並んでおり、最大振幅を１ボルト
と想定した場合、検知信号の各ピーク３０６、３０８は
約＋１又は−１ボルトの最大振幅を有することとなる。
ピーク振幅は、変換器３０２の径方向位置と共に変化す
る。例えば、変換器３０２がトラックＴｒｋnと径方向
で並んでいるとき、変換器は、バースト・パターンの半
分の上を通過するのみであるので、Ａバースト２１０か
ら得られる変換器信号３０４は、約＋０．５又は−０．
５ボルトの最大ピーク振幅を有することとなる。
向で並んだ変換器３０２も示されている。変換器３０２
がバースト・パターン２１０上を通過すると、図３
（Ｂ）の検知信号３０４が発生される。バースト・パタ
ーン２１０の各変移により、変換器信号３０４に対応す
るピーク３０６、３０８が生じる。これらのピークのタ
イミングが、バースト変移と同じ周波数をもつ参照クロ
ック３０５と関係付けて示されている。このクロック３
０５は、サーボ情報の周波数及び位相に適合させるため
に可変周波数発振器を調整するべく、ＡＧＣフィールド
及びＳＩＤを用いて得ることができる。別の方法とし
て、高周波を、ＡＧＣフィールドのガイダンスに適合す
る位相へ分周してもよい。図示のように、ヘッドが径方
向でバースト２１０と並んでおり、最大振幅を１ボルト
と想定した場合、検知信号の各ピーク３０６、３０８は
約＋１又は−１ボルトの最大振幅を有することとなる。
ピーク振幅は、変換器３０２の径方向位置と共に変化す
る。例えば、変換器３０２がトラックＴｒｋnと径方向
で並んでいるとき、変換器は、バースト・パターンの半
分の上を通過するのみであるので、Ａバースト２１０か
ら得られる変換器信号３０４は、約＋０．５又は−０．
５ボルトの最大ピーク振幅を有することとなる。
【００２４】図３（Ｃ）は、ＰＥＳ信号を得るための面
積積分法を示すグラフであり、図４は、面積積分回路の
実施例のブロック図である。図３（Ａ）のバースト・パ
ターンから導出された変換器信号Ｓ（ｔ）３０４は、正
弦波である（図３（Ｂ）を参照）。汎用的方法によれ
ば、変換器信号Ｓ（ｔ）３０４は、先ず、全波整流器３
２２により整流された後、積分回路３２４へ入力され
る。ここで、ＰＥＳ信号のセグメント３１４を発生する
ために変移が合計され、最大振幅利得に近づく。この利
得はアナログ・デジタル変換器(ＡＤＣ）３２６へ与え
られ、ここで、所与のデジタル表現へと変換される。例
えば、「７ＦＦ（Ｘ）」等である。その後、デジタル値
はマイクロプロセッサへ入力され、そこで、サーボ・マ
イクロコードがそれをトラック値へと変換する。変換器
３０２がバーストと好適に並んでいる場合、この値は、
図２に示したバースト・パターンについて最大となる、
すなわち１トラックにおけるものとなる。マイクロプロ
セッサは、バースト情報と、方形バースト・パターンの
Ｂ、Ｃ及びＤバーストから得られる類似の信号及びグレ
イ・コードとを組合せるすなわち「継ぎ合わせる（stit
ch）」ことにより、連続的な位置信号を発生する。ＰＥ
Ｓ信号発生についてのさらに詳細な説明は、米国特許出
願第08/628,217号を参照されたい。各バーストの径方向
位置が異なるので、各バーストに対する変換器の配列が
異なることになり、それによりこれらに対応する振幅利
得が異なることとなる。
積積分法を示すグラフであり、図４は、面積積分回路の
実施例のブロック図である。図３（Ａ）のバースト・パ
ターンから導出された変換器信号Ｓ（ｔ）３０４は、正
弦波である（図３（Ｂ）を参照）。汎用的方法によれ
ば、変換器信号Ｓ（ｔ）３０４は、先ず、全波整流器３
２２により整流された後、積分回路３２４へ入力され
る。ここで、ＰＥＳ信号のセグメント３１４を発生する
ために変移が合計され、最大振幅利得に近づく。この利
得はアナログ・デジタル変換器(ＡＤＣ）３２６へ与え
られ、ここで、所与のデジタル表現へと変換される。例
えば、「７ＦＦ（Ｘ）」等である。その後、デジタル値
はマイクロプロセッサへ入力され、そこで、サーボ・マ
イクロコードがそれをトラック値へと変換する。変換器
３０２がバーストと好適に並んでいる場合、この値は、
図２に示したバースト・パターンについて最大となる、
すなわち１トラックにおけるものとなる。マイクロプロ
セッサは、バースト情報と、方形バースト・パターンの
Ｂ、Ｃ及びＤバーストから得られる類似の信号及びグレ
イ・コードとを組合せるすなわち「継ぎ合わせる（stit
ch）」ことにより、連続的な位置信号を発生する。ＰＥ
Ｓ信号発生についてのさらに詳細な説明は、米国特許出
願第08/628,217号を参照されたい。各バーストの径方向
位置が異なるので、各バーストに対する変換器の配列が
異なることになり、それによりこれらに対応する振幅利
得が異なることとなる。
【００２５】以上の記載から明らかなように、面積積分
法は、バースト毎の変移数の減少に対して敏感であり、
デジタル・データがコード化されるときに減少が生じる
結果となる。変移数が少ないと、ＰＥＳセグメントの利
得において対応する減少を生じる。各バーストの振幅減
少が知られていたならば、それでもなお有効な位置信号
を得ることができる。なぜなら、ＰＥＳ信号は、米国特
許出願第08/628,217号に開示の方法に従って正規化する
ことができるからである。正規化プロセスは、各バース
トの利得が同じ量だけ減少されたとすれば、単純化され
るであろう。バースト・フィールド毎に同数の又は実質
的に同数の変移を保証するコードか方式を選択すること
により、整合性ある減少を実現することができる。
法は、バースト毎の変移数の減少に対して敏感であり、
デジタル・データがコード化されるときに減少が生じる
結果となる。変移数が少ないと、ＰＥＳセグメントの利
得において対応する減少を生じる。各バーストの振幅減
少が知られていたならば、それでもなお有効な位置信号
を得ることができる。なぜなら、ＰＥＳ信号は、米国特
許出願第08/628,217号に開示の方法に従って正規化する
ことができるからである。正規化プロセスは、各バース
トの利得が同じ量だけ減少されたとすれば、単純化され
るであろう。バースト・フィールド毎に同数の又は実質
的に同数の変移を保証するコードか方式を選択すること
により、整合性ある減少を実現することができる。
【００２６】図３（Ｄ）は、ＰＥＳ信号を得るためのピ
ークホールド法を示すグラフである。変換器信号Ｓ
（ｔ）３０４は整流器へ入力され、整流された変換器信
号はキャパシタ回路へ与えられる。キャパシタは、第１
の変移パルスを受け取り、そのパルスの持続中充電す
る。その後、その充電された値を次のピークが発生する
まで保持し、そして信号３１６により示すように、その
パルスの最大振幅が到達するまで後続の各ピークの持続
中充電を続ける。充電プロセスが繰り返されるので、最
大ピーク振幅を得るためにピークホールド回路に対して
バースト毎に少なくともしきい値数だけのパルス数を与
えることが必要である。
ークホールド法を示すグラフである。変換器信号Ｓ
（ｔ）３０４は整流器へ入力され、整流された変換器信
号はキャパシタ回路へ与えられる。キャパシタは、第１
の変移パルスを受け取り、そのパルスの持続中充電す
る。その後、その充電された値を次のピークが発生する
まで保持し、そして信号３１６により示すように、その
パルスの最大振幅が到達するまで後続の各ピークの持続
中充電を続ける。充電プロセスが繰り返されるので、最
大ピーク振幅を得るためにピークホールド回路に対して
バースト毎に少なくともしきい値数だけのパルス数を与
えることが必要である。
【００２７】図５（Ａ）乃至図５（Ｄ）を参照して、本
発明を説明する。この場合、サーボ・セクタにおいてバ
ースト・パターンより前に先行するデジタル・サーボ・
データが、各ＰＥＳバーストへコード化される。従来技
術より改善された本発明の第１の態様は、バイナリ・サ
ーボ情報の各ビットがバースト・パターンの単一タイム
・スロット内に表されることである。従来技術と異な
り、各ビットを表現するために複数のタイム・スロット
を用いる必要がなく、サーボ・データをフラグで区切る
必要もない。その代わりに、バイナリ・データが、ビッ
ト毎を基本として効率的に「振幅復調」される。デジタ
ル情報は、次のうち１又は複数を含む。すなわち、ＳＩ
Ｄ、インデックス・マーク、並びに、シリンダ番号、ト
ラック番号、ヘッド番号及びセクタ番号等のトラック識
別情報である。さらに、全体をコード化することもで
き、あるいは一部のみをコード化することもでき、そし
て複数の隣り合うサーボ・セクタの間に分けることもで
きる。本発明の第２の態様として、デジタル・サーボ・
データは、バースト内にしきい値数だけの変移が存在す
ることを確保するような方法でバーストに書き込まれ
る。これにより、バースト・パターンの正確なピークホ
ールド検出が可能となる。別の方法として、バイナリ・
データが、バースト毎に同数の変移又は実質的に一定数
の変移を確保するような方法でバーストに書き込まれ
る。これにより、正確な面積積分検出ができる。
発明を説明する。この場合、サーボ・セクタにおいてバ
ースト・パターンより前に先行するデジタル・サーボ・
データが、各ＰＥＳバーストへコード化される。従来技
術より改善された本発明の第１の態様は、バイナリ・サ
ーボ情報の各ビットがバースト・パターンの単一タイム
・スロット内に表されることである。従来技術と異な
り、各ビットを表現するために複数のタイム・スロット
を用いる必要がなく、サーボ・データをフラグで区切る
必要もない。その代わりに、バイナリ・データが、ビッ
ト毎を基本として効率的に「振幅復調」される。デジタ
ル情報は、次のうち１又は複数を含む。すなわち、ＳＩ
Ｄ、インデックス・マーク、並びに、シリンダ番号、ト
ラック番号、ヘッド番号及びセクタ番号等のトラック識
別情報である。さらに、全体をコード化することもで
き、あるいは一部のみをコード化することもでき、そし
て複数の隣り合うサーボ・セクタの間に分けることもで
きる。本発明の第２の態様として、デジタル・サーボ・
データは、バースト内にしきい値数だけの変移が存在す
ることを確保するような方法でバーストに書き込まれ
る。これにより、バースト・パターンの正確なピークホ
ールド検出が可能となる。別の方法として、バイナリ・
データが、バースト毎に同数の変移又は実質的に一定数
の変移を確保するような方法でバーストに書き込まれ
る。これにより、正確な面積積分検出ができる。
【００２８】図５（Ａ）は、デジタル・サーボ情報を含
むサーボ・バースト・フィールド４１０を示す概略図で
ある。好適には、サーボ・セクタの各バースト、例え
ば、方形パターンの各バーストは、同じデジタル情報を
含む。バースト・フィールドのいくつかのタイム・スロ
ットｔ0〜ｔnのみが変移を含み、残りはヌル（空）を含
む。本実施例については、ＰＥＳバーストのピークホー
ルド検出ができるように、バーストが十分な数の又はし
きい値数だけのバーストを含むと想定する。バースト毎
にしきい値数だけの変移を確保するための特定の方法に
ついては、後述する。しきい値数は、ピークホールド回
路中のキャパシタの特定の充電特性により決定される。
むサーボ・バースト・フィールド４１０を示す概略図で
ある。好適には、サーボ・セクタの各バースト、例え
ば、方形パターンの各バーストは、同じデジタル情報を
含む。バースト・フィールドのいくつかのタイム・スロ
ットｔ0〜ｔnのみが変移を含み、残りはヌル（空）を含
む。本実施例については、ＰＥＳバーストのピークホー
ルド検出ができるように、バーストが十分な数の又はし
きい値数だけのバーストを含むと想定する。バースト毎
にしきい値数だけの変移を確保するための特定の方法に
ついては、後述する。しきい値数は、ピークホールド回
路中のキャパシタの特定の充電特性により決定される。
【００２９】変換器３０２が、コード化されたバースト
・フィールド４１０上を通ると、図５（Ｂ）に示す変換
器信号４０８が発生される。それは、ピーク４０２、４
０６を含む。これらのピークは、変移を含むタイム・ス
ロットに対して時間的に対応し、平坦部分４０４は、ヌ
ル・スロットに対して時間的に対応する。ＡＧＣフィー
ルド及びＳＩＤを介してサーボ・バースト周波数へ同期
した参照クロック信号３０５は、参照のために設けられ
ている。この参照クロックは、バイナリ・データを抽出
しかつデジタル化するために用いられる。
・フィールド４１０上を通ると、図５（Ｂ）に示す変換
器信号４０８が発生される。それは、ピーク４０２、４
０６を含む。これらのピークは、変移を含むタイム・ス
ロットに対して時間的に対応し、平坦部分４０４は、ヌ
ル・スロットに対して時間的に対応する。ＡＧＣフィー
ルド及びＳＩＤを介してサーボ・バースト周波数へ同期
した参照クロック信号３０５は、参照のために設けられ
ている。この参照クロックは、バイナリ・データを抽出
しかつデジタル化するために用いられる。
【００３０】図５（Ｃ）は、変換器信号４０８のピーク
ホールド検出を示すグラフである。デジタル・サーボ・
データをコード化する方法が記憶媒体の各バースト内の
同数の変移又は実質的に同数の変移を与える場合、面積
積分を用いることもできる。キャパシタ出力信号４１２
の経過により示されるように、ピークホールド・キャパ
シタは最大利得へ充電を続ける。なぜなら、検知されて
いるバースト・フィールド中に最小数のピークが存在す
るからである。
ホールド検出を示すグラフである。デジタル・サーボ・
データをコード化する方法が記憶媒体の各バースト内の
同数の変移又は実質的に同数の変移を与える場合、面積
積分を用いることもできる。キャパシタ出力信号４１２
の経過により示されるように、ピークホールド・キャパ
シタは最大利得へ充電を続ける。なぜなら、検知されて
いるバースト・フィールド中に最小数のピークが存在す
るからである。
【００３１】ＰＥＳ信号の発生と同時に、デジタル・サ
ーボ・データが抽出されて図５（Ｄ）に示すようなデジ
タル表現が生成される。データは、好適には、汎用的な
ピーク検出回路を用いて抽出される。すなわち、ＰＥＳ
パターンの特定のタイム・スロットに対応する変換器信
号が最小しきい値を超えた場合、そのタイム・スロット
は「１」のビットを含むとみなされ、デジタル・パルス
４１８が発生される。それ以外の場合、タイム・スロッ
トはヌルとみなされるのでパルスは発生されない（符号
４２０）。
ーボ・データが抽出されて図５（Ｄ）に示すようなデジ
タル表現が生成される。データは、好適には、汎用的な
ピーク検出回路を用いて抽出される。すなわち、ＰＥＳ
パターンの特定のタイム・スロットに対応する変換器信
号が最小しきい値を超えた場合、そのタイム・スロット
は「１」のビットを含むとみなされ、デジタル・パルス
４１８が発生される。それ以外の場合、タイム・スロッ
トはヌルとみなされるのでパルスは発生されない（符号
４２０）。
【００３２】サーボ・セクタのＰＥＳバーストは、互い
に関して径方向に隔たりがあるので、前述のように、検
知されるバーストに依存して変換器信号の振幅が変化す
ることになる。例えば、変換器が図２のトラックＴｒｋ
nと並んでいる場合、Ａバースト２１０の半分のみを検
知することになり、その結果、約０．５ボルトのピーク
振幅をもつ変換器信号が得られる。同様に、Ｃバースト
２１４の半分のみが検知される結果、約０．５ボルトの
変換器信号が得られる。Ｂバースト２１２は変換器と完
全に並ぶので、１ボルトのピークをもつ変換器信号を発
生し、Ｄバースト２１６は変換器の範囲から出ているの
で、実質的に平坦な信号を発生する。従って、ヘッドが
トラックと並んでいるとき、ピーク検出のための最小し
きい値電圧を約０．３ボルトの値に設定すればＡ、Ｂ及
びＣのバーストからデジタル情報を抽出することができ
る。復号化のために、最も大きな振幅をもつ信号が選択
されるが、他の信号もまた確認のために検査される。従
って、読み戻し信頼性をより大きくするために、検出方
式に冗長性が設けられる。
に関して径方向に隔たりがあるので、前述のように、検
知されるバーストに依存して変換器信号の振幅が変化す
ることになる。例えば、変換器が図２のトラックＴｒｋ
nと並んでいる場合、Ａバースト２１０の半分のみを検
知することになり、その結果、約０．５ボルトのピーク
振幅をもつ変換器信号が得られる。同様に、Ｃバースト
２１４の半分のみが検知される結果、約０．５ボルトの
変換器信号が得られる。Ｂバースト２１２は変換器と完
全に並ぶので、１ボルトのピークをもつ変換器信号を発
生し、Ｄバースト２１６は変換器の範囲から出ているの
で、実質的に平坦な信号を発生する。従って、ヘッドが
トラックと並んでいるとき、ピーク検出のための最小し
きい値電圧を約０．３ボルトの値に設定すればＡ、Ｂ及
びＣのバーストからデジタル情報を抽出することができ
る。復号化のために、最も大きな振幅をもつ信号が選択
されるが、他の信号もまた確認のために検査される。従
って、読み戻し信頼性をより大きくするために、検出方
式に冗長性が設けられる。
【００３３】検出回路は、参照クロックを用いてデジタ
ル・サーボ・データを抽出し、ＰＥＳバーストのタイム
・スロットへ同期させられている。各クロック・サイク
ルは、既知の方法により、変換器信号中のパルスの有無
を検出するためのタイミング・ウィンドウの役割を果た
す。
ル・サーボ・データを抽出し、ＰＥＳバーストのタイム
・スロットへ同期させられている。各クロック・サイク
ルは、既知の方法により、変換器信号中のパルスの有無
を検出するためのタイミング・ウィンドウの役割を果た
す。
【００３４】本発明において、バースト毎のしきい値数
だけの変移の数を保証するための２つの方法が提示され
る。図６は、第１の方法を示す表である。この例におい
ては、各ＰＥＳパターンが１０個のタイム・スロットを
有すると想定される。２ビットのヘッド番号がバースト
・フィールドへコード化されるとする。残りのデジタル
・サーボ・データは、従来技術に従いバースト・フィー
ルドより先行する。ヘッド番号が１つのサーボ・バース
トへ書き込まれようとした場合、１０個のタイム・スロ
ットのうち２個を占有することになる。ヘッド番号が
「００」の値をもつことがあるので、バースト毎に８個
だけの変移がバースト・フィールドに表れることを保証
される。これは、ピークホールド検出のために必要な変
移のしきい値数が８より小さいか又は等しい場合には問
題ない。しかしながら、しきい値数が９である場合、こ
の表現方式は、必要なしきい値を保証することができな
くなる。
だけの変移の数を保証するための２つの方法が提示され
る。図６は、第１の方法を示す表である。この例におい
ては、各ＰＥＳパターンが１０個のタイム・スロットを
有すると想定される。２ビットのヘッド番号がバースト
・フィールドへコード化されるとする。残りのデジタル
・サーボ・データは、従来技術に従いバースト・フィー
ルドより先行する。ヘッド番号が１つのサーボ・バース
トへ書き込まれようとした場合、１０個のタイム・スロ
ットのうち２個を占有することになる。ヘッド番号が
「００」の値をもつことがあるので、バースト毎に８個
だけの変移がバースト・フィールドに表れることを保証
される。これは、ピークホールド検出のために必要な変
移のしきい値数が８より小さいか又は等しい場合には問
題ない。しかしながら、しきい値数が９である場合、こ
の表現方式は、必要なしきい値を保証することができな
くなる。
【００３５】この問題を解決するために、図６の表に示
すように、ヘッド番号が２つのセクタＳnとＳn+1へ分け
られる。これにより各セクタのバーストは、ヘッド値に
関係なく最小数の変移を所有する。この例においては、
偶数番号のサーボ・セクタがトラック上に存在し、ヘッ
ド番号の最上位ビットがセクタＳnの各バーストの所定
のタイム・スロットへ書き込まれ、そして最下位ビット
がセクタＳn+1の各バーストの所定のタイム・スロット
へ書き込まれると仮定する。タイム・スロットｔ2は、
この例では任意に選ばれる。
すように、ヘッド番号が２つのセクタＳnとＳn+1へ分け
られる。これにより各セクタのバーストは、ヘッド値に
関係なく最小数の変移を所有する。この例においては、
偶数番号のサーボ・セクタがトラック上に存在し、ヘッ
ド番号の最上位ビットがセクタＳnの各バーストの所定
のタイム・スロットへ書き込まれ、そして最下位ビット
がセクタＳn+1の各バーストの所定のタイム・スロット
へ書き込まれると仮定する。タイム・スロットｔ2は、
この例では任意に選ばれる。
【００３６】上記の例ではヘッド番号を取り扱ったが、
同じ基本的手法を他のタイプのバイナリ・サーボ情報に
ついて用いることができる。その場合、バイナリ・デー
タを、ピークホールド検出のためのバースト毎の最小数
の変移が可能な方法により、複数のセクタの間で分割す
ることができる。例えば、バーストが１０スロット、変
移のしきい値数が６個、バイナリ・サーボ・データが１
２ビットであると想定すると、その１２ビットのデータ
は、各部分に分けられて複数の隣り合うサーボ・セクタ
へ書き込まれる。各バーストの６個のスロットが変移を
含まなければならないので、各データ部分は、４スロッ
ト（すなわち、１０スロット−６スロット）より多い情
報を占有できない。これを実行するための多数の方法が
あることは明らかである。例えば、データを、３つの４
ビット部分へ分割したり、４つの３ビット部分へ分割し
たりする等、トラック上のサーボ・セクタの全数に依存
する特定のフォーマットへと分割できる。すなわち、サ
ーボ・セクタの全数が３で割り切れる場合は、３つの４
ビット部分への分割が選択できる。全数が４で割り切れ
る場合は、４つの３ビット部分への分割が選択できる。
しかしながら、読み戻し信頼性は、できるだけ少ないサ
ーボ・セクタへデータを分散することにより最大とされ
ることに留意すべきである。
同じ基本的手法を他のタイプのバイナリ・サーボ情報に
ついて用いることができる。その場合、バイナリ・デー
タを、ピークホールド検出のためのバースト毎の最小数
の変移が可能な方法により、複数のセクタの間で分割す
ることができる。例えば、バーストが１０スロット、変
移のしきい値数が６個、バイナリ・サーボ・データが１
２ビットであると想定すると、その１２ビットのデータ
は、各部分に分けられて複数の隣り合うサーボ・セクタ
へ書き込まれる。各バーストの６個のスロットが変移を
含まなければならないので、各データ部分は、４スロッ
ト（すなわち、１０スロット−６スロット）より多い情
報を占有できない。これを実行するための多数の方法が
あることは明らかである。例えば、データを、３つの４
ビット部分へ分割したり、４つの３ビット部分へ分割し
たりする等、トラック上のサーボ・セクタの全数に依存
する特定のフォーマットへと分割できる。すなわち、サ
ーボ・セクタの全数が３で割り切れる場合は、３つの４
ビット部分への分割が選択できる。全数が４で割り切れ
る場合は、４つの３ビット部分への分割が選択できる。
しかしながら、読み戻し信頼性は、できるだけ少ないサ
ーボ・セクタへデータを分散することにより最大とされ
ることに留意すべきである。
【００３７】サーボ・セクタの全数が３で割り切れると
仮定すると、３つの４ビット部分が隣り合うサーボ・セ
クタのグループへ分散される。データの第１の部分は、
セクタＳn、Ｓn+3、Ｓn+6、...へと書き込まれる。同様
にして、第２の部分は、セクタＳn+1、Ｓn+4、
Ｓn+7、...へと書き込まれ、そして第３の部分は、セク
タＳn+ 2、Ｓn+5、Ｓn+8、...へと書き込まれる。この方
法では、サーボ・セクタの各バーストの４個のタイム・
スロットがバイナリ情報を含み、残りの６個のタイム・
スロットが変移を含む。これにより、最小しきい値要求
を満足する。
仮定すると、３つの４ビット部分が隣り合うサーボ・セ
クタのグループへ分散される。データの第１の部分は、
セクタＳn、Ｓn+3、Ｓn+6、...へと書き込まれる。同様
にして、第２の部分は、セクタＳn+1、Ｓn+4、
Ｓn+7、...へと書き込まれ、そして第３の部分は、セク
タＳn+ 2、Ｓn+5、Ｓn+8、...へと書き込まれる。この方
法では、サーボ・セクタの各バーストの４個のタイム・
スロットがバイナリ情報を含み、残りの６個のタイム・
スロットが変移を含む。これにより、最小しきい値要求
を満足する。
【００３８】第１の例では、ヘッド番号が、記憶媒体表
面上の全てのバーストについて同じになることに留意す
べきである。結果的に、同じデータ表面の全てのバース
トに同数のビットが現れることになる。従って、この特
定の実施例では、ピークホールド検出の替わりとして面
積積分が適しているであろう。
面上の全てのバーストについて同じになることに留意す
べきである。結果的に、同じデータ表面の全てのバース
トに同数のビットが現れることになる。従って、この特
定の実施例では、ピークホールド検出の替わりとして面
積積分が適しているであろう。
【００３９】記憶媒体が高速で移動しているとき、幾つ
かのサーボ・セクタに亘って分割されたバイナリ・サー
ボ情報の全ての部分を正確に読み取ることも重要であ
る。データのいずれかの部分の読取りを誤ると、次のサ
ーボ・セクタの組で再試行することが必要となる。本発
明は、この問題を大きく軽減する。具体的には、サーボ
・セクタ・サイズを縮小することにより、データ容量を
減らすことなくトラック毎により多くのサーボ・セクタ
が設けられることになる。より多くのサーボ・セクタが
あることで、整合性よくデータを読み取る機会が増す。
かのサーボ・セクタに亘って分割されたバイナリ・サー
ボ情報の全ての部分を正確に読み取ることも重要であ
る。データのいずれかの部分の読取りを誤ると、次のサ
ーボ・セクタの組で再試行することが必要となる。本発
明は、この問題を大きく軽減する。具体的には、サーボ
・セクタ・サイズを縮小することにより、データ容量を
減らすことなくトラック毎により多くのサーボ・セクタ
が設けられることになる。より多くのサーボ・セクタが
あることで、整合性よくデータを読み取る機会が増す。
【００４０】図７は、バースト・フィールド毎の最小数
の変移を保証するための第２の方法を示す。この場合、
５ビットのバイナリ・トラック番号がバースト中に表さ
れることになる。この例においては、バーストが１０個
のタイム・スロットを有しかつ正確なピークホールド検
出のために必要な変移のしきい値数は８個であると想定
する。トラック番号がバースト・フィールドへ直接書き
込まれたとすると、５個のタイム・スロットを占有する
ので、保証された変移存在スロットを５個のみ残すこと
になる。その代わりに、先ず、トラック番号が１０ビッ
ト・パターンの組と共にコード化され、各々が２個を超
えない「０」を有することにより、いずれのバースト・
パターンにおいても、少なくとも８個のタイム・スロッ
トが「１」を含むことになる。各トラック番号及びその
対応する表現を含むルックアップ・テーブル等の手段を
用いて、データがコード化されかつ復号化される。別の
方法として、アルゴリズム又は専用ハードウェアをこの
目的のために用いることができる。変移の個数の変化は
小さいので、この方法もまた、面積積分検出を用いる記
憶装置に適しており、特に、位置エラー信号が正規化さ
れる場合に適している。
の変移を保証するための第２の方法を示す。この場合、
５ビットのバイナリ・トラック番号がバースト中に表さ
れることになる。この例においては、バーストが１０個
のタイム・スロットを有しかつ正確なピークホールド検
出のために必要な変移のしきい値数は８個であると想定
する。トラック番号がバースト・フィールドへ直接書き
込まれたとすると、５個のタイム・スロットを占有する
ので、保証された変移存在スロットを５個のみ残すこと
になる。その代わりに、先ず、トラック番号が１０ビッ
ト・パターンの組と共にコード化され、各々が２個を超
えない「０」を有することにより、いずれのバースト・
パターンにおいても、少なくとも８個のタイム・スロッ
トが「１」を含むことになる。各トラック番号及びその
対応する表現を含むルックアップ・テーブル等の手段を
用いて、データがコード化されかつ復号化される。別の
方法として、アルゴリズム又は専用ハードウェアをこの
目的のために用いることができる。変移の個数の変化は
小さいので、この方法もまた、面積積分検出を用いる記
憶装置に適しており、特に、位置エラー信号が正規化さ
れる場合に適している。
【００４１】バースト毎のビットの最小数を確保するた
めのさらに別の方法は、図８に示すように、デジタル・
サーボ・データ又はその「１」の補数のいずれかを選択
的に書き込むことである。選択は、いずれの態様がバー
スト中により多くの変移を与えるかに基づいて行われ
る。バースト中の特定フィールドは、いずれの態様のデ
ータが書き込まれたかを示す。例えば、図８において
は、列５０２が結果的に書き込まれるバイナリ・データ
の状態を示す。列５０２中の「１」は、データの「１」
の補数が列５０４中に続くことを示すのに対し、「０」
は、列５０４中のデータが変更されていないことを示
す。バーストの残りのタイム・スロットは、列５０６に
示すように変移で充填される。この方式によれば、書き
込まれたデータの半分以上のビットが「１」となる（こ
の場合、３個）。この数を、列５０６中の変移の数に加
えると、保証された変移の全数になる（ここでは、保証
された変移は、３＋３＝６）。
めのさらに別の方法は、図８に示すように、デジタル・
サーボ・データ又はその「１」の補数のいずれかを選択
的に書き込むことである。選択は、いずれの態様がバー
スト中により多くの変移を与えるかに基づいて行われ
る。バースト中の特定フィールドは、いずれの態様のデ
ータが書き込まれたかを示す。例えば、図８において
は、列５０２が結果的に書き込まれるバイナリ・データ
の状態を示す。列５０２中の「１」は、データの「１」
の補数が列５０４中に続くことを示すのに対し、「０」
は、列５０４中のデータが変更されていないことを示
す。バーストの残りのタイム・スロットは、列５０６に
示すように変移で充填される。この方式によれば、書き
込まれたデータの半分以上のビットが「１」となる（こ
の場合、３個）。この数を、列５０６中の変移の数に加
えると、保証された変移の全数になる（ここでは、保証
された変移は、３＋３＝６）。
【００４２】本発明の別の実施例においては、バイナリ
・サーボ・データが、バースト毎の一定数の変移を保証
するような方法でバーストに書き込まれる。図９は、デ
ジタル・サーボ・データを表現する方法を示し、この方
法は、バースト毎の同数のビットを保証することから面
積積分検出法に適合する。説明のために、３ビットのヘ
ッド番号が示されているが、他のサーボ情報であっても
同様に表すことができる。この方法においては、１０個
のタイム・スロットを有するバースト中に、Ｍ個の
「０」ビットが占め、残りのＮ個のタイム・スロットが
変移で充填される。ここでは、Ｍ＝２及びＮ＝８であ
る。よって、各バースト中で８個の変移が保証される。
さらに、全部で（Ｎ＋Ｍ）！／Ｎ！Ｍ！＝４５個のワー
ドを、この方法で表すことができる。３ビットのヘッド
番号については８個のみのヘッド値が可能であるので、
この方式は、この例に対して十分過ぎる程の個別パター
ンを与える。このコード化方式の別の例として、バース
ト・スロットの数が２４個のタイム・スロットまで増え
た場合、すなわちＮ＝１６及びＭ＝８の場合、７３５，
４７１個のワードを表すことができる。表すことができ
るワードの数を考えれば、これが高ビット効率のコード
化方式であることは明らかであろう。
・サーボ・データが、バースト毎の一定数の変移を保証
するような方法でバーストに書き込まれる。図９は、デ
ジタル・サーボ・データを表現する方法を示し、この方
法は、バースト毎の同数のビットを保証することから面
積積分検出法に適合する。説明のために、３ビットのヘ
ッド番号が示されているが、他のサーボ情報であっても
同様に表すことができる。この方法においては、１０個
のタイム・スロットを有するバースト中に、Ｍ個の
「０」ビットが占め、残りのＮ個のタイム・スロットが
変移で充填される。ここでは、Ｍ＝２及びＮ＝８であ
る。よって、各バースト中で８個の変移が保証される。
さらに、全部で（Ｎ＋Ｍ）！／Ｎ！Ｍ！＝４５個のワー
ドを、この方法で表すことができる。３ビットのヘッド
番号については８個のみのヘッド値が可能であるので、
この方式は、この例に対して十分過ぎる程の個別パター
ンを与える。このコード化方式の別の例として、バース
ト・スロットの数が２４個のタイム・スロットまで増え
た場合、すなわちＮ＝１６及びＭ＝８の場合、７３５，
４７１個のワードを表すことができる。表すことができ
るワードの数を考えれば、これが高ビット効率のコード
化方式であることは明らかであろう。
【００４３】図１０に、別の方法を示す。この方法にお
いては、バイナリ・サーボ・データのＸビットがバース
トに書き込まれ、その後に、それらの「１」の補数が続
く。デジタル・サーボ・データがＰＥＳバースト長の半
分よりも長い長さを有する場合、例えば、１０個のタイ
ム・スロットをもつバースト長においてＸが５ビットを
超える場合、そのデジタル・サーボ・データは図示のよ
うに複数のセクタに対して分割され、各部分は、その後
に「１」の補数が続くように書き込まれる。例えば、ト
ラック番号「０００００１」は、Ｘ＝６ビットを含む。
Ｘ＞５であるので、トラック番号は２つの部分「００
０」と「００１」へ分割される。各部分は、もはやバー
スト長の半分より長くない。第１の部分「０００」は、
列５０８で表されるようにセクタＳnの各バーストへ書
き込まれる。列５１２に示すように、これらのビットの
後にそれらの「１」の補数である「１１１」が続く。各
バーストの残りのタイム・スロットは、列５１６で表さ
れるようにＹ個の変移で充填される。同様に、第２の部
分「００１」は、列５１０で表されるようにセクタＳ
n+1の各バーストへ書き込まれ、列５１４で示されるよ
うにその「１」の補数「１１０」が続く。再び、各バー
ストの残りのタイム・スロットは、列５１８で示すよう
にＹ個の変移で充填される。この方法では、各バースト
は、一定のＸ／２＋Ｙ個の変移を含む。
いては、バイナリ・サーボ・データのＸビットがバース
トに書き込まれ、その後に、それらの「１」の補数が続
く。デジタル・サーボ・データがＰＥＳバースト長の半
分よりも長い長さを有する場合、例えば、１０個のタイ
ム・スロットをもつバースト長においてＸが５ビットを
超える場合、そのデジタル・サーボ・データは図示のよ
うに複数のセクタに対して分割され、各部分は、その後
に「１」の補数が続くように書き込まれる。例えば、ト
ラック番号「０００００１」は、Ｘ＝６ビットを含む。
Ｘ＞５であるので、トラック番号は２つの部分「００
０」と「００１」へ分割される。各部分は、もはやバー
スト長の半分より長くない。第１の部分「０００」は、
列５０８で表されるようにセクタＳnの各バーストへ書
き込まれる。列５１２に示すように、これらのビットの
後にそれらの「１」の補数である「１１１」が続く。各
バーストの残りのタイム・スロットは、列５１６で表さ
れるようにＹ個の変移で充填される。同様に、第２の部
分「００１」は、列５１０で表されるようにセクタＳ
n+1の各バーストへ書き込まれ、列５１４で示されるよ
うにその「１」の補数「１１０」が続く。再び、各バー
ストの残りのタイム・スロットは、列５１８で示すよう
にＹ個の変移で充填される。この方法では、各バースト
は、一定のＸ／２＋Ｙ個の変移を含む。
【００４４】図１１（Ａ）は、図９の表に示すように表
されたデジタル・サーボ・データを含むサーボ・バース
ト・フィールド６１０の概略図である。同じサーボ・セ
クタの各バーストは、好適には冗長性について同じ方法
で書き込まれる。変換器３０２がバースト６１０の上を
通過すると、図１１（Ｂ）の信号６０８が得られる。前
述のように、これは、変移を含むタイム・スロットに時
間的に対応するピーク６０２、６０４と、ヌル・タイム
・スロットへ対応する平坦部分６０６を有する。信号６
０８は、バースト変移の周波数の半分で駆動されている
クロック信号３０５に関連付けて示されている。
されたデジタル・サーボ・データを含むサーボ・バース
ト・フィールド６１０の概略図である。同じサーボ・セ
クタの各バーストは、好適には冗長性について同じ方法
で書き込まれる。変換器３０２がバースト６１０の上を
通過すると、図１１（Ｂ）の信号６０８が得られる。前
述のように、これは、変移を含むタイム・スロットに時
間的に対応するピーク６０２、６０４と、ヌル・タイム
・スロットへ対応する平坦部分６０６を有する。信号６
０８は、バースト変移の周波数の半分で駆動されている
クロック信号３０５に関連付けて示されている。
【００４５】図１１（Ｃ）は、図１１（Ｂ）の変換器信
号の面積積分を示すグラフである。図示のように、利得
は、バースト・パターンのヌル・タイム・スロットによ
り影響を受ける。しかしながら、バースト毎の変移の数
が一定でありかつデータ表面全体について知られている
ので、欠損を補うように利得を増加させることができ、
最大値１ボルトが得られる。さらに、前述のように、継
ぎ合わせ後におけるより円滑な位置信号のために利得曲
線６１２を正規化することができる。
号の面積積分を示すグラフである。図示のように、利得
は、バースト・パターンのヌル・タイム・スロットによ
り影響を受ける。しかしながら、バースト毎の変移の数
が一定でありかつデータ表面全体について知られている
ので、欠損を補うように利得を増加させることができ、
最大値１ボルトが得られる。さらに、前述のように、継
ぎ合わせ後におけるより円滑な位置信号のために利得曲
線６１２を正規化することができる。
【００４６】図１１（Ｄ）は、本発明により図１１
（Ｂ）の変換器信号から並行して抽出されるデジタル・
データを表す。ここでも、バースト・パターンのタイム
・スロットが変移を含む場合にのみパルスが示される。
（Ｂ）の変換器信号から並行して抽出されるデジタル・
データを表す。ここでも、バースト・パターンのタイム
・スロットが変移を含む場合にのみパルスが示される。
【００４７】図１２は、本発明によりバースト・フィー
ルドからＰＥＳ及びデジタル・サーボ・データの双方を
検出するためのサーボ電子回路における検出回路の一例
のブロック図である。アナログ変換器信号が、増幅器７
０４により受け入れられ、ＰＥＳとデジタルの双方の検
出回路へ与えられる。ＰＥＳ検出回路は復調器７０６を
含み、例えば、ピークホールド回路又は面積積分回路を
有する。復調器７０６の出力は、アナログ・デジタル
（Ａ／Ｄ）変換器７０８によりデジタル化される。その
後、デジタル化ＰＥＳ信号はマイクロプロセッサ７１２
へ与えられ、そして変換器位置を示す位置信号を発生す
るためにデジタル・サーボ情報と継ぎ合わされることと
なる。
ルドからＰＥＳ及びデジタル・サーボ・データの双方を
検出するためのサーボ電子回路における検出回路の一例
のブロック図である。アナログ変換器信号が、増幅器７
０４により受け入れられ、ＰＥＳとデジタルの双方の検
出回路へ与えられる。ＰＥＳ検出回路は復調器７０６を
含み、例えば、ピークホールド回路又は面積積分回路を
有する。復調器７０６の出力は、アナログ・デジタル
（Ａ／Ｄ）変換器７０８によりデジタル化される。その
後、デジタル化ＰＥＳ信号はマイクロプロセッサ７１２
へ与えられ、そして変換器位置を示す位置信号を発生す
るためにデジタル・サーボ情報と継ぎ合わされることと
なる。
【００４８】デジタル検出回路はデジタル復調器７１０
を含み、例えば、ピーク検出回路を有する。デジタル復
調器７１０は、所定の最小しきい値振幅を用いることに
よって、入力するアナログ信号からデジタル・パルス・
ストリームを作成する。デジタル・ストリームはマイク
ロプロセッサ７１２へ与えられ、マイクロプロセッサ７
１２は、４個のバーストの１つからデジタル情報を選択
し、それを用いて位置信号を作成する。さらにマイクロ
プロセッサ７１２は、冗長性検査のために、選択された
バーストから抽出されたデジタル・データと、他の検出
されたバーストから抽出されたデジタル・データを比較
する。
を含み、例えば、ピーク検出回路を有する。デジタル復
調器７１０は、所定の最小しきい値振幅を用いることに
よって、入力するアナログ信号からデジタル・パルス・
ストリームを作成する。デジタル・ストリームはマイク
ロプロセッサ７１２へ与えられ、マイクロプロセッサ７
１２は、４個のバーストの１つからデジタル情報を選択
し、それを用いて位置信号を作成する。さらにマイクロ
プロセッサ７１２は、冗長性検査のために、選択された
バーストから抽出されたデジタル・データと、他の検出
されたバーストから抽出されたデジタル・データを比較
する。
【００４９】最後に、図１３（Ａ）は、読み戻し信頼性
をさらに大きくするべく、バースト８０２中のバイナリ
・サーボ・データの各ビットを表すために単一変移では
なく一対の変移すなわち「双ビット」が用いられる別の
表現方式を表している。言い換えるならば、バイナリ・
データの「１」ビットが２つの連続的な変移含有タイム
・スロット８０４により表され、各「０」ビットが２つ
の連続的な空タイム・スロット８０６により表される。
図１３（Ａ）に表されたバイナリ・データは、図１１
（Ａ）のバーストに表された情報と同じである。容易に
判るように、この表現方式は、先に提示した方式におけ
る占有場所の２倍を必要とするので、サーボ情報の読み
戻し信頼性が空間要求よりも重視される場合に望ましい
方式である。
をさらに大きくするべく、バースト８０２中のバイナリ
・サーボ・データの各ビットを表すために単一変移では
なく一対の変移すなわち「双ビット」が用いられる別の
表現方式を表している。言い換えるならば、バイナリ・
データの「１」ビットが２つの連続的な変移含有タイム
・スロット８０４により表され、各「０」ビットが２つ
の連続的な空タイム・スロット８０６により表される。
図１３（Ａ）に表されたバイナリ・データは、図１１
（Ａ）のバーストに表された情報と同じである。容易に
判るように、この表現方式は、先に提示した方式におけ
る占有場所の２倍を必要とするので、サーボ情報の読み
戻し信頼性が空間要求よりも重視される場合に望ましい
方式である。
【００５０】バースト８０２から発生される変換器信号
８０８が図１３（Ｂ）に示される。バーストの各変移の
対は、双ビット８１０を発生する一方、空スロットの対
は、平坦な信号部分８１２を発生する。この表現方式に
おけるデジタル復調器回路は、２つのクロック・サイク
ルにより規定されるタイム・ウィンドウ内で双ビットの
存在が検出されたときにのみデジタル・パルス・ストリ
ーム８１４中にパルス８１６が発生されるように変形さ
れる。この時間内に双ビットの対がない場合、平坦な信
号部分８１８となる。
８０８が図１３（Ｂ）に示される。バーストの各変移の
対は、双ビット８１０を発生する一方、空スロットの対
は、平坦な信号部分８１２を発生する。この表現方式に
おけるデジタル復調器回路は、２つのクロック・サイク
ルにより規定されるタイム・ウィンドウ内で双ビットの
存在が検出されたときにのみデジタル・パルス・ストリ
ーム８１４中にパルス８１６が発生されるように変形さ
れる。この時間内に双ビットの対がない場合、平坦な信
号部分８１８となる。
【００５１】まとめとして、本発明の構成に関して以下
の事項を開示する。
の事項を開示する。
【００５２】（１）記憶表面を有するデータ記憶媒体に
おいて、サーボ・バーストを書き込んだデータ記憶トラ
ックと、前記サーボ・バースト内に表されたバイナリ・
サーボ・データとを有し、上記サーボ・バーストが前記
トラック中央に対して変換器を位置決めするためのアナ
ログ位置情報を与えかつｔn個のタイム・スロットを含
み、上記バイナリ・サーボ・データの各ビットが一続き
で前記バーストのタイム・スロットの１つのみに表さ
れ、前記バイナリ・データの各「１」ビットが変移とし
て表され、かつ各「０」ビットがヌルとして表されるこ
とにより、前記バイナリ・サーボ・データ及び前記アナ
ログ位置情報の双方を同じバーストから取り出すことが
できるデータ記憶媒体。 （２）前記記憶表面がさらに、少なくとも１つのサーボ
領域を有し、各サーボ領域が複数のバーストを含む上記
（１）のデータ記憶媒体。 （３）同一のバイナリ・データが、同じサーボ領域の各
バーストに書き込まれる上記（２）のデータ記憶媒体。 （４）前記サーボ・データの少なくとも一部が、前記バ
ーストへ書き込まれる前にコード化される上記（１）の
データ記憶媒体。 （５）前記記憶媒体が複数のデータ記憶トラックを具備
するデータ記憶ディスクを有し、前記バイナリ・サーボ
・データがトラック番号を有する上記（１）のデータ記
憶媒体。 （６）前記記憶媒体が、少なくとも１つのデータ記憶デ
ィスクと少なくとも２つのデータ記憶表面を有し、それ
らの記憶表面の間に複数のデータ・シリンダを形成し、
前記バイナリ・サーボ・データがシリンダ番号を有する
上記（１）のデータ記憶媒体。 （７）前記記憶媒体が複数のデータ記憶表面を有し、前
記バイナリ・サーボ・データが前記記憶表面の１つを識
別するヘッド番号を有する上記（１）のデータ記憶媒
体。 （８）前記記憶媒体が、複数のデータ・トラックと、前
記データ・トラック間に配置された複数のサーボ領域と
を有し、前記バイナリ・サーボ・データがセクタ番号を
有する上記（１）のデータ記憶媒体。 （９）前記バイナリ・サーボ・データがＳＩＤを有する
上記（１）のデータ記憶媒体。 （１０）前記バイナリ・サーボ・データがインデックス
・マークを有する上記（１）のデータ記憶媒体。 （１１）前記記憶表面が複数のバーストを含み、正確な
ピークホールド復調を容易に行うべく各バースト内にし
きい値数だけの変移が設けられるように前記バースト内
に前記バイナリ・サーボ・データが表される上記（１）
のデータ記憶媒体。 （１２）前記記憶表面が複数のサーボ領域を有し、各サ
ーボ領域がバーストを含み、かつ、前記バイナリ・サー
ボ・データが複数の部分へ分割され、各部分がＸi個の
ビットを有し、ｔn−Ｘiがしきい値数より小さくなく、
各部分が複数のサーボ領域の別々のバーストに表される
上記（１１）のデータ記憶媒体。 （１３）バイナリ・サーボ・データが複数の可能な値を
もつバイナリ・ワードを有し、かつ、バーストに表され
る各バイナリ・ワードの値が少なくともしきい値数だけ
の「１」ビットをもつｔn個のビットからなる個別のパ
ターンとしてコード化されることにより、前記ワードが
バーストへ書き込まれるとき、前記バーストが少なくと
もしきい値数だけの変移を含む上記（１１）のデータ記
憶媒体。 （１４）前記バイナリ・データがその１の補数よりも多
い「１」ビットを有する場合、前記バイナリ・データが
そのバーストに書き込まれることを示すパターンと共に
前記バイナリ・データが前記バーストに書き込まれ、前
記バイナリ・データがその１の補数よりも少ない「１」
ビットを有する場合、前記バイナリ・データの１の補数
がそのバーストに書き込まれることを示すパターンと共
にその１の補数が前記バーストに書き込まれる上記
（１）のデータ記憶媒体。 （１５）前記データ記憶表面上の情報を読み取るべく前
記データ記憶表面の近傍に位置決めされる変換器と、前
記変換器により読み取られる情報からアナログ位置情報
を検出するべく前記変換器へ接続されたピークホールド
検出回路とを有する上記（１）のデータ記憶媒体。 （１６）前記記憶媒体が複数のバーストを含み、かつ正
確な面積積分検出を容易に行うべく各バースト中に一定
数の変移が設けられるように前記バイナリ・サーボ・デ
ータが前記バーストに書き込まれる上記（１）のデータ
記憶媒体。 （１７）前記バイナリ・サーボ情報が複数の可能な値を
もつバイナリ・ワードであり、前記バーストに書き込ま
れる各ワード値がＮ個の変移含有スロットとＭ個の空ス
ロットからなる個別パターンとして表される上記（１
６）のデータ記憶媒体。 （１８）前記バイナリ・サーボ・データがＸ個のビット
を有し、２Ｘがｔnより小さいか又は等しく、かつ、バ
イナリ・サーボ・データ及びその１の補数が各バースト
へ書き込まれ、前記バーストのタイム・スロットのいず
れの残りの「１」も変移により書き込まれる上記（１
６）のデータ記憶媒体。 （１９）前記データ記憶表面上の情報を読み取るべく前
記データ記憶表面の近傍に位置決めされる変換器と、前
記変換器により読み取られる情報からアナログ位置情報
を検出するべく前記変換器へ接続された面積積分検出回
路とを有する上記（１）のデータ記憶媒体。 （２０）複数のバーストを有し、前記面積積分検出回路
がさらに、各バースト中の変移の数の変動を補正するた
めに前記面積積分検出回路の出力を正規化する手段を有
する上記（１９）のデータ記憶媒体。 （２１）前記バーストから前記バイナリ・サーボ・デー
タ及びアナログ位置情報を同時に検出する検出回路をさ
らに有する上記（２０）のデータ記憶媒体。 （２２）変換器と、前記変換器へ接続された検出回路
と、前記変換器の近傍に配置され記憶表面を具備するデ
ータ記憶媒体とを有するデータ記憶装置において、前記
データ記憶媒体が、サーボ・バーストを書き込んだデー
タ記憶トラックと、前記サーボ・バースト内に表された
バイナリ・サーボ・データとを有し、上記サーボ・バー
ストが前記トラック中央に対して変換器を位置決めする
ためのアナログ位置情報を与えかつｔn個のタイム・ス
ロットを含み、上記バイナリ・サーボ・データの各ビッ
トが一続きでかつ前記バーストのタイム・スロットの１
つのみに表され、前記バイナリ・データの各「１」ビッ
トが変移として表され、かつ各「０」ビットがヌルとし
て表されることにより、前記バイナリ・サーボ・データ
及び前記アナログ位置情報の双方を同じバーストから読
み取ることができるデータ記憶装置。 （２３）前記記憶表面がさらに、少なくとも１つのサー
ボ領域を有し、各サーボ領域が複数のバーストを含む上
記（２２）のデータ記憶装置。 （２４）同じ前記サーボ領域の各バーストに同一のバイ
ナリ・データが書き込まれる上記（２３）のデータ記憶
装置。 （２５）前記バーストへ書き込まれる前に、前記バイナ
リ・サーボ・データの少なくとも一部がコード化される
上記（２２）のデータ記憶装置。 （２６）前記記憶媒体が、複数のデータ記憶トラックを
具備するデータ記憶ディスクを有し、かつ、前記バイナ
リ・サーボ・データがトラック番号を有する上記（２
２）のデータ記憶装置。 （２７）前記記憶媒体が、少なくとも１つのデータ記憶
ディスクと少なくとも２つのデータ記憶表面を有し、前
記データ記憶表面の間に複数のデータ・シリンダを形成
し、かつ、前記バイナリ・サーボ・データがシリンダ番
号を有する上記（２２）のデータ記憶装置。 （２８）前記記憶媒体が、複数のデータ記憶表面を有
し、かつ、前記バイナリ・サーボ・データが、前記デー
タ記憶表面の１つを個別に識別するヘッド番号を有する
上記（２２）のデータ記憶装置。 （２９）前記記憶媒体が、複数のデータ・トラックと、
前記データ・トラック間に配置された複数のサーボ領域
とを有し、かつ、前記バイナリ・サーボ・データがセク
タ番号を有する上記（２２）のデータ記憶装置。 （３０）前記バイナリ・サーボ・データがＳＩＤを有す
る上記（２２）のデータ記憶装置。 （３１）前記バイナリ・サーボ・データがインデックス
・マークを有する上記（２２）のデータ記憶装置。 （３２）前記記憶表面が複数のバーストを含み、かつ、
正確なピークホールド検出を容易に行うべく各バースト
にしきい値数だけの変移を設けるように前記バイナリ・
サーボ・データが前記バーストに表される上記（２２）
のデータ記憶装置。 （３３）前記記憶表面が複数のサーボ領域を有し、その
各々がバーストを含み、かつ、前記バイナリ・サーボ・
データが複数の部分へ分割され、各部分がＸi個のビッ
トを有し、ｔn−Ｘiがしきい値数より小さくなく、かつ
各部分が前記複数のサーボ領域の別々のバーストに表さ
れる上記（３２）のデータ記憶装置。 （３４）前記バイナリ・サーボ・データが複数の可能な
値をもつバイナリ・ワードを有し、かつ、前記バイナリ
・ワードがバーストに書き込まれるとき前記バーストが
少なくともしきい値数だけの変移を含むように、バース
トに表される各バイナリ・ワード値が少なくともしきい
値数だけの１ビットを有するｔn個のビットからなる個
別のパターンとしてコード化される上記（３２）のデー
タ記憶装置。 （３５）前記バイナリ・データがその１の補数よりも多
い「１」ビットを有する場合、前記バイナリ・データが
そのバーストに書き込まれることを示すパターンと共に
前記バイナリ・データが前記バーストに書き込まれ、か
つ、前記バイナリ・データがその１の補数よりも少ない
「１」ビットを有する場合、バイナリ・データの前記１
の補数がそのバーストに書き込まれることを示すパター
ンと共に前記１の補数が前記バーストに書き込まれる上
記（２２）のデータ記憶装置。 （３６）前記検出回路が、前記変換器により読み取られ
たバースト情報から前記バイナリ・サーボ・データを検
出するべく、前記変換器へ接続されたピークホールド検
出回路を有する上記（２２）のデータ記憶装置。 （３７）前記記憶媒体が複数のバーストを含み、かつ、
正確な面積積分検出を容易に行うべく一定数の変移が各
バーストに設けられるように前記バイナリ・サーボ・デ
ータが前記バーストに書き込まれる上記（２２）のデー
タ記憶装置。 （３８）前記バイナリ・サーボ情報が複数の可能な値を
もつバイナリ・ワードであり、かつ、前記バーストに書
き込まれる各ワード値が、Ｎ個の変移含有スロットとＭ
個の空スロットとからなる個別のパターンとして表され
る上記（３７）のデータ記憶装置。 （３９）前記バイナリ・サーボ・データがＸ個のビット
を有し、２Ｘがｔnより小さいか又は等しく、かつ、前
記バイナリ・サーボ・データ及びその１の補数が各バー
ストに書き込まれ、前記バーストのタイム・スロットの
いずれの残りのスロットにも変移が書き込まれる上記
（３７）のデータ記憶装置。 （４０）前記検出回路が、前記変換器により読み取られ
るバースト情報から前記バイナリ・サーボ・データを検
出するべく、前記変換器へ接続される面積積分検出回路
を有する上記（２２）のデータ記憶装置。 （４１）前記記憶媒体が複数のバーストを有し、かつ、
前記面積積分検出回路がさらに、各バースト中の変移の
数の変動を補正するために前記面積積分検出回路の出力
を正規化する手段を有する上記（４０）のデータ記憶装
置。 （４２）前記バーストから前記バイナリ・サーボ・デー
タ及びアナログ位置情報を同時に検出するために検出回
路をさらに有する上記（４１）のデータ記憶装置。 （４３）記憶媒体上に存在するｔn個のタイム・スロッ
トを有するサーボ・バースト中にバイナリ・サーボ・デ
ータを表す方法において、前記バイナリ・データの各ビ
ットを一続きで前記バーストのタイム・スロットの１つ
のみに表現するステップを有し、前記バイナリ・データ
の各「１」ビットは変移として表され、そして各「０」
ビットはヌルとして表されることにより、バイナリ・サ
ーボ・データとアナログ位置情報の双方を同じバースト
から取り出すことができるサーボ・バースト中にバイナ
リ・サーボ・データを表す方法。 （４４）前記記憶媒体が少なくとも１つのサーボ領域を
有し、各サーボ領域が複数のバーストを含む上記（４
３）の方法。 （４５）同一のバイナリ・データが同じ前記サーボ・領
域の各バーストに書き込まれる上記（４４）の方法。 （４６）前記バイナリ・サーボ・データの少なくとも一
部が前記バーストに書き込まれる前にコード化される上
記（４３）の方法。 （４７）前記記憶媒体が複数のデータ記憶トラックを具
備するデータ記憶ディスクを有し、かつ、前記バイナリ
・サーボ・データがトラック番号を有する上記（４３）
の方法。 （４８）前記記憶媒体が少なくとも１つのデータ記憶デ
ィスクと少なくとも１つのデータ記憶表面を有し、前記
データ記憶表面の間に複数のデータ・シリンダを形成
し、かつ、前記バイナリ・サーボ・データがシリンダ番
号を有する上記（４３）の方法。 （４９）前記記憶媒体が複数のデータ記憶表面を有し、
かつ、前記バイナリ・サーボ・データが前記データ記憶
表面の１つを個別に識別するヘッド番号を有する上記
（４３）の方法。 （５０）前記記憶媒体が、複数のデータ・トラックと、
前記データ・トラック間に配置された複数のサーボ領域
とを有し、かつ、前記バイナリ・サーボ・データがセク
タ番号を有する上記（４３）の方法。 （５１）前記バイナリ・サーボ・データがＳＩＤを有す
る上記（４３）の方法。 （５２）前記バイナリ・サーボ・データがインデックス
・マークを有する上記（４３）の方法。 （５３）前記記憶媒体が複数のバーストを含み、さら
に、正確なピークホールド検出を容易に行うために各バ
ーストにしきい値数だけの変移が設けられるように前記
バイナリ・サーボ・データを前記バーストへ書き込むス
テップを有する上記（４３）の方法。 （５４）前記記憶媒体が複数のサーボ領域を有し、各サ
ーボ領域がバーストを含み、さらに、ｔnと、書き込ま
れるバイナリ・サーボ・データのビット数Ｘとの差を決
定するステップと、前記差が前記しきい値数より小さい
場合、前記バイナリ・サーボ・データを複数の部分へ分
割して各部分がＸiビットを有しかつｔn−Ｘiがしきい
値数より小さくないようにし、そして各部分を前記複数
のサーボ領域の別々の領域へ書き込むステップとを有す
る上記（５３）の方法。 （５５）前記バイナリ・サーボ・データが、複数の可能
な値をもつバイナリ・ワードを有し、さらに、前記ワー
ドがバーストに書き込まれるときに前記バーストが少な
くともしきい値数だけの変移を含むように、各バイナリ
・ワード値を少なくともしきい値数だけの「１」ビット
を有するｔn個のビットからなる個別のパターンとして
コード化するステップを有する上記（５３）の方法。 （５６）前記バイナリ・データ又はその１の補数のいず
れがより多くの「１」ビットを有するかを決定するステ
ップと、前記バイナリ・データの方がより多くの「１」
ビットを有する場合、前記バイナリ・データが前記バー
ストに書き込まれることを示すパターンと共に前記バイ
ナリ・データを前記バーストの１つに書き込むステップ
と、前記バイナリ・データの１の補数の方がより多くの
「１」ビットを有する場合、前記バイナリ・データの１
の補数が前記バーストに書き込まれることを示すパター
ンと共に前記バイナリ・データの１の補数を前記バース
トの１つに書き込むステップとを有する上記（４３）の
方法。 （５７）ピークホールド検出回路を用いて前記バースト
から前記バイナリ・サーボ・データを検出するステップ
をさらに有する上記（４３）の方法。 （５８）前記記憶媒体が複数のバーストを含み、かつ、
正確な面積積分検出を容易に行うために一定数の変移が
各バーストに設けられるように、前記バイナリ・サーボ
・データが前記バーストに書き込まれる上記（４３）の
方法。 （５９）前記バイナリ・サーボ情報が、複数の可能な値
をもつバイナリ・ワードであり、さらに、Ｎ個の変移含
有スロットとＭ個の空スロットからなる個別パターンと
して、書き込まれる各ワード値を表すステップを有する
上記（５８）の方法。 （６０）前記バイナリ・サーボ・データがＸ個のビット
を有し、２Ｘがｔnより小さいか又は等しく、かつ、前
記バイナリ・サーボ・データおよびその１の補数が各バ
ーストに書き込まれ、前記バーストの残りのいずれのタ
イム・スロットにも変移が書き込まれる上記（５８）の
方法。 （６１）面積積分検出回路を用いて前記バーストからバ
イナリ・サーボ情報を検出するステップをさらに有する
上記（４３）の方法。 （６２）前記記憶媒体が複数のバーストを有し、かつ、
前記面積積分検出回路がさらに、各バースト中の変移の
数の変動を補正するために、前記面積積分検出回路の出
力を正規化する手段を有する上記（６１）の方法。 （６３）前記バーストから前記バイナリ・サーボ・デー
タ及びアナログ・バースト情報を同時に検出するステッ
プをさらに有する上記（６２）の方法。 （６４）前記バイナリ・データの各「１」ビットが双ビ
ットとして表され、かつ各「０」ビットが一対のヌルと
して表される上記（１）のデータ記憶媒体。 （６５）前記バイナリ・データの各「１」ビットが双ビ
ットとして表され、かつ各「０」ビットが一対のヌルと
して表される上記（２２）のデータ記憶装置。 （６６）前記バイナリ・データの各「１」ビットが双ビ
ットとして表され、かつ各「０」ビットが一対のヌルと
して表される上記（４３）の方法。
おいて、サーボ・バーストを書き込んだデータ記憶トラ
ックと、前記サーボ・バースト内に表されたバイナリ・
サーボ・データとを有し、上記サーボ・バーストが前記
トラック中央に対して変換器を位置決めするためのアナ
ログ位置情報を与えかつｔn個のタイム・スロットを含
み、上記バイナリ・サーボ・データの各ビットが一続き
で前記バーストのタイム・スロットの１つのみに表さ
れ、前記バイナリ・データの各「１」ビットが変移とし
て表され、かつ各「０」ビットがヌルとして表されるこ
とにより、前記バイナリ・サーボ・データ及び前記アナ
ログ位置情報の双方を同じバーストから取り出すことが
できるデータ記憶媒体。 （２）前記記憶表面がさらに、少なくとも１つのサーボ
領域を有し、各サーボ領域が複数のバーストを含む上記
（１）のデータ記憶媒体。 （３）同一のバイナリ・データが、同じサーボ領域の各
バーストに書き込まれる上記（２）のデータ記憶媒体。 （４）前記サーボ・データの少なくとも一部が、前記バ
ーストへ書き込まれる前にコード化される上記（１）の
データ記憶媒体。 （５）前記記憶媒体が複数のデータ記憶トラックを具備
するデータ記憶ディスクを有し、前記バイナリ・サーボ
・データがトラック番号を有する上記（１）のデータ記
憶媒体。 （６）前記記憶媒体が、少なくとも１つのデータ記憶デ
ィスクと少なくとも２つのデータ記憶表面を有し、それ
らの記憶表面の間に複数のデータ・シリンダを形成し、
前記バイナリ・サーボ・データがシリンダ番号を有する
上記（１）のデータ記憶媒体。 （７）前記記憶媒体が複数のデータ記憶表面を有し、前
記バイナリ・サーボ・データが前記記憶表面の１つを識
別するヘッド番号を有する上記（１）のデータ記憶媒
体。 （８）前記記憶媒体が、複数のデータ・トラックと、前
記データ・トラック間に配置された複数のサーボ領域と
を有し、前記バイナリ・サーボ・データがセクタ番号を
有する上記（１）のデータ記憶媒体。 （９）前記バイナリ・サーボ・データがＳＩＤを有する
上記（１）のデータ記憶媒体。 （１０）前記バイナリ・サーボ・データがインデックス
・マークを有する上記（１）のデータ記憶媒体。 （１１）前記記憶表面が複数のバーストを含み、正確な
ピークホールド復調を容易に行うべく各バースト内にし
きい値数だけの変移が設けられるように前記バースト内
に前記バイナリ・サーボ・データが表される上記（１）
のデータ記憶媒体。 （１２）前記記憶表面が複数のサーボ領域を有し、各サ
ーボ領域がバーストを含み、かつ、前記バイナリ・サー
ボ・データが複数の部分へ分割され、各部分がＸi個の
ビットを有し、ｔn−Ｘiがしきい値数より小さくなく、
各部分が複数のサーボ領域の別々のバーストに表される
上記（１１）のデータ記憶媒体。 （１３）バイナリ・サーボ・データが複数の可能な値を
もつバイナリ・ワードを有し、かつ、バーストに表され
る各バイナリ・ワードの値が少なくともしきい値数だけ
の「１」ビットをもつｔn個のビットからなる個別のパ
ターンとしてコード化されることにより、前記ワードが
バーストへ書き込まれるとき、前記バーストが少なくと
もしきい値数だけの変移を含む上記（１１）のデータ記
憶媒体。 （１４）前記バイナリ・データがその１の補数よりも多
い「１」ビットを有する場合、前記バイナリ・データが
そのバーストに書き込まれることを示すパターンと共に
前記バイナリ・データが前記バーストに書き込まれ、前
記バイナリ・データがその１の補数よりも少ない「１」
ビットを有する場合、前記バイナリ・データの１の補数
がそのバーストに書き込まれることを示すパターンと共
にその１の補数が前記バーストに書き込まれる上記
（１）のデータ記憶媒体。 （１５）前記データ記憶表面上の情報を読み取るべく前
記データ記憶表面の近傍に位置決めされる変換器と、前
記変換器により読み取られる情報からアナログ位置情報
を検出するべく前記変換器へ接続されたピークホールド
検出回路とを有する上記（１）のデータ記憶媒体。 （１６）前記記憶媒体が複数のバーストを含み、かつ正
確な面積積分検出を容易に行うべく各バースト中に一定
数の変移が設けられるように前記バイナリ・サーボ・デ
ータが前記バーストに書き込まれる上記（１）のデータ
記憶媒体。 （１７）前記バイナリ・サーボ情報が複数の可能な値を
もつバイナリ・ワードであり、前記バーストに書き込ま
れる各ワード値がＮ個の変移含有スロットとＭ個の空ス
ロットからなる個別パターンとして表される上記（１
６）のデータ記憶媒体。 （１８）前記バイナリ・サーボ・データがＸ個のビット
を有し、２Ｘがｔnより小さいか又は等しく、かつ、バ
イナリ・サーボ・データ及びその１の補数が各バースト
へ書き込まれ、前記バーストのタイム・スロットのいず
れの残りの「１」も変移により書き込まれる上記（１
６）のデータ記憶媒体。 （１９）前記データ記憶表面上の情報を読み取るべく前
記データ記憶表面の近傍に位置決めされる変換器と、前
記変換器により読み取られる情報からアナログ位置情報
を検出するべく前記変換器へ接続された面積積分検出回
路とを有する上記（１）のデータ記憶媒体。 （２０）複数のバーストを有し、前記面積積分検出回路
がさらに、各バースト中の変移の数の変動を補正するた
めに前記面積積分検出回路の出力を正規化する手段を有
する上記（１９）のデータ記憶媒体。 （２１）前記バーストから前記バイナリ・サーボ・デー
タ及びアナログ位置情報を同時に検出する検出回路をさ
らに有する上記（２０）のデータ記憶媒体。 （２２）変換器と、前記変換器へ接続された検出回路
と、前記変換器の近傍に配置され記憶表面を具備するデ
ータ記憶媒体とを有するデータ記憶装置において、前記
データ記憶媒体が、サーボ・バーストを書き込んだデー
タ記憶トラックと、前記サーボ・バースト内に表された
バイナリ・サーボ・データとを有し、上記サーボ・バー
ストが前記トラック中央に対して変換器を位置決めする
ためのアナログ位置情報を与えかつｔn個のタイム・ス
ロットを含み、上記バイナリ・サーボ・データの各ビッ
トが一続きでかつ前記バーストのタイム・スロットの１
つのみに表され、前記バイナリ・データの各「１」ビッ
トが変移として表され、かつ各「０」ビットがヌルとし
て表されることにより、前記バイナリ・サーボ・データ
及び前記アナログ位置情報の双方を同じバーストから読
み取ることができるデータ記憶装置。 （２３）前記記憶表面がさらに、少なくとも１つのサー
ボ領域を有し、各サーボ領域が複数のバーストを含む上
記（２２）のデータ記憶装置。 （２４）同じ前記サーボ領域の各バーストに同一のバイ
ナリ・データが書き込まれる上記（２３）のデータ記憶
装置。 （２５）前記バーストへ書き込まれる前に、前記バイナ
リ・サーボ・データの少なくとも一部がコード化される
上記（２２）のデータ記憶装置。 （２６）前記記憶媒体が、複数のデータ記憶トラックを
具備するデータ記憶ディスクを有し、かつ、前記バイナ
リ・サーボ・データがトラック番号を有する上記（２
２）のデータ記憶装置。 （２７）前記記憶媒体が、少なくとも１つのデータ記憶
ディスクと少なくとも２つのデータ記憶表面を有し、前
記データ記憶表面の間に複数のデータ・シリンダを形成
し、かつ、前記バイナリ・サーボ・データがシリンダ番
号を有する上記（２２）のデータ記憶装置。 （２８）前記記憶媒体が、複数のデータ記憶表面を有
し、かつ、前記バイナリ・サーボ・データが、前記デー
タ記憶表面の１つを個別に識別するヘッド番号を有する
上記（２２）のデータ記憶装置。 （２９）前記記憶媒体が、複数のデータ・トラックと、
前記データ・トラック間に配置された複数のサーボ領域
とを有し、かつ、前記バイナリ・サーボ・データがセク
タ番号を有する上記（２２）のデータ記憶装置。 （３０）前記バイナリ・サーボ・データがＳＩＤを有す
る上記（２２）のデータ記憶装置。 （３１）前記バイナリ・サーボ・データがインデックス
・マークを有する上記（２２）のデータ記憶装置。 （３２）前記記憶表面が複数のバーストを含み、かつ、
正確なピークホールド検出を容易に行うべく各バースト
にしきい値数だけの変移を設けるように前記バイナリ・
サーボ・データが前記バーストに表される上記（２２）
のデータ記憶装置。 （３３）前記記憶表面が複数のサーボ領域を有し、その
各々がバーストを含み、かつ、前記バイナリ・サーボ・
データが複数の部分へ分割され、各部分がＸi個のビッ
トを有し、ｔn−Ｘiがしきい値数より小さくなく、かつ
各部分が前記複数のサーボ領域の別々のバーストに表さ
れる上記（３２）のデータ記憶装置。 （３４）前記バイナリ・サーボ・データが複数の可能な
値をもつバイナリ・ワードを有し、かつ、前記バイナリ
・ワードがバーストに書き込まれるとき前記バーストが
少なくともしきい値数だけの変移を含むように、バース
トに表される各バイナリ・ワード値が少なくともしきい
値数だけの１ビットを有するｔn個のビットからなる個
別のパターンとしてコード化される上記（３２）のデー
タ記憶装置。 （３５）前記バイナリ・データがその１の補数よりも多
い「１」ビットを有する場合、前記バイナリ・データが
そのバーストに書き込まれることを示すパターンと共に
前記バイナリ・データが前記バーストに書き込まれ、か
つ、前記バイナリ・データがその１の補数よりも少ない
「１」ビットを有する場合、バイナリ・データの前記１
の補数がそのバーストに書き込まれることを示すパター
ンと共に前記１の補数が前記バーストに書き込まれる上
記（２２）のデータ記憶装置。 （３６）前記検出回路が、前記変換器により読み取られ
たバースト情報から前記バイナリ・サーボ・データを検
出するべく、前記変換器へ接続されたピークホールド検
出回路を有する上記（２２）のデータ記憶装置。 （３７）前記記憶媒体が複数のバーストを含み、かつ、
正確な面積積分検出を容易に行うべく一定数の変移が各
バーストに設けられるように前記バイナリ・サーボ・デ
ータが前記バーストに書き込まれる上記（２２）のデー
タ記憶装置。 （３８）前記バイナリ・サーボ情報が複数の可能な値を
もつバイナリ・ワードであり、かつ、前記バーストに書
き込まれる各ワード値が、Ｎ個の変移含有スロットとＭ
個の空スロットとからなる個別のパターンとして表され
る上記（３７）のデータ記憶装置。 （３９）前記バイナリ・サーボ・データがＸ個のビット
を有し、２Ｘがｔnより小さいか又は等しく、かつ、前
記バイナリ・サーボ・データ及びその１の補数が各バー
ストに書き込まれ、前記バーストのタイム・スロットの
いずれの残りのスロットにも変移が書き込まれる上記
（３７）のデータ記憶装置。 （４０）前記検出回路が、前記変換器により読み取られ
るバースト情報から前記バイナリ・サーボ・データを検
出するべく、前記変換器へ接続される面積積分検出回路
を有する上記（２２）のデータ記憶装置。 （４１）前記記憶媒体が複数のバーストを有し、かつ、
前記面積積分検出回路がさらに、各バースト中の変移の
数の変動を補正するために前記面積積分検出回路の出力
を正規化する手段を有する上記（４０）のデータ記憶装
置。 （４２）前記バーストから前記バイナリ・サーボ・デー
タ及びアナログ位置情報を同時に検出するために検出回
路をさらに有する上記（４１）のデータ記憶装置。 （４３）記憶媒体上に存在するｔn個のタイム・スロッ
トを有するサーボ・バースト中にバイナリ・サーボ・デ
ータを表す方法において、前記バイナリ・データの各ビ
ットを一続きで前記バーストのタイム・スロットの１つ
のみに表現するステップを有し、前記バイナリ・データ
の各「１」ビットは変移として表され、そして各「０」
ビットはヌルとして表されることにより、バイナリ・サ
ーボ・データとアナログ位置情報の双方を同じバースト
から取り出すことができるサーボ・バースト中にバイナ
リ・サーボ・データを表す方法。 （４４）前記記憶媒体が少なくとも１つのサーボ領域を
有し、各サーボ領域が複数のバーストを含む上記（４
３）の方法。 （４５）同一のバイナリ・データが同じ前記サーボ・領
域の各バーストに書き込まれる上記（４４）の方法。 （４６）前記バイナリ・サーボ・データの少なくとも一
部が前記バーストに書き込まれる前にコード化される上
記（４３）の方法。 （４７）前記記憶媒体が複数のデータ記憶トラックを具
備するデータ記憶ディスクを有し、かつ、前記バイナリ
・サーボ・データがトラック番号を有する上記（４３）
の方法。 （４８）前記記憶媒体が少なくとも１つのデータ記憶デ
ィスクと少なくとも１つのデータ記憶表面を有し、前記
データ記憶表面の間に複数のデータ・シリンダを形成
し、かつ、前記バイナリ・サーボ・データがシリンダ番
号を有する上記（４３）の方法。 （４９）前記記憶媒体が複数のデータ記憶表面を有し、
かつ、前記バイナリ・サーボ・データが前記データ記憶
表面の１つを個別に識別するヘッド番号を有する上記
（４３）の方法。 （５０）前記記憶媒体が、複数のデータ・トラックと、
前記データ・トラック間に配置された複数のサーボ領域
とを有し、かつ、前記バイナリ・サーボ・データがセク
タ番号を有する上記（４３）の方法。 （５１）前記バイナリ・サーボ・データがＳＩＤを有す
る上記（４３）の方法。 （５２）前記バイナリ・サーボ・データがインデックス
・マークを有する上記（４３）の方法。 （５３）前記記憶媒体が複数のバーストを含み、さら
に、正確なピークホールド検出を容易に行うために各バ
ーストにしきい値数だけの変移が設けられるように前記
バイナリ・サーボ・データを前記バーストへ書き込むス
テップを有する上記（４３）の方法。 （５４）前記記憶媒体が複数のサーボ領域を有し、各サ
ーボ領域がバーストを含み、さらに、ｔnと、書き込ま
れるバイナリ・サーボ・データのビット数Ｘとの差を決
定するステップと、前記差が前記しきい値数より小さい
場合、前記バイナリ・サーボ・データを複数の部分へ分
割して各部分がＸiビットを有しかつｔn−Ｘiがしきい
値数より小さくないようにし、そして各部分を前記複数
のサーボ領域の別々の領域へ書き込むステップとを有す
る上記（５３）の方法。 （５５）前記バイナリ・サーボ・データが、複数の可能
な値をもつバイナリ・ワードを有し、さらに、前記ワー
ドがバーストに書き込まれるときに前記バーストが少な
くともしきい値数だけの変移を含むように、各バイナリ
・ワード値を少なくともしきい値数だけの「１」ビット
を有するｔn個のビットからなる個別のパターンとして
コード化するステップを有する上記（５３）の方法。 （５６）前記バイナリ・データ又はその１の補数のいず
れがより多くの「１」ビットを有するかを決定するステ
ップと、前記バイナリ・データの方がより多くの「１」
ビットを有する場合、前記バイナリ・データが前記バー
ストに書き込まれることを示すパターンと共に前記バイ
ナリ・データを前記バーストの１つに書き込むステップ
と、前記バイナリ・データの１の補数の方がより多くの
「１」ビットを有する場合、前記バイナリ・データの１
の補数が前記バーストに書き込まれることを示すパター
ンと共に前記バイナリ・データの１の補数を前記バース
トの１つに書き込むステップとを有する上記（４３）の
方法。 （５７）ピークホールド検出回路を用いて前記バースト
から前記バイナリ・サーボ・データを検出するステップ
をさらに有する上記（４３）の方法。 （５８）前記記憶媒体が複数のバーストを含み、かつ、
正確な面積積分検出を容易に行うために一定数の変移が
各バーストに設けられるように、前記バイナリ・サーボ
・データが前記バーストに書き込まれる上記（４３）の
方法。 （５９）前記バイナリ・サーボ情報が、複数の可能な値
をもつバイナリ・ワードであり、さらに、Ｎ個の変移含
有スロットとＭ個の空スロットからなる個別パターンと
して、書き込まれる各ワード値を表すステップを有する
上記（５８）の方法。 （６０）前記バイナリ・サーボ・データがＸ個のビット
を有し、２Ｘがｔnより小さいか又は等しく、かつ、前
記バイナリ・サーボ・データおよびその１の補数が各バ
ーストに書き込まれ、前記バーストの残りのいずれのタ
イム・スロットにも変移が書き込まれる上記（５８）の
方法。 （６１）面積積分検出回路を用いて前記バーストからバ
イナリ・サーボ情報を検出するステップをさらに有する
上記（４３）の方法。 （６２）前記記憶媒体が複数のバーストを有し、かつ、
前記面積積分検出回路がさらに、各バースト中の変移の
数の変動を補正するために、前記面積積分検出回路の出
力を正規化する手段を有する上記（６１）の方法。 （６３）前記バーストから前記バイナリ・サーボ・デー
タ及びアナログ・バースト情報を同時に検出するステッ
プをさらに有する上記（６２）の方法。 （６４）前記バイナリ・データの各「１」ビットが双ビ
ットとして表され、かつ各「０」ビットが一対のヌルと
して表される上記（１）のデータ記憶媒体。 （６５）前記バイナリ・データの各「１」ビットが双ビ
ットとして表され、かつ各「０」ビットが一対のヌルと
して表される上記（２２）のデータ記憶装置。 （６６）前記バイナリ・データの各「１」ビットが双ビ
ットとして表され、かつ各「０」ビットが一対のヌルと
して表される上記（４３）の方法。
【図１】本発明の実施するために適切な固定ブロック・
アーキテクチャのディスク・ドライブを示す概略図であ
る。
アーキテクチャのディスク・ドライブを示す概略図であ
る。
【図２】従来のサーボ・セクタを示す概略図である。
【図３】（Ａ）は従来のサーボ・バースト・フィールド
の概略図であり、（Ｂ）はクロック信号に関係させた
（Ａ）のバースト・パターンから得られる変換器信号を
表し、（Ｃ）は（Ｂ）の変換器信号からＰＥＳを得るた
めの面積積分法を示すグラフであり、（Ｄ）は（Ｂ）の
変換器信号からＰＥＳ信号を得るためのピークホールド
法を示すグラフである。
の概略図であり、（Ｂ）はクロック信号に関係させた
（Ａ）のバースト・パターンから得られる変換器信号を
表し、（Ｃ）は（Ｂ）の変換器信号からＰＥＳを得るた
めの面積積分法を示すグラフであり、（Ｄ）は（Ｂ）の
変換器信号からＰＥＳ信号を得るためのピークホールド
法を示すグラフである。
【図４】面積積分検出回路の一例のブロック図である。
【図５】（Ａ）は本発明におけるデジタル・サーボ情報
でコード化されたサーボ・バースト・フィールドの概略
図であり、（Ｂ）は（Ａ）のバースト・パターンから得
られた変換器信号をクロック信号に関係させて表し、
（Ｃ）は（Ｂ）の変換器信号からＰＥＳ信号を得る面積
積分法を示すグラフであり、（Ｄ）は（Ｂ）の変換器信
号から抽出されたデジタル・データを表す。
でコード化されたサーボ・バースト・フィールドの概略
図であり、（Ｂ）は（Ａ）のバースト・パターンから得
られた変換器信号をクロック信号に関係させて表し、
（Ｃ）は（Ｂ）の変換器信号からＰＥＳ信号を得る面積
積分法を示すグラフであり、（Ｄ）は（Ｂ）の変換器信
号から抽出されたデジタル・データを表す。
【図６】本発明によるバースト信号中のデジタル・サー
ボ・データを表現する方法を示す表である。
ボ・データを表現する方法を示す表である。
【図７】本発明によるバースト信号中のデジタル・サー
ボ・データを表現する方法を示す表である。
ボ・データを表現する方法を示す表である。
【図８】本発明によるバースト信号中のデジタル・サー
ボ・データを表現する方法を示す表である。
ボ・データを表現する方法を示す表である。
【図９】本発明によるバースト信号中のデジタル・サー
ボ・データを表現する方法を示す表である。
ボ・データを表現する方法を示す表である。
【図１０】本発明によるバースト信号中のデジタル・サ
ーボ・データを表現する方法を示す表である。
ーボ・データを表現する方法を示す表である。
【図１１】（Ａ）は本発明による図６乃至図１０に示し
た表のコード化データを含むサーボ・バースト・フィー
ルドの概略図であり、（Ｂ）はクロック信号に関係させ
た（Ａ）のバースト・パターンから得られた変換器信号
を表し、（Ｃ）は（Ｂ）の変換器信号からＰＥＳ信号を
得る面積積分法を示すグラフであり、（Ｄ）は（Ｂ）の
変換器信号から抽出されたデジタル・データを表す。
た表のコード化データを含むサーボ・バースト・フィー
ルドの概略図であり、（Ｂ）はクロック信号に関係させ
た（Ａ）のバースト・パターンから得られた変換器信号
を表し、（Ｃ）は（Ｂ）の変換器信号からＰＥＳ信号を
得る面積積分法を示すグラフであり、（Ｄ）は（Ｂ）の
変換器信号から抽出されたデジタル・データを表す。
【図１２】本発明によるバースト・フィールドからＰＥ
Ｓ及びデジタル・サーボ・データの双方を検出するサー
ボ電子回路における検出回路の構成図である。
Ｓ及びデジタル・サーボ・データの双方を検出するサー
ボ電子回路における検出回路の構成図である。
【図１３】（Ａ）は本発明の別の実施例によるサーボ・
バースト・フィールドに書き込まれたバイナリ・サーボ
・データの概略図であり、（Ｂ）は（Ａ）のバースト・
パターンから得られる変換器信号であり、（Ｃ）は
（Ｂ）の変換器信号から抽出されたデジタル・データを
表す。
バースト・フィールドに書き込まれたバイナリ・サーボ
・データの概略図であり、（Ｂ）は（Ａ）のバースト・
パターンから得られる変換器信号であり、（Ｃ）は
（Ｂ）の変換器信号から抽出されたデジタル・データを
表す。
１０２ ディスク・ドライブ １０４ ディスク（データ記憶媒体） １０６ アクチュエータ・アーム １０８ データ記録変換器（記録ヘッド） １１０ ボイス・コイル・モータ １１２ サーボ電子回路 １１３ 読取り／書込み電子回路 １１４ インタフェース電子回路 １１５ フォーマッター電子回路 １１６ マイクロプロセッサ １１７ ＲＡＭ １１８ トラック １２０ サーボ・セクタ １２１ データ記憶トラック １２２ ＲＯＭ １５４ データ・セクタ １６２ インタフェース ２１０、４１０、６１０、８０２ バースト ３０２ 変換器 to〜tn タイム・スロット ８０４、８０６ 連続的な変移含有タイム・スロット
───────────────────────────────────────────────────── フロントページの続き (72)発明者 マントル・マン−ホン・ユ アメリカ合衆国95120、カリフォルニア州、 サンノゼ、キャピタンシロス・ドライブ 1596
Claims (66)
- 【請求項１】記憶表面を有するデータ記憶媒体におい
て、 サーボ・バーストを書き込んだデータ記憶トラックと、 前記サーボ・バースト内に表されたバイナリ・サーボ・
データとを有し、 上記サーボ・バーストが前記トラック中央に対して変換
器を位置決めするためのアナログ位置情報を与えかつｔ
n個のタイム・スロットを含み、 上記バイナリ・サーボ・データの各ビットが一続きで前
記バーストのタイム・スロットの１つのみに表され、前
記バイナリ・データの各「１」ビットが変移として表さ
れ、かつ各「０」ビットがヌルとして表されることによ
り、 前記バイナリ・サーボ・データ及び前記アナログ位置情
報の双方を同じバーストから取り出すことができるデー
タ記憶媒体。 - 【請求項２】前記記憶表面がさらに、少なくとも１つの
サーボ領域を有し、各サーボ領域が複数のバーストを含
む請求項１のデータ記憶媒体。 - 【請求項３】同一のバイナリ・データが、同じサーボ領
域の各バーストに書き込まれる請求項２のデータ記憶媒
体。 - 【請求項４】前記サーボ・データの少なくとも一部が、
前記バーストへ書き込まれる前にコード化される請求項
１のデータ記憶媒体。 - 【請求項５】前記記憶媒体が複数のデータ記憶トラック
を具備するデータ記憶ディスクを有し、前記バイナリ・
サーボ・データがトラック番号を有する請求項１のデー
タ記憶媒体。 - 【請求項６】前記記憶媒体が、少なくとも１つのデータ
記憶ディスクと少なくとも２つのデータ記憶表面を有
し、それらの記憶表面の間に複数のデータ・シリンダを
形成し、前記バイナリ・サーボ・データがシリンダ番号
を有する請求項１のデータ記憶媒体。 - 【請求項７】前記記憶媒体が複数のデータ記憶表面を有
し、前記バイナリ・サーボ・データが前記記憶表面の１
つを識別するヘッド番号を有する請求項１のデータ記憶
媒体。 - 【請求項８】前記記憶媒体が、複数のデータ・トラック
と、前記データ・トラック間に配置された複数のサーボ
領域とを有し、前記バイナリ・サーボ・データがセクタ
番号を有する請求項１のデータ記憶媒体。 - 【請求項９】前記バイナリ・サーボ・データがＳＩＤを
有する請求項１のデータ記憶媒体。 - 【請求項１０】前記バイナリ・サーボ・データがインデ
ックス・マークを有する請求項１のデータ記憶媒体。 - 【請求項１１】前記記憶表面が複数のバーストを含み、
正確なピークホールド復調を容易に行うべく各バースト
内にしきい値数だけの変移が設けられるように前記バー
スト内に前記バイナリ・サーボ・データが表される請求
項１のデータ記憶媒体。 - 【請求項１２】前記記憶表面が複数のサーボ領域を有
し、各サーボ領域がバーストを含み、かつ、前記バイナ
リ・サーボ・データが複数の部分へ分割され、各部分が
Ｘi個のビットを有し、ｔn−Ｘiがしきい値数より小さ
くなく、各部分が複数のサーボ領域の別々のバーストに
表される請求項１１のデータ記憶媒体。 - 【請求項１３】バイナリ・サーボ・データが複数の可能
な値をもつバイナリ・ワードを有し、かつ、バーストに
表される各バイナリ・ワードの値が少なくともしきい値
数だけの「１」ビットをもつｔn個のビットからなる個
別のパターンとしてコード化されることにより、前記ワ
ードがバーストへ書き込まれるとき、前記バーストが少
なくともしきい値数だけの変移を含む請求項１１のデー
タ記憶媒体。 - 【請求項１４】前記バイナリ・データがその１の補数よ
りも多い「１」ビットを有する場合、前記バイナリ・デ
ータがそのバーストに書き込まれることを示すパターン
と共に前記バイナリ・データが前記バーストに書き込ま
れ、前記バイナリ・データがその１の補数よりも少ない
「１」ビットを有する場合、前記バイナリ・データの１
の補数がそのバーストに書き込まれることを示すパター
ンと共にその１の補数が前記バーストに書き込まれる請
求項１のデータ記憶媒体。 - 【請求項１５】前記データ記憶表面上の情報を読み取る
べく前記データ記憶表面の近傍に位置決めされる変換器
と、前記変換器により読み取られる情報からアナログ位
置情報を検出するべく前記変換器へ接続されたピークホ
ールド検出回路とを有する請求項１のデータ記憶媒体。 - 【請求項１６】前記記憶媒体が複数のバーストを含み、
かつ正確な面積積分検出を容易に行うべく各バースト中
に一定数の変移が設けられるように前記バイナリ・サー
ボ・データが前記バーストに書き込まれる請求項１のデ
ータ記憶媒体。 - 【請求項１７】前記バイナリ・サーボ情報が複数の可能
な値をもつバイナリ・ワードであり、前記バーストに書
き込まれる各ワード値がＮ個の変移含有スロットとＭ個
の空スロットからなる個別パターンとして表される請求
項１６のデータ記憶媒体。 - 【請求項１８】前記バイナリ・サーボ・データがＸ個の
ビットを有し、２Ｘがｔnより小さいか又は等しく、か
つ、バイナリ・サーボ・データ及びその１の補数が各バ
ーストへ書き込まれ、前記バーストのタイム・スロット
のいずれの残りの「１」も変移により書き込まれる請求
項１６のデータ記憶媒体。 - 【請求項１９】前記データ記憶表面上の情報を読み取る
べく前記データ記憶表面の近傍に位置決めされる変換器
と、前記変換器により読み取られる情報からアナログ位
置情報を検出するべく前記変換器へ接続された面積積分
検出回路とを有する請求項１のデータ記憶媒体。 - 【請求項２０】複数のバーストを有し、前記面積積分検
出回路がさらに、各バースト中の変移の数の変動を補正
するために前記面積積分検出回路の出力を正規化する手
段を有する請求項１９のデータ記憶媒体。 - 【請求項２１】前記バーストから前記バイナリ・サーボ
・データ及びアナログ位置情報を同時に検出する検出回
路をさらに有する請求項２０のデータ記憶媒体。 - 【請求項２２】変換器と、 前記変換器へ接続された検出回路と、 前記変換器の近傍に配置され記憶表面を具備するデータ
記憶媒体とを有するデータ記憶装置において、前記デー
タ記憶媒体が、 サーボ・バーストを書き込んだデータ記憶トラックと、 前記サーボ・バースト内に表されたバイナリ・サーボ・
データとを有し、 上記サーボ・バーストが前記トラック中央に対して変換
器を位置決めするためのアナログ位置情報を与えかつｔ
n個のタイム・スロットを含み、 上記バイナリ・サーボ・データの各ビットが一続きでか
つ前記バーストのタイム・スロットの１つのみに表さ
れ、前記バイナリ・データの各「１」ビットが変移とし
て表され、かつ各「０」ビットがヌルとして表されるこ
とにより、 前記バイナリ・サーボ・データ及び前記アナログ位置情
報の双方を同じバーストから読み取ることができるデー
タ記憶装置。 - 【請求項２３】前記記憶表面がさらに、少なくとも１つ
のサーボ領域を有し、各サーボ領域が複数のバーストを
含む請求項２２のデータ記憶装置。 - 【請求項２４】同じ前記サーボ領域の各バーストに同一
のバイナリ・データが書き込まれる請求項２３のデータ
記憶装置。 - 【請求項２５】前記バーストへ書き込まれる前に、前記
バイナリ・サーボ・データの少なくとも一部がコード化
される請求項２２のデータ記憶装置。 - 【請求項２６】前記記憶媒体が、複数のデータ記憶トラ
ックを具備するデータ記憶ディスクを有し、かつ、前記
バイナリ・サーボ・データがトラック番号を有する請求
項２２のデータ記憶装置。 - 【請求項２７】前記記憶媒体が、少なくとも１つのデー
タ記憶ディスクと少なくとも２つのデータ記憶表面を有
し、前記データ記憶表面の間に複数のデータ・シリンダ
を形成し、かつ、前記バイナリ・サーボ・データがシリ
ンダ番号を有する請求項２２のデータ記憶装置。 - 【請求項２８】前記記憶媒体が、複数のデータ記憶表面
を有し、かつ、前記バイナリ・サーボ・データが、前記
データ記憶表面の１つを個別に識別するヘッド番号を有
する請求項２２のデータ記憶装置。 - 【請求項２９】前記記憶媒体が、複数のデータ・トラッ
クと、前記データ・トラック間に配置された複数のサー
ボ領域とを有し、かつ、前記バイナリ・サーボ・データ
がセクタ番号を有する請求項２２のデータ記憶装置。 - 【請求項３０】前記バイナリ・サーボ・データがＳＩＤ
を有する請求項２２のデータ記憶装置。 - 【請求項３１】前記バイナリ・サーボ・データがインデ
ックス・マークを有する請求項２２のデータ記憶装置。 - 【請求項３２】前記記憶表面が複数のバーストを含み、
かつ、正確なピークホールド検出を容易に行うべく各バ
ーストにしきい値数だけの変移を設けるように前記バイ
ナリ・サーボ・データが前記バーストに表される請求項
２２のデータ記憶装置。 - 【請求項３３】前記記憶表面が複数のサーボ領域を有
し、その各々がバーストを含み、かつ、前記バイナリ・
サーボ・データが複数の部分へ分割され、各部分がＸi
個のビットを有し、ｔn−Ｘiがしきい値数より小さくな
く、かつ各部分が前記複数のサーボ領域の別々のバース
トに表される請求項３２のデータ記憶装置。 - 【請求項３４】前記バイナリ・サーボ・データが複数の
可能な値をもつバイナリ・ワードを有し、かつ、前記バ
イナリ・ワードがバーストに書き込まれるとき前記バー
ストが少なくともしきい値数だけの変移を含むように、
バーストに表される各バイナリ・ワード値が少なくとも
しきい値数だけの１ビットを有するｔn個のビットから
なる個別のパターンとしてコード化される請求項３２の
データ記憶装置。 - 【請求項３５】前記バイナリ・データがその１の補数よ
りも多い「１」ビットを有する場合、前記バイナリ・デ
ータがそのバーストに書き込まれることを示すパターン
と共に前記バイナリ・データが前記バーストに書き込ま
れ、かつ、前記バイナリ・データがその１の補数よりも
少ない「１」ビットを有する場合、バイナリ・データの
前記１の補数がそのバーストに書き込まれることを示す
パターンと共に前記１の補数が前記バーストに書き込ま
れる請求項２２のデータ記憶装置。 - 【請求項３６】前記検出回路が、前記変換器により読み
取られたバースト情報から前記バイナリ・サーボ・デー
タを検出するべく、前記変換器へ接続されたピークホー
ルド検出回路を有する請求項２２のデータ記憶装置。 - 【請求項３７】前記記憶媒体が複数のバーストを含み、
かつ、正確な面積積分検出を容易に行うべく一定数の変
移が各バーストに設けられるように前記バイナリ・サー
ボ・データが前記バーストに書き込まれる請求項２２の
データ記憶装置。 - 【請求項３８】前記バイナリ・サーボ情報が複数の可能
な値をもつバイナリ・ワードであり、かつ、前記バース
トに書き込まれる各ワード値が、Ｎ個の変移含有スロッ
トとＭ個の空スロットとからなる個別のパターンとして
表される請求項３７のデータ記憶装置。 - 【請求項３９】前記バイナリ・サーボ・データがＸ個の
ビットを有し、２Ｘがｔnより小さいか又は等しく、か
つ、前記バイナリ・サーボ・データ及びその１の補数が
各バーストに書き込まれ、前記バーストのタイム・スロ
ットのいずれの残りのスロットにも変移が書き込まれる
請求項３７のデータ記憶装置。 - 【請求項４０】前記検出回路が、前記変換器により読み
取られるバースト情報から前記バイナリ・サーボ・デー
タを検出するべく、前記変換器へ接続される面積積分検
出回路を有する請求項２２のデータ記憶装置。 - 【請求項４１】前記記憶媒体が複数のバーストを有し、
かつ、前記面積積分検出回路がさらに、各バースト中の
変移の数の変動を補正するために前記面積積分検出回路
の出力を正規化する手段を有する請求項４０のデータ記
憶装置。 - 【請求項４２】前記バーストから前記バイナリ・サーボ
・データ及びアナログ位置情報を同時に検出するために
検出回路をさらに有する請求項４１のデータ記憶装置。 - 【請求項４３】記憶媒体上に存在するｔn個のタイム・
スロットを有するサーボ・バースト中にバイナリ・サー
ボ・データを表す方法において、 前記バイナリ・データの各ビットを一続きで前記バース
トのタイム・スロットの１つのみに表現するステップを
有し、前記バイナリ・データの各「１」ビットは変移と
して表され、そして各「０」ビットはヌルとして表され
ることにより、バイナリ・サーボ・データとアナログ位
置情報の双方を同じバーストから取り出すことができる
サーボ・バースト中にバイナリ・サーボ・データを表す
方法。 - 【請求項４４】前記記憶媒体が少なくとも１つのサーボ
領域を有し、各サーボ領域が複数のバーストを含む請求
項４３の方法。 - 【請求項４５】同一のバイナリ・データが同じ前記サー
ボ・領域の各バーストに書き込まれる請求項４４の方
法。 - 【請求項４６】前記バイナリ・サーボ・データの少なく
とも一部が前記バーストに書き込まれる前にコード化さ
れる請求項４３の方法。 - 【請求項４７】前記記憶媒体が複数のデータ記憶トラッ
クを具備するデータ記憶ディスクを有し、かつ、前記バ
イナリ・サーボ・データがトラック番号を有する請求項
４３の方法。 - 【請求項４８】前記記憶媒体が少なくとも１つのデータ
記憶ディスクと少なくとも１つのデータ記憶表面を有
し、前記データ記憶表面の間に複数のデータ・シリンダ
を形成し、かつ、前記バイナリ・サーボ・データがシリ
ンダ番号を有する請求項４３の方法。 - 【請求項４９】前記記憶媒体が複数のデータ記憶表面を
有し、かつ、前記バイナリ・サーボ・データが前記デー
タ記憶表面の１つを個別に識別するヘッド番号を有する
請求項４３の方法。 - 【請求項５０】前記記憶媒体が、複数のデータ・トラッ
クと、前記データ・トラック間に配置された複数のサー
ボ領域とを有し、かつ、前記バイナリ・サーボ・データ
がセクタ番号を有する請求項４３の方法。 - 【請求項５１】前記バイナリ・サーボ・データがＳＩＤ
を有する請求項４３の方法。 - 【請求項５２】前記バイナリ・サーボ・データがインデ
ックス・マークを有する請求項４３の方法。 - 【請求項５３】前記記憶媒体が複数のバーストを含み、
さらに、正確なピークホールド検出を容易に行うために
各バーストにしきい値数だけの変移が設けられるように
前記バイナリ・サーボ・データを前記バーストへ書き込
むステップを有する請求項４３の方法。 - 【請求項５４】前記記憶媒体が複数のサーボ領域を有
し、各サーボ領域がバーストを含み、さらに、 ｔnと、書き込まれるバイナリ・サーボ・データのビッ
ト数Ｘとの差を決定するステップと、 前記差が前記しきい値数より小さい場合、前記バイナリ
・サーボ・データを複数の部分へ分割して各部分がＸi
ビットを有しかつｔn−Ｘiがしきい値数より小さくない
ようにし、そして各部分を前記複数のサーボ領域の別々
の領域へ書き込むステップとを有する請求項５３の方
法。 - 【請求項５５】前記バイナリ・サーボ・データが、複数
の可能な値をもつバイナリ・ワードを有し、さらに、前
記ワードがバーストに書き込まれるときに前記バースト
が少なくともしきい値数だけの変移を含むように、各バ
イナリ・ワード値を少なくともしきい値数だけの「１」
ビットを有するｔn個のビットからなる個別のパターン
としてコード化するステップを有する請求項５３の方
法。 - 【請求項５６】前記バイナリ・データ又はその１の補数
のいずれがより多くの「１」ビットを有するかを決定す
るステップと、 前記バイナリ・データの方がより多くの「１」ビットを
有する場合、前記バイナリ・データが前記バーストに書
き込まれることを示すパターンと共に前記バイナリ・デ
ータを前記バーストの１つに書き込むステップと、 前記バイナリ・データの１の補数の方がより多くの
「１」ビットを有する場合、前記バイナリ・データの１
の補数が前記バーストに書き込まれることを示すパター
ンと共に前記バイナリ・データの１の補数を前記バース
トの１つに書き込むステップとを有する請求項４３の方
法。 - 【請求項５７】ピークホールド検出回路を用いて前記バ
ーストから前記バイナリ・サーボ・データを検出するス
テップをさらに有する請求項４３の方法。 - 【請求項５８】前記記憶媒体が複数のバーストを含み、
かつ、正確な面積積分検出を容易に行うために一定数の
変移が各バーストに設けられるように、前記バイナリ・
サーボ・データが前記バーストに書き込まれる請求項４
３の方法。 - 【請求項５９】前記バイナリ・サーボ情報が、複数の可
能な値をもつバイナリ・ワードであり、さらに、Ｎ個の
変移含有スロットとＭ個の空スロットからなる個別パタ
ーンとして、書き込まれる各ワード値を表すステップを
有する請求項５８の方法。 - 【請求項６０】前記バイナリ・サーボ・データがＸ個の
ビットを有し、２Ｘがｔnより小さいか又は等しく、か
つ、前記バイナリ・サーボ・データおよびその１の補数
が各バーストに書き込まれ、前記バーストの残りのいず
れのタイム・スロットにも変移が書き込まれる請求項５
８の方法。 - 【請求項６１】面積積分検出回路を用いて前記バースト
からバイナリ・サーボ情報を検出するステップをさらに
有する請求項４３の方法。 - 【請求項６２】前記記憶媒体が複数のバーストを有し、
かつ、前記面積積分検出回路がさらに、各バースト中の
変移の数の変動を補正するために、前記面積積分検出回
路の出力を正規化する手段を有する請求項６１の方法。 - 【請求項６３】前記バーストから前記バイナリ・サーボ
・データ及びアナログ・バースト情報を同時に検出する
ステップをさらに有する請求項６２の方法。 - 【請求項６４】前記バイナリ・データの各「１」ビット
が双ビットとして表され、かつ各「０」ビットが一対の
ヌルとして表される請求項１のデータ記憶媒体。 - 【請求項６５】前記バイナリ・データの各「１」ビット
が双ビットとして表され、かつ各「０」ビットが一対の
ヌルとして表される請求項２２のデータ記憶装置。 - 【請求項６６】前記バイナリ・データの各「１」ビット
が双ビットとして表され、かつ各「０」ビットが一対の
ヌルとして表される請求項４３の方法。
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