JPH10247772A - 導体配線パターンの形成方法 - Google Patents
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Abstract
まり良く微細かつ高精度な平坦性のある導体配線パター
ンを得る。 【解決手段】 支持基板1上に配線パターンを形成すべ
き部分を凹部2とし、その他の部分をシリカ粒子含有レ
ジスト3で被着する。このレジスト3の表面をエッチン
グしてシリカ粒子層4を形成し、その上に金属膜5を形
成する。選択エッチングにより金属膜5をエッチングし
て、導体配線パターン6を得る。この配線パターン6と
シリカ粒子含有レジスト3との膜厚を一致させることに
より、配線段差のない平坦化構造が、微細かつ精度良く
実現できる。
Description
形成方法に関し、特に半導体素子等の電子部品を搭載す
る実装基板の導体配線パターンの形成方法に関するもの
である。
導体配線パターンの形成方法としては、支持基材に銅泊
を貼り付けた後、レジストパターンを形成しエッチング
する方法(サブトラックティブ法)や、スパッタリング
法、蒸着法等のドライプロセス、あるいは無電解メッキ
法等のウェットプロセスにより下地金属膜を支持基板上
に形成した後、レジストパターンを形成し必要な部分の
みに電解メッキ法で金属を析出させ、最後に下地金属を
エッチングする方法(セミアディティブ法)等が良く知
られている。
れた導体配線パターンも支持基板より突出しているた
め、その上に絶縁層を形成し、更に導体配線パターンを
形成して多層配線構造を形成する場合、上下導体の絶縁
信頼性確保のために、絶縁層を薄くすることや配線段差
をなくした平坦化構造を実現することが困難である。
面に直接レジストパターンを形成し必要な部分のみに無
電解メッキ法で金属を析出させて導体配線パターンを形
成する方法(アディティブ法)がある。本方式を用いれ
ば、導体配線パターンの膜厚とレジストパターンの膜厚
を揃えることが比較的容易なため、配線段差のない平坦
化構造を実現でき、絶縁層を薄くする要求にも応えるこ
とができる。
せた後にレジストのパターン形成を行っているため、レ
ジストの現像工程において触媒が除去されてしまいメッ
キの不析出による断線、あるいは支持基板との密着性低
下を引き起こす問題点がある。また、導体配線パターン
を形成しない部分にも触媒が残ることになるので、金属
イオンのマイグレーションが起こりやすく絶縁信頼性が
低下する問題点がある。これ等傾向は高密度微細配線形
成において特に顕著となる。
触媒処理を行う方法もあるが、この方法ではレジストパ
ターン上にも触媒が吸着してしまうので無電解メッキを
施すとブリッジを引き起こしショート不良となってしま
う問題点があり、やはり高密度微細配線形成には不向き
なプロセスと言える。
する方法として、例えば特開昭63−289988号公
報で開示されている様に、支持基板上に予め導体配線パ
ターンとなるべき部分が凹となる様に成形した後、基板
全面に金属薄膜を形成し、金属薄膜を物理的な研削によ
って凹状溝のパターン部以外を除去し、最後に凹状溝の
パターン部に金属を厚付けメッキして導体配線パターン
を形成する方法が提案されている。
ーンとなるべき部分が凹部32となる様に成形した支持
基板31の全面に触媒33が設けられ(図4(a),
(b))、次いで無電解メッキ法により金属薄膜35が
形成される(図4(c))。ここで、金属薄膜35を物
理的な研削により凹状溝のパターン部以外を除去してパ
ターン部36´を形成し(図4(d))、最後にこのパ
ターン部に金属を厚付けメッキして導体配線パターン3
6を形成する(図4(e))。
示した従来の導体配線パターンの形成方法では、物理的
な研削によって不要な金属薄膜を除去して導体配線パタ
ーンを形成しているので、例えばサンドペーパ,バフ等
の研削に用いる研磨剤の粒径の不均一から、本来残すべ
き凹状溝のパターン部に傷を付けてしまい、結果として
パターンの断線を引き起こしてしまう問題点がある。
不良はある程度改善されるが、一方で研磨力が落ちるた
め微細かつ高密度配線なパターンを形成する時には研磨
残りが出てしまい、結果としてショート不良を引き起こ
す問題点が生じる。特に支持基板の大面積化により上述
した様な問題点がより顕著となりプロセスが極めて不安
定になるので、歩留まりが著しく低下してしまう。
でも歩留まり良く微細かつ高密度な導体配線パターンを
形成することが課題である。更に、導体配線パターンの
形成方法は、配線段差がなく平坦性に優れ、かつ絶縁信
頼性に優れた多層配線構造も実現できる方法でなければ
ならない。
上に導体配線となるべき部分が凹状となる様にシリカ粒
子含有レジストでパターン形成し、その表面をプラズマ
アッシング処理によりシリカ粒子含有レジスト上にシリ
カ粒子を露出させ、更にスパッタリング法,あるいは蒸
着法等のドライ工程により金属膜を形成した後、シリカ
粒子含有レジスト上に露出したシリカ粒子を除去して金
属膜をエッチングする工程を特徴とする導体配線パター
ンの形成方法により解決できる。
いて、シリカ粒子含有レジストとして粒径5μm以下の
シリカ粒子とフルオレン骨格を有するエポキシアクリレ
ートにより構成されるものを用いることにより、より微
細かつ高密度は導体配線パターンを形成することができ
る。
いは少なくともCu層,Pd層を有する複数層により構
成されたものを用いることにより、シリカ粒子含有レジ
スト上に露出したシリカ粒子を除去して金属膜をエッチ
ングした後、無電解メッキ法により金属を厚付けするこ
とにより、任意の膜厚を有する導体配線パターンを形成
することもできる。
面を参照して説明する。
各断面図である。本例では、支持基板上に導体配線とな
るべき部分が凹状となる様にシリカ粒子含有レジストで
パターン形成し、その表面をプラズマアッシング処理に
よりシリカ含有レジスト上にシリカ粒子を露出させ、更
にスパッタリング法、あるいは蒸着法等のドライ工程に
より金属膜を形成した後、シリカ粒子含有レジスト上に
堆積したシリカ粒子を除去して金属膜をエッチングする
工程を特徴とする導体配線パターンの形成方法を示す。
1の表面に、導体配線となるべき部分2が凹となる様に
シリカ粒子含有レジスト3のパターンを形成する(図1
(a))。シリカ粒子含有レジスト3のパターン形成
は、旭化学工業(株)製感光性ポリイミドワニス(商品
名G−7613N)に粒径10nmの溶融シリカ粒子を
重量比でワニス10に対し溶融シリカ1の割合で混入し
てなるコーティング剤を用いて、これを支持基板1上に
スピンコート法を用いて乾燥後に数μm程度の膜厚とな
る様に全面に塗布した後、80℃で20分の乾燥、60
0mJ/cm2 の露光、γ−ブチロラクトンを主成分と
する溶剤で現像した後、窒素中で350℃で1時間の加
熱硬化により行う。
ング処理を行いシリカ粒子含有レジスト3の表面を0.
1μmから1μm程度エッチングすると、樹脂成分であ
るポリイミドはエッチングされていくが、含有している
シリカ粒子はエッチングされないために表面に残って露
出されていくので、シリカ粒子層4が形成される(図1
(b))。
等のドライプロセスを用いて、膜厚数μm程度の例えば
アルミならなる金属膜5を形成する(図1(c))。次
いで、金属膜5の表面を例えばスプレー水洗すると、シ
リカ粒子層4がシリカ粒子含有レジスト3上から除去さ
れるので、シリカ粒子層4に形成した金属膜5のみがエ
ッチングされ、導体配線パターン6が形成される(図1
(d))。
いると、導体配線パターン6の膜厚とシリカ粒子含有レ
ジスト3との膜厚を一致させることにより配線段差のな
い平坦化構造を実現できるので、図1(e)に示す様に
層間絶縁膜7とヴィアホール8を形成した後、上述した
本発明の導体配線パターンの形成方法を繰り返し導体配
線パターン9とシリカ含有レジスト10を形成すること
により、平坦化構造に優れ、かつ層間絶縁膜7の膜厚を
薄くしても絶縁信頼性に優れた多層配線構造100を得
ることができる。
ばSiウエハ,ガラス基板,プリント基板の他、金属板
や金属配線を有する基板上に絶縁膜を形成したもの、あ
るいはポリイミド等のフィルム形状のものでも良い。
ン形成に用いるコーティング剤としては樹脂成分に特に
限定はなく、例えば東京応化工業(株)製フォトレジス
ト(商品名OFPR8600)等のワニス状レジストに
シリカ粒子を混入したものを用いれば、上述した実施例
と同様に導体配線パターン6を形成することができる。
して粒径5μm以下、望ましくは1μm以下のシリカ粒
子とフルオレン骨格を有するエポキシアクリレートによ
り構成されるものを用いることにより、更に微細かつ高
密度で絶縁信頼性のある導体配線パターンを大面積でも
歩留まり良く形成することができる。これはフルオレン
骨格を有するエポキシアクリレートは、極めて解像度に
優れるほか、耐熱性,耐湿性,耐薬品性にも優れるので
絶縁信頼性にも優れているからである。
ることが望ましいのは、粒径がこれ以上大きいと解像度
が低下することや、プラズマアッシング処理によるシリ
カ粒子含有レジストのエッチング量を多くしなければな
らず生産性が低下するからである。
各断面図である。本例では、図1で説明した実施例の導
体配線パターンの形成方法において、シリカ粒子含有レ
ジストとして粒径5μm以下のシリカ粒子とフルオレン
骨格を有するエポキシアクリレートにより構成されるも
のを用いた導体配線パターンの形成方法を示す。
線となるべき部分12が凹となる様に、粒径10nmの
溶融シリカ粒子とフルオレン骨格を有するエポキシアク
リレートにより構成されるコーティング剤を用いて、ス
ピンコート法により乾燥後に1.2μmの膜厚となる様
に塗布した後、75℃で10分の乾燥、100mJ/c
m2 の露光、1%炭酸ソーダで水溶液現像した後、15
0℃で1時間の加熱硬化を行い、シリカ粒子含有レジス
ト13のパターンを形成する(図2(a))。
を用いたプラズマアッシング処理によりシリカ粒子含有
レジスト13の表面を0.1μm程度エッチングし、シ
リカ粒子層14を形成する(図2(b))。次にスパッ
タリング法により、膜厚1μmの金属膜15を形成し
(図2(c))、スプレー水洗により金属膜15をエッ
チングして導体配線パターン16を得る(図2
(d))。
絶縁膜17とヴィアホール18を形成した後に、本発明
の導体配線の形成方法を繰り返し導体配線パターン19
とシリカ粒子含有レジスト20を形成することにより、
平坦化構造に優れ、かつ絶縁信頼性にも非常に優れた多
層配線構造200を得ることができる(図2(e))。
方法を用いて、300mm角のガラス基板上に膜厚1μ
mのアルミ配線の解像度テストパターンを形成したとこ
ろ、ライン幅/スペースが最小0.8μm/0.8μm
までのパターンを形成することができた。
いレジストを用いてアルミ配線を形成すべき部分が凹と
なる様にパターンを形成した後、図4で示した様な従来
技術によりパターン形成を行ったところ、様々な研磨剤
粒径のベルトサンダーやバフを用いてもライン幅/スペ
ースで100μm/100μmが形成できるにすぎなか
った。
順の各断面図である。本例では、ドライ工程により形成
される金属膜が、Cu,Pd,あるいは少なくともCu
層,Pd層を有する複数層により構成されたものであ
り、シリカ粒子含有レジスト上に露出したシリカ粒子を
除去して金属膜をエッチングした後、無電解メッキ法に
より金属を厚付けすることを特徴とする導体配線パター
ンの形成方法を示す。
持基板21の表面に、導体配線となるべき部分22が凹
となる様に、粒径30nmの溶融シリカ粒子とフルオレ
ン骨格を有するエポキシアクリレートにより構成される
コーティング剤を用いて、カーテンコート法により乾燥
後に20μmの膜厚となる様に塗布する。その後、75
℃で20分の乾燥、400mJ/cm2 の露光、1%炭
酸ソーダ水溶液で現像した後、150℃で1時間の加熱
硬化を行って、シリカ粒子含有レジスト23のパターン
を形成する(図3(a))。
ング処理によりシリカ粒子含有レジスト23の表面を
0.1μm程度エッチングしてシリカ粒子層24を形成
する(図3(b))。更に、スパッタリング法により、
膜厚0.05μmのCr層と膜厚0.05μmのPd層
により構成される金属膜25を形成し(図3(c))、
スプレー水洗により金属膜25をエッチングして導体配
線パターン26´を得る(図3(d))。
の金属を厚付けすることにより、任意の膜厚の導体配線
パターンを形成することができるので、例えばメッキ厚
を20μmとすることにより平坦化構造を実現した任意
の膜厚を有する導体配線パターン26を形成することが
できる(図3(e))。
ル28を形成した後、上述の導体配線パターンの形成方
法を繰り返し、導体配線パターン29とシリカ粒子含有
レジスト30を形成することにより、平坦化構造に優
れ、かつ絶縁信頼性にも優れた多層配線構造300を得
ることができる(図3(f))。
方法を用いて、330mm角のFR−4エポキシプリン
ト基板上に膜厚20μmのCu配線の解像度テストパタ
ーンを形成したところ、ライン幅/スペースが最小20
μm/20μmまでのパターンを形成することができ
た。
いレジストを用いてCu配線を形成すべき部分が凹とな
る様にパターンを形成した後、図4で示した様な従来技
術によるパターン形成を行ったところ、様々な研磨剤粒
径のベルトサンダーやバフを用いてもライン幅/スペー
スで150μm/150μmが形成できるにすぎなかっ
た。
よれば、支持基板上に導体配線となるべき部分が凹状と
なる様にシリカ粒子含有レジストでパターン形成し、そ
の表面をプラズマアッシング処理によりシリカ粒子含有
レジスト上にシリカ粒子を露出させ、更にスパッタリン
グ法,あるいは蒸着法等のドライ工程により金属膜を形
成した後、シリカ粒子含有レジスト上に露出したシリカ
粒子を除去して金属膜をエッチングする工程からなるの
で、断線やショート不良がなく、微細かつ高密度な導体
配線パターンを大面積でも歩留まり良く形成することが
でき、更に配線段差がなく平坦性に優れ、かつ絶縁信頼
性に優れた多層配線構造も実現することができる。
5μm以下のシリカ粒子とフルオレン骨格を有するエポ
キシアクリレートにより構成されるものを用いることに
より、更に微細かつ高密度な導体配線パターンを形成す
ることができる。
として、Cu,Pd,あるいは少なくともCu層,Pd
層を有する複数層により構成されたものを用いることに
より、シリカ粒子含有レジスト上に露出したシリカ粒子
を除去して金属膜をエッチングした後、無電解メッキ法
により金属を厚付けすることにより、任意の膜厚の導体
配線パターンを形成することもできる。
る。
る。
である。
す製造工程順の断面図である。
Claims (3)
- 【請求項1】 支持基板の一主表面上に導体配線となる
べき部分が凹状となるようにシリカ粒子含有レジストを
使用してパターニング処理する工程と、このパターンニ
ング処理後の表面をプラズマアッシング処理により前記
シリカ粒子含有レジスト上にシリカ粒子を露出せしめる
露出工程と、この露出工程後の表面に金属膜を被着形成
する工程と、前記露出工程で露出したシリカ粒子を除去
することによりその上の前記金属膜を除去する除去工程
とを含むことを特徴とする導体配線パターンの形成方
法。 - 【請求項2】 前記シリカ粒子含有レジストが、粒子5
μm以下のシリカ粒子とフレオン骨格を有するエポキシ
アクリレートにより構成されていることを特徴とする請
求項1記載の導体配線パターンの形成方法。 - 【請求項3】 前記金属膜は、Cu,Pd,または少な
くともCu層、Pd層を有する複数層により構成されて
おり、前記除去工程の後に無電解メッキ法により更に金
属膜を厚付けする工程を含むことを特徴とする請求項1
または2記載の導体配線パターンの形成方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9049527A JP2836616B2 (ja) | 1997-03-05 | 1997-03-05 | 導体配線パターンの形成方法 |
US09/033,356 US6150074A (en) | 1997-03-05 | 1998-03-02 | Method of forming electrically conductive wiring pattern |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9049527A JP2836616B2 (ja) | 1997-03-05 | 1997-03-05 | 導体配線パターンの形成方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH10247772A true JPH10247772A (ja) | 1998-09-14 |
JP2836616B2 JP2836616B2 (ja) | 1998-12-14 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP9049527A Expired - Lifetime JP2836616B2 (ja) | 1997-03-05 | 1997-03-05 | 導体配線パターンの形成方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US6150074A (ja) |
JP (1) | JP2836616B2 (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6444403B1 (en) | 1999-05-20 | 2002-09-03 | Nec Corporation | Resin laminated wiring sheet, wiring structure using the same, and production method thereof |
KR100487812B1 (ko) * | 2002-06-26 | 2005-05-06 | 엘지전자 주식회사 | 인쇄회로기판의 미세회로패턴 제조방법 |
JP2005191526A (ja) * | 2003-08-26 | 2005-07-14 | Sony Internatl Europ Gmbh | 有機材料又は有機材料と無機材料を組み合わせた材料をパターニングする方法 |
JP2009038409A (ja) * | 2000-10-18 | 2009-02-19 | Nec Corp | 半導体パッケージの製造方法 |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TWI336022B (en) * | 2004-10-29 | 2011-01-11 | Altus Technology Inc | Digital still camera lens module |
US7842223B2 (en) * | 2004-12-22 | 2010-11-30 | Nordson Corporation | Plasma process for removing excess molding material from a substrate |
US20110244263A1 (en) * | 2010-04-02 | 2011-10-06 | Peicheng Ku | Patterning using electrolysis |
US11510320B2 (en) | 2016-12-02 | 2022-11-22 | Ulvac, Inc. | Method of processing wiring substrate |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4732838A (en) * | 1985-12-31 | 1988-03-22 | General Electric Company | Method of forming a patterned glass layer over the surface of a substrate |
JPS63289988A (ja) * | 1987-05-22 | 1988-11-28 | Seiko Epson Corp | プリント配線板の製造方法 |
US5173392A (en) * | 1989-08-28 | 1992-12-22 | International Business Machines, Corp. | Forming a pattern on a substrate |
JP2818321B2 (ja) * | 1990-06-11 | 1998-10-30 | 富士写真フイルム株式会社 | 基板上に金属パターンを形成する方法及び薄膜磁気ヘッドの製造方法 |
JP3332456B2 (ja) * | 1992-03-24 | 2002-10-07 | 株式会社東芝 | 半導体装置の製造方法及び半導体装置 |
KR0155877B1 (ko) * | 1995-09-12 | 1998-12-15 | 이대원 | 다층 회로기판 및 그 제조방법 |
US5648125A (en) * | 1995-11-16 | 1997-07-15 | Cane; Frank N. | Electroless plating process for the manufacture of printed circuit boards |
US5714247A (en) * | 1996-06-14 | 1998-02-03 | Industrial Technology Research Institute | Reflective surface for LCD and method for forming it |
TW339313B (en) * | 1996-08-07 | 1998-09-01 | Teijin Ltd | Photoresist layer supporting polyester flm and photoresist film laminate |
-
1997
- 1997-03-05 JP JP9049527A patent/JP2836616B2/ja not_active Expired - Lifetime
-
1998
- 1998-03-02 US US09/033,356 patent/US6150074A/en not_active Expired - Lifetime
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6444403B1 (en) | 1999-05-20 | 2002-09-03 | Nec Corporation | Resin laminated wiring sheet, wiring structure using the same, and production method thereof |
JP2009038409A (ja) * | 2000-10-18 | 2009-02-19 | Nec Corp | 半導体パッケージの製造方法 |
KR100487812B1 (ko) * | 2002-06-26 | 2005-05-06 | 엘지전자 주식회사 | 인쇄회로기판의 미세회로패턴 제조방법 |
JP2005191526A (ja) * | 2003-08-26 | 2005-07-14 | Sony Internatl Europ Gmbh | 有機材料又は有機材料と無機材料を組み合わせた材料をパターニングする方法 |
JP4557285B2 (ja) * | 2003-08-26 | 2010-10-06 | ソニー ドイチュラント ゲゼルシャフト ミット ベシュレンクテル ハフツング | 有機材料又は有機材料と無機材料を組み合わせた材料をパターニングする方法 |
Also Published As
Publication number | Publication date |
---|---|
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US6150074A (en) | 2000-11-21 |
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