JPH10135786A - Ｔｖ受信用チューナ装置およびｐｌｌ−ｉｃ - Google Patents
Ｔｖ受信用チューナ装置およびｐｌｌ−ｉｃInfo
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- JPH10135786A JPH10135786A JP8305602A JP30560296A JPH10135786A JP H10135786 A JPH10135786 A JP H10135786A JP 8305602 A JP8305602 A JP 8305602A JP 30560296 A JP30560296 A JP 30560296A JP H10135786 A JPH10135786 A JP H10135786A
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Abstract
(57)【要約】
【課題】本発明は、簡単な構成により、別体の高周波装
置のコストが低減され得るようにした、ＴＶ受信用チュ
ーナ装置を提供することを目的とする。 【解決手段】順次に接続されたアンテナ同調回路１２，
ＲＦアンプ１３，局部発振回路１４ａからの局部発振周
波数が入力されるミキサ１４，ＩＦ増幅部１５と、を含
んでおり、上記局部発振回路が、クリスタル発振器１７
からの所定周波数の基準発振信号に基づいてＰＬＬ回路
１８により動作するように、構成されている、ＴＶ受信
用チューナ装置１０において、上記ＰＬＬ回路１８が、
クリスタル発振器からの基準発振信号を取り出すための
バッファアンプ１８ｇを備えており、このバッファアン
プの出力信号が、別体の高周波装置１９内に設けられた
少なくとも一つの回路１９を動作させるＰＬＬ回路２０
に対して、基準信号として出力されるように、ＴＶ受信
用チューナ装置１０を構成する。
置のコストが低減され得るようにした、ＴＶ受信用チュ
ーナ装置を提供することを目的とする。 【解決手段】順次に接続されたアンテナ同調回路１２，
ＲＦアンプ１３，局部発振回路１４ａからの局部発振周
波数が入力されるミキサ１４，ＩＦ増幅部１５と、を含
んでおり、上記局部発振回路が、クリスタル発振器１７
からの所定周波数の基準発振信号に基づいてＰＬＬ回路
１８により動作するように、構成されている、ＴＶ受信
用チューナ装置１０において、上記ＰＬＬ回路１８が、
クリスタル発振器からの基準発振信号を取り出すための
バッファアンプ１８ｇを備えており、このバッファアン
プの出力信号が、別体の高周波装置１９内に設けられた
少なくとも一つの回路１９を動作させるＰＬＬ回路２０
に対して、基準信号として出力されるように、ＴＶ受信
用チューナ装置１０を構成する。
Description
【０００１】
【発明の属する技術分野】本発明は、ＴＶ放送信号を受
信して、映像信号および音声信号を生成するための、Ｔ
Ｖ受信用チューナ装置およびＴＶ受信用チューナ装置で
使用されるＰＬＬ−ＩＣに関するものである。
信して、映像信号および音声信号を生成するための、Ｔ
Ｖ受信用チューナ装置およびＴＶ受信用チューナ装置で
使用されるＰＬＬ−ＩＣに関するものである。
【０００２】
【従来の技術】従来、例えばＴＶ受信用チューナ装置
は、図３に示すように、構成されている。即ち、図３に
おいて、ＴＶ受信用チューナ装置１は、アンテナ２から
の信号が入力されるアンテナ同調回路３，ＲＦアンプ
４，ミキサ５，ＩＦアンプ６と、を含んでおり、ＩＦア
ンプ６からの中間周波数信号ＩＦがＴＶ、ＶＴＲ等のセ
ット部Ｓに接続されている。
は、図３に示すように、構成されている。即ち、図３に
おいて、ＴＶ受信用チューナ装置１は、アンテナ２から
の信号が入力されるアンテナ同調回路３，ＲＦアンプ
４，ミキサ５，ＩＦアンプ６と、を含んでおり、ＩＦア
ンプ６からの中間周波数信号ＩＦがＴＶ、ＶＴＲ等のセ
ット部Ｓに接続されている。
【０００３】ここで、上記アンテナ同調回路３およびＲ
Ｆアンプ４は、それぞれＶＨＦ用およびＵＨＦ用とし
て、それぞれ二つのアンテナ同調回路およびＲＦアン
プ、即ち、ＶＨＦ用アンテナ同調回路３ａ，ＵＨＦ用ア
ンテナ同調回路３ｂ，ＶＨＦ用ＲＦアンプ４ａおよびＵ
ＨＦ用ＲＦアンプ４ｂを備えている。
Ｆアンプ４は、それぞれＶＨＦ用およびＵＨＦ用とし
て、それぞれ二つのアンテナ同調回路およびＲＦアン
プ、即ち、ＶＨＦ用アンテナ同調回路３ａ，ＵＨＦ用ア
ンテナ同調回路３ｂ，ＶＨＦ用ＲＦアンプ４ａおよびＵ
ＨＦ用ＲＦアンプ４ｂを備えている。
【０００４】上記ミキサ５は、上記各ＲＦアンプ４ａ，
４ｂからのＲＦ信号が入力されると共に、局部発振回路
５ａからの局部発振周波数が入力されており、ＲＦ信号
と局部発振周波数を混合して、中間周波数信号を生成す
る。尚、この局部発振回路５ａは、クリスタル発振器８
から所定周波数の基準発振信号によって、ＰＬＬ回路９
を介して制御される。
４ｂからのＲＦ信号が入力されると共に、局部発振回路
５ａからの局部発振周波数が入力されており、ＲＦ信号
と局部発振周波数を混合して、中間周波数信号を生成す
る。尚、この局部発振回路５ａは、クリスタル発振器８
から所定周波数の基準発振信号によって、ＰＬＬ回路９
を介して制御される。
【０００５】さらに、セット部Ｓには、例えば、ＲＦモ
ジュレータ、衛星放送受信用チューナ装置等、上記ＴＶ
受信用チューナ装置１と共に併用されるような高周波装
置７が内蔵されている。
ジュレータ、衛星放送受信用チューナ装置等、上記ＴＶ
受信用チューナ装置１と共に併用されるような高周波装
置７が内蔵されている。
【０００６】このように構成されたＴＶ受信用チューナ
装置１によれば、アンテナ２からの受信信号が、各アン
テナ同調回路３ａまたは３ｂに入力されることにより、
所望の周波数成分のみが通過し、ＲＦアンプ４ａまたは
４ｂにより増幅されてＲＦ信号が生成され、ミキサ５に
入力される。該ミキサ５には、クリスタル発振器８のク
リスタル結晶によって決まる所定周波数の基準発振信号
が、ＰＬＬ回路９を介して入力されており、該ミキサ５
は、ＲＦアンプ４ａ，４ｂからのＲＦ信号と上記局部発
振回路５ａからの局部発振周波数とを混合して、中間周
波数信号ＩＦを生成する。
装置１によれば、アンテナ２からの受信信号が、各アン
テナ同調回路３ａまたは３ｂに入力されることにより、
所望の周波数成分のみが通過し、ＲＦアンプ４ａまたは
４ｂにより増幅されてＲＦ信号が生成され、ミキサ５に
入力される。該ミキサ５には、クリスタル発振器８のク
リスタル結晶によって決まる所定周波数の基準発振信号
が、ＰＬＬ回路９を介して入力されており、該ミキサ５
は、ＲＦアンプ４ａ，４ｂからのＲＦ信号と上記局部発
振回路５ａからの局部発振周波数とを混合して、中間周
波数信号ＩＦを生成する。
【０００７】上記中間周波数信号ＩＦは、ＩＦアンプ６
にて増幅され、セット部Ｓに入力される。そして、この
中間周波数信号ＩＦは、セット部Ｓにより処理されるよ
うになっている。
にて増幅され、セット部Ｓに入力される。そして、この
中間周波数信号ＩＦは、セット部Ｓにより処理されるよ
うになっている。
【０００８】
【発明が解決しようとする課題】ところで、このように
構成されたＴＶ受信用チューナ装置１においては、上記
ＰＬＬ回路９は、図４に示すように、構成されている。
即ち、図４において、ＰＬＬ回路９は、入力端子９ａに
対して順次に接続されたプリスケーラ９ｂ，位相比較器
９ｃ，チャージポンプ９ｄ，ディバイダ９ｅおよび外付
けのクリスタル発振器８からの所定周波数の基準発振信
号が入力される発振回路９ｆから構成されている。これ
により、入力端子９ａに入力される局部発振回路５ａか
らの信号が、位相比較器９ｃにより位相比較され、チャ
ージポンプ９ｄの出力端子９ｇより出力されて、局部発
振回路５ａへフィードバックされる。また、入力端子９
ｈに入力されるセット部Ｓからの選択データによって、
受信周波数を選択できるようになっている。
構成されたＴＶ受信用チューナ装置１においては、上記
ＰＬＬ回路９は、図４に示すように、構成されている。
即ち、図４において、ＰＬＬ回路９は、入力端子９ａに
対して順次に接続されたプリスケーラ９ｂ，位相比較器
９ｃ，チャージポンプ９ｄ，ディバイダ９ｅおよび外付
けのクリスタル発振器８からの所定周波数の基準発振信
号が入力される発振回路９ｆから構成されている。これ
により、入力端子９ａに入力される局部発振回路５ａか
らの信号が、位相比較器９ｃにより位相比較され、チャ
ージポンプ９ｄの出力端子９ｇより出力されて、局部発
振回路５ａへフィードバックされる。また、入力端子９
ｈに入力されるセット部Ｓからの選択データによって、
受信周波数を選択できるようになっている。
【０００９】これに対して、上述したチューナ装置１に
おいては、高周波装置７内には、例えば処理回路を構成
するＰＬＬ回路７ａが備えられており、このＰＬＬ回路
７ａを動作させるための基準周波数発生用のクリスタル
発振器７ｂが備えられていることから、部品点数が多く
なり、部品コストおよび組立コストが高くなってしまう
という問題があった。
おいては、高周波装置７内には、例えば処理回路を構成
するＰＬＬ回路７ａが備えられており、このＰＬＬ回路
７ａを動作させるための基準周波数発生用のクリスタル
発振器７ｂが備えられていることから、部品点数が多く
なり、部品コストおよび組立コストが高くなってしまう
という問題があった。
【００１０】本発明は、以上の点に鑑み、簡単な構成に
より、別体の高周波装置のコストが低減され得るように
した、ＴＶ受信用チューナ装置およびＰＬＬ−ＩＣを提
供することを目的としている。
より、別体の高周波装置のコストが低減され得るように
した、ＴＶ受信用チューナ装置およびＰＬＬ−ＩＣを提
供することを目的としている。
【００１１】
【課題を解決するための手段】上記目的は、本発明によ
れば、順次に接続されたアンテナ同調回路，ＲＦアン
プ，局部発振回路からの局部発振周波数が入力されるミ
キサ，ＩＦ増幅部と、を含んでおり、上記局部発振回路
が、クリスタル発振器からの所定周波数の基準発振信号
に基づいてＰＬＬ回路により動作するように、構成され
ている、ＴＶ受信用チューナ装置において、上記ＰＬＬ
回路が、クリスタル発振器からの基準発振信号を取り出
すためのバッファアンプを備えており、このバッファア
ンプの出力信号が、別体の高周波装置内に設けられた少
なくとも一つの回路を動作させるＰＬＬ回路に対して、
基準信号として出力されることを特徴とする、ＴＶ受信
用チューナ装置により、達成される。
れば、順次に接続されたアンテナ同調回路，ＲＦアン
プ，局部発振回路からの局部発振周波数が入力されるミ
キサ，ＩＦ増幅部と、を含んでおり、上記局部発振回路
が、クリスタル発振器からの所定周波数の基準発振信号
に基づいてＰＬＬ回路により動作するように、構成され
ている、ＴＶ受信用チューナ装置において、上記ＰＬＬ
回路が、クリスタル発振器からの基準発振信号を取り出
すためのバッファアンプを備えており、このバッファア
ンプの出力信号が、別体の高周波装置内に設けられた少
なくとも一つの回路を動作させるＰＬＬ回路に対して、
基準信号として出力されることを特徴とする、ＴＶ受信
用チューナ装置により、達成される。
【００１２】本発明によるＴＶ受信用チューナ装置は、
好ましくは、上記ＰＬＬ回路が、バッファアンプと共
に、一体のＩＣとして構成されている。
好ましくは、上記ＰＬＬ回路が、バッファアンプと共
に、一体のＩＣとして構成されている。
【００１３】また、上記目的は、本発明によれば、局部
発振回路を、クリスタル発振器からの所定周波数の基準
発振信号に基づいて動作させるＰＬＬ回路を構成する、
ＰＬＬ−ＩＣにおいて、上記ＰＬＬ回路が、クリスタル
発振器からの基準発振信号を取り出すためのバッファア
ンプと、このバッファアンプの出力信号を外部出力する
ための出力端子端子を備えていることを特徴とする、Ｐ
ＬＬ−ＩＣにより達成される。
発振回路を、クリスタル発振器からの所定周波数の基準
発振信号に基づいて動作させるＰＬＬ回路を構成する、
ＰＬＬ−ＩＣにおいて、上記ＰＬＬ回路が、クリスタル
発振器からの基準発振信号を取り出すためのバッファア
ンプと、このバッファアンプの出力信号を外部出力する
ための出力端子端子を備えていることを特徴とする、Ｐ
ＬＬ−ＩＣにより達成される。
【００１４】上記構成によれば、ＰＬＬ回路がバッファ
アンプを備えているので、クリスタル発振器からの基準
発振信号が、このバッファアンプを介して出力され、別
体の高周波装置内の他のＰＬＬ回路に対して基準信号と
して入力されることになるので、この高周波装置内の他
のＰＬＬ回路に関して、基準信号を発生するためのクリ
スタル発振器を設ける必要がなくなる。従って、別体の
高周波装置は部品点数が少なくて済み、部品コストおよ
び組立コストが低減され得ることになる。
アンプを備えているので、クリスタル発振器からの基準
発振信号が、このバッファアンプを介して出力され、別
体の高周波装置内の他のＰＬＬ回路に対して基準信号と
して入力されることになるので、この高周波装置内の他
のＰＬＬ回路に関して、基準信号を発生するためのクリ
スタル発振器を設ける必要がなくなる。従って、別体の
高周波装置は部品点数が少なくて済み、部品コストおよ
び組立コストが低減され得ることになる。
【００１５】上記ＰＬＬ回路が、バッファアンプと共
に、一体のＩＣとして構成されている場合には、ＰＬＬ
回路を構成するＩＣの製造の際に、同時にバッファアン
プも製造され得ることになり、別個にバッファアンプを
構成する必要がなく、コストが低減され得ることにな
る。
に、一体のＩＣとして構成されている場合には、ＰＬＬ
回路を構成するＩＣの製造の際に、同時にバッファアン
プも製造され得ることになり、別個にバッファアンプを
構成する必要がなく、コストが低減され得ることにな
る。
【００１６】
【発明の実施の形態】以下、図面に示した実施形態に基
づいて、本発明を詳細に説明する。図１および図２は、
本発明によるＴＶ受信用チューナ装置の一実施形態の構
成を示している。
づいて、本発明を詳細に説明する。図１および図２は、
本発明によるＴＶ受信用チューナ装置の一実施形態の構
成を示している。
【００１７】図１において、ＴＶ受信用チューナ装置１
０は、アンテナ１１からの信号が入力されるアンテナ同
調回路１２，ＲＦアンプ１３，ミキサ１４，ＩＦアンプ
１５と、を含んでおり、ＩＦアンプ１５からの中間周波
数信号ＩＦがＴＶ、ＶＴＲ等のセット部Ｓに接続されて
いる。
０は、アンテナ１１からの信号が入力されるアンテナ同
調回路１２，ＲＦアンプ１３，ミキサ１４，ＩＦアンプ
１５と、を含んでおり、ＩＦアンプ１５からの中間周波
数信号ＩＦがＴＶ、ＶＴＲ等のセット部Ｓに接続されて
いる。
【００１８】ここで、上記アンテナ同調回路１２および
ＲＦアンプ１３は、それぞれＶＨＦ用およびＵＨＦ用と
して、それぞれ二つのアンテナ同調回路およびＲＦアン
プ、即ち、ＶＨＦ用アンテナ同調回路１２ａ，ＵＨＦ用
アンテナ同調回路１２ｂ，ＶＨＦ用ＲＦアンプ１３ａお
よびＵＨＦ用ＲＦアンプ１３ｂを備えている。
ＲＦアンプ１３は、それぞれＶＨＦ用およびＵＨＦ用と
して、それぞれ二つのアンテナ同調回路およびＲＦアン
プ、即ち、ＶＨＦ用アンテナ同調回路１２ａ，ＵＨＦ用
アンテナ同調回路１２ｂ，ＶＨＦ用ＲＦアンプ１３ａお
よびＵＨＦ用ＲＦアンプ１３ｂを備えている。
【００１９】上記ミキサ１４は、上記各ＲＦアンプ１３
ａ，１３ｂからのＲＦ信号が入力されると共に、局部発
振回路１４ａからの局部発振周波数が入力されており、
ＲＦ信号と局部発振周波数を混合して、中間周波数信号
ＩＦを生成する。尚、この局部発振回路１４ａは、クリ
スタル発振器１７から所定周波数の基準発振信号によっ
て、ＰＬＬ回路１８を介して制御される。
ａ，１３ｂからのＲＦ信号が入力されると共に、局部発
振回路１４ａからの局部発振周波数が入力されており、
ＲＦ信号と局部発振周波数を混合して、中間周波数信号
ＩＦを生成する。尚、この局部発振回路１４ａは、クリ
スタル発振器１７から所定周波数の基準発振信号によっ
て、ＰＬＬ回路１８を介して制御される。
【００２０】さらに、セット部Ｓには、例えばＲＦモジ
ュレータ、衛星放送受信用チューナ装置等、上記ＴＶ受
信用チューナ装置１０と共に、併用されるような高周波
装置１９が内蔵されている。このような高周波装置１９
は、例えばＴＶ受信用チューナ装置１０と共に、一つの
装置として同じシャーシ上に実装され、あるいは一つの
ケース内に組み込まれて使用されるようになっている。
ュレータ、衛星放送受信用チューナ装置等、上記ＴＶ受
信用チューナ装置１０と共に、併用されるような高周波
装置１９が内蔵されている。このような高周波装置１９
は、例えばＴＶ受信用チューナ装置１０と共に、一つの
装置として同じシャーシ上に実装され、あるいは一つの
ケース内に組み込まれて使用されるようになっている。
【００２１】上記ＰＬＬ回路１８は、図２に示すよう
に、入力端子１８ａに対して順次に接続されたプリスケ
ーラ１８ｂ，位相比較器１８ｃ，チャージポンプ１８
ｄ，ディバイダ１８ｅおよび外付けのクリスタル発振器
１７からの所定周波数の基準発振信号が入力される発振
回路１８ｆから構成されている。これにより、入力端子
１８ａに入力される局部発振回路１４ａからの信号が、
位相比較器１８ｃにより位相比較され、チャージポンプ
１８ｄの出力端子１８ｈより出力されて、局部発振回路
１４ａへフィードバックされる。また、入力端子１８ｉ
に入力されるセット部Ｓからの選択データによって、受
信周波数を選択できるようになっている。
に、入力端子１８ａに対して順次に接続されたプリスケ
ーラ１８ｂ，位相比較器１８ｃ，チャージポンプ１８
ｄ，ディバイダ１８ｅおよび外付けのクリスタル発振器
１７からの所定周波数の基準発振信号が入力される発振
回路１８ｆから構成されている。これにより、入力端子
１８ａに入力される局部発振回路１４ａからの信号が、
位相比較器１８ｃにより位相比較され、チャージポンプ
１８ｄの出力端子１８ｈより出力されて、局部発振回路
１４ａへフィードバックされる。また、入力端子１８ｉ
に入力されるセット部Ｓからの選択データによって、受
信周波数を選択できるようになっている。
【００２２】以上の構成は、図３に示した従来のＴＶ受
信用チューナ装置１と同様の構成であるが、本発明実施
形態によるＴＶ受信用チューナ装置１０においては、以
下の点で異なる構成になっている。
信用チューナ装置１と同様の構成であるが、本発明実施
形態によるＴＶ受信用チューナ装置１０においては、以
下の点で異なる構成になっている。
【００２３】即ち、上述したＰＬＬ回路１８は、図２に
示すように、クリスタル発振器１７からの基準発振信号
を取り出すためのバッファアンプ１８ｇを備えており、
このバッファアンプ１８ｇの出力信号が、ＰＬＬ回路１
８から外部出力されて、上述した高周波装置１９内に設
けられた所定の回路内に設けられた発振回路（図示せ
ず）を動作させるためのＰＬＬ回路２０に対して、基準
信号として入力されるようになっている。
示すように、クリスタル発振器１７からの基準発振信号
を取り出すためのバッファアンプ１８ｇを備えており、
このバッファアンプ１８ｇの出力信号が、ＰＬＬ回路１
８から外部出力されて、上述した高周波装置１９内に設
けられた所定の回路内に設けられた発振回路（図示せ
ず）を動作させるためのＰＬＬ回路２０に対して、基準
信号として入力されるようになっている。
【００２４】これにより、クリスタル発振器１７からの
基準発振信号は、発振回路１８ｆにて、所定周波数（例
えば４ＭＨｚ）の基準信号として、干渉を排除するため
に、バッファアンプ１８ｇを介して、高周波装置１９内
の回路に設けられたＰＬＬ回路２０に入力される。従っ
て、ＰＬＬ回路２０は、クリスタル発振器１７の基準発
振信号が、ＰＬＬ回路１８を介して、基準信号として入
力され、この信号に基づいて、所定周波数の発振信号を
生成して、高周波装置１９内の回路１９を動作させるよ
うになっている。
基準発振信号は、発振回路１８ｆにて、所定周波数（例
えば４ＭＨｚ）の基準信号として、干渉を排除するため
に、バッファアンプ１８ｇを介して、高周波装置１９内
の回路に設けられたＰＬＬ回路２０に入力される。従っ
て、ＰＬＬ回路２０は、クリスタル発振器１７の基準発
振信号が、ＰＬＬ回路１８を介して、基準信号として入
力され、この信号に基づいて、所定周波数の発振信号を
生成して、高周波装置１９内の回路１９を動作させるよ
うになっている。
【００２５】本発明実施形態によるＴＶ受信用チューナ
装置１０は、以上のように構成されており、アンテナ１
１からの受信信号が、各アンテナ同調回路１２ａまたは
１２ｂに入力されることにより、所望の周波数成分のみ
が通過し、ＲＦアンプ１３ａまたは１３ｂにより増幅さ
れてＲＦ信号が生成され、ミキサ１４に入力される。該
ミキサ１４には、クリスタル発振器１７のクリスタル結
晶によって決まる所定周波数の基準発振信号が、ＰＬＬ
回路１８を介して入力されており、ミキサ１４は、ＲＦ
アンプ１３ａ，１３ｂからのＲＦ信号と上記局部発振回
路１４ａからの局部発振周波数とを混合して、中間周波
数信号ＩＦを生成する。
装置１０は、以上のように構成されており、アンテナ１
１からの受信信号が、各アンテナ同調回路１２ａまたは
１２ｂに入力されることにより、所望の周波数成分のみ
が通過し、ＲＦアンプ１３ａまたは１３ｂにより増幅さ
れてＲＦ信号が生成され、ミキサ１４に入力される。該
ミキサ１４には、クリスタル発振器１７のクリスタル結
晶によって決まる所定周波数の基準発振信号が、ＰＬＬ
回路１８を介して入力されており、ミキサ１４は、ＲＦ
アンプ１３ａ，１３ｂからのＲＦ信号と上記局部発振回
路１４ａからの局部発振周波数とを混合して、中間周波
数信号ＩＦを生成する。
【００２６】上記中間周波数信号ＩＦは、ＩＦアンプ１
５にて増幅された後、セット部Ｓに入力される。そし
て、この中間周波数信号ＩＦは、セット部Ｓに信号処理
されるようになっている。
５にて増幅された後、セット部Ｓに入力される。そし
て、この中間周波数信号ＩＦは、セット部Ｓに信号処理
されるようになっている。
【００２７】この場合、高周波装置１６内の回路１９の
ＰＬＬ回路２０は、クリスタル発振器１７の基準発振信
号が、ＰＬＬ回路１８の発振回路１８ｆから、干渉を回
避するためのバッファアンプ１８ｇを介して入力され、
この発振信号に基づいて、所定周波数のクロック信号を
生成するようになっているので、このＰＬＬ回路２０の
ためのクリスタル発振器が不要となり、部品点数が少な
くて済み、部品コストおよび組立コストが低減され得る
と共に、全体として小型に構成され得ることになる。
ＰＬＬ回路２０は、クリスタル発振器１７の基準発振信
号が、ＰＬＬ回路１８の発振回路１８ｆから、干渉を回
避するためのバッファアンプ１８ｇを介して入力され、
この発振信号に基づいて、所定周波数のクロック信号を
生成するようになっているので、このＰＬＬ回路２０の
ためのクリスタル発振器が不要となり、部品点数が少な
くて済み、部品コストおよび組立コストが低減され得る
と共に、全体として小型に構成され得ることになる。
【００２８】
【発明の効果】以上述べたように、本発明によれば、Ｐ
ＬＬ回路がバッファアンプを備えているので、クリスタ
ル発振器からの基準発振信号が、このバッファアンプを
介して出力され、別体の高周波装置内の他のＰＬＬ回路
に対して基準信号として入力されることになるので、こ
の高周波装置内の他のＰＬＬ回路に関して、基準信号を
発生するためのクリスタル発振器を設ける必要がなくな
る。従って、別体の高周波装置の部品点数が少なくて済
み、部品コストおよび組立コストが低減され得ることに
なる。
ＬＬ回路がバッファアンプを備えているので、クリスタ
ル発振器からの基準発振信号が、このバッファアンプを
介して出力され、別体の高周波装置内の他のＰＬＬ回路
に対して基準信号として入力されることになるので、こ
の高周波装置内の他のＰＬＬ回路に関して、基準信号を
発生するためのクリスタル発振器を設ける必要がなくな
る。従って、別体の高周波装置の部品点数が少なくて済
み、部品コストおよび組立コストが低減され得ることに
なる。
【００２９】かくして、本発明によれば、簡単な構成に
より、別体の高周波装置のコストが低減され得るように
した、極めて優れたＴＶ受信用チューナ装置が提供され
得ることになる。
より、別体の高周波装置のコストが低減され得るように
した、極めて優れたＴＶ受信用チューナ装置が提供され
得ることになる。
【図１】本発明によるＴＶ受信用チューナ装置の一実施
形態における構成を示すブロック図である。
形態における構成を示すブロック図である。
【図２】図１のＴＶ受信用チューナ装置の、ＰＬＬ回路
の構成を示すブロック図である。
の構成を示すブロック図である。
【図３】従来のＴＶ受信用チューナ装置の一例を示すブ
ロック図である。
ロック図である。
【図４】図３のＴＶ受信用チューナ装置のＰＬＬ回路の
構成を示す、ブロック図である。
構成を示す、ブロック図である。
１０ ＴＶ受信用チューナ装置 １１ アンテナ １２，１２ａ，１２ｂ アンテナ同調回路 １３，１３ａ，１３ｂ ＲＦアンプ １４ ミキサ １４ａ 局部発振回路 １５ ＩＦ増幅部 １７ クリスタル発振器 １８ ＰＬＬ回路 １８ｆ 発振回路 １８ｇ バッファアンプ １９ 高周波装置 ２０ ＰＬＬ回路 Ｓ セット部
Claims (3)
- 【請求項１】 順次に接続されたアンテナ同調回路，Ｒ
Ｆアンプ，局部発振回路からの局部発振周波数が入力さ
れるミキサ，ＩＦ増幅部と、を含んでおり、上記局部発
振回路が、クリスタル発振器からの所定周波数の基準発
振信号に基づいてＰＬＬ回路により動作するように、構
成されている、ＴＶ受信用チューナ装置において、 上記ＰＬＬ回路が、クリスタル発振器からの基準発振信
号を取り出すためのバッファアンプを備えており、この
バッファアンプの出力信号が、別体の高周波装置内に設
けられた少なくとも一つの回路を動作させるＰＬＬ回路
に対して、基準信号として出力されることを特徴とす
る、ＴＶ受信用チューナ装置。 - 【請求項２】 上記ＰＬＬ回路が、バッファアンプと共
に、一体のＩＣとして構成されていることを特徴とす
る、請求項１に記載のＴＶ受信用チューナ装置。 - 【請求項３】 局部発振回路を、クリスタル発振器から
の所定周波数の基準発振信号に基づいて動作させるＰＬ
Ｌ回路を構成する、ＰＬＬ−ＩＣにおいて、 上記ＰＬ
Ｌ回路が、クリスタル発振器からの基準発振信号を取り
出すためのバッファアンプと、このバッファアンプの出
力信号を外部出力するための出力端子端子を備えている
ことを特徴とする、ＰＬＬ−ＩＣ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8305602A JPH10135786A (ja) | 1996-10-31 | 1996-10-31 | Ｔｖ受信用チューナ装置およびｐｌｌ−ｉｃ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8305602A JPH10135786A (ja) | 1996-10-31 | 1996-10-31 | Ｔｖ受信用チューナ装置およびｐｌｌ−ｉｃ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10135786A true JPH10135786A (ja) | 1998-05-22 |
Family
ID=17947130
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8305602A Pending JPH10135786A (ja) | 1996-10-31 | 1996-10-31 | Ｔｖ受信用チューナ装置およびｐｌｌ−ｉｃ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10135786A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6798257B1 (en) * | 2001-03-21 | 2004-09-28 | Cisco Technology, Inc. | Method and apparatus for providing multiple clock signals on a chip using a second PLL library circuit connected to a buffered reference clock output of a first PLL library circuit |
-
1996
- 1996-10-31 JP JP8305602A patent/JPH10135786A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6798257B1 (en) * | 2001-03-21 | 2004-09-28 | Cisco Technology, Inc. | Method and apparatus for providing multiple clock signals on a chip using a second PLL library circuit connected to a buffered reference clock output of a first PLL library circuit |
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