JPH0964864A - Ｉｎｓネット６４用のｄｓｕ−端末間接続方法 - Google Patents
Ｉｎｓネット６４用のｄｓｕ−端末間接続方法Info
- Publication number
- JPH0964864A JPH0964864A JP7218697A JP21869795A JPH0964864A JP H0964864 A JPH0964864 A JP H0964864A JP 7218697 A JP7218697 A JP 7218697A JP 21869795 A JP21869795 A JP 21869795A JP H0964864 A JPH0964864 A JP H0964864A
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- Japan
- Prior art keywords
- dsu
- signal
- terminal
- terminal equipment
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- Communication Control (AREA)
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Abstract
(57)【要約】
【課題】接続する信号線を増加することにより信号速度
を低速化し、ＤＳＵ，端末側のＨ／Ｗの規模を小さく、
コストを低減する。 【解決手段】２対のクロック信号線４１と２つのＢチャ
ネルと１つのＤチャネルとを伝送するための６対のデー
タ信号線４２とで接続し、各信号線のデータ速度を６４
Ｋビット／Ｓとし、ＤＳＵ，端末側のＨ／Ｗの規模を小
さくし、また汎用ＭＳＩを使用するなどでコストを低下
させる。端末のＴＡ２はクロック信号１０１，１０２か
らロードタイミング信号１１０を生成し、この信号を用
いてデータ信号１０３〜１０８を直並列あるいは並直列
変換して端末内部バス２３に接続する。またＤデータ信
号１０７，１０８に付加された制御ビットによりＤＳＵ
側との発呼，着呼制御を行う。
を低速化し、ＤＳＵ，端末側のＨ／Ｗの規模を小さく、
コストを低減する。 【解決手段】２対のクロック信号線４１と２つのＢチャ
ネルと１つのＤチャネルとを伝送するための６対のデー
タ信号線４２とで接続し、各信号線のデータ速度を６４
Ｋビット／Ｓとし、ＤＳＵ，端末側のＨ／Ｗの規模を小
さくし、また汎用ＭＳＩを使用するなどでコストを低下
させる。端末のＴＡ２はクロック信号１０１，１０２か
らロードタイミング信号１１０を生成し、この信号を用
いてデータ信号１０３〜１０８を直並列あるいは並直列
変換して端末内部バス２３に接続する。またＤデータ信
号１０７，１０８に付加された制御ビットによりＤＳＵ
側との発呼，着呼制御を行う。
Description
【０００１】
【発明の属する技術分野】本発明は、ＩＮＳネット６４
用（ＮＴＴでサービスするＩｎｆｏｒｍａｔｉｏｎ Ｎ
ｅｔｗｏｒｋ Ｓｙｓｔｅｍの基本インタフェース、６
４Ｋビット／ＳのＢチャネルを２チャネルと１６Ｋビッ
ト／ＳのＤチャネルを１チャネルとで構成される１４４
Ｋビット／Ｓの回線という）のＤＳＵ（Ｄｉｇｉｔａｌ
Ｓｅｒｖｉｃｅ Ｕｎｉｔ）に関し、特に、ＤＳＵと
端末とが同一装置内に設けられるなど近距離に設置され
る場合に適用される接続方法に関する。
用（ＮＴＴでサービスするＩｎｆｏｒｍａｔｉｏｎ Ｎ
ｅｔｗｏｒｋ Ｓｙｓｔｅｍの基本インタフェース、６
４Ｋビット／ＳのＢチャネルを２チャネルと１６Ｋビッ
ト／ＳのＤチャネルを１チャネルとで構成される１４４
Ｋビット／Ｓの回線という）のＤＳＵ（Ｄｉｇｉｔａｌ
Ｓｅｒｖｉｃｅ Ｕｎｉｔ）に関し、特に、ＤＳＵと
端末とが同一装置内に設けられるなど近距離に設置され
る場合に適用される接続方法に関する。
【０００２】
【従来の技術】従来のＩＮＳネット６４用のＤＳＵと端
末間インタフェースにおける伝送信号のフレームフォー
マットを図４に示す。また、ＤＳＵ−端末間のインタフ
ェース構成例を図３に示す。
末間インタフェースにおける伝送信号のフレームフォー
マットを図４に示す。また、ＤＳＵ−端末間のインタフ
ェース構成例を図３に示す。
【０００３】ＩＮＳネット６４用のＤＳＵの端末インタ
フェース接続方法などは、ＩＴＵ−Ｉ．４００系シリー
ズにて勧告化されており、本勧告に準拠した形で提供さ
れている。また、このインタフェースは、一般的には、
ユーザ・網インタフェース、または、Ｉ．インタフェー
スと呼ばれている。（参照、ＩＳＤＮ，Ｉシリーズ国際
標準とその技術，電気通信協会刊Ｐ６５〜１４０，尚Ｉ
ＮＳは国際標準ではＩＳＤＮに相当する。） 図３において、ＤＳＵ５と端末６とはデータ信号線８０
の２対の信号線で接続されている。ＤＳＵ５はＩＮＳ交
換機の加入者線７０に接続されており、加入者線側の信
号終端処理および２線式半二重方式のデータ信号を４線
式のデータ信号２０１，２０２に変換する機能を有し、
端末６はＤＳＵ側との信号終端処理およびデータ信号２
０１，２０２をＢ１，Ｂ２，Ｄの各チャネルに分離し、
並列信号に変換して端末内部バス２３に送出するターミ
ナルアダプタ部６１とＤＴＥ本体６２とで構成されてい
る。
フェース接続方法などは、ＩＴＵ−Ｉ．４００系シリー
ズにて勧告化されており、本勧告に準拠した形で提供さ
れている。また、このインタフェースは、一般的には、
ユーザ・網インタフェース、または、Ｉ．インタフェー
スと呼ばれている。（参照、ＩＳＤＮ，Ｉシリーズ国際
標準とその技術，電気通信協会刊Ｐ６５〜１４０，尚Ｉ
ＮＳは国際標準ではＩＳＤＮに相当する。） 図３において、ＤＳＵ５と端末６とはデータ信号線８０
の２対の信号線で接続されている。ＤＳＵ５はＩＮＳ交
換機の加入者線７０に接続されており、加入者線側の信
号終端処理および２線式半二重方式のデータ信号を４線
式のデータ信号２０１，２０２に変換する機能を有し、
端末６はＤＳＵ側との信号終端処理およびデータ信号２
０１，２０２をＢ１，Ｂ２，Ｄの各チャネルに分離し、
並列信号に変換して端末内部バス２３に送出するターミ
ナルアダプタ部６１とＤＴＥ本体６２とで構成されてい
る。
【０００４】データ信号２０１はＤＳＵから端末方向の
信号で、またデータ信号２０２は端末からＤＳＵ方向信
号で、それぞれ図４に示すようなフレームフォーマット
となっている。このフレームフォーマットは１フレーム
１６ビット（６４Ｋビット／Ｓ）の２つのＢチャネル
（Ｂ１，Ｂ２チャネル）と１フレーム４ビット（１６Ｋ
ビット／Ｓ）のＤチャネルと、Ｆ，Ｌなどのフレーム，
ビット同期を抽出するための信号、あるいは発着信制御
のための１２ビットの信号が付加されて構成されてい
る。合計１フレーム４８ビットで１９２Ｋビット／Ｓの
データ信号となっている。
信号で、またデータ信号２０２は端末からＤＳＵ方向信
号で、それぞれ図４に示すようなフレームフォーマット
となっている。このフレームフォーマットは１フレーム
１６ビット（６４Ｋビット／Ｓ）の２つのＢチャネル
（Ｂ１，Ｂ２チャネル）と１フレーム４ビット（１６Ｋ
ビット／Ｓ）のＤチャネルと、Ｆ，Ｌなどのフレーム，
ビット同期を抽出するための信号、あるいは発着信制御
のための１２ビットの信号が付加されて構成されてい
る。合計１フレーム４８ビットで１９２Ｋビット／Ｓの
データ信号となっている。
【０００５】
【発明が解決しようとする課題】このように従来のＩＮ
Ｓネット６４用ＤＳＵ−端末間インタフェースを２対の
データ信号線で接続しており、この信号線のデータ信号
は多重化された１９２Ｋビット／Ｓのデータ信号となる
ため、ＤＳＵ、端末においてはこのデータ信号の高速性
と、多重化などの変換および同期クロックの抽出などを
要することから回路が複雑となり、装置が大きくなり価
格も高くなるという問題がある。
Ｓネット６４用ＤＳＵ−端末間インタフェースを２対の
データ信号線で接続しており、この信号線のデータ信号
は多重化された１９２Ｋビット／Ｓのデータ信号となる
ため、ＤＳＵ、端末においてはこのデータ信号の高速性
と、多重化などの変換および同期クロックの抽出などを
要することから回路が複雑となり、装置が大きくなり価
格も高くなるという問題がある。
【０００６】
【課題を解決するための手段】本発明のＩＮＳネット６
４用のＤＳＵ−端末間接続方法は、ＩＮＳネットワーク
の６４ＫＨｚ回線におけるＤＳＵと端末間インタフェー
スを、回線に同期した４ＫＨｚのフレームクロック信号
とフレームクロックに同期したデータ転送のための６４
ＫＨｚの転送クロックとを前記ＤＳＵから前記端末方向
に伝送するための２対のクロック系信号線と、前記転送
クロックに同期し且つ１フレーム１６ビット構成の２つ
のＢチャネルデータ信号を双方向に伝送するための４対
のデータ系信号線と、発呼着信制御のためのＩＮＦＯ３
情報及びＱビットと合成された前記端末から前記ＤＳＵ
方向のＤチャネルデータ信号と、ＤＳＵ及び回線の状態
表示，エコー，Ｓビットと合成された前記ＤＳＵから前
記端末方向のＤチャネルデータ信号とを伝送するための
２対のデータ系信号線とで接続している。
４用のＤＳＵ−端末間接続方法は、ＩＮＳネットワーク
の６４ＫＨｚ回線におけるＤＳＵと端末間インタフェー
スを、回線に同期した４ＫＨｚのフレームクロック信号
とフレームクロックに同期したデータ転送のための６４
ＫＨｚの転送クロックとを前記ＤＳＵから前記端末方向
に伝送するための２対のクロック系信号線と、前記転送
クロックに同期し且つ１フレーム１６ビット構成の２つ
のＢチャネルデータ信号を双方向に伝送するための４対
のデータ系信号線と、発呼着信制御のためのＩＮＦＯ３
情報及びＱビットと合成された前記端末から前記ＤＳＵ
方向のＤチャネルデータ信号と、ＤＳＵ及び回線の状態
表示，エコー，Ｓビットと合成された前記ＤＳＵから前
記端末方向のＤチャネルデータ信号とを伝送するための
２対のデータ系信号線とで接続している。
【０００７】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面を参照して説明する。図１は、実施の形態例を示
すブロック図である。また図２は、図１におけるデータ
信号のフレームフォーマットを示す構成図である。
て図面を参照して説明する。図１は、実施の形態例を示
すブロック図である。また図２は、図１におけるデータ
信号のフレームフォーマットを示す構成図である。
【０００８】図１において、ＤＳＵ１と端末２とはデー
タ信号線４２の６対の信号線とクロック信号線４１の２
対の信号線で接続されている。ＤＳＵ１はＩＮＳ交換機
の加入者線３０に接続されており加入者線側の信号終端
処理および２線式半二重方式のデータ信号をＢ１，Ｂ
２，Ｄの各チャネルに分離し、それぞれ４線式のデータ
信号１０３〜１０８に変換する機能、およびクロック信
号１０１，１０２を生成する機能を有し、端末２はＤＳ
Ｕ側との信号終端処理およびクロック信号１０１，１０
２により生成されるロードタイミング信号１１０でデー
タ信号１０３〜１０８を並列信号に変換して端末内部バ
ス２３に送出するターミナルアダプタ部２１と、ＤＴＥ
本体２２とで構成されている。
タ信号線４２の６対の信号線とクロック信号線４１の２
対の信号線で接続されている。ＤＳＵ１はＩＮＳ交換機
の加入者線３０に接続されており加入者線側の信号終端
処理および２線式半二重方式のデータ信号をＢ１，Ｂ
２，Ｄの各チャネルに分離し、それぞれ４線式のデータ
信号１０３〜１０８に変換する機能、およびクロック信
号１０１，１０２を生成する機能を有し、端末２はＤＳ
Ｕ側との信号終端処理およびクロック信号１０１，１０
２により生成されるロードタイミング信号１１０でデー
タ信号１０３〜１０８を並列信号に変換して端末内部バ
ス２３に送出するターミナルアダプタ部２１と、ＤＴＥ
本体２２とで構成されている。
【０００９】データ信号１０４，１０６，１０８および
クロック信号１０１，１０２はＤＳＵから端末方向の信
号でデータ信号１０３，１０５，１０７は端末からＤＳ
Ｕ方向信号でそれぞれ図２に示すようなフレームフォー
マットとなっている。図２において、各信号は２５０μ
ｓ，１フレームで１６ビットの信号で、伝送速度は６４
Ｋビット／Ｓの信号である。即ち、４ＫＨｚのフレーム
クロックのクロック信号１０１と、ビット同期のクロッ
ク信号１０２と、１フレーム１６ビットの２つのＢチャ
ネル（Ｂ１，Ｂ２チャネル）のＢデータ信号１０３〜１
０６と、１フレーム４ビットのＤチャネルにＳＩ１，Ｓ
Ｉ２，ＳＩ３などの発着信制御の各信号を付加したＤデ
ータ信号１０７，１０８の合計８本の信号である。
クロック信号１０１，１０２はＤＳＵから端末方向の信
号でデータ信号１０３，１０５，１０７は端末からＤＳ
Ｕ方向信号でそれぞれ図２に示すようなフレームフォー
マットとなっている。図２において、各信号は２５０μ
ｓ，１フレームで１６ビットの信号で、伝送速度は６４
Ｋビット／Ｓの信号である。即ち、４ＫＨｚのフレーム
クロックのクロック信号１０１と、ビット同期のクロッ
ク信号１０２と、１フレーム１６ビットの２つのＢチャ
ネル（Ｂ１，Ｂ２チャネル）のＢデータ信号１０３〜１
０６と、１フレーム４ビットのＤチャネルにＳＩ１，Ｓ
Ｉ２，ＳＩ３などの発着信制御の各信号を付加したＤデ
ータ信号１０７，１０８の合計８本の信号である。
【００１０】
【発明の効果】以上説明したように本発明は、データ信
号線は増加するが各データ信号は６４Ｋビット／Ｓの低
速信号でフレーム構成が簡略化されており、１フレーム
の各信号が、１６ビット単位で連続しているため、特に
端末２においては、ターミナルアダプタ部のＴＡ２１の
Ｓ→Ｐ変換，Ｐ→Ｓ変換あるいはロードタイミング信号
１１０を生成する際に汎用の小型ＭＳＩで構成すること
ができる。従ってＤＳＵ，端末のＨ／Ｗの規模を小さ
く、かつ低価格化することができる効果がある。
号線は増加するが各データ信号は６４Ｋビット／Ｓの低
速信号でフレーム構成が簡略化されており、１フレーム
の各信号が、１６ビット単位で連続しているため、特に
端末２においては、ターミナルアダプタ部のＴＡ２１の
Ｓ→Ｐ変換，Ｐ→Ｓ変換あるいはロードタイミング信号
１１０を生成する際に汎用の小型ＭＳＩで構成すること
ができる。従ってＤＳＵ，端末のＨ／Ｗの規模を小さ
く、かつ低価格化することができる効果がある。
【図１】本発明の実施の形態例を示すブロック図であ
る。
る。
【図２】図１におけるフレームフォーマットを示す構成
図である。
図である。
【図３】従来例を示すブロック図である。
【図４】図３におけるフレームフォーマットを示す構成
図である。
図である。
１ ＤＳＵ ２ 端末 ２１ ＴＡ ２２ ＤＴＥ本体 ２３ 端末内部バス ３０ 加入者線 ４１ クロック信号線 ４２ データ信号線
Claims (1)
- 【請求項１】 ＩＮＳネットワークの６４ＫＨｚ回線に
おけるＤＳＵと端末間インタフェースを、回線に同期し
た４ＫＨｚのフレームクロック信号とフレームクロック
に同期したデータ転送のための６４ＫＨｚの転送クロッ
クとを前記ＤＳＵから前記端末方向に伝送するための２
対のクロック系信号線と、前記転送クロックに同期し且
つ１フレーム１６ビット構成の２つのＢチャネルデータ
信号を双方向に伝送するための４対のデータ系信号線
と、発呼着信制御のためのＩＮＦＯ３情報及びＱビット
と合成された前記端末から前記ＤＳＵ方向のＤチャネル
データ信号と、ＤＳＵ及び回線の状態表示，エコー，Ｓ
ビットと合成された前記ＤＳＵから前記端末方向のＤチ
ャネルデータ信号とを伝送するための２対のデータ系信
号線とで接続することを特徴とするＩＮＳネット６４用
のＤＳＵ−端末間接続方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7218697A JP2752928B2 (ja) | 1995-08-28 | 1995-08-28 | Ｉｎｓネット６４用のｄｓｕ−端末間接続方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7218697A JP2752928B2 (ja) | 1995-08-28 | 1995-08-28 | Ｉｎｓネット６４用のｄｓｕ−端末間接続方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0964864A true JPH0964864A (ja) | 1997-03-07 |
| JP2752928B2 JP2752928B2 (ja) | 1998-05-18 |
Family
ID=16724005
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7218697A Expired - Lifetime JP2752928B2 (ja) | 1995-08-28 | 1995-08-28 | Ｉｎｓネット６４用のｄｓｕ−端末間接続方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2752928B2 (ja) |
-
1995
- 1995-08-28 JP JP7218697A patent/JP2752928B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JP2752928B2 (ja) | 1998-05-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980203 |