JPH0918261A - 電子機器のミューティング回路 - Google Patents
電子機器のミューティング回路Info
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- JPH0918261A JPH0918261A JP7160899A JP16089995A JPH0918261A JP H0918261 A JPH0918261 A JP H0918261A JP 7160899 A JP7160899 A JP 7160899A JP 16089995 A JP16089995 A JP 16089995A JP H0918261 A JPH0918261 A JP H0918261A
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- signal
- circuit
- reset
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- Control Of Amplification And Gain Control (AREA)
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Abstract
(57)【要約】
【目的】ディスクプレーヤー等の電子機器に使用され、
電源のオンオフ時等に発生する雑音を抑えるミューティ
ング回路を提供する。 【構成】電源供給動作時リセット信号が入力されるリセ
ット端子Ｒ及びミューティング信号を出力するミューテ
ィング信号出力端子Ｍを備えたシステム制御回路１１
と、動作状態にあるときオーディオ信号の出力動作を阻
止するミューティング回路５と、前記ミューティング信
号出力端子Ｍに出力されるミューティング信号によって
動作が制御されるとともに前記ミューティング回路５の
動作を制御するミューティング制御用トランジスター１
５とより構成されている。
電源のオンオフ時等に発生する雑音を抑えるミューティ
ング回路を提供する。 【構成】電源供給動作時リセット信号が入力されるリセ
ット端子Ｒ及びミューティング信号を出力するミューテ
ィング信号出力端子Ｍを備えたシステム制御回路１１
と、動作状態にあるときオーディオ信号の出力動作を阻
止するミューティング回路５と、前記ミューティング信
号出力端子Ｍに出力されるミューティング信号によって
動作が制御されるとともに前記ミューティング回路５の
動作を制御するミューティング制御用トランジスター１
５とより構成されている。
Description
【０００１】
【産業上の利用分野】本発明は、ディスクプレーヤー等
の電子機器に使用され、電源のオンオフ時等に発生する
雑音を抑えるミューティング回路に関する。
の電子機器に使用され、電源のオンオフ時等に発生する
雑音を抑えるミューティング回路に関する。
【０００２】
【従来の技術】ディスクに記録されている信号を光学式
ピックアップより出力される光ビームによって読み出し
て音楽等の信号を再生聴取するように構成されたディス
クプレーヤーが普及している。斯かるディスクプレーヤ
ーの中には、ヘッドフォンによって再生信号の聴取動作
を行うように構成されたポータブル型のディスクプレー
ヤーがあり、斯かるディスクプレーヤーは、電源のオン
オフ時に発生する雑音信号の出力動作を阻止するミュー
ティングと呼ばれる回路を一般に備えている。
ピックアップより出力される光ビームによって読み出し
て音楽等の信号を再生聴取するように構成されたディス
クプレーヤーが普及している。斯かるディスクプレーヤ
ーの中には、ヘッドフォンによって再生信号の聴取動作
を行うように構成されたポータブル型のディスクプレー
ヤーがあり、斯かるディスクプレーヤーは、電源のオン
オフ時に発生する雑音信号の出力動作を阻止するミュー
ティングと呼ばれる回路を一般に備えている。
【０００３】
【発明が解決しようとする課題】ディスクプレーヤー
は、ディスクからの信号の読み取り動作や信号の復調動
作を制御するシステム制御回路を備えており、ミューテ
ィング回路の動作不動作は、前記システム制御回路によ
って制御されるように構成されている。また、斯かるシ
ステム制御回路は、電源の投入時に回路がリセットされ
るように構成されているが、斯かるリセット動作は、該
システム制御回路に設けられているリセット端子にリセ
ット信号を入力させることによって行うように構成され
ている。
は、ディスクからの信号の読み取り動作や信号の復調動
作を制御するシステム制御回路を備えており、ミューテ
ィング回路の動作不動作は、前記システム制御回路によ
って制御されるように構成されている。また、斯かるシ
ステム制御回路は、電源の投入時に回路がリセットされ
るように構成されているが、斯かるリセット動作は、該
システム制御回路に設けられているリセット端子にリセ
ット信号を入力させることによって行うように構成され
ている。
【０００４】このように構成されたシステム制御回路が
組み込まれているディスクプレーヤーにおいて、電源変
動等の理由によりシステム制御回路のリセット動作が行
われた場合、該システム制御回路による制御動作が行わ
れないため、ミューティング制御動作が行われない状態
になり、雑音信号が出力されて聴取者に不快感を与える
ことがあった。
組み込まれているディスクプレーヤーにおいて、電源変
動等の理由によりシステム制御回路のリセット動作が行
われた場合、該システム制御回路による制御動作が行わ
れないため、ミューティング制御動作が行われない状態
になり、雑音信号が出力されて聴取者に不快感を与える
ことがあった。
【０００５】本発明は、斯かる問題を解決したミューテ
ィング回路を提供しようとするものである。
ィング回路を提供しようとするものである。
【０００６】
【課題を解決するための手段】本発明のミューティング
回路は、電源供給動作時リセット信号が入力されるリセ
ット端子及びミューティング信号を出力するミューティ
ング信号出力端子を備えたシステム制御回路と、オーデ
ィオ信号路に設けられているとともに動作状態にあると
きオーディオ信号の出力動作を阻止するミューティング
手段と、前記システム制御回路に設けられているミュー
ティング信号出力端子に出力されるミューティング信号
によって動作が制御されるとともに前記ミューティング
手段の動作を制御するミューティング制御手段とより構
成されている。
回路は、電源供給動作時リセット信号が入力されるリセ
ット端子及びミューティング信号を出力するミューティ
ング信号出力端子を備えたシステム制御回路と、オーデ
ィオ信号路に設けられているとともに動作状態にあると
きオーディオ信号の出力動作を阻止するミューティング
手段と、前記システム制御回路に設けられているミュー
ティング信号出力端子に出力されるミューティング信号
によって動作が制御されるとともに前記ミューティング
手段の動作を制御するミューティング制御手段とより構
成されている。
【０００７】
【作用】本発明は、システム制御回路に設けられている
リセット端子にリセット信号が入力されたとき該リセッ
ト信号によりミューティング制御手段を動作せしめ、該
ミューティング制御手段の動作によってミューティング
手段を動作状態にするようにしたものである。
リセット端子にリセット信号が入力されたとき該リセッ
ト信号によりミューティング制御手段を動作せしめ、該
ミューティング制御手段の動作によってミューティング
手段を動作状態にするようにしたものである。
【０００８】
【実施例】図１は本発明のミューティング回路をディス
クプレーヤーに実施した場合の一実施例を示す回路図で
ある。
クプレーヤーに実施した場合の一実施例を示す回路図で
ある。
【０００９】図１において、１はディスクに記録されて
いる信号の読み取り動作を行う光学式ピックアップ及び
該光学式ピックアップより得られる信号の波形成形等を
行うデジタル信号再生回路、２は前記デジタル信号再生
回路１より出力されるデジタル信号が入力されるととも
に該信号の復調動作を行うデジタル信号処理回路、３は
前記デジタル信号処理回路２より出力される信号である
オーディオデータ信号が入力されるＤ／Ａコンバータで
あり、デジタルのオーディオデータ信号をアナログのオ
ーディオ信号に変換する作用を成すものである。
いる信号の読み取り動作を行う光学式ピックアップ及び
該光学式ピックアップより得られる信号の波形成形等を
行うデジタル信号再生回路、２は前記デジタル信号再生
回路１より出力されるデジタル信号が入力されるととも
に該信号の復調動作を行うデジタル信号処理回路、３は
前記デジタル信号処理回路２より出力される信号である
オーディオデータ信号が入力されるＤ／Ａコンバータで
あり、デジタルのオーディオデータ信号をアナログのオ
ーディオ信号に変換する作用を成すものである。
【００１０】４は前記Ｄ／Ａコンバータ３より出力され
るオーディオ信号が入力されるとともに該信号を増幅す
るライン増幅回路、５は前記ライン増幅回路４の出力端
子とライン出力端子６との間のオーディオ信号路に設け
られている第１ミューティング回路であり、制御端子５
ＣにＨ（高い）レベルの信号が印加されているとき動作
状態になり、前記ライン増幅回路４の出力端子に出力さ
れる再生信号の前記ライン出力端子６への印加動作を阻
止するように構成されている。
るオーディオ信号が入力されるとともに該信号を増幅す
るライン増幅回路、５は前記ライン増幅回路４の出力端
子とライン出力端子６との間のオーディオ信号路に設け
られている第１ミューティング回路であり、制御端子５
ＣにＨ（高い）レベルの信号が印加されているとき動作
状態になり、前記ライン増幅回路４の出力端子に出力さ
れる再生信号の前記ライン出力端子６への印加動作を阻
止するように構成されている。
【００１１】７は前記ライン増幅回路４の出力端子に出
力される再生信号が印加されるとともに該信号のレベル
を調整する可変抵抗器、８は前記可変抵抗器７によって
レベル調整された信号が入力されるとともに該信号を増
幅する主増幅回路、９は前記主増幅回路８の出力端子と
ヘッドフォンのプラグが挿入されるヘッドフォンジャッ
ク１０を構成する信号端子１０Ｓとの間のオーディオ信
号路に設けられている第２ミューティング回路であり、
制御端子９ＣにＨレベルの信号が印加されているとき動
作状態になり、前記主増幅回路８の出力端子に出力され
る再生信号の前記ヘッドフォンジャック１０を構成する
信号端子１０Ｓへの印加動作を阻止するように構成され
ている。
力される再生信号が印加されるとともに該信号のレベル
を調整する可変抵抗器、８は前記可変抵抗器７によって
レベル調整された信号が入力されるとともに該信号を増
幅する主増幅回路、９は前記主増幅回路８の出力端子と
ヘッドフォンのプラグが挿入されるヘッドフォンジャッ
ク１０を構成する信号端子１０Ｓとの間のオーディオ信
号路に設けられている第２ミューティング回路であり、
制御端子９ＣにＨレベルの信号が印加されているとき動
作状態になり、前記主増幅回路８の出力端子に出力され
る再生信号の前記ヘッドフォンジャック１０を構成する
信号端子１０Ｓへの印加動作を阻止するように構成され
ている。
【００１２】１１はディスクプレーヤーを構成するディ
スク駆動装置等の動作を制御するとともに前記デジタル
信号再生回路１及びデジタル信号処理回路２の動作を制
御するシステム制御回路であり、リセット端子Ｒ及びミ
ューティング信号出力端子Ｍが設けられている。１２は
電源の投入時や電源電圧の変動時出力端子１２ＲにＬ
（低い）レベルのリセット信号を出力するリセット回路
であり、その出力端子１２Ｒは、前記システム制御回路
１１に設けられているリセット端子Ｒに接続されてい
る。また、前記リセット端子Ｒは、抵抗１３を介して電
源に接続されているとともにコンデンサ１４を介して接
地されている。
スク駆動装置等の動作を制御するとともに前記デジタル
信号再生回路１及びデジタル信号処理回路２の動作を制
御するシステム制御回路であり、リセット端子Ｒ及びミ
ューティング信号出力端子Ｍが設けられている。１２は
電源の投入時や電源電圧の変動時出力端子１２ＲにＬ
（低い）レベルのリセット信号を出力するリセット回路
であり、その出力端子１２Ｒは、前記システム制御回路
１１に設けられているリセット端子Ｒに接続されてい
る。また、前記リセット端子Ｒは、抵抗１３を介して電
源に接続されているとともにコンデンサ１４を介して接
地されている。
【００１３】１５はエミッタが電源に接続されていると
ともにコレクタが前記第１ミューティング回路５の制御
端子５Ｃ及び第２ミューティング回路９の制御端子９Ｃ
に接続されているミューティング制御用トランジスター
であり、そのベースは抵抗１６を介して前記システム制
御回路１１に設けられているミューティング信号出力端
子Ｍに接続されている。１７はアノードが前記ミューテ
ィング信号出力端子Ｍに接続されているとともにカソー
ドがリセット端子Ｒに接続されているダイオードであ
る。
ともにコレクタが前記第１ミューティング回路５の制御
端子５Ｃ及び第２ミューティング回路９の制御端子９Ｃ
に接続されているミューティング制御用トランジスター
であり、そのベースは抵抗１６を介して前記システム制
御回路１１に設けられているミューティング信号出力端
子Ｍに接続されている。１７はアノードが前記ミューテ
ィング信号出力端子Ｍに接続されているとともにカソー
ドがリセット端子Ｒに接続されているダイオードであ
る。
【００１４】斯かる構成において、電源スイッチ（図示
せず）の閉成によってディスクプレーヤーを構成する各
回路へ電源が供給されるとシステム制御回路１１のリセ
ット動作が行われた後、該システム制御回路１１に設け
られているミューティング信号出力端子Ｍに所定時間Ｌ
レベルの信号が出力されるとともにその間に該システム
制御回路１１の制御動作によってデジタル信号再生回路
１、デジタル信号処理回路２、ライン増幅回路４及び主
増幅回路８への電源供給動作が行われるように構成され
ている。また、ディスクプレーヤーが動作状態にあると
きに何らかの原因によってリセット回路１２よりリセッ
ト信号が出力されるとシステム制御回路１１のリセット
動作が行われるように構成されている。
せず）の閉成によってディスクプレーヤーを構成する各
回路へ電源が供給されるとシステム制御回路１１のリセ
ット動作が行われた後、該システム制御回路１１に設け
られているミューティング信号出力端子Ｍに所定時間Ｌ
レベルの信号が出力されるとともにその間に該システム
制御回路１１の制御動作によってデジタル信号再生回路
１、デジタル信号処理回路２、ライン増幅回路４及び主
増幅回路８への電源供給動作が行われるように構成され
ている。また、ディスクプレーヤーが動作状態にあると
きに何らかの原因によってリセット回路１２よりリセッ
ト信号が出力されるとシステム制御回路１１のリセット
動作が行われるように構成されている。
【００１５】以上の如く、本発明のミューティング回路
は構成されているが、次に斯かる回路の動作について説
明する。電源スイッチを閉成するとディスクプレーヤー
を構成する各回路に電源が供給されるが、デジタル信号
再生回路１、デジタル信号処理回路２、ライン増幅回路
４及び主増幅回路８への電源供給動作は、システム制御
回路１１によって制御されるので、その電源供給動作
は、該システム制御回路１１のリセット動作が行われた
後に行われる。
は構成されているが、次に斯かる回路の動作について説
明する。電源スイッチを閉成するとディスクプレーヤー
を構成する各回路に電源が供給されるが、デジタル信号
再生回路１、デジタル信号処理回路２、ライン増幅回路
４及び主増幅回路８への電源供給動作は、システム制御
回路１１によって制御されるので、その電源供給動作
は、該システム制御回路１１のリセット動作が行われた
後に行われる。
【００１６】システム制御回路１１に電源が供給される
とリセット端子Ｒと接地間にコンデンサ１４が接続され
ているため、該リセット端子ＲにＬレベルの信号が入力
され、該システム制御回路１１のリセット動作が行われ
る。そして、斯かるリセット動作が行われている間、前
記システム制御回路１１に設けられているミューティン
グ信号出力端子ＭにＬレベルの信号が出力される。前記
ミューティング信号出力端子ＭにＬレベルの信号が出力
されると、該ミューティング信号出力端子Ｍににベース
が接続されているミューティング制御用トランジスター
１５が導通状態になり、該ミューティング制御用トラン
ジスター１５のエミッタ・コレクタ路を通して前記第１
ミューティング回路５の制御端子５Ｃ及び第２ミューテ
ィング回路９の制御端子９ＣにＨレベルの信号が印加さ
れる。その結果、前記第１ミューティング回路５及び第
２ミューティング回路９が動作状態になり、ライン出力
端子６及びヘッドフォンジャック１０を構成する信号端
子１０Ｓへの信号の出力動作を阻止する。従って、斯か
る状態において、システム制御回路１１の制御動作によ
ってデジタル信号再生回路１、デジタル信号処理回路
２、ライン増幅回路４及び主増幅回路８への電源供給動
作が行われることにより発生する雑音信号が、ライン出
力端子６及びヘッドフォンジャック１０を構成する信号
端子１０Ｓに出力されることはなく、聴取者に不快感を
与えることはない。
とリセット端子Ｒと接地間にコンデンサ１４が接続され
ているため、該リセット端子ＲにＬレベルの信号が入力
され、該システム制御回路１１のリセット動作が行われ
る。そして、斯かるリセット動作が行われている間、前
記システム制御回路１１に設けられているミューティン
グ信号出力端子ＭにＬレベルの信号が出力される。前記
ミューティング信号出力端子ＭにＬレベルの信号が出力
されると、該ミューティング信号出力端子Ｍににベース
が接続されているミューティング制御用トランジスター
１５が導通状態になり、該ミューティング制御用トラン
ジスター１５のエミッタ・コレクタ路を通して前記第１
ミューティング回路５の制御端子５Ｃ及び第２ミューテ
ィング回路９の制御端子９ＣにＨレベルの信号が印加さ
れる。その結果、前記第１ミューティング回路５及び第
２ミューティング回路９が動作状態になり、ライン出力
端子６及びヘッドフォンジャック１０を構成する信号端
子１０Ｓへの信号の出力動作を阻止する。従って、斯か
る状態において、システム制御回路１１の制御動作によ
ってデジタル信号再生回路１、デジタル信号処理回路
２、ライン増幅回路４及び主増幅回路８への電源供給動
作が行われることにより発生する雑音信号が、ライン出
力端子６及びヘッドフォンジャック１０を構成する信号
端子１０Ｓに出力されることはなく、聴取者に不快感を
与えることはない。
【００１７】斯かる状態において、所定時間経過すると
前記システム制御回路１１に設けられているミューティ
ング信号出力端子Ｍの出力がＬレベルよりＨレベルに反
転する。前記ミューティング信号出力端子Ｍの出力がＬ
レベルよりＨレベルに反転すると、前記ミューティング
制御用トランジスター１５のベースにＨレベルの信号が
印加されるので、該ミューティング制御用トランジスタ
ー１５は逆バイアスされて非導通状態に反転する。その
結果、前記第１ミューティング回路５及び第２ミューテ
ィング回路９が不動作状態になり、ミューティング状態
が解除される。
前記システム制御回路１１に設けられているミューティ
ング信号出力端子Ｍの出力がＬレベルよりＨレベルに反
転する。前記ミューティング信号出力端子Ｍの出力がＬ
レベルよりＨレベルに反転すると、前記ミューティング
制御用トランジスター１５のベースにＨレベルの信号が
印加されるので、該ミューティング制御用トランジスタ
ー１５は逆バイアスされて非導通状態に反転する。その
結果、前記第１ミューティング回路５及び第２ミューテ
ィング回路９が不動作状態になり、ミューティング状態
が解除される。
【００１８】斯かる状態において、ディスクプレーヤー
の再生操作が行われると、前記システム制御回路１１の
制御動作によって再生動作状態が構成されることにな
る。デジタル信号処理回路２より出力されるオーディオ
データは、Ｄ／Ａコンバータ３に入力されて、アナログ
信号であるオーディオ信号に変換される。斯かるオーデ
ィオ信号は、再生信号としてライン増幅回路４に入力さ
れて増幅される。
の再生操作が行われると、前記システム制御回路１１の
制御動作によって再生動作状態が構成されることにな
る。デジタル信号処理回路２より出力されるオーディオ
データは、Ｄ／Ａコンバータ３に入力されて、アナログ
信号であるオーディオ信号に変換される。斯かるオーデ
ィオ信号は、再生信号としてライン増幅回路４に入力さ
れて増幅される。
【００１９】前記ライン増幅回路４によって増幅された
再生信号は、不動作状態にある第１ミューティング回路
５を通してライン出力端子６に供給される。それ故、前
記ライン出力端子６より出力される信号が入力される増
幅器（図示せず）によって増幅された信号が印加される
べく接続されているスピーカ（図示せず）の放音動作に
よりディスクに記録されている信号の聴取動作を行うこ
とが出来る。
再生信号は、不動作状態にある第１ミューティング回路
５を通してライン出力端子６に供給される。それ故、前
記ライン出力端子６より出力される信号が入力される増
幅器（図示せず）によって増幅された信号が印加される
べく接続されているスピーカ（図示せず）の放音動作に
よりディスクに記録されている信号の聴取動作を行うこ
とが出来る。
【００２０】外部に設けられている増幅器による再生信
号の聴取動作は、以上のように行われるが次にヘッドフ
ォンによる再生聴取動作について説明する。前記ライン
増幅回路４によって増幅された再生信号は、可変抵抗器
７に印加されてそのレベルが調整される。前記可変抵抗
器７によってレベルが調整された再生信号は、主増幅回
路８に入力された後、不動作状態にある第２ミューティ
ング回路９を通してヘッドフォンジャック１０を構成す
る信号端子１０Ｓに印加される。従って、前記ヘッドフ
ォンジャック１０に挿入接続されているヘッドフォンに
よって再生信号を聴取することが出来る。
号の聴取動作は、以上のように行われるが次にヘッドフ
ォンによる再生聴取動作について説明する。前記ライン
増幅回路４によって増幅された再生信号は、可変抵抗器
７に印加されてそのレベルが調整される。前記可変抵抗
器７によってレベルが調整された再生信号は、主増幅回
路８に入力された後、不動作状態にある第２ミューティ
ング回路９を通してヘッドフォンジャック１０を構成す
る信号端子１０Ｓに印加される。従って、前記ヘッドフ
ォンジャック１０に挿入接続されているヘッドフォンに
よって再生信号を聴取することが出来る。
【００２１】以上に説明したように電源投入時のミュー
ティング動作及びディスクプレーヤーの再生動作は、行
われるが、次に再生動作状態にあるときに電源変動等の
何らかの原因によってリセットを行う状態になり、前記
リセット回路１２の出力端子１２ＲにＬレベルのリセッ
ト信号が出力された場合の動作について説明する。
ティング動作及びディスクプレーヤーの再生動作は、行
われるが、次に再生動作状態にあるときに電源変動等の
何らかの原因によってリセットを行う状態になり、前記
リセット回路１２の出力端子１２ＲにＬレベルのリセッ
ト信号が出力された場合の動作について説明する。
【００２２】前記リセット回路１２の出力端子１２Ｒに
Ｌレベルのリセット信号が出力されると、前記システム
制御回路１１のリセット端子ＲにＬレベルのリセット信
号が入力されるため、該システム制御回路１１のリセッ
ト動作が開始される。前記システム制御回路１１のリセ
ット動作が開始されると、デジタル信号再生回路１、デ
ジタル信号処理回路２、ライン増幅回路４及び主増幅回
路８への電源供給動作が断たれた後、該システム制御回
路１１のリセット動作が終了した後に再度電源供給動作
が行われる。
Ｌレベルのリセット信号が出力されると、前記システム
制御回路１１のリセット端子ＲにＬレベルのリセット信
号が入力されるため、該システム制御回路１１のリセッ
ト動作が開始される。前記システム制御回路１１のリセ
ット動作が開始されると、デジタル信号再生回路１、デ
ジタル信号処理回路２、ライン増幅回路４及び主増幅回
路８への電源供給動作が断たれた後、該システム制御回
路１１のリセット動作が終了した後に再度電源供給動作
が行われる。
【００２３】斯かるシステム制御回路１１のリセット動
作が行われると、デジタル信号再生回路１、デジタル信
号処理回路２、ライン増幅回路４及び主増幅回路８への
電源供給が断たれるため、その電源遮断に起因して雑音
信号が発生することになる。そして、斯かる動作が行わ
れている状態では、システム制御回路１１のミューティ
ング信号出力端子Ｍよりミューティング信号が出力され
ることはない。従って、前記システム制御回路１１のミ
ューティング信号出力端子Ｍより出力される信号による
ミューティング動作は行われることはない。
作が行われると、デジタル信号再生回路１、デジタル信
号処理回路２、ライン増幅回路４及び主増幅回路８への
電源供給が断たれるため、その電源遮断に起因して雑音
信号が発生することになる。そして、斯かる動作が行わ
れている状態では、システム制御回路１１のミューティ
ング信号出力端子Ｍよりミューティング信号が出力され
ることはない。従って、前記システム制御回路１１のミ
ューティング信号出力端子Ｍより出力される信号による
ミューティング動作は行われることはない。
【００２４】しかしながら、本発明のミューティング回
路は、システム制御回路１１のミューティング信号出力
端子Ｍとシステム制御回路１１のリセット端子Ｒとの間
にダイオード１７が接続されているため、リセット回路
１２の出力端子１２ＲにＬレベルの信号が出力されると
前記ミューティング制御用トランジスター１５のベース
電位が低下する。従って、前記ミューティング制御用ト
ランジスター１５がバイアスされて導通状態になり、該
ミューティング制御用トランジスター１５のエミッタ・
コレクタ路を通して前記第１ミューティング回路５の制
御端子５Ｃ及び第２ミューティング回路９の制御端子９
ＣにＨレベルの信号が印加される。その結果、前記第１
ミューティング回路５及び第２ミューティング回路９が
動作状態になり、ライン出力端子６及びヘッドフォンジ
ャック１０を構成する信号端子１０Ｓへの信号の出力動
作を阻止する。従って、システム制御回路１１のリセッ
ト動作によってデジタル信号再生回路１、デジタル信号
処理回路２、ライン増幅回路４及び主増幅回路８への電
源供給遮断動作により発生する雑音信号が、ライン出力
端子６及びヘッドフォンジャック１０を構成する信号端
子１０Ｓに出力されることはなく、聴取者に不快感を与
えることはない。
路は、システム制御回路１１のミューティング信号出力
端子Ｍとシステム制御回路１１のリセット端子Ｒとの間
にダイオード１７が接続されているため、リセット回路
１２の出力端子１２ＲにＬレベルの信号が出力されると
前記ミューティング制御用トランジスター１５のベース
電位が低下する。従って、前記ミューティング制御用ト
ランジスター１５がバイアスされて導通状態になり、該
ミューティング制御用トランジスター１５のエミッタ・
コレクタ路を通して前記第１ミューティング回路５の制
御端子５Ｃ及び第２ミューティング回路９の制御端子９
ＣにＨレベルの信号が印加される。その結果、前記第１
ミューティング回路５及び第２ミューティング回路９が
動作状態になり、ライン出力端子６及びヘッドフォンジ
ャック１０を構成する信号端子１０Ｓへの信号の出力動
作を阻止する。従って、システム制御回路１１のリセッ
ト動作によってデジタル信号再生回路１、デジタル信号
処理回路２、ライン増幅回路４及び主増幅回路８への電
源供給遮断動作により発生する雑音信号が、ライン出力
端子６及びヘッドフォンジャック１０を構成する信号端
子１０Ｓに出力されることはなく、聴取者に不快感を与
えることはない。
【００２５】尚、本実施例では、ディスクに記録されて
いる信号を再生するディスクプレーヤーに実施した場合
について説明したが、テープレコーダー等の電子機器に
使用することは勿論可能である。
いる信号を再生するディスクプレーヤーに実施した場合
について説明したが、テープレコーダー等の電子機器に
使用することは勿論可能である。
【００２６】
【発明の効果】本発明は、システム制御回路に設けられ
ているリセット端子にリセット信号が入力されたとき、
該リセット信号によってミューティング制御手段を動作
せしめてミューティング動作を行うように構成したの
で、電子機器が動作状態にあるときに何らかの原因によ
ってシステム制御回路のリセット動作が行われても、雑
音信号の出力動作を阻止することが出来、聴取者に不快
感を与えることが無いという効果を有している。
ているリセット端子にリセット信号が入力されたとき、
該リセット信号によってミューティング制御手段を動作
せしめてミューティング動作を行うように構成したの
で、電子機器が動作状態にあるときに何らかの原因によ
ってシステム制御回路のリセット動作が行われても、雑
音信号の出力動作を阻止することが出来、聴取者に不快
感を与えることが無いという効果を有している。
【００２７】また、本発明は、ミューティング動作を制
御するべく設けられているミューティング制御用トラン
ジスターのベースをダイオードを介してシステム制御回
路に設けられているリセット端子に接続することによっ
てリセット動作時におけるミューティング動作を行うよ
うに構成したので、回路構成が非常に簡単になるという
利点を有している。
御するべく設けられているミューティング制御用トラン
ジスターのベースをダイオードを介してシステム制御回
路に設けられているリセット端子に接続することによっ
てリセット動作時におけるミューティング動作を行うよ
うに構成したので、回路構成が非常に簡単になるという
利点を有している。
【図１】本発明のミューティング回路をディスクプレー
ヤーに実施した場合の一実施例を示す回路図である。
ヤーに実施した場合の一実施例を示す回路図である。
１ デジタル信号再生回路 ２ デジタル信号処理回路 ４ ライン増幅回路 ５ 第１ミューティング回路 ６ ライン出力端子 ８ 主増幅回路 ９ 第２ミューティング回路 １０ ヘッドフォンジャック １１ システム制御回路 １２ リセット回路 １５ ミューティング制御用トランジスター １７ ダイオード Ｍ ミューティング信号出力端子 Ｒ リセット端子
Claims (2)
- 【請求項１】電子機器の動作を制御するとともに電源供
給動作時リセット信号が入力されるリセット端子を備
え、且つ電源供給動作時所定時間ミューティング信号を
出力するミューティング信号出力端子を備えたシステム
制御回路が組み込まれた電子機器において、オーディオ
信号路に設けられているとともに動作状態にあるときオ
ーディオ信号の出力動作を阻止するミューティング手段
と、前記システム制御回路に設けられているミューティ
ング信号出力端子に出力されるミューティング信号によ
って動作が制御されるとともに前記ミューティング手段
の動作を制御するミューティング制御手段とより成り、
前記システム制御回路に設けられているリセット端子に
リセット信号が入力されたとき該リセット信号により前
記ミューティング制御手段を動作状態にせしめ、以って
前記ミューティング手段を動作状態にするようにしたこ
とを特徴とする電子機器のミューティング回路。 - 【請求項２】システム制御回路に設けられているミュー
ティング信号出力端子にベースが接続されているととも
にミューティング手段の動作を制御するミューティング
制御用トランジスターを設け、該ミューティング制御用
トランジスターのベースをダイオードを介してシステム
制御回路に設けられているリセット端子に接続したこと
を特徴とする請求項１に記載のミューティング回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7160899A JPH0918261A (ja) | 1995-06-27 | 1995-06-27 | 電子機器のミューティング回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7160899A JPH0918261A (ja) | 1995-06-27 | 1995-06-27 | 電子機器のミューティング回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0918261A true JPH0918261A (ja) | 1997-01-17 |
Family
ID=15724767
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7160899A Pending JPH0918261A (ja) | 1995-06-27 | 1995-06-27 | 電子機器のミューティング回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0918261A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1999017417A1 (fr) * | 1997-09-26 | 1999-04-08 | Wellpine Communications Co., Ltd. | Systeme d'alimentation electrique |
-
1995
- 1995-06-27 JP JP7160899A patent/JPH0918261A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1999017417A1 (fr) * | 1997-09-26 | 1999-04-08 | Wellpine Communications Co., Ltd. | Systeme d'alimentation electrique |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A521 | Written amendment |
Effective date: 20040623 Free format text: JAPANESE INTERMEDIATE CODE: A523 |
|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20040623 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20050221 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20050308 |
|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050509 |
|
| A02 | Decision of refusal |
Effective date: 20050920 Free format text: JAPANESE INTERMEDIATE CODE: A02 |