JPH0845185A - 情報再生装置 - Google Patents
情報再生装置Info
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- JPH0845185A JPH0845185A JP18136494A JP18136494A JPH0845185A JP H0845185 A JPH0845185 A JP H0845185A JP 18136494 A JP18136494 A JP 18136494A JP 18136494 A JP18136494 A JP 18136494A JP H0845185 A JPH0845185 A JP H0845185A
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- circuit
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Abstract
(57)【要約】
【目的】 常時多値検出を行うための閾値を適切なレベ
ルに維持でき、デジタル情報をエラーを生じることなく
再生できるようにする。 【構成】 情報記録媒体に記録されたデジタル情報を再
生するに際し、前記記録媒体から再生された再生信号を
波形等化後、少なくとも２つ以上の閾値Ｔｈ1 ，Ｔｈ2
で２値化してデータ検出を行う情報再生装置において、
前記２値化された２値化信号のパルス幅と、この２値化
信号を同期クロックで同期化後の信号のパルス幅が同じ
になるように前記閾値Ｔｈ1 ，Ｔｈ2 を制御する。
ルに維持でき、デジタル情報をエラーを生じることなく
再生できるようにする。 【構成】 情報記録媒体に記録されたデジタル情報を再
生するに際し、前記記録媒体から再生された再生信号を
波形等化後、少なくとも２つ以上の閾値Ｔｈ1 ，Ｔｈ2
で２値化してデータ検出を行う情報再生装置において、
前記２値化された２値化信号のパルス幅と、この２値化
信号を同期クロックで同期化後の信号のパルス幅が同じ
になるように前記閾値Ｔｈ1 ，Ｔｈ2 を制御する。
Description
【０００１】
【産業上の利用分野】本発明は、情報記録媒体に記録さ
れたデジタル情報を再生する情報再生装置に関するもの
である。
れたデジタル情報を再生する情報再生装置に関するもの
である。
【０００２】
【従来の技術】従来、光磁気ディスク装置などのような
情報記録再生装置に対して情報の高密度記録が要求さ
れ、こうした要求に応える方法としてパーシャルレスポ
ンス等化という等化検出方法が考えられている。このパ
ーシャルレスポンス等化においては、符号間干渉を付加
したままデータ検出を行うことにより、等化器出力の周
波数特性を狭帯域にすることが可能となり、その結果、
情報の高密度化を実現するというものである。
情報記録再生装置に対して情報の高密度記録が要求さ
れ、こうした要求に応える方法としてパーシャルレスポ
ンス等化という等化検出方法が考えられている。このパ
ーシャルレスポンス等化においては、符号間干渉を付加
したままデータ検出を行うことにより、等化器出力の周
波数特性を狭帯域にすることが可能となり、その結果、
情報の高密度化を実現するというものである。
【０００３】図１０はパーシャルレスポンスの一例とし
て、ＰＲ（１，１）等化の概念を説明するためのブロッ
ク図、図１１は図１０の各部の信号を示した信号波形図
である。図１０において、２７は記録データｘ0 (t) を
ＮＲＺＩ変換して、記録信号ｘ1 (t) を出力するための
プリコーダである。図１１（ａ）は記録媒体に記録すべ
き記録データ、図１１（ｂ）はその記録データをプリコ
ーダ２７でＮＲＺＩ変換して得られた記録信号である。
２８はこのようにプリコーダ２７で変調して得られた記
録信号を記録媒体に記録し、それを再生するための記録
再生系である。この記録再生系２８で記録媒体に記録さ
れた記録信号を再生すると、図１１（ｃ）のような再生
信号が得られる。ここで、ＰＲ（１，１）等化において
は情報を再生する場合、図１１（ｃ）のように２つの閾
値Ｔｈ1 ，Ｔｈ2 が設定され、再生信号と２つの閾値を
比較することで、データの検出が行われる。即ち、判定
器２９では０＜Ｔｈ2 ＜１、１＜Ｔｈ1 ＜２なる２つの
閾値Ｔｈ1 ，Ｔｈ2 と再生信号ｙ(t) を比較し、ｙ(t)
＜Ｔｈ2 またはｙ(t) ＞Ｔｈ1 ならば０と判定し、Ｔｈ
2 ＜ｙ(t) ＜Ｔｈ1 ならば１と判定することで、図１１
（ｄ）のような再生デジタル信号ｘ0 ′(t) が生成され
る。
て、ＰＲ（１，１）等化の概念を説明するためのブロッ
ク図、図１１は図１０の各部の信号を示した信号波形図
である。図１０において、２７は記録データｘ0 (t) を
ＮＲＺＩ変換して、記録信号ｘ1 (t) を出力するための
プリコーダである。図１１（ａ）は記録媒体に記録すべ
き記録データ、図１１（ｂ）はその記録データをプリコ
ーダ２７でＮＲＺＩ変換して得られた記録信号である。
２８はこのようにプリコーダ２７で変調して得られた記
録信号を記録媒体に記録し、それを再生するための記録
再生系である。この記録再生系２８で記録媒体に記録さ
れた記録信号を再生すると、図１１（ｃ）のような再生
信号が得られる。ここで、ＰＲ（１，１）等化において
は情報を再生する場合、図１１（ｃ）のように２つの閾
値Ｔｈ1 ，Ｔｈ2 が設定され、再生信号と２つの閾値を
比較することで、データの検出が行われる。即ち、判定
器２９では０＜Ｔｈ2 ＜１、１＜Ｔｈ1 ＜２なる２つの
閾値Ｔｈ1 ，Ｔｈ2 と再生信号ｙ(t) を比較し、ｙ(t)
＜Ｔｈ2 またはｙ(t) ＞Ｔｈ1 ならば０と判定し、Ｔｈ
2 ＜ｙ(t) ＜Ｔｈ1 ならば１と判定することで、図１１
（ｄ）のような再生デジタル信号ｘ0 ′(t) が生成され
る。
【０００４】図１２はＰＲ（１，１）等化を採用した情
報再生装置の概略構成を示したブロック図である。図１
２において、１は再生信号の高周波ノイズを除去するＬ
ＰＦ（ローパスフィルター）、２は再生信号の波形等化
を行う波形等化回路である。ここではＰＲ（１，１）等
化が行われる。３は波形等化後の再生信号の振幅を一定
に制御するＡＧＣ（オートゲインコントロール）回路で
ある。ここで、ＰＲ（１，１）等化においては、前述の
ように２つの閾値Ｔｈ1 ，Ｔｈ2 が設定されるのである
が、従来ではこの閾値を設定する場合、ピークホールド
回路３０で再生信号のピーク値、ボトムホールド回路３
１で再生信号のボトム値がそれぞれ検出される。そし
て、得られたピーク値からボトム値までのレベルの３／
４が閾値Ｔｈ1 としてコンパレータ７に与えられ、１／
４が閾値Ｔｈ2 としてコンパレータ１１に与えられる。
コンパレータ７及び１１ではそれぞれ設定された閾値で
再生信号が２値化され、得られた２値化信号をアンド回
路６で合成することで再生デジタル信号が生成される。
報再生装置の概略構成を示したブロック図である。図１
２において、１は再生信号の高周波ノイズを除去するＬ
ＰＦ（ローパスフィルター）、２は再生信号の波形等化
を行う波形等化回路である。ここではＰＲ（１，１）等
化が行われる。３は波形等化後の再生信号の振幅を一定
に制御するＡＧＣ（オートゲインコントロール）回路で
ある。ここで、ＰＲ（１，１）等化においては、前述の
ように２つの閾値Ｔｈ1 ，Ｔｈ2 が設定されるのである
が、従来ではこの閾値を設定する場合、ピークホールド
回路３０で再生信号のピーク値、ボトムホールド回路３
１で再生信号のボトム値がそれぞれ検出される。そし
て、得られたピーク値からボトム値までのレベルの３／
４が閾値Ｔｈ1 としてコンパレータ７に与えられ、１／
４が閾値Ｔｈ2 としてコンパレータ１１に与えられる。
コンパレータ７及び１１ではそれぞれ設定された閾値で
再生信号が２値化され、得られた２値化信号をアンド回
路６で合成することで再生デジタル信号が生成される。
【０００５】
【発明が解決しようとしている課題】しかしながら、上
記従来の閾値の設定方法では、図１３（ａ）のように再
生信号が正常なときは問題ないが、例えば媒体欠陥や汚
れなどによって再生信号が図１３（ｂ）のように歪んだ
状態になった場合は、正確にボトム値が検出できないの
で、閾値を適切なレベルに設定できなかった。そのた
め、コンパレータで２値化する際にパルス幅が変動して
しまい、変動が大きすぎると、データエラーが発生する
という問題があった。
記従来の閾値の設定方法では、図１３（ａ）のように再
生信号が正常なときは問題ないが、例えば媒体欠陥や汚
れなどによって再生信号が図１３（ｂ）のように歪んだ
状態になった場合は、正確にボトム値が検出できないの
で、閾値を適切なレベルに設定できなかった。そのた
め、コンパレータで２値化する際にパルス幅が変動して
しまい、変動が大きすぎると、データエラーが発生する
という問題があった。
【０００６】また、記録媒体として光磁気ディスクを用
いて光変調記録を行う場合、論理“１”のときに光ビー
ムを記録パワーにし、論理“０”のときに光ビームのパ
ワーを低下させてデジタル情報の記録が行われる。しか
し、記録パワーが強すぎるとそれによって記録されるマ
ークが光ビームを照射しない領域に食い込むことにな
り、相対的に論理“１”の長さが論理“０”の長さより
も長くなってしまう。従って、このような場合は、アイ
パターンが図１４（ｂ）のようになり（図１４（ａ）は
正常なアイパターン）、閾値Ｔｈ1 のレベルが信号レベ
ル３／４では最適でなく、閾値Ｔｈ2 のレベルが信号レ
ベルの１／４では最適でなくなるという問題があった。
いて光変調記録を行う場合、論理“１”のときに光ビー
ムを記録パワーにし、論理“０”のときに光ビームのパ
ワーを低下させてデジタル情報の記録が行われる。しか
し、記録パワーが強すぎるとそれによって記録されるマ
ークが光ビームを照射しない領域に食い込むことにな
り、相対的に論理“１”の長さが論理“０”の長さより
も長くなってしまう。従って、このような場合は、アイ
パターンが図１４（ｂ）のようになり（図１４（ａ）は
正常なアイパターン）、閾値Ｔｈ1 のレベルが信号レベ
ル３／４では最適でなく、閾値Ｔｈ2 のレベルが信号レ
ベルの１／４では最適でなくなるという問題があった。
【０００７】本発明は、上記従来の問題点に鑑みなされ
たもので、その目的は、常時多値検出を行うための閾値
を適切なレベルに維持でき、デジタル情報をエラーを生
じることなく再生することが可能な情報再生装置を提供
することにある。
たもので、その目的は、常時多値検出を行うための閾値
を適切なレベルに維持でき、デジタル情報をエラーを生
じることなく再生することが可能な情報再生装置を提供
することにある。
【０００８】
【課題を解決するための手段】本発明の目的は、情報記
録媒体に記録されたデジタル情報を再生するに際し、前
記記録媒体から再生された再生信号を波形等化後、少な
くとも２つ以上の閾値で２値化してデータ読出を行う情
報再生装置において、前記２値化された２値化信号のパ
ルス幅と、この２値化信号を同期クロックで同期化後の
信号のパルス幅が同じになるように前記閾値を制御する
ことを特徴とする情報再生装置によって達成される。
録媒体に記録されたデジタル情報を再生するに際し、前
記記録媒体から再生された再生信号を波形等化後、少な
くとも２つ以上の閾値で２値化してデータ読出を行う情
報再生装置において、前記２値化された２値化信号のパ
ルス幅と、この２値化信号を同期クロックで同期化後の
信号のパルス幅が同じになるように前記閾値を制御する
ことを特徴とする情報再生装置によって達成される。
【０００９】
【実施例】以下、本発明の実施例について図面を参照し
て詳細に説明する。図１は本発明の情報再生装置の一実
施例を示したブロック図である。なお、図１では図１２
の従来装置と同一部分は同一符号を付してある。図１に
おいて、光磁気ディスク（図示せず）から再生された再
生信号はＬＰＦ（ローパスフィルター）１で高周波ノイ
ズが除去された後、波形等化回路２でデータ検出に最適
な波形等化が行われる。ここでは、ＰＲ（１，１）波形
等化を行うものとする。波形等化後の再生信号はＡＧＣ
回路３で振幅が一定となるように制御される。ＰＲ
（１，１）特性は図１４（ａ）に示すように信号波形が
データ識別点で“０”，“１”または“２”となるもの
である。従って、再生データを検出する場合は、２つの
コンパレータに閾値Ｔｈ1 ，Ｔｈ2 を設定して再生信号
を２つのコンパレータでそれぞれ２値化し、得られた２
つの２値化信号をアンド回路でアンドをとって再生デー
タの検出が行われる。
て詳細に説明する。図１は本発明の情報再生装置の一実
施例を示したブロック図である。なお、図１では図１２
の従来装置と同一部分は同一符号を付してある。図１に
おいて、光磁気ディスク（図示せず）から再生された再
生信号はＬＰＦ（ローパスフィルター）１で高周波ノイ
ズが除去された後、波形等化回路２でデータ検出に最適
な波形等化が行われる。ここでは、ＰＲ（１，１）波形
等化を行うものとする。波形等化後の再生信号はＡＧＣ
回路３で振幅が一定となるように制御される。ＰＲ
（１，１）特性は図１４（ａ）に示すように信号波形が
データ識別点で“０”，“１”または“２”となるもの
である。従って、再生データを検出する場合は、２つの
コンパレータに閾値Ｔｈ1 ，Ｔｈ2 を設定して再生信号
を２つのコンパレータでそれぞれ２値化し、得られた２
つの２値化信号をアンド回路でアンドをとって再生デー
タの検出が行われる。
【００１０】ＡＧＣ回路３で振幅を制御された再生信号
は、２値化回路４及び５に送られ、閾値Ｔｈ1 ，Ｔｈ2
での２値化が行われる。即ち、２値化回路４では３値検
出の一方の閾値Ｔｈ1 で再生信号の２値化が行われ、２
値化回路５では３値検出のもう一方の閾値Ｔｈ2 で再生
信号の２値化が行われる。２値化回路４，５で得られた
２値化信号はアンド回路６で合成して再生デジタル信号
が生成され、更にこの再生デジタル信号は後段の復調回
路（図示せず）に送られてデータの復調が行われる。
は、２値化回路４及び５に送られ、閾値Ｔｈ1 ，Ｔｈ2
での２値化が行われる。即ち、２値化回路４では３値検
出の一方の閾値Ｔｈ1 で再生信号の２値化が行われ、２
値化回路５では３値検出のもう一方の閾値Ｔｈ2 で再生
信号の２値化が行われる。２値化回路４，５で得られた
２値化信号はアンド回路６で合成して再生デジタル信号
が生成され、更にこの再生デジタル信号は後段の復調回
路（図示せず）に送られてデータの復調が行われる。
【００１１】２値化回路４は、再生信号を閾値Ｔｈ1 で
２値化するコンパレータ７、コンパレータ７の２値化信
号から同期クロックを抽出するＰＬＬ回路８、コンパレ
ータ７の２値化信号を同期クロックによって同期化する
データセパレータ９から構成されている。また、２値化
回路４内にはコンパレータ７に閾値Ｔｈ1 を出力するた
めのスライスレベル生成回路１０が設けられており、詳
しく後述するようにコンパレータ７の２値化信号とデー
タセパレータ９の出力信号のパルス幅が等しくなるよう
に閾値Ｔｈ1 の制御が行われる。更に、２値化回路５も
同様に再生信号を閾値Ｔｈ2 で２値化するコンパレータ
１１、同期クロックを抽出するＰＬＬ回路１２、２値化
信号を同期化するデータセパレータ１３、閾値Ｔｈ2 を
生成するスライスレベル生成回路１４から構成されてい
る。スライスレベル生成回路１４では、同様にコンパレ
ータ１１の２値化信号とデータセパレータ１３の出力信
号のパルス幅が等しくなるよう閾値Ｔｈ2 の制御が行わ
れる。
２値化するコンパレータ７、コンパレータ７の２値化信
号から同期クロックを抽出するＰＬＬ回路８、コンパレ
ータ７の２値化信号を同期クロックによって同期化する
データセパレータ９から構成されている。また、２値化
回路４内にはコンパレータ７に閾値Ｔｈ1 を出力するた
めのスライスレベル生成回路１０が設けられており、詳
しく後述するようにコンパレータ７の２値化信号とデー
タセパレータ９の出力信号のパルス幅が等しくなるよう
に閾値Ｔｈ1 の制御が行われる。更に、２値化回路５も
同様に再生信号を閾値Ｔｈ2 で２値化するコンパレータ
１１、同期クロックを抽出するＰＬＬ回路１２、２値化
信号を同期化するデータセパレータ１３、閾値Ｔｈ2 を
生成するスライスレベル生成回路１４から構成されてい
る。スライスレベル生成回路１４では、同様にコンパレ
ータ１１の２値化信号とデータセパレータ１３の出力信
号のパルス幅が等しくなるよう閾値Ｔｈ2 の制御が行わ
れる。
【００１２】図２はスライスレベル生成回路１０の具体
的な構成を示した回路図である。図中１５はコンパレー
タ７の２値化信号の立ち下がりとデータセパレータ９の
出力信号の立ち下がりの時間差のパルス信号を出力する
ゲート回路、１６はコンパレータ７の２値化信号の立ち
上がりとデータセパレータ９の出力信号の立ち上がりの
時間差のパルス信号を出力するゲート回路である。ま
た、１７はゲート回路１５のパルス幅だけオンしてコン
デンサＣをチャージする定電流源、１８はゲート回路１
６のパルス幅だけオンしてコンデンサＣの電荷をディス
チャージする定電流源、１９は増幅器でその出力が閾値
Ｔｈ1 として出力される。
的な構成を示した回路図である。図中１５はコンパレー
タ７の２値化信号の立ち下がりとデータセパレータ９の
出力信号の立ち下がりの時間差のパルス信号を出力する
ゲート回路、１６はコンパレータ７の２値化信号の立ち
上がりとデータセパレータ９の出力信号の立ち上がりの
時間差のパルス信号を出力するゲート回路である。ま
た、１７はゲート回路１５のパルス幅だけオンしてコン
デンサＣをチャージする定電流源、１８はゲート回路１
６のパルス幅だけオンしてコンデンサＣの電荷をディス
チャージする定電流源、１９は増幅器でその出力が閾値
Ｔｈ1 として出力される。
【００１３】図３は２値化回路４の各部の信号を示した
信号波形図である。図３（ａ）はコンパレータ７の２値
化信号、図３（ｂ）はＰＬＬ回路８で抽出された同期ク
ロックである。データセパレータ９では図３（ｃ）のよ
うに同期クロックにより２値化信号が同期化される。こ
こで、コンパレータ７の２値化信号とデータセパレータ
９の出力信号はゲート回路１５及び１６に入力され、ゲ
ート回路１５では図３（ｄ）のように２値化信号の立ち
下がりとデータセパレータ９の出力信号の立ち下がりの
時間差に相当する幅のパルス信号が出力される。また、
ゲート回路１６では図３（ｅ）のように２値化信号の立
ち上がりとデータセパレータ９の出力信号の立ち上がり
の時間差に相当する幅のパルス信号が出力される。
信号波形図である。図３（ａ）はコンパレータ７の２値
化信号、図３（ｂ）はＰＬＬ回路８で抽出された同期ク
ロックである。データセパレータ９では図３（ｃ）のよ
うに同期クロックにより２値化信号が同期化される。こ
こで、コンパレータ７の２値化信号とデータセパレータ
９の出力信号はゲート回路１５及び１６に入力され、ゲ
ート回路１５では図３（ｄ）のように２値化信号の立ち
下がりとデータセパレータ９の出力信号の立ち下がりの
時間差に相当する幅のパルス信号が出力される。また、
ゲート回路１６では図３（ｅ）のように２値化信号の立
ち上がりとデータセパレータ９の出力信号の立ち上がり
の時間差に相当する幅のパルス信号が出力される。
【００１４】定電流源１７ではゲート回路１５からパル
ス信号が出力されると、そのパルス信号の幅の時間だけ
オンし、このオン時間中に定電流源１７によってコンデ
ンサＣがチャージされる。また、定電流源１８はゲート
回路１６のパルス幅の時間だけオンし、この時間中にコ
ンデンサＣの電荷がディスチャージされる。このように
２値化信号とデータセパレータ９の出力信号の立ち下が
り時間差だけコンデンサＣをチャージし、立ち上がり時
間差だけコンデンサＣをディスチャージすることで、コ
ンデンサＣの電荷が０になるように閾値Ｔｈ1 が制御さ
れる。従って、立ち下がりの時間差と立ち上がりの時間
差が同じになるように制御がかかり、その結果、コンパ
レータ７の２値化信号のパルス幅とデータセパレータ９
の出力信号のパルス幅が同じになる。このようにスライ
スレベル生成回路１０では、２値化信号と同期化後の信
号のパルス幅を比較して２つの信号のパルス幅が同じに
なるように閾値Ｔｈ1 の制御が行われる。また、スライ
スレベル生成回路１４も全く同じ構成であり、同様にコ
ンパレータ１１の２値化信号とデータセパレータ１３の
出力信号のパルス幅が同じになるように閾値Ｔｈ2 の制
御が行われる。
ス信号が出力されると、そのパルス信号の幅の時間だけ
オンし、このオン時間中に定電流源１７によってコンデ
ンサＣがチャージされる。また、定電流源１８はゲート
回路１６のパルス幅の時間だけオンし、この時間中にコ
ンデンサＣの電荷がディスチャージされる。このように
２値化信号とデータセパレータ９の出力信号の立ち下が
り時間差だけコンデンサＣをチャージし、立ち上がり時
間差だけコンデンサＣをディスチャージすることで、コ
ンデンサＣの電荷が０になるように閾値Ｔｈ1 が制御さ
れる。従って、立ち下がりの時間差と立ち上がりの時間
差が同じになるように制御がかかり、その結果、コンパ
レータ７の２値化信号のパルス幅とデータセパレータ９
の出力信号のパルス幅が同じになる。このようにスライ
スレベル生成回路１０では、２値化信号と同期化後の信
号のパルス幅を比較して２つの信号のパルス幅が同じに
なるように閾値Ｔｈ1 の制御が行われる。また、スライ
スレベル生成回路１４も全く同じ構成であり、同様にコ
ンパレータ１１の２値化信号とデータセパレータ１３の
出力信号のパルス幅が同じになるように閾値Ｔｈ2 の制
御が行われる。
【００１５】次に、上記実施例の具体的な情報再生動作
を図４に基づいて説明する。図４は前述のように２値化
出力とデータセパレータ出力のパルス幅が等しくなるよ
うに閾値Ｔｈ1 とＴｈ2 を制御し、コンパレータ７の閾
値Ｔｈ1 とコンパレータ１１の閾値Ｔｈ2 が再生信号に
対して適正に設定されているときの各部の信号を示した
タイムチャートである。図４（ａ）は記録データ、図４
（ｂ）はその記録データをプリコーダでプリコードした
記録信号である。光磁気ディスクにはこのような記録信
号が記録され、それを再生すると図４（ｃ）のような再
生信号が得られる。図４（ｃ）の再生信号はＡＧＣ回路
３を介した信号である。コンパレータ７では図４（ｃ）
のように再生信号とスライスレベル生成回路１０の閾値
Ｔｈ1 を比較して図４（ｄ）のように２値化され、ＰＬ
Ｌ回路８では得られた２値化信号から図４（ｅ）のよう
な同期クロックが抽出される。データセパレータ９では
抽出された同期クロックにより図４（ｆ）のように２値
化信号が同期化される。
を図４に基づいて説明する。図４は前述のように２値化
出力とデータセパレータ出力のパルス幅が等しくなるよ
うに閾値Ｔｈ1 とＴｈ2 を制御し、コンパレータ７の閾
値Ｔｈ1 とコンパレータ１１の閾値Ｔｈ2 が再生信号に
対して適正に設定されているときの各部の信号を示した
タイムチャートである。図４（ａ）は記録データ、図４
（ｂ）はその記録データをプリコーダでプリコードした
記録信号である。光磁気ディスクにはこのような記録信
号が記録され、それを再生すると図４（ｃ）のような再
生信号が得られる。図４（ｃ）の再生信号はＡＧＣ回路
３を介した信号である。コンパレータ７では図４（ｃ）
のように再生信号とスライスレベル生成回路１０の閾値
Ｔｈ1 を比較して図４（ｄ）のように２値化され、ＰＬ
Ｌ回路８では得られた２値化信号から図４（ｅ）のよう
な同期クロックが抽出される。データセパレータ９では
抽出された同期クロックにより図４（ｆ）のように２値
化信号が同期化される。
【００１６】また、コンパレータ１１では図４（ｃ）の
ように再生信号とスライスレベル生成回路１４の閾値Ｔ
ｈ2 を比較して図４（ｇ）のように２値化され、ＰＬＬ
回路１２ではその２値化信号から図４（ｈ）のような同
期クロックが抽出される。データセパレータ１３では抽
出された同期クロックにより図４（ｉ）のように２値化
信号が同期化される。データセパレータ９及び１３の出
力信号はアンド回路６で図４（ｊ）のように合成され、
再生デジタル信号が生成される。そして、得られた再生
デジタル信号は後段の復調回路（図示せず）へ送られ、
再生データが生成される。
ように再生信号とスライスレベル生成回路１４の閾値Ｔ
ｈ2 を比較して図４（ｇ）のように２値化され、ＰＬＬ
回路１２ではその２値化信号から図４（ｈ）のような同
期クロックが抽出される。データセパレータ１３では抽
出された同期クロックにより図４（ｉ）のように２値化
信号が同期化される。データセパレータ９及び１３の出
力信号はアンド回路６で図４（ｊ）のように合成され、
再生デジタル信号が生成される。そして、得られた再生
デジタル信号は後段の復調回路（図示せず）へ送られ、
再生データが生成される。
【００１７】ここで、コンパレータ７，１１の閾値が適
切でない場合、例えば図５に示すように閾値Ｔｈ1 が何
らかの原因で適正レベルでない場合は、２値化信号のパ
ルス幅に異常が生じる。図５の例では、閾値Ｔｈ1 の変
動によって図５（ｄ）のようにコンパレータ７の２値化
信号のパルス幅が狭くなっている。こうしたパルス幅の
変動は、ある程度はデータセパレータ９の同期化によっ
て図５（ｆ）のように正常な状態に修復できるのである
が、パルス幅の変動が大きくなると本来の同期化の目的
であるノイズなどのジッターの吸収ができなくなってデ
ータエラーを起こしてしまう。このような場合、本実施
例では、前述のように２値化信号のパルス幅とデータセ
パレータで同期化後のパルス幅を比較し、この２つのパ
ルス幅が同じになるように閾値を制御するので、常時閾
値を適正なレベルに維持することができ、これによって
２値化信号のパルス幅が変動することがなくなるので、
データエラーの発生を抑制することができる。また、前
述のように光磁気ディスクに光変調方式で記録する際に
記録パワーが強すぎた場合であっても、閾値のレベルを
適切なレベルに設定することができる。
切でない場合、例えば図５に示すように閾値Ｔｈ1 が何
らかの原因で適正レベルでない場合は、２値化信号のパ
ルス幅に異常が生じる。図５の例では、閾値Ｔｈ1 の変
動によって図５（ｄ）のようにコンパレータ７の２値化
信号のパルス幅が狭くなっている。こうしたパルス幅の
変動は、ある程度はデータセパレータ９の同期化によっ
て図５（ｆ）のように正常な状態に修復できるのである
が、パルス幅の変動が大きくなると本来の同期化の目的
であるノイズなどのジッターの吸収ができなくなってデ
ータエラーを起こしてしまう。このような場合、本実施
例では、前述のように２値化信号のパルス幅とデータセ
パレータで同期化後のパルス幅を比較し、この２つのパ
ルス幅が同じになるように閾値を制御するので、常時閾
値を適正なレベルに維持することができ、これによって
２値化信号のパルス幅が変動することがなくなるので、
データエラーの発生を抑制することができる。また、前
述のように光磁気ディスクに光変調方式で記録する際に
記録パワーが強すぎた場合であっても、閾値のレベルを
適切なレベルに設定することができる。
【００１８】図６は本発明の第２実施例を示したブロッ
ク図である。なお、図６では図１の実施例と同一部分は
同一符号を付し、また図１のＬＰＦ１、波形等化回路
２、ＡＧＣ回路３は省略して示してある。波形等化は図
１と同様にＰＲ（１，１）等化を行うものとし、スライ
スレベル生成回路１０及び１４では図１と同様に閾値Ｔ
ｈ1 ，Ｔｈ2 の制御が行われる。この実施例では、コン
パレータ７の２値化信号とコンパレータ１１の２値化信
号がアンド回路２１で合成され、ＰＬＬ回路２２ではそ
の合成された信号から同期クロックが抽出される。ま
た、アンド回路６でデータセパレータ９及び１３の信号
を合成して得られた再生デジタル信号は、データセパレ
ータ２３によって、ＰＬＬ回路２３の同期クロックで再
同期を行うように構成されている。
ク図である。なお、図６では図１の実施例と同一部分は
同一符号を付し、また図１のＬＰＦ１、波形等化回路
２、ＡＧＣ回路３は省略して示してある。波形等化は図
１と同様にＰＲ（１，１）等化を行うものとし、スライ
スレベル生成回路１０及び１４では図１と同様に閾値Ｔ
ｈ1 ，Ｔｈ2 の制御が行われる。この実施例では、コン
パレータ７の２値化信号とコンパレータ１１の２値化信
号がアンド回路２１で合成され、ＰＬＬ回路２２ではそ
の合成された信号から同期クロックが抽出される。ま
た、アンド回路６でデータセパレータ９及び１３の信号
を合成して得られた再生デジタル信号は、データセパレ
ータ２３によって、ＰＬＬ回路２３の同期クロックで再
同期を行うように構成されている。
【００１９】図７は図６の各部の信号を示した信号波形
図である。図７（ａ）はコンパレータ７の２値化信号、
図７（ｂ）はＰＬＬ回路８の同期クロック、図７（ｃ）
はデータセパレータ９で同期化された信号である。ま
た、図７（ｄ）はコンパレータ１１の２値化信号、図７
（ｅ）はＰＬＬ回路１２の同期クロック、図７（ｆ）は
データセパレータ１３で同期化された信号である。ここ
では、図７（ｂ），（ｅ）から明らかなように２つの同
期クロックに位相ずれが生じている例を示しているが、
このように位相ずれが生じた場合は、図７（ｇ）のよう
にアンド回路６で合成して得られた再生デジタル信号の
パルス幅が狭くなってしまう。そのため、これをそのま
ま復調回路で復調すると、正常にデータを再生できない
事態が生じる。
図である。図７（ａ）はコンパレータ７の２値化信号、
図７（ｂ）はＰＬＬ回路８の同期クロック、図７（ｃ）
はデータセパレータ９で同期化された信号である。ま
た、図７（ｄ）はコンパレータ１１の２値化信号、図７
（ｅ）はＰＬＬ回路１２の同期クロック、図７（ｆ）は
データセパレータ１３で同期化された信号である。ここ
では、図７（ｂ），（ｅ）から明らかなように２つの同
期クロックに位相ずれが生じている例を示しているが、
このように位相ずれが生じた場合は、図７（ｇ）のよう
にアンド回路６で合成して得られた再生デジタル信号の
パルス幅が狭くなってしまう。そのため、これをそのま
ま復調回路で復調すると、正常にデータを再生できない
事態が生じる。
【００２０】そこで、本実施例では、コンパレータ７及
び１１の２値化信号がアンド回路２１で図７（ｈ）のよ
うに合成され、ＰＬＬ回路２３ではその合成した信号か
ら図７（ｉ）のように同期クロックが抽出される。そし
て、データセパレータ２３では得られた同期クロックに
よってゲート回路６の再生デジタル信号が再度同期化さ
れ、図７（ｊ）のようにパルス幅の変動の修復された再
生デジタル信号が生成される。このように本実施例で
は、２値化信号を合成した信号から同期クロックを抽出
し、得られた同期クロックを用いて再生デジタル信号を
再同期することにより、同期クロックに位相ずれが生じ
た場合であっても、位相ずれに伴なう再生デジタル信号
のパルス幅の変動を修復でき、正常にデータを復調する
ことができる。
び１１の２値化信号がアンド回路２１で図７（ｈ）のよ
うに合成され、ＰＬＬ回路２３ではその合成した信号か
ら図７（ｉ）のように同期クロックが抽出される。そし
て、データセパレータ２３では得られた同期クロックに
よってゲート回路６の再生デジタル信号が再度同期化さ
れ、図７（ｊ）のようにパルス幅の変動の修復された再
生デジタル信号が生成される。このように本実施例で
は、２値化信号を合成した信号から同期クロックを抽出
し、得られた同期クロックを用いて再生デジタル信号を
再同期することにより、同期クロックに位相ずれが生じ
た場合であっても、位相ずれに伴なう再生デジタル信号
のパルス幅の変動を修復でき、正常にデータを復調する
ことができる。
【００２１】図８は本発明の第３実施例を示したブロッ
ク図である。図８においても図１と同一部分は同一符号
を付し、また図１のＬＰＦ１、波形等化回路２、ＡＧＣ
回路３は省略して示してある。波形等化は、図１と同様
にＰＲ（１，１）等化が行われ、閾値の制御も図１と同
様に行われる。この実施例では、データセパレータ９で
同期化された信号はＰＬＬ回路８の同期クロックにより
ＦＩＦＯ２４に入力され、データセパレータ１３で同期
化された信号も同様にＰＬＬ回路１２の同期クロックに
よりＦＩＦＯ２５に入力される。ＦＩＦＯ２４及び２５
は信号を記憶するＦＩＦＯメモリのことである。ＦＩＦ
Ｏ２４及び２５に記憶された信号は、リファレンスクロ
ック２６によって同時に読み出され、この読み出された
信号をアンド回路６で合成することで再生デジタル信号
が生成される。
ク図である。図８においても図１と同一部分は同一符号
を付し、また図１のＬＰＦ１、波形等化回路２、ＡＧＣ
回路３は省略して示してある。波形等化は、図１と同様
にＰＲ（１，１）等化が行われ、閾値の制御も図１と同
様に行われる。この実施例では、データセパレータ９で
同期化された信号はＰＬＬ回路８の同期クロックにより
ＦＩＦＯ２４に入力され、データセパレータ１３で同期
化された信号も同様にＰＬＬ回路１２の同期クロックに
よりＦＩＦＯ２５に入力される。ＦＩＦＯ２４及び２５
は信号を記憶するＦＩＦＯメモリのことである。ＦＩＦ
Ｏ２４及び２５に記憶された信号は、リファレンスクロ
ック２６によって同時に読み出され、この読み出された
信号をアンド回路６で合成することで再生デジタル信号
が生成される。
【００２２】図９は図８の各部の信号を示した信号波形
図である。図９（ａ）はコンパレータ７の２値化信号、
図９（ｂ）はＰＬＬ回路８の同期クロック、図９（ｃ）
はデータセパレータ９の出力信号である。また、図９
（ｄ）はコンパレータ１１の２値化信号、図９（ｅ）は
ＰＬＬ回路１２の同期クロック、図９（ｆ）はデータセ
パレータ１３の出力信号である。ここでも、ＰＬＬ回路
８と１２の同期クロックは図９（ｂ），（ｅ）のように
位相がずれている。このように２つの同期クロックの位
相がずれると、前述のようにデータセパレータ９と１３
の出力信号を合成した場合、パルス幅が変動し、データ
の復調に悪影響を与えてしまう。図９（ｇ）はこのパル
ス幅の変動を示している。
図である。図９（ａ）はコンパレータ７の２値化信号、
図９（ｂ）はＰＬＬ回路８の同期クロック、図９（ｃ）
はデータセパレータ９の出力信号である。また、図９
（ｄ）はコンパレータ１１の２値化信号、図９（ｅ）は
ＰＬＬ回路１２の同期クロック、図９（ｆ）はデータセ
パレータ１３の出力信号である。ここでも、ＰＬＬ回路
８と１２の同期クロックは図９（ｂ），（ｅ）のように
位相がずれている。このように２つの同期クロックの位
相がずれると、前述のようにデータセパレータ９と１３
の出力信号を合成した場合、パルス幅が変動し、データ
の復調に悪影響を与えてしまう。図９（ｇ）はこのパル
ス幅の変動を示している。
【００２３】そこで、本実施例では、データセパレータ
９，１３の同期化された信号はそれぞれ同期クロックに
よってＦＩＦＯ２４，２５に取り込まれ、そのＦＩＦＯ
２４と２５の信号を読み出すときは、図９（ｈ）のリフ
ァレンスクロック２６によって同時に読み出される。読
み出された信号はアンド回路６で合成され、図９（ｉ）
のように再生デジタル信号が生成される。このように一
度ＦＩＦＯ２４，２５に信号を取り込み、その信号をリ
ファレンスクロック２６で同時に読み出すことにより、
同期クロックの位相がずれたとしても、ＦＩＦＯ２４と
２５の出力信号の位相が揃うので、正確な再生デジタル
信号を得ることができる。
９，１３の同期化された信号はそれぞれ同期クロックに
よってＦＩＦＯ２４，２５に取り込まれ、そのＦＩＦＯ
２４と２５の信号を読み出すときは、図９（ｈ）のリフ
ァレンスクロック２６によって同時に読み出される。読
み出された信号はアンド回路６で合成され、図９（ｉ）
のように再生デジタル信号が生成される。このように一
度ＦＩＦＯ２４，２５に信号を取り込み、その信号をリ
ファレンスクロック２６で同時に読み出すことにより、
同期クロックの位相がずれたとしても、ＦＩＦＯ２４と
２５の出力信号の位相が揃うので、正確な再生デジタル
信号を得ることができる。
【００２４】なお、以上の実施例では、パーシャルレス
ポンス波形等化として、ＰＲ（１，１）等化を採用した
装置を例として説明したが、本発明はこれに限ることな
く、例えばＰＲ（１，２，１）特性など他の波形等化に
も適用できることは言うまでもない。
ポンス波形等化として、ＰＲ（１，１）等化を採用した
装置を例として説明したが、本発明はこれに限ることな
く、例えばＰＲ（１，２，１）特性など他の波形等化に
も適用できることは言うまでもない。
【００２５】
【発明の効果】以上説明したように本発明は、２値化信
号のパルス幅とこれを同期クロックで同期化後の信号の
パルス幅が同じになるように閾値を制御することによ
り、常時閾値を最適なレベルに維持することができるの
で、常に正常な再生デジタル信号を得ることができ、デ
ータエラーの発生を抑止できるという効果がある。
号のパルス幅とこれを同期クロックで同期化後の信号の
パルス幅が同じになるように閾値を制御することによ
り、常時閾値を最適なレベルに維持することができるの
で、常に正常な再生デジタル信号を得ることができ、デ
ータエラーの発生を抑止できるという効果がある。
【図１】本発明の情報再生装置の一実施例を示したブロ
ック図である。
ック図である。
【図２】図１の実施例のスライスレベル生成回路を詳細
に示した回路図である。
に示した回路図である。
【図３】図２のスライスレベル生成回路の動作を説明す
るための信号波形図である。
るための信号波形図である。
【図４】図１の実施例の各部の信号を示した信号波形図
である。
である。
【図５】図１の実施例において閾値が適正なレベルでな
いと仮定したときの各部の信号を示した信号波形図であ
る。
いと仮定したときの各部の信号を示した信号波形図であ
る。
【図６】本発明の第２実施例を示したブロック図であ
る。
る。
【図７】図６の実施例の各部の信号を示した信号波形図
である。
である。
【図８】本発明の第３実施例を示したブロック図であ
る。
る。
【図９】図８の実施例の各部の信号を示した信号波形図
である。
である。
【図１０】パーシャルレスポンスＰＲ（１，１）波形等
化の概念を説明するためのブロック図である。
化の概念を説明するためのブロック図である。
【図１１】図１０の各部の信号を示した信号波形図であ
る。
る。
【図１２】従来のパーシャルレスポンス波形等化を採用
した情報再生装置の概略ブロック図である。
した情報再生装置の概略ブロック図である。
【図１３】正常な再生信号と媒体欠陥などで歪んだ再生
信号を示した図である。
信号を示した図である。
【図１４】ＰＲ（１，１）波形等化のアイパターンを示
した図である。
した図である。
１ ＬＰＦ（ローパスフィルター） ２ 波形等化回路 ３ ＡＧＣ回路 ６，２１ アンド回路 ７，１１ コンパレータ ８，１２，２２ ＰＬＬ回路 ９，１３，２３ データセパレータ １０，１４ スライスレベル生成回路 １５，１６ ゲート回路 １７，１８ 定電流源 ２４，２５ ＦＩＦＯ Ｃ コンデンサ
Claims (3)
- 【請求項１】 情報記録媒体に記録されたデジタル情報
を再生するに際し、前記記録媒体から再生された再生信
号を波形等化後、少なくとも２つ以上の閾値で２値化し
てデータ検出を行う情報再生装置において、前記２値化
された２値化信号のパルス幅と、この２値化信号を同期
クロックで同期化後の信号のパルス幅が同じになるよう
に前記閾値を制御することを特徴とする情報再生装置。 - 【請求項２】 前記少なくとも２つ以上の閾値で２値化
された２値化信号を合成した信号から同期クロックを抽
出し、この抽出された同期クロックにより前記２値化信
号の同期化後の信号を合成して得られた再生デジタル信
号の再同期を行うことを特徴とする請求項１の情報再生
装置。 - 【請求項３】 前記少なくとも２つ以上の閾値で２値化
された２値化信号の同期化後の信号をそれぞれ同期クロ
ックでＦＩＦＯメモリに取り込むと共に、このＦＩＦＯ
メモリに記憶された信号を同一のリファレンスクロック
で読み出して合成することにより、再生デジタル信号を
生成することを特徴とする請求項１の情報再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18136494A JPH0845185A (ja) | 1994-08-02 | 1994-08-02 | 情報再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18136494A JPH0845185A (ja) | 1994-08-02 | 1994-08-02 | 情報再生装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0845185A true JPH0845185A (ja) | 1996-02-16 |
Family
ID=16099438
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18136494A Pending JPH0845185A (ja) | 1994-08-02 | 1994-08-02 | 情報再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0845185A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010150624A1 (ja) * | 2009-06-23 | 2010-12-29 | 日本電気株式会社 | 等化装置、等化方法及びプログラム |
-
1994
- 1994-08-02 JP JP18136494A patent/JPH0845185A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010150624A1 (ja) * | 2009-06-23 | 2010-12-29 | 日本電気株式会社 | 等化装置、等化方法及びプログラム |
| US8638842B2 (en) | 2009-06-23 | 2014-01-28 | Nec Corporation | Equalization device, equalization method, and program |
| JP5423793B2 (ja) * | 2009-06-23 | 2014-02-19 | 日本電気株式会社 | 等化装置、等化方法及びプログラム |
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