JPH0767649B2 - 放電加工方法 - Google Patents
放電加工方法Info
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- JPH0767649B2 JPH0767649B2 JP7259586A JP7259586A JPH0767649B2 JP H0767649 B2 JPH0767649 B2 JP H0767649B2 JP 7259586 A JP7259586 A JP 7259586A JP 7259586 A JP7259586 A JP 7259586A JP H0767649 B2 JPH0767649 B2 JP H0767649B2
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- Japan
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- discharge
- circuit
- pulse
- voltage
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- Electrical Discharge Machining, Electrochemical Machining, And Combined Machining (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は放電加工により被加工体を電極低消耗の中加工
乃至は仕上げ加工条件で加工する際の加工方法、特に低
消耗条件に於ける加工方法に関する。
乃至は仕上げ加工条件で加工する際の加工方法、特に低
消耗条件に於ける加工方法に関する。
放電加工は電極と被加工体を微小な加工間隙を隔てて対
向させ、両者間に加工液を供給しつゝ電圧パルスを印加
して放電を生ぜしめ、そのときに生じる熱と圧力により
被加工体を微小量宛除去して被加工体を所望の形状に加
工するものである。
向させ、両者間に加工液を供給しつゝ電圧パルスを印加
して放電を生ぜしめ、そのときに生じる熱と圧力により
被加工体を微小量宛除去して被加工体を所望の形状に加
工するものである。
印加する電圧パルスは通常100V程度の電圧であり、電流
ピーク値は300A程度であるが、例えば一つの電圧パルス
又は放電パルスの立上げから立下げまでの時間が100〜1
50μｓ以下程度（放電の衝撃係数τon/Ip≧10〜15）の
仕上加工等で10A以下の低い電流ピーク値を用いて加工
する場合には、一つの放電パルス波形の立上げ（前縁）
半値点から立下げ（後縁）半値点までの区間内（本明細
書中において、「一つの放電パルスのパルス幅内」とい
う。ここで「パルス幅」とは、パルスの立上り半値点か
ら立下り半値点までの時間を指す。パルス技術用語JIS
−Ｃ−5620（1973）用語番号１−25準拠。」）で放電電
流が不規則に断続することがあり、そのために電極が過
度に消耗するという問題があった。
ピーク値は300A程度であるが、例えば一つの電圧パルス
又は放電パルスの立上げから立下げまでの時間が100〜1
50μｓ以下程度（放電の衝撃係数τon/Ip≧10〜15）の
仕上加工等で10A以下の低い電流ピーク値を用いて加工
する場合には、一つの放電パルス波形の立上げ（前縁）
半値点から立下げ（後縁）半値点までの区間内（本明細
書中において、「一つの放電パルスのパルス幅内」とい
う。ここで「パルス幅」とは、パルスの立上り半値点か
ら立下り半値点までの時間を指す。パルス技術用語JIS
−Ｃ−5620（1973）用語番号１−25準拠。」）で放電電
流が不規則に断続することがあり、そのために電極が過
度に消耗するという問題があった。
叙上の問題点は、放電回路のインピーダンスを複数段に
切り換え可能に構成すると共に、放電電流又は放電電圧
の変化を監視し、一つの放電パルスのパルス幅内で、放
電電流が所定の閾値以下となるか、又は放電電圧が所定
の閾値以上となるときは放電回路のインピーダンスを低
下せしめると共に、放電電流が、上記と同一又はそれよ
り大きな閾値以上となるか、又は放電電圧が、上記と同
一又はそれより小さい閾値以下となるときは放電回路の
インピーダンスを増加せしめ、これにより放電電流を所
定の許容範囲内に保持せしめるよう構成することにより
解決できる。
切り換え可能に構成すると共に、放電電流又は放電電圧
の変化を監視し、一つの放電パルスのパルス幅内で、放
電電流が所定の閾値以下となるか、又は放電電圧が所定
の閾値以上となるときは放電回路のインピーダンスを低
下せしめると共に、放電電流が、上記と同一又はそれよ
り大きな閾値以上となるか、又は放電電圧が、上記と同
一又はそれより小さい閾値以下となるときは放電回路の
インピーダンスを増加せしめ、これにより放電電流を所
定の許容範囲内に保持せしめるよう構成することにより
解決できる。
叙上の如く構成することにより、放電電流又は放電電圧
の変化が監視され、一つの放電パルスのパルス幅内では
これが断たれることなく、常に所定の許容範囲内の放電
電流が維持され、過渡な電極消耗が防止されるものであ
る。
の変化が監視され、一つの放電パルスのパルス幅内では
これが断たれることなく、常に所定の許容範囲内の放電
電流が維持され、過渡な電極消耗が防止されるものであ
る。
以下、図面を参照しつゝ本発明の詳細を説明する。
第１図は本発明方法を実施するための放電回路の一実施
例を示す回路図であり、第２図は従来の加工方法による
ときの放電電圧の変化を示すグラフ、第３図は従来の加
工方法によるときの放電電流の変化を示すグラフ、第４
図は本発明方法によるときの放電電流の変化を示すグラ
フである。
例を示す回路図であり、第２図は従来の加工方法による
ときの放電電圧の変化を示すグラフ、第３図は従来の加
工方法によるときの放電電流の変化を示すグラフ、第４
図は本発明方法によるときの放電電流の変化を示すグラ
フである。
先ず第２図乃至第４図について説明する。
従来の加工方法によると、例えば一つの放電パルスのパ
ルス幅が約100〜150μｓ、或いはさらに200μｓ迄より
小さい仕上加工等で10A以下の低い電流ピーク値により
加工する場合には、第３図に示す如く、放電パルスに負
のスパイクが生じ、放電電流が断続したりすることがあ
る。
ルス幅が約100〜150μｓ、或いはさらに200μｓ迄より
小さい仕上加工等で10A以下の低い電流ピーク値により
加工する場合には、第３図に示す如く、放電パルスに負
のスパイクが生じ、放電電流が断続したりすることがあ
る。
これに対して、本発明方法による加工では第４図に示す
如く、下限許容値A2以下となることがほとんどなく、所
定の許容範囲内の放電電流が維持されるものである。
如く、下限許容値A2以下となることがほとんどなく、所
定の許容範囲内の放電電流が維持されるものである。
而して、第１図中、１は直流電源、２は電極、３は被加
工体、４はパルスジェネレータ、５はスイッチング素
子、６、７、８は抵抗、９、10はシュミットトリガ回
路、11、12、13は入力否定子、14、15はアンド回路、1
6、17はスイッチング素子である。
工体、４はパルスジェネレータ、５はスイッチング素
子、６、７、８は抵抗、９、10はシュミットトリガ回
路、11、12、13は入力否定子、14、15はアンド回路、1
6、17はスイッチング素子である。
第１図に示す回路に於て、スイッチング素子16及び17は
共に常時OFFであり、この状態のときは、直流電源１、
パルスジェネレータ４、スイッチング素子５、電極２、
被加工体３、抵抗６、抵抗７及び抵抗８から放電回路が
構成され、パルスジェネレータ４からのパルス信号によ
ってスイッチング素子５がオン・オフし、直流電源１か
ら供給される電圧パルスによって電極２と被加工体３の
間にパルス放電を生ぜしめる。
共に常時OFFであり、この状態のときは、直流電源１、
パルスジェネレータ４、スイッチング素子５、電極２、
被加工体３、抵抗６、抵抗７及び抵抗８から放電回路が
構成され、パルスジェネレータ４からのパルス信号によ
ってスイッチング素子５がオン・オフし、直流電源１か
ら供給される電圧パルスによって電極２と被加工体３の
間にパルス放電を生ぜしめる。
スイッチング素子16がONの状態となるとＲ−Ｓ間が短絡
し、放電回路は上記した回路から抵抗７を除いた回路と
なり、回路のインピーダンスが一段だけ低下する。この
状態で更にスイッチング素子17がONの状態となるとＲ−
Ｔ間が短絡し、放電回路は上記した回路から抵抗７及び
抵抗８を共に除いた回路となってインピーダンスが更に
一段低下する。
し、放電回路は上記した回路から抵抗７を除いた回路と
なり、回路のインピーダンスが一段だけ低下する。この
状態で更にスイッチング素子17がONの状態となるとＲ−
Ｔ間が短絡し、放電回路は上記した回路から抵抗７及び
抵抗８を共に除いた回路となってインピーダンスが更に
一段低下する。
而して、シュミットトリガ回路９及び10の入力は抵抗６
の端子Ｐ及びＱに接続されており、シュミットトリガ回
路９の出力は入力否定子11及び12を介してアンド回路14
及び15に、シュミットトリガ回路10の出力は入力否定子
13を介してアンド回路15に接続されている。
の端子Ｐ及びＱに接続されており、シュミットトリガ回
路９の出力は入力否定子11及び12を介してアンド回路14
及び15に、シュミットトリガ回路10の出力は入力否定子
13を介してアンド回路15に接続されている。
ここで、直流電源１の開放電圧をV0、放電電流の望まし
い値をＡ、そのときの抵抗６の端子Ｐ−Ｑ間電圧をＶ、
抵抗６に流れる電流がその下方警戒値A1になったときの
端子Ｐ−Ｑ間の電圧をV1とし、抵抗６に流れる電流がさ
らに低い下限許容値A2になったときの端子Ｐ−Ｑ間の電
圧をV2とする。
い値をＡ、そのときの抵抗６の端子Ｐ−Ｑ間電圧をＶ、
抵抗６に流れる電流がその下方警戒値A1になったときの
端子Ｐ−Ｑ間の電圧をV1とし、抵抗６に流れる電流がさ
らに低い下限許容値A2になったときの端子Ｐ−Ｑ間の電
圧をV2とする。
Ａ＞A1＞A2であるから、V0＞V2＞V1＞Ｖである。
而して、シュミットトリガ回路９及び10の出力が状態０
となるレベルをV1及びV2としておく。又、シュミットト
リガ回路９及び10には適宜のヒステリシス特性を与えて
おくことが望ましい。
となるレベルをV1及びV2としておく。又、シュミットト
リガ回路９及び10には適宜のヒステリシス特性を与えて
おくことが望ましい。
而して、パルスジェネレータ４がパルス信号を発し、ス
イッチング素子５がONとなっている状態、即ち、一つの
放電パルスのパルス幅内に於て、放電電流が下限警戒値
A1以上であるときは、シュミットトリガ回路９、10はト
リガされ、その出力はいずれも状態１となる。このため
アンド回路14、15の出力は状態０となり、スイッチング
素子16、17はいずれも導通せず、従って放電回路のイン
ピーダンスは高いレベルに保たれる。
イッチング素子５がONとなっている状態、即ち、一つの
放電パルスのパルス幅内に於て、放電電流が下限警戒値
A1以上であるときは、シュミットトリガ回路９、10はト
リガされ、その出力はいずれも状態１となる。このため
アンド回路14、15の出力は状態０となり、スイッチング
素子16、17はいずれも導通せず、従って放電回路のイン
ピーダンスは高いレベルに保たれる。
放電電流が上記下限警戒値A1以下となると、シュミット
トリガ回路９の出力が状態０となるので、アンド回路14
の出力が状態１となり、スイッチング素子16が導通し、
放電回路のインピーダンスが低下するので、放電電流が
更に低下するのが防止される。
トリガ回路９の出力が状態０となるので、アンド回路14
の出力が状態１となり、スイッチング素子16が導通し、
放電回路のインピーダンスが低下するので、放電電流が
更に低下するのが防止される。
而して、このとき、放電電流が増大し、抵抗６の端子電
圧が、シュミットトリガ回路９の出力が状態１となるレ
ベルを越えるとシュミットトリガ回路９の出力は状態１
となり、スイッチング素子16の導通が遮断されるが、こ
のレベルは前述のV1より高く設定されているので、作動
が不安定となることはない。
圧が、シュミットトリガ回路９の出力が状態１となるレ
ベルを越えるとシュミットトリガ回路９の出力は状態１
となり、スイッチング素子16の導通が遮断されるが、こ
のレベルは前述のV1より高く設定されているので、作動
が不安定となることはない。
放電電流が更に下がって下方の許容限界値A2より低くな
ると、抵抗６の端子間の電圧がV2より下がり、シュミッ
トトリガ回路９に加えてシュミットトリガ回路10の出力
も状態０となり、アンドゲート14及び15の出力は共に状
態１となり、スイッチング素子16及び17が共に導通し、
放電回路のインピーダンスが更に一段低下する。
ると、抵抗６の端子間の電圧がV2より下がり、シュミッ
トトリガ回路９に加えてシュミットトリガ回路10の出力
も状態０となり、アンドゲート14及び15の出力は共に状
態１となり、スイッチング素子16及び17が共に導通し、
放電回路のインピーダンスが更に一段低下する。
上記の状態から逆に放電電流が上がって、抵抗６の端子
電圧がシュミットトリガ回路10の出力が状態１となるレ
ベルより高くなると、シュミットトリガ回路９の出力は
状態０のまゝであるが、シュミットトリガ回路10の出力
が状態１となるから、アンドゲート14の出力が状態１と
なり、アンドゲート15の出力が状態０となってスイッチ
ング素子17がOFFとなり、回路のインピーダンスが一段
増加する。
電圧がシュミットトリガ回路10の出力が状態１となるレ
ベルより高くなると、シュミットトリガ回路９の出力は
状態０のまゝであるが、シュミットトリガ回路10の出力
が状態１となるから、アンドゲート14の出力が状態１と
なり、アンドゲート15の出力が状態０となってスイッチ
ング素子17がOFFとなり、回路のインピーダンスが一段
増加する。
この状態から放電電流が更に上がって、抵抗６の端子電
圧がシュミットトリガ回路９の出力が状態１となるレベ
ルより高くなると、シュミットトリガ回路の９及び10の
出力が共に状態１となるから、アンドゲート14及び15の
出力は共に状態０となり、スイッチング素子16及び17が
共にOFFとなって回路のインピーダンスが更に一段増加
する。
圧がシュミットトリガ回路９の出力が状態１となるレベ
ルより高くなると、シュミットトリガ回路の９及び10の
出力が共に状態１となるから、アンドゲート14及び15の
出力は共に状態０となり、スイッチング素子16及び17が
共にOFFとなって回路のインピーダンスが更に一段増加
する。
而して、シュミットトリガ回路９及び10の出力が状態１
に遷移するレベルと、状態０に遷移するレベルとの差異
を適切に設定しておくと、他に特別な回路を設けなくと
も、スイッチング素子16、17のオン、オフに伴うプレシ
ュート、オーバーシュート等による誤動作や発振を防止
することができる。
に遷移するレベルと、状態０に遷移するレベルとの差異
を適切に設定しておくと、他に特別な回路を設けなくと
も、スイッチング素子16、17のオン、オフに伴うプレシ
ュート、オーバーシュート等による誤動作や発振を防止
することができる。
然しながら、場合によっては、更に動作を確実なものと
するため、アンドゲート14、15とスイッチング素子16、
17のベース間にモノステーブルエレメントを挿入して、
スイッチング素子16、17の導通時間を一定に保ったり、
又、バイステーブルエレメントを挿入して、スイッチン
グ素子16、17がオンとなったとき、当該電圧パルスの持
続時間中（即ち、スイッチング素子５のオンタイム中）
スイッチング素子16、17を導通状態に保持することも推
奨されるものである。
するため、アンドゲート14、15とスイッチング素子16、
17のベース間にモノステーブルエレメントを挿入して、
スイッチング素子16、17の導通時間を一定に保ったり、
又、バイステーブルエレメントを挿入して、スイッチン
グ素子16、17がオンとなったとき、当該電圧パルスの持
続時間中（即ち、スイッチング素子５のオンタイム中）
スイッチング素子16、17を導通状態に保持することも推
奨されるものである。
本発明は叙上の如く構成されるから本発明によるとき
は、例えば電圧パルス又は放電パルスの幅が100〜150μ
ｓ程度以下の仕上加工等で10A以下の低い電流ピーク値
を用いて加工する場合にも、一つの放電パルスのパルス
幅内でスパイクが発生したり、放電電流が不規則に断続
したりすることがなく、所定の許容範囲内の放電電流が
所定時間持続され、電極の過度の消耗を防止することが
できる。
は、例えば電圧パルス又は放電パルスの幅が100〜150μ
ｓ程度以下の仕上加工等で10A以下の低い電流ピーク値
を用いて加工する場合にも、一つの放電パルスのパルス
幅内でスパイクが発生したり、放電電流が不規則に断続
したりすることがなく、所定の許容範囲内の放電電流が
所定時間持続され、電極の過度の消耗を防止することが
できる。
第１図は本発明方法を実施するための放電回路の一実施
例を示す回路図であり、第２図は放電電圧の変化を示す
グラフ、第３図は従来の加工方法によるときの放電電流
の変化を示すグラフ、第４図は本発明方法によるときの
放電電流の変化を示すグラフである。 １……直流電源 ２……電極 ３……被加工体 ４……パルスジェネレータ ５……スイッチング素子 ６、７、８……抵抗 ９、10……シュミットトリガ回路 11、12、13……入力否定子 14、15……アンド回路 16、17……スイッチング素子
例を示す回路図であり、第２図は放電電圧の変化を示す
グラフ、第３図は従来の加工方法によるときの放電電流
の変化を示すグラフ、第４図は本発明方法によるときの
放電電流の変化を示すグラフである。 １……直流電源 ２……電極 ３……被加工体 ４……パルスジェネレータ ５……スイッチング素子 ６、７、８……抵抗 ９、10……シュミットトリガ回路 11、12、13……入力否定子 14、15……アンド回路 16、17……スイッチング素子
Claims (1)
- 【請求項１】10A以下のピーク電流パルスを用いて低消
耗条件で放電加工を行なう方法に於て、 放電回路のインピーダンスを複数段に切り換え可能に構
成すると共に、放電電流又は放電電圧の変化を監視し、
一つの放電パルスのパルス幅内で、放電電流が所定の閾
値以下となるか、又は放電電圧が所定の閾値以上となる
ときは放電回路のインピーダンスを低下せしめると共
に、放電電流が、上記と同一又はそれより大きな閾値以
上となるか、又は放電電圧が、上記と同一又はそれより
小さい閾値以下となるときは放電回路のインピーダンス
を増加せしめ、これにより放電電流を所定の許容範囲内
に保持せしめることを特徴とする上記の放電加工方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7259586A JPH0767649B2 (ja) | 1986-04-01 | 1986-04-01 | 放電加工方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7259586A JPH0767649B2 (ja) | 1986-04-01 | 1986-04-01 | 放電加工方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62236622A JPS62236622A (ja) | 1987-10-16 |
| JPH0767649B2 true JPH0767649B2 (ja) | 1995-07-26 |
Family
ID=13493910
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7259586A Expired - Fee Related JPH0767649B2 (ja) | 1986-04-01 | 1986-04-01 | 放電加工方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0767649B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2682276B2 (ja) * | 1991-07-26 | 1997-11-26 | 三菱電機株式会社 | 放電加工装置の電源 |
-
1986
- 1986-04-01 JP JP7259586A patent/JPH0767649B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62236622A (ja) | 1987-10-16 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| LAPS | Cancellation because of no payment of annual fees |