JPH07249540A - Capacitor array - Google Patents

Capacitor array

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Publication number
JPH07249540A
JPH07249540A JP6068152A JP6815294A JPH07249540A JP H07249540 A JPH07249540 A JP H07249540A JP 6068152 A JP6068152 A JP 6068152A JP 6815294 A JP6815294 A JP 6815294A JP H07249540 A JPH07249540 A JP H07249540A
Authority
JP
Japan
Prior art keywords
capacitor array
printed
electrode
capacitor
printed ceramic
Prior art date
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Pending
Application number
JP6068152A
Other languages
Japanese (ja)
Inventor
Hisayoshi Shimazaki
久義 嶋先
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Carbide Industries Co Inc
Original Assignee
Nippon Carbide Industries Co Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Carbide Industries Co Inc filed Critical Nippon Carbide Industries Co Inc
Priority to JP6068152A priority Critical patent/JPH07249540A/en
Publication of JPH07249540A publication Critical patent/JPH07249540A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To provide a capacitor array which is made of printed ceramic capacitors and which has a small size, uniform thin thickness, and good solderability, does not require any lead frame, and can be manufactured at high productivity and easily mounted on a printed board, etc. CONSTITUTION:A capacitor array is provided with printed ceramic capacitors formed on a substrate l and terminal electrodes 7 and 7' having solderable bumps 6.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、電子部品において小型
化、高性能化が要求されているコンデンサアレーに関す
るものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a capacitor array for which electronic components are required to be compact and have high performance.

【0002】[0002]

【従来の技術】従来は、個々のチップコンデンサを基板
上に整列配置したチップ状素子ネットワークデバイス
(実開平4−15825号公報)、若しくは個々のチッ
プコンデンサをプリント配線板などに直接搭載して使用
されている。
2. Description of the Related Art Conventionally, a chip-shaped element network device in which individual chip capacitors are aligned on a substrate (Japanese Utility Model Publication No. 4-15825) or individual chip capacitors are directly mounted on a printed wiring board or the like for use. Has been done.

【0003】[0003]

【発明が解決しようとする課題】上述のようなコンデン
サアレーは、回路配線が形成された基板の上に個々のチ
ップコンデンサを整列搭載配置し、半田付けし、リード
フレームを付ける等複雑で多くの工程があり、高価にな
り、また、小型化、薄型化を阻害するものである。プリ
ント配線板などにチップコンデンサを直接搭載する場合
においてもプリント配線板などに個々のチップコンデン
サを整列搭載配置し、半田付けする多くの工程数が必要
である。
The capacitor array as described above has many complicated and complicated arrangements such that individual chip capacitors are aligned and mounted on a substrate on which circuit wiring is formed, soldered, and lead frames are attached. There are processes, the cost is high, and the miniaturization and thinning are hindered. Even when the chip capacitors are directly mounted on the printed wiring board or the like, it is necessary to arrange and arrange the individual chip capacitors on the printed wiring board or the like, and to perform many soldering steps.

【0004】従って、本発明の目的は、小型化及び薄型
化及びリードフレームが不要並びに低価格なコンデンサ
アレーを提供するものである。
Therefore, an object of the present invention is to provide a capacitor array which is compact and thin, does not require a lead frame, and is inexpensive.

【0005】[0005]

【課題を解決するための手段】本発明は、下部電極2、
誘電体層3、上部電極4、保護コート5等がアルミナセ
ラミック等の基板1の上にスクリーン印刷等により形成
された複数個の印刷セラミックコンデンサ10と、該印
刷セラミックコンデンサの端子電極7・7’が半田付け
可能な電極であり、小型化、薄型化、リードフレーム不
要、低価格なコンデンサアレーを提供するものである。
The present invention provides a lower electrode 2,
A plurality of printed ceramic capacitors 10 each having a dielectric layer 3, an upper electrode 4, a protective coat 5 and the like formed on an alumina ceramic substrate 1 by screen printing or the like, and terminal electrodes 7, 7'of the printed ceramic capacitors. Is an electrode that can be soldered, and provides a low-priced capacitor array that is compact and thin, does not require a lead frame.

【0006】以下、本発明に係るコンデンサアレーにつ
いて詳述する。図1(A)は、本発明に係るコンデンサ
アレーの一実施態様を示す上面図であり、図1(B)
は、図1(A)のJ−J’線に沿った断面視図であり、
また、図1(C)は、図1(A)のI−I’線に沿った
断面視図である。
The capacitor array according to the present invention will be described in detail below. FIG. 1 (A) is a top view showing an embodiment of the capacitor array according to the present invention, and FIG.
Is a cross-sectional view taken along the line JJ ′ of FIG.
In addition, FIG. 1C is a cross-sectional view taken along the line II ′ of FIG.

【0007】本発明に係るコンデンサアレーは一般に図
1に示す如くであり、アルミナセラミック基板1等の上
に下部電極2、誘電体層3、上部電極4、保護コート5
等が厚膜印刷技術等のそれ自身公知の方法で印刷・乾燥
・焼成され印刷セラミックコンデンサ10が形成され
る。尚、保護コート5は、各々印刷セラミックコンデン
サの上部電極の一部分と共通電極である下部電極の一部
分の端子電極7・7’が露出するように構成、印刷され
る。このような前記端子電極は、半田付け可能であるこ
とが好ましい。また、本発明の印刷セラミックコンデン
サにおいては、その印刷方法、材料、形状を特に限定す
るものではない。好ましくは、誘電体層はPb(Mg
1/3Nb2/3)O3、Pb(Zn1/3Nb2/3)O3、PbT
iO3、Bi23の少なくとも1種類を含む組成のもの
がよく、高静電容量が必要な場合は、多層印刷構造の多
層印刷セラミックコンデンサにするのがよく、特に層数
を限定するものではない。また、誘電体層は共通したも
のでもよいが、印刷セラミックコンデンサの個々独立し
たものが好ましい。
The capacitor array according to the present invention is generally as shown in FIG. 1, and includes a lower electrode 2, a dielectric layer 3, an upper electrode 4 and a protective coat 5 on an alumina ceramic substrate 1 or the like.
Etc. are printed, dried and fired by a method known per se such as a thick film printing technique to form the printed ceramic capacitor 10. The protective coat 5 is formed and printed so that a part of the upper electrode of the printed ceramic capacitor and a part of the lower electrode which is a common electrode are exposed. Such terminal electrodes are preferably solderable. The printed ceramic capacitor of the present invention is not particularly limited in its printing method, material and shape. Preferably, the dielectric layer is Pb (Mg
1/3 Nb 2/3 ) O 3 , Pb (Zn 1/3 Nb 2/3 ) O 3 , PbT
A composition containing at least one of iO 3 and Bi 2 O 3 is preferable, and when a high capacitance is required, it is preferable to use a multilayer printed ceramic capacitor having a multilayer printing structure, and especially the number of layers is limited. is not. Further, the dielectric layers may be common, but it is preferable that each of the printed ceramic capacitors is independent.

【0008】このように作製された印刷セラミックコン
デンサは、このままコンデンサアレーとして使用するこ
ともできるが、更に、前記印刷セラミックコンデンサの
個々に対応した上部電極4の端子電極7及び印刷セラミ
ックコンデンサの共通した下部電極2の端子電極7’に
半田等によるバンプ6を形成したコンデンサアレーとす
るのが好ましい。
The printed ceramic capacitor thus manufactured can be used as it is as a capacitor array, but further, the terminal electrode 7 of the upper electrode 4 corresponding to each of the printed ceramic capacitors and the printed ceramic capacitor are commonly used. It is preferable to use a capacitor array in which bumps 6 made of solder or the like are formed on the terminal electrodes 7'of the lower electrode 2.

【0009】更に、コンデンサアレーは、信頼性をより
向上させるために露出した端子電極部及びバンプ部を省
く印刷セラミックコンデンサ部とアルミナセラミック基
板を樹脂等で被覆するのが好ましい。
Further, in the capacitor array, it is preferable to cover the printed ceramic capacitor portion and the alumina ceramic substrate, which omit the exposed terminal electrode portions and bump portions, with a resin or the like in order to further improve reliability.

【0010】また、本発明のコンデンサアレーにおいて
は、形状および印刷セラミックコンデンサの静電容量・
素子数・上部電極と下部電極の組み合わせを特に限定す
るものではない。
Further, in the capacitor array of the present invention, the shape and the capacitance of the printed ceramic capacitor
The number of elements and the combination of the upper electrode and the lower electrode are not particularly limited.

【0011】このように作製されたコンデンサアレー
は、電子部品として広く応用できプリント基板等への搭
載の工程数が非常に減少すると共に信頼性が向上する。
例えば、濾波用、結合用、同調用等の用途としてコンデ
ンサアレーを使用することができる。
The capacitor array thus manufactured can be widely applied as an electronic component, and the number of steps of mounting on a printed circuit board or the like can be greatly reduced and the reliability can be improved.
For example, the capacitor array can be used for applications such as filtering, coupling, and tuning.

【0012】[0012]

【実施例】以下、本発明に係るコンデンサアレーの実施
例を説明する。尚、本発明に係るコンデンサアレーは、
以下の実施例に限るものでない。
EXAMPLES Examples of the capacitor array according to the present invention will be described below. The capacitor array according to the present invention is
It is not limited to the following examples.

【0013】(実施例1)先ず、ブレイクラインが形成
された多数個取りで、向きを決める切り込み8を有する
アルミナセラミック基板1の上面にAg−Pd系導電性
ペーストをスクリーン印刷し、乾燥し、850℃10分
間焼成し共通電極となる下部電極2を形成した。
(Embodiment 1) First, an Ag-Pd-based conductive paste was screen-printed on the upper surface of an alumina ceramic substrate 1 having cuts 8 for determining the orientation by a multi-cavity formation in which break lines were formed, and then dried. The lower electrode 2 serving as a common electrode was formed by firing at 850 ° C. for 10 minutes.

【0014】次に、[Pb(Mg1/3Nb2/3)O3:P
bTiO3:Bi23=97:2.7:0.3モル%]
の誘電体粉よりなる誘電体ペーストを下部電極2の上に
スクリーン印刷し、乾燥した。誘電体ペーストのスクリ
ーン印刷は、1回、複数回でもよいが本実施例ではスク
リーン印刷・乾燥を3回行い、ピーク温度900℃10
分間維持し各々独立した誘電体層3を形成した。
Next, [Pb (Mg 1/3 Nb 2/3 ) O 3 : P
bTiO 3 : Bi 2 O 3 = 97: 2.7: 0.3 mol%]
A dielectric paste made of the dielectric powder of 1 was screen-printed on the lower electrode 2 and dried. Screen printing of the dielectric paste may be performed once or plural times, but in the present embodiment, screen printing and drying are performed three times to obtain a peak temperature of 900 ° C. 10
The dielectric layers 3 were formed by maintaining the temperature for a minute.

【0015】次に、誘電体層3の上にAg−Pd系導電
性ペーストをスクリーン印刷し、乾燥し、900℃10
分間焼成し、下部電極2と接触しない上部電極4を形成
した。但し、共通電極端子15部のみにおいては、下部
電極に接触するような上部電極のパターンとし、下部電
極と上部電極を電気接続した。このように形成された印
刷セラミックコンデンサ10の端子電極7と共通電極端
子15の端子電極7’の高さがほぼ同じになった。
Next, an Ag-Pd type conductive paste is screen-printed on the dielectric layer 3 and dried to 900 ° C. 10
After baking for a minute, the upper electrode 4 that does not contact the lower electrode 2 was formed. However, only in the common electrode terminal 15 part, the pattern of the upper electrode was formed so as to contact the lower electrode, and the lower electrode and the upper electrode were electrically connected. The height of the terminal electrode 7 of the printed ceramic capacitor 10 and the terminal electrode 7 ′ of the common electrode terminal 15 thus formed is almost the same.

【0016】次に、オーバーコート用ガラスぺーストを
前記上部電極4の一部分が覆われないような端子電極
7、7’を形成するパターンでスクリーン印刷し、乾燥
し、530℃10分間焼成し下部電極・誘電体層・上部
電極を十分覆う保護コート5を形成して印刷セラミック
コンデンサ10・共通電極端子15を形成した。このよ
うに形成された印刷セラミックコンデンサ10の端子電
極7と共通電極端子15の端子電極7’の高さは、ほぼ
同じになった。
Next, an overcoat glass paste is screen-printed with a pattern for forming the terminal electrodes 7, 7'so that a part of the upper electrode 4 is not covered, dried, baked at 530 ° C. for 10 minutes, and then dried. A protective coat 5 that sufficiently covers the electrodes, the dielectric layer, and the upper electrode was formed to form a printed ceramic capacitor 10 and a common electrode terminal 15. The heights of the terminal electrode 7 of the printed ceramic capacitor 10 and the terminal electrode 7 ′ of the common electrode terminal 15 formed in this manner were almost the same.

【0017】更に、前記印刷セラミックコンデンサ10
・共通電極端子15の形成されたアルミナセラミック基
板1をウェイブ半田漕に通して上部電極の端子電極7、
7’にAg入り半田によるバンプ6を形成し、コンデン
サアレーを作製した。
Further, the printed ceramic capacitor 10
-Passing the alumina ceramic substrate 1 on which the common electrode terminal 15 is formed through a wave solder bath, the terminal electrode 7 of the upper electrode,
Bumps 6 made of Ag-containing solder were formed on 7'to prepare a capacitor array.

【0018】このように作製されたコンデンサアレー
は、小型で・薄く・厚さがほぼ均一で・リードフレーム
が不要で・同時に多数個の作製ができ・生産性が良く、
電子部品としてプリント基板等への搭載が安易で半田付
け性も良く非常に有用である。本実施例では、アルミナ
セラミック基板1の厚みが0.5mm、印刷セラミック
コンデンサの厚みが0.10mm、コンデンサアレー全
体の厚みが1.2mmであった。
The capacitor array thus manufactured is small, thin, and has a substantially uniform thickness. No lead frame is required. A large number of capacitors can be manufactured at the same time.
It is very useful as an electronic component because it is easy to mount on a printed circuit board and has good solderability. In this example, the thickness of the alumina ceramic substrate 1 was 0.5 mm, the thickness of the printed ceramic capacitor was 0.10 mm, and the thickness of the entire capacitor array was 1.2 mm.

【0019】また、共通電極端子15部において、誘電
体層3・上部電極4が形成されず、下部電極に直接バン
プを形成したコンデンサアレーにおいても同様の効果が
あった。
Further, in the common electrode terminal 15 part, the same effect was obtained even in the capacitor array in which the dielectric layer 3 and the upper electrode 4 were not formed and the bump was directly formed on the lower electrode.

【0020】(実施例2)アルミナセラミック基板1の
上面に、実施例1と略同様にして多層印刷して、下部電
極・誘電体層・上部電極・誘電体層・下部電極・誘電体
層・上部電極・保護コートを形成して誘電体層が3層の
多層印刷セラミックコンデンサを作製した。
(Embodiment 2) Multilayer printing is performed on the upper surface of the alumina ceramic substrate 1 in substantially the same manner as in Embodiment 1, and a lower electrode, a dielectric layer, an upper electrode, a dielectric layer, a lower electrode, a dielectric layer, An upper electrode / protective coat was formed to produce a multilayer printed ceramic capacitor having three dielectric layers.

【0021】更に、実施例1と略同様にして、端子電極
にAg入りの半田によるバンプ6を形成し、コンデンサ
アレーを作製した。
Further, in the same manner as in Example 1, bumps 6 made of Ag-containing solder were formed on the terminal electrodes to produce a capacitor array.

【0022】このように作製されたコンデンサアレー
は、小型で・薄く・厚さがほぼ均一で・リードフレーム
が不要で・・高い静電容量で・同時に多数個の作製がで
き・生産性が良く、電子部品としてプリント基板等への
搭載が安易で半田付け性も良く非常に有用である。本実
施例のコンデンサアレーの全体の厚みは、1.4mmで
あった。
The capacitor array manufactured in this manner is small, thin, and has a substantially uniform thickness. No lead frame is required .. With high capacitance. A large number of capacitors can be manufactured at the same time. It is very useful as an electronic component because it is easy to mount on a printed circuit board and has good solderability. The total thickness of the capacitor array of this example was 1.4 mm.

【0023】(実施例3)アルミナセラミック基板1の
上面に、実施例1と略同様に印刷して、下部電極2・誘
電体層3・上部電極4・保護コート5を形成し、印刷セ
ラミックコンデンサを形成し、端子電極7・7’にバン
プの無いコンデンサアレーを作製した。
(Embodiment 3) Printing is performed on the upper surface of the alumina ceramic substrate 1 in substantially the same manner as in Embodiment 1 to form the lower electrode 2, the dielectric layer 3, the upper electrode 4 and the protective coat 5, and a printed ceramic capacitor is formed. To form a capacitor array having no bumps on the terminal electrodes 7 and 7 '.

【0024】このように作製されたバンプの無いコンデ
ンサアレーは、小型で・薄く・厚さがほぼ均一で・リー
ドフレームが不要で・同時に多数個の作製ができ・生産
性が良く、電子部品としてプリント基板等への搭載が安
易で半田付け性も良く非常に有用である。
The bump-free capacitor array thus manufactured is small, thin, and has a substantially uniform thickness. No lead frame is required. A large number of capacitors can be manufactured at the same time. It is very useful because it is easy to mount on a printed circuit board and has good solderability.

【0025】[0025]

【発明の効果】本発明に係るコンデンサアレーは、非常
に薄く・厚さがほぼ均一であり・小型であり・リードフ
レームが不要で・生産性が良く・安価で・プリント基板
等への搭載が安易で半田付け性も良い・有用な電子部品
を提供できる。
The capacitor array according to the present invention is extremely thin, has a substantially uniform thickness, is small, does not require a lead frame, has high productivity, is inexpensive, and can be mounted on a printed circuit board or the like. We can provide useful electronic parts that are easy and have good solderability.

【0026】[0026]

【図面の簡単な説明】[Brief description of drawings]

【図1】(A)および(B)および(C)は、本発明に
係る印刷セラミックコンデンサによる半田バンプ付きの
コンデンサアレーの一実施態様を示す上面図および断面
視図である。(A)図は、上面より見た図であり、
(B)図は(A)図のJ−J’線に沿った断面視図であ
り、(C)図は、(A)図のI−I’線に沿った断面視
図である。
1 (A), (B) and (C) are a top view and a cross-sectional view showing an embodiment of a capacitor array with solder bumps of a printed ceramic capacitor according to the present invention. (A) is a view seen from the top,
(B) is a sectional view taken along the line JJ 'of (A), and (C) is a sectional view taken along the line II' of (A).

【0027】[0027]

【符号の説明】[Explanation of symbols]

1 アルミナセラミック基板 2 下部電極 3 誘電体層 4 上部電極 5 保護コート 6 バンプ 7・7’ 端子電極 8 切り込み 10 印刷セラミックコンデンサ 15 共通電極端子 1 Alumina Ceramic Substrate 2 Lower Electrode 3 Dielectric Layer 4 Upper Electrode 5 Protective Coating 6 Bumps 7 · 7 'Terminal Electrode 8 Notch 10 Printed Ceramic Capacitor 15 Common Electrode Terminal

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】 印刷法により基板の上面に下部電極を形
成し、該下部電極の上に誘電体層を形成し、該誘電体層
の上に上部電極を形成し、形成された下部電極の一部分
と上部電極の一部分を省く部分を保護コートして作製さ
れた複数個の印刷セラミックコンデンサよりなることを
特徴とするコンデンサアレー。
1. A lower electrode is formed on the upper surface of a substrate by a printing method, a dielectric layer is formed on the lower electrode, and an upper electrode is formed on the dielectric layer. A capacitor array comprising a plurality of printed ceramic capacitors manufactured by protecting and coating a part of the upper electrode and a part of the upper electrode.
【請求項2】 多層印刷してなる多層印刷セラミックコ
ンデンサよりなることを特徴とする請求項1記載のコン
デンサアレー。
2. The capacitor array according to claim 1, comprising a multilayer printed ceramic capacitor formed by multilayer printing.
【請求項3】 保護コートが省かれている印刷セラミッ
クコンデンサの端子電極にバンプを形成したことを特徴
とする請求項1、2記載のコンデンサアレー。
3. The capacitor array according to claim 1, wherein bumps are formed on the terminal electrodes of the printed ceramic capacitor without the protective coat.
JP6068152A 1994-03-14 1994-03-14 Capacitor array Pending JPH07249540A (en)

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