JPH0635487A - 騒音低減装置 - Google Patents
騒音低減装置Info
- Publication number
- JPH0635487A JPH0635487A JP4195462A JP19546292A JPH0635487A JP H0635487 A JPH0635487 A JP H0635487A JP 4195462 A JP4195462 A JP 4195462A JP 19546292 A JP19546292 A JP 19546292A JP H0635487 A JPH0635487 A JP H0635487A
- Authority
- JP
- Japan
- Prior art keywords
- noise
- pulse
- signal
- adaptive filter
- tap
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Soundproofing, Sound Blocking, And Sound Damping (AREA)
- Filters That Use Time-Delay Elements (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】
【目的】 本発明は周期性騒音を低減させる騒音低減装
置に関し、装置構成を簡易化した騒音低減装置を提供す
ることを目的とする。 【構成】 マイクロホーンに入力される騒音を低減させ
る信号を発生する適応フィルタのタップ値を、前記マイ
クロホーンよりの出力により適応制御して前記マイクロ
ホーンよりの騒音信号を低減するようにした騒音低減装
置において、騒音の周期に同期したパルスを発生させる
同期パルス発生回路と、前記同期パルス発生回路で発生
したパルスの発生間隔を検出するパルス間隔検出回路
と、前記パルス間隔検出回路で検出された間隔に等くな
るよう前記適応フィルタのタップ付遅延線のタップ数に
切替えるタップ数切替部とを備える。
置に関し、装置構成を簡易化した騒音低減装置を提供す
ることを目的とする。 【構成】 マイクロホーンに入力される騒音を低減させ
る信号を発生する適応フィルタのタップ値を、前記マイ
クロホーンよりの出力により適応制御して前記マイクロ
ホーンよりの騒音信号を低減するようにした騒音低減装
置において、騒音の周期に同期したパルスを発生させる
同期パルス発生回路と、前記同期パルス発生回路で発生
したパルスの発生間隔を検出するパルス間隔検出回路
と、前記パルス間隔検出回路で検出された間隔に等くな
るよう前記適応フィルタのタップ付遅延線のタップ数に
切替えるタップ数切替部とを備える。
Description
【０００１】
【産業上の利用分野】本発明は、騒音を、位相が反転し
た騒音と同じ信号を発生させて低減させる騒音低減装置
に関し、とくに騒音が周期性騒音である場合の騒音低減
装置に関する。
た騒音と同じ信号を発生させて低減させる騒音低減装置
に関し、とくに騒音が周期性騒音である場合の騒音低減
装置に関する。
【０００２】
【従来の技術】例えば、自動車の室内においてはエンジ
ンの回転によって、また空調設備などにおいてはファン
やコンプレッサの回転などによって騒音が発生し不愉快
な気分にさせられることがある。
ンの回転によって、また空調設備などにおいてはファン
やコンプレッサの回転などによって騒音が発生し不愉快
な気分にさせられることがある。
【０００３】このような騒音を低減させる従来例を図７
乃至図９を参照して説明する。図７は従来例の構成図、
図８は従来例の適応フィルタおよびタップ値更新部の構
成図、図９は従来例の伝達特性補償部の構成図である。
図７において、１０は騒音源、１１は騒音源１０よりの
騒音をピックアップするピックアップ回路、１２および
１６はアナログディジタル変換器（Ａ／Ｄ）、１３はデ
ィジタルアナログ変換器（Ｄ／Ａ）、１４はスピーカ、
７は適応フィルタ、８は伝達特性補償部、９は適応フィ
ルタ７のタップ値を更新するタップ値更新部である。
乃至図９を参照して説明する。図７は従来例の構成図、
図８は従来例の適応フィルタおよびタップ値更新部の構
成図、図９は従来例の伝達特性補償部の構成図である。
図７において、１０は騒音源、１１は騒音源１０よりの
騒音をピックアップするピックアップ回路、１２および
１６はアナログディジタル変換器（Ａ／Ｄ）、１３はデ
ィジタルアナログ変換器（Ｄ／Ａ）、１４はスピーカ、
７は適応フィルタ、８は伝達特性補償部、９は適応フィ
ルタ７のタップ値を更新するタップ値更新部である。
【０００４】マイクロホーン１５は騒音を低減させよう
とする地点に設置される。適応フィルタ７は、ピックア
ップ回路１１でピックアップした信号がマイクロホーン
１５に入力される騒音源１０よりの騒音と異なる部分を
補正してスピーカ１４より送出され、マイクロホーン１
５に到達した信号が、騒音源１０よりの騒音と同振幅で
逆位相の信号を発生させる。
とする地点に設置される。適応フィルタ７は、ピックア
ップ回路１１でピックアップした信号がマイクロホーン
１５に入力される騒音源１０よりの騒音と異なる部分を
補正してスピーカ１４より送出され、マイクロホーン１
５に到達した信号が、騒音源１０よりの騒音と同振幅で
逆位相の信号を発生させる。
【０００５】適応フィルタ７は、後で図８を参照して詳
細に説明するように、タップ付遅延線より成るディジタ
ルフィルタで構成されている。すなわち、あらゆる波形
の信号はフーリエ変換することにより周波数スペクトル
に分解することができる。また、周波数スペクトルが同
一であるならば、フーリエ逆変換を行なうことにより同
一の波形を得ることができる。したがって、適応フィル
タ７はピックアップ回路１１よりピックアップされた信
号のスペクトルをマイクロホーン１５で受信する騒音源
１０よりの騒音信号のスペクトルと同一スペクトルにな
るよう通過スペクトルを制御している。
細に説明するように、タップ付遅延線より成るディジタ
ルフィルタで構成されている。すなわち、あらゆる波形
の信号はフーリエ変換することにより周波数スペクトル
に分解することができる。また、周波数スペクトルが同
一であるならば、フーリエ逆変換を行なうことにより同
一の波形を得ることができる。したがって、適応フィル
タ７はピックアップ回路１１よりピックアップされた信
号のスペクトルをマイクロホーン１５で受信する騒音源
１０よりの騒音信号のスペクトルと同一スペクトルにな
るよう通過スペクトルを制御している。
【０００６】タップ値更新部９は適応フィルタ７のタッ
プ値を更新させ、通過スペクトルが騒音信号のスペクト
ルと同一スペクトルとなるように濾波特性を作り出して
いる。伝達特性補償部８は、適応フィルタ７で発生した
信号がＤ／Ａ１３およびスピーカ１４を通ってマイクロ
ホーン１５に到達するまでには時間遅れや帯域制限など
の影響を受けるため、これらの伝達特性を補償して、マ
イクロホーンの入力で騒音源１０よりの信号と同振幅で
逆位相となるよう補償信号を発生している。
プ値を更新させ、通過スペクトルが騒音信号のスペクト
ルと同一スペクトルとなるように濾波特性を作り出して
いる。伝達特性補償部８は、適応フィルタ７で発生した
信号がＤ／Ａ１３およびスピーカ１４を通ってマイクロ
ホーン１５に到達するまでには時間遅れや帯域制限など
の影響を受けるため、これらの伝達特性を補償して、マ
イクロホーンの入力で騒音源１０よりの信号と同振幅で
逆位相となるよう補償信号を発生している。
【０００７】この伝達特性もタップ付遅延線より成るデ
ィジタルフィルタで構成させることができる。図９は伝
達特性補償部８の構成を示したものであり、８０−１〜
８０−Ｊは遅延素子で、Ａ／Ｄ１２および１６に入力さ
れるサンプリングパルスのサンプリング間隔に対応する
時間遅延される。また８１−０〜８１−Ｊはタップ値で
あり、遅延素子の出力値をタップ値倍されて出力され
る。
ィジタルフィルタで構成させることができる。図９は伝
達特性補償部８の構成を示したものであり、８０−１〜
８０−Ｊは遅延素子で、Ａ／Ｄ１２および１６に入力さ
れるサンプリングパルスのサンプリング間隔に対応する
時間遅延される。また８１−０〜８１−Ｊはタップ値で
あり、遅延素子の出力値をタップ値倍されて出力され
る。
【０００８】そこで、ｔ＝ｔn ときのＡ／Ｄ１２の出力
値をｘ（ｎ）、その次のｔ＝ｔn+1のときの出力値をｘ
（ｎ＋１）で表わし、 ＜ｉ＝１，３＞Σｘi ＝ｘ1 ＋ｘ2 ＋ｘ3 で表わすと、加算器８２より出力される伝達特性補償部
８よりの補償信号Ｃ（ｎ）は、 Ｃ（ｎ）＝＜ｉ＝０，Ｊ＞Σｘ（ｎ−ｉ）Ｃｉ …（１） で表わされる。
値をｘ（ｎ）、その次のｔ＝ｔn+1のときの出力値をｘ
（ｎ＋１）で表わし、 ＜ｉ＝１，３＞Σｘi ＝ｘ1 ＋ｘ2 ＋ｘ3 で表わすと、加算器８２より出力される伝達特性補償部
８よりの補償信号Ｃ（ｎ）は、 Ｃ（ｎ）＝＜ｉ＝０，Ｊ＞Σｘ（ｎ−ｉ）Ｃｉ …（１） で表わされる。
【０００９】適応フィルタ７は、図８で示されるよう
に、遅延素子７０−１〜７０−Ｚ、タップ値７１−０〜
７１−Ｚおよび加算器７２で構成される。遅延素子７０
はサンプリングパルスの発生間隔に等しい時間Ａ／Ｄ１
２よりの出力信号を遅延させる。
に、遅延素子７０−１〜７０−Ｚ、タップ値７１−０〜
７１−Ｚおよび加算器７２で構成される。遅延素子７０
はサンプリングパルスの発生間隔に等しい時間Ａ／Ｄ１
２よりの出力信号を遅延させる。
【００１０】したがって、適応フィルタ７よりの出力ｙ
（ｎ）は ｙ（ｎ）＝＜ｉ＝０，Ｚ＞Σｘ（ｎ−ｉ）Ｗｉ（ｎ） …（２） で表わされ、Ｄ／Ａ１３でアナログ信号に変換されてス
ピーカ１４より送出される。
（ｎ）は ｙ（ｎ）＝＜ｉ＝０，Ｚ＞Σｘ（ｎ−ｉ）Ｗｉ（ｎ） …（２） で表わされ、Ｄ／Ａ１３でアナログ信号に変換されてス
ピーカ１４より送出される。
【００１１】適応フィルタ７のタップ値ＷO （ｎ）〜Ｗ
Z （ｎ）はサンプリングパルスが発生される毎に更新さ
れる。このタップ値の更新はタップ値更新部９によって
行なわれる。タップ値更新部９は、図８に示されるよう
に、乗算器９０，９１および９２と加算器９３で構成さ
れる。
Z （ｎ）はサンプリングパルスが発生される毎に更新さ
れる。このタップ値の更新はタップ値更新部９によって
行なわれる。タップ値更新部９は、図８に示されるよう
に、乗算器９０，９１および９２と加算器９３で構成さ
れる。
【００１２】先ず遅延素子９０では、前記伝達特性補償
部８よりの出力信号Ｃ（ｎ）が入力され、サンプリング
パルスの発生間隔に等しい時間遅延されて伝播される。
また、乗算器９１ではマイクロホーン１５よりの出力ｅ
（ｔ）がＡ／Ｄ１６でディジタル値に交換された信号ｅ
（ｎ）をα倍する乗算が行なわれる。このαは適応制御
系のループ特性によって決定される。
部８よりの出力信号Ｃ（ｎ）が入力され、サンプリング
パルスの発生間隔に等しい時間遅延されて伝播される。
また、乗算器９１ではマイクロホーン１５よりの出力ｅ
（ｔ）がＡ／Ｄ１６でディジタル値に交換された信号ｅ
（ｎ）をα倍する乗算が行なわれる。このαは適応制御
系のループ特性によって決定される。
【００１３】次に、適応フィルタ７の各タップ値の更新
値Ｗ（ｎ＋１）の算出を行なう。説明を容易にするた
め、タップ７１−０のタップ値ＷO （ｎ）がＷO （ｎ＋
１）に更新される場合を例にとって説明する。乗算器９
２−０では、乗算器９１の出力と伝達特性補償部８より
の出力値Ｃ（ｎ）との乗算が行なわれる。加算器９３−
０では、ｔ＝ｔn におけるタップ値Ｗ O （ｎ）より乗算
器９２−０より出力値の減算が行なわれ、結果を次のｔ
＝ｔn+ 1 におけるタップ値ＷO （ｎ＋１）としてタップ
値を更新する。
値Ｗ（ｎ＋１）の算出を行なう。説明を容易にするた
め、タップ７１−０のタップ値ＷO （ｎ）がＷO （ｎ＋
１）に更新される場合を例にとって説明する。乗算器９
２−０では、乗算器９１の出力と伝達特性補償部８より
の出力値Ｃ（ｎ）との乗算が行なわれる。加算器９３−
０では、ｔ＝ｔn におけるタップ値Ｗ O （ｎ）より乗算
器９２−０より出力値の減算が行なわれ、結果を次のｔ
＝ｔn+ 1 におけるタップ値ＷO （ｎ＋１）としてタップ
値を更新する。
【００１４】すなわち、 ＷO （ｎ＋１）＝ＷO （ｎ）−αＣ（ｎ）ｅ（ｎ） …（３） なるタップ値に更新を行なう。またその他のタップＷi
についても Ｗi （ｎ＋１）＝Ｗi （ｎ）−αＣ（ｎ−ｉ）ｅ（ｎ） …（４） なるタップ値に更新を行なう。
についても Ｗi （ｎ＋１）＝Ｗi （ｎ）−αＣ（ｎ−ｉ）ｅ（ｎ） …（４） なるタップ値に更新を行なう。
【００１５】以上説明したように、タップ値が更新され
ることにより、スピーカ１４より送出される音波はマイ
クロホーン１５の入力で騒音源１０より騒音と同振幅で
逆位相となり、マイクロホーンの付近における騒音を低
減させている。
ることにより、スピーカ１４より送出される音波はマイ
クロホーン１５の入力で騒音源１０より騒音と同振幅で
逆位相となり、マイクロホーンの付近における騒音を低
減させている。
【００１６】
【発明が解決しようとする課題】前述したように、従来
の騒音低減装置は、騒音源よりピックアップした騒音信
号を適応フィルタを通して騒音と同振幅で逆位相の信号
を発生させて騒音を低減するようにしていた。
の騒音低減装置は、騒音源よりピックアップした騒音信
号を適応フィルタを通して騒音と同振幅で逆位相の信号
を発生させて騒音を低減するようにしていた。
【００１７】このため、適応フィルタではタップ数に等
しい乗算を、また、タップ値の更新にはタップ数に等し
い乗算および加算を行なわせる必要がある。これらの乗
算や加算を個別の乗算器や加算器で構成した場合は装置
構成が非常に複雑となり、一般にはプロセッサによる処
理で行なわせている。しかし、前述したように非常に多
くのタップ数に対応した乗算および加算処理をサンプリ
ングパルスの間隔の間で行なわせるには高速のプロセッ
サを必要とし、装置価格を高価にしていた。
しい乗算を、また、タップ値の更新にはタップ数に等し
い乗算および加算を行なわせる必要がある。これらの乗
算や加算を個別の乗算器や加算器で構成した場合は装置
構成が非常に複雑となり、一般にはプロセッサによる処
理で行なわせている。しかし、前述したように非常に多
くのタップ数に対応した乗算および加算処理をサンプリ
ングパルスの間隔の間で行なわせるには高速のプロセッ
サを必要とし、装置価格を高価にしていた。
【００１８】本発明は、一般の騒音源としては周期性の
あるものが非常に多く、この周期性のある騒音に対して
装置構成を非常に簡易化した騒音低減装置を提供するこ
とを目的とする。
あるものが非常に多く、この周期性のある騒音に対して
装置構成を非常に簡易化した騒音低減装置を提供するこ
とを目的とする。
【００１９】
【課題を解決するための手段】まず、課題を解決するた
めの手段を説明する前に、本発明の原理を説明する。前
述した従来例では、適応フィルタに入力する信号は、マ
イクロホーンに入力する騒音のスペクトルに近い信号と
して、騒音源よりピックアップした信号を入力してい
た。
めの手段を説明する前に、本発明の原理を説明する。前
述した従来例では、適応フィルタに入力する信号は、マ
イクロホーンに入力する騒音のスペクトルに近い信号と
して、騒音源よりピックアップした信号を入力してい
た。
【００２０】しかし、適応フィルタに入力する信号は、
騒音のスペクトルに近い信号を入力させる必要はなく、
騒音のスペクトルを包含するスペクトルを有する信号で
あればどのような信号であっても良い。すなわち、騒音
のスペクトルを包含しておれば、フィルタの特性を変化
させて、騒音のスペクトルと同一スペクトル特性にする
ことが出来、騒音の波形と同一波形にすることができ
る。
騒音のスペクトルに近い信号を入力させる必要はなく、
騒音のスペクトルを包含するスペクトルを有する信号で
あればどのような信号であっても良い。すなわち、騒音
のスペクトルを包含しておれば、フィルタの特性を変化
させて、騒音のスペクトルと同一スペクトル特性にする
ことが出来、騒音の波形と同一波形にすることができ
る。
【００２１】また、周期性の騒音に対しては、適応フィ
ルタを構成するタップ付遅延線の総遅延量を騒音の周期
に等しい時間としてもフィルタ特性を得ることができ
る。すなわち、騒音が周期性であるため、１周期の騒音
信号に対するレスポンスを騒音の周期で分割し、これら
の分割されたレスポンスを重合わす重合せの定理が成立
する。このことは、タップ付遅延線の遅延量を騒音の周
期に等しい時間で分割して重合せ、重合ったタップ値を
合計したタップ値にしたことと同じになる。
ルタを構成するタップ付遅延線の総遅延量を騒音の周期
に等しい時間としてもフィルタ特性を得ることができ
る。すなわち、騒音が周期性であるため、１周期の騒音
信号に対するレスポンスを騒音の周期で分割し、これら
の分割されたレスポンスを重合わす重合せの定理が成立
する。このことは、タップ付遅延線の遅延量を騒音の周
期に等しい時間で分割して重合せ、重合ったタップ値を
合計したタップ値にしたことと同じになる。
【００２２】本発明はこの原理に基くものであり、適応
フィルタの演算処理を、従来例では式（２）で示される
ｙ（ｎ）の算出をｉ＝０からＺまで行なうのに対して、
遅延量が騒音の周期に等しい時間となるＩ番目のタップ
まで行なわせる。また、適応フィルタでＩ番目のタップ
までの演算処理を行なうことから、タップ値の更新は式
（４）で示されるＷi のｉ＝０よりＩ番目までで良くな
る。
フィルタの演算処理を、従来例では式（２）で示される
ｙ（ｎ）の算出をｉ＝０からＺまで行なうのに対して、
遅延量が騒音の周期に等しい時間となるＩ番目のタップ
まで行なわせる。また、適応フィルタでＩ番目のタップ
までの演算処理を行なうことから、タップ値の更新は式
（４）で示されるＷi のｉ＝０よりＩ番目までで良くな
る。
【００２３】さらに、適応フィルタに入力する信号を騒
音源より発生する騒音の周期に同期したバルスを入力さ
せることにより、パルスのスペクトルは非常に広く、騒
音のスペクトルを包含する。またパルスの振幅ｘを
“１”に正規化すれば、式（２）は ｙ（ｎ）＝＜ｉ＝Ｋ1 ，Ｋ2 ＞ΣＷi （ｎ） …（５） ただし、Ｋ1 およびＫ2 はパルスが存在する遅延素子の
番号で、Ｋ1 番よりＫ2 番目までパルスが存在している
ことを示す で表わされ、加算のみの処理となり、単純化される。
音源より発生する騒音の周期に同期したバルスを入力さ
せることにより、パルスのスペクトルは非常に広く、騒
音のスペクトルを包含する。またパルスの振幅ｘを
“１”に正規化すれば、式（２）は ｙ（ｎ）＝＜ｉ＝Ｋ1 ，Ｋ2 ＞ΣＷi （ｎ） …（５） ただし、Ｋ1 およびＫ2 はパルスが存在する遅延素子の
番号で、Ｋ1 番よりＫ2 番目までパルスが存在している
ことを示す で表わされ、加算のみの処理となり、単純化される。
【００２４】つぎに課題を解決するための手段を説明す
る。マイクロホーンに入力される騒音を低減させる信号
を発生する適応フィルタのタップ値を、前記マイクロホ
ーンよりの出力と前記適応フィルタで発生した信号が前
記マイクロホーンに到達するまでの伝達特性を補償する
信号とにより適応制御して前記マイクロホーンよりの騒
音信号を低減するようにした騒音低減装置において、前
記適応フィルタで発生する信号および前記伝達特性を補
償する信号を発生させるための騒音の周期に同期したパ
ルスを発生させる同期パルス発生回路と、前記同期パル
ス発生回路で発生したパルスの発生間隔を検出するパル
ス間隔検出回路と、前記パルス間隔検出回路で検出され
た間隔に等くなるように前記適応フィルタのタップ付遅
延線の遅延量となるタップ数に切替えるタップ数切替部
と、を備える。
る。マイクロホーンに入力される騒音を低減させる信号
を発生する適応フィルタのタップ値を、前記マイクロホ
ーンよりの出力と前記適応フィルタで発生した信号が前
記マイクロホーンに到達するまでの伝達特性を補償する
信号とにより適応制御して前記マイクロホーンよりの騒
音信号を低減するようにした騒音低減装置において、前
記適応フィルタで発生する信号および前記伝達特性を補
償する信号を発生させるための騒音の周期に同期したパ
ルスを発生させる同期パルス発生回路と、前記同期パル
ス発生回路で発生したパルスの発生間隔を検出するパル
ス間隔検出回路と、前記パルス間隔検出回路で検出され
た間隔に等くなるように前記適応フィルタのタップ付遅
延線の遅延量となるタップ数に切替えるタップ数切替部
と、を備える。
【００２５】
【作用】同期パルス発生回路では騒音の周期に同期した
パルスを発生して適応フィルタおよび伝達特性補償部に
入力する。パルス間隔検出回路では前記同期パルス発生
回路で発生したパルス間隔を検出する。
パルスを発生して適応フィルタおよび伝達特性補償部に
入力する。パルス間隔検出回路では前記同期パルス発生
回路で発生したパルス間隔を検出する。
【００２６】タップ数切替部では適応フィルタのタップ
付遅延線の遅延量が前記パルス間隔検出回路で検出した
パルス間隔と等しくなるタップ数で打切る切替を行な
う。以上のように、騒音の周期に同期したパルスを発生
させて適応フィルタに入力し、適応フィルタのタップ付
遅延線のタップ数を、入力したパルスの間隔に等しい遅
延量となるタップ数で打切るようにさせたので、適応フ
ィルタでの演算処理回数を大幅に低減させることがで
き、装置構成を簡易化することができる。
付遅延線の遅延量が前記パルス間隔検出回路で検出した
パルス間隔と等しくなるタップ数で打切る切替を行な
う。以上のように、騒音の周期に同期したパルスを発生
させて適応フィルタに入力し、適応フィルタのタップ付
遅延線のタップ数を、入力したパルスの間隔に等しい遅
延量となるタップ数で打切るようにさせたので、適応フ
ィルタでの演算処理回数を大幅に低減させることがで
き、装置構成を簡易化することができる。
【００２７】
【実施例】本発明の一実施例を図１および図２を参照し
て説明する。図１は本発明の実施例の構成図、図２は同
実施例のタップ切替部、適応フィルタ、伝達特性補償部
およびタップ値更新部の具体例である。
て説明する。図１は本発明の実施例の構成図、図２は同
実施例のタップ切替部、適応フィルタ、伝達特性補償部
およびタップ値更新部の具体例である。
【００２８】図１において、１は同期パルス発生回路で
あり、騒音源１０の騒音の周期に同期したパルスを発生
する。２はパルス間隔検出回路であり、同期パルス発生
回路１で発生したパルス間隔を検出する。実施例ではパ
ルス間隔をＡ／Ｄ１６のサンプリングパルス数でパルス
間隔を検出させている。
あり、騒音源１０の騒音の周期に同期したパルスを発生
する。２はパルス間隔検出回路であり、同期パルス発生
回路１で発生したパルス間隔を検出する。実施例ではパ
ルス間隔をＡ／Ｄ１６のサンプリングパルス数でパルス
間隔を検出させている。
【００２９】３はタップ数切替部であり、適応フィルタ
４のタップ数をパルス間隔検出回路２で検出されたサン
プリングパルス数に等しいタップ数となるよう切替えを
行なう。５は伝達特性補償部、６はタップ値更新部、１
３はＤ／Ａ、１４はスピーカ、１５はマイクロホーン、
１６はＡ／Ｄである。
４のタップ数をパルス間隔検出回路２で検出されたサン
プリングパルス数に等しいタップ数となるよう切替えを
行なう。５は伝達特性補償部、６はタップ値更新部、１
３はＤ／Ａ、１４はスピーカ、１５はマイクロホーン、
１６はＡ／Ｄである。
【００３０】サンプリングパルスの繰返し周波数はマイ
クロホーン１５より出力される信号に含まれる最高周波
数の２倍以上とし、装置設計時に予め決定されている。
また、以後の説明を容易にするため、同期パルス発生回
路１より発生する同期パルスｐ（ｔ）の幅は３サンプリ
ングパルス時間、また、パルス間隔検出回路２で検出さ
れるパルス間隔はＩサンプリングとする。
クロホーン１５より出力される信号に含まれる最高周波
数の２倍以上とし、装置設計時に予め決定されている。
また、以後の説明を容易にするため、同期パルス発生回
路１より発生する同期パルスｐ（ｔ）の幅は３サンプリ
ングパルス時間、また、パルス間隔検出回路２で検出さ
れるパルス間隔はＩサンプリングとする。
【００３１】まず、伝達特性補償部５について説明す
る。伝達特性補償部５は、従来例で説明したように図９
で示す構成のものも使用できるが、入力信号がパルスと
したことにより簡易化した構成が可能となる。すなわ
ち、入力パルスが遅延素子に存在する係数のみを加算す
れば良く、パルスの振幅ｘを“１”に正規化すれば、式
（１）は Ｃ（ｎ）＝＜ｉ＝ｋ，ｋ−２＞ΣＣi …（６） ただし、ｋは最初の入力パルスが存在する遅延素子の番
号で表わされる。
る。伝達特性補償部５は、従来例で説明したように図９
で示す構成のものも使用できるが、入力信号がパルスと
したことにより簡易化した構成が可能となる。すなわ
ち、入力パルスが遅延素子に存在する係数のみを加算す
れば良く、パルスの振幅ｘを“１”に正規化すれば、式
（１）は Ｃ（ｎ）＝＜ｉ＝ｋ，ｋ−２＞ΣＣi …（６） ただし、ｋは最初の入力パルスが存在する遅延素子の番
号で表わされる。
【００３２】また、タップ値Ｃi は、図３で示されるよ
うに、スピーカ１４、マイクロホーン１５の設置位置お
よびＤ／Ａ１３やスピーカの特性が決まれば決定され
る。したがって、最初の入力パルスがタップ番号ｋであ
るときの式（６）の右辺を予じめ計算し、第ｋ番目のタ
ップ値ＨＣk を ＨＣk ＝＜ｉ＝ｋ，ｋ−２＞ΣＣi …（７） ただし、ｉ＜０およびｉ＞Ｊの時Ｃi ＝０ とすることにより加算処理が不要となる。
うに、スピーカ１４、マイクロホーン１５の設置位置お
よびＤ／Ａ１３やスピーカの特性が決まれば決定され
る。したがって、最初の入力パルスがタップ番号ｋであ
るときの式（６）の右辺を予じめ計算し、第ｋ番目のタ
ップ値ＨＣk を ＨＣk ＝＜ｉ＝ｋ，ｋ−２＞ΣＣi …（７） ただし、ｉ＜０およびｉ＞Ｊの時Ｃi ＝０ とすることにより加算処理が不要となる。
【００３３】つぎに、図２を参照して、タップ数切替部
３、適応フィルタ４、伝達特性補償部５およびタップ値
更新部６の動作を説明する。図２は具体例である。伝達
特性補償部５はメモリ５１で構成され、式（７）で示し
たｋをアドレスとしてＨＣk が格納されている。
３、適応フィルタ４、伝達特性補償部５およびタップ値
更新部６の動作を説明する。図２は具体例である。伝達
特性補償部５はメモリ５１で構成され、式（７）で示し
たｋをアドレスとしてＨＣk が格納されている。
【００３４】タップ数切替部３はＭＯＤ（Ｉ）回路３１
で構成される。タップ値更新部６はアドレス発生回路６
１、加算器６２および６６、ＭＯＤ（Ｉ）回路６３、乗
算回路６４および６５で構成される。また、適応フィル
タ４はカウンタ４１、微分回路４２、アドレス発生回路
４３、メモリ４４および加算回路４５で構成される。
ＭＯＤ（Ｉ）回路３１および６３のＩはパルス間隔検出
回路２より与えられる。
で構成される。タップ値更新部６はアドレス発生回路６
１、加算器６２および６６、ＭＯＤ（Ｉ）回路６３、乗
算回路６４および６５で構成される。また、適応フィル
タ４はカウンタ４１、微分回路４２、アドレス発生回路
４３、メモリ４４および加算回路４５で構成される。
ＭＯＤ（Ｉ）回路３１および６３のＩはパルス間隔検出
回路２より与えられる。
【００３５】カウンタ４１は同期パルス発生回路１で発
生するパルスを微分回路４２で微分してリセットされ、
０よりＩ−１のカウント値で繰返えされる。アドレス発
生回路４３では、カウンタ４１のカウント値、カウント
値−１およびカウント値−２のアドレス値を時分割で発
生する。この３つのアドレスは式（５）の＜ｉ＝Ｋ1 ，
Ｋ2 ＞に対応するものである。
生するパルスを微分回路４２で微分してリセットされ、
０よりＩ−１のカウント値で繰返えされる。アドレス発
生回路４３では、カウンタ４１のカウント値、カウント
値−１およびカウント値−２のアドレス値を時分割で発
生する。この３つのアドレスは式（５）の＜ｉ＝Ｋ1 ，
Ｋ2 ＞に対応するものである。
【００３６】ＭＯＤ（Ｉ）回路３１はアドレス発生回路
４３で発生したデータ値をＩを法とする数に変換し、メ
モリ４４のアドレスとして送出する。すなわち、ＭＯＤ
（Ｉ）回路は、例えばＩを３０とするならば、データ値
が３０ならば０、３１ならば１、逆に−１ならば２９、
−２ならば２８を出力する。
４３で発生したデータ値をＩを法とする数に変換し、メ
モリ４４のアドレスとして送出する。すなわち、ＭＯＤ
（Ｉ）回路は、例えばＩを３０とするならば、データ値
が３０ならば０、３１ならば１、逆に−１ならば２９、
−２ならば２８を出力する。
【００３７】メモリ４４ではアドレスに対応するデータ
値（タップ値）が読出され、加算回路４５で加算して出
力する。すなわち、加算回路４５では式（５）の加算を
行ってｙ（ｎ）を出力する。更に具体的に適応フィルタ
４での出力値ｙ（ｎ）の算出を、図８で示した従来例の
構成で対比して説明すると、遅延素子７０には同期パル
ス発生回路１より同期パルスｐ（ｔ）が入力されて伝播
される。
値（タップ値）が読出され、加算回路４５で加算して出
力する。すなわち、加算回路４５では式（５）の加算を
行ってｙ（ｎ）を出力する。更に具体的に適応フィルタ
４での出力値ｙ（ｎ）の算出を、図８で示した従来例の
構成で対比して説明すると、遅延素子７０には同期パル
ス発生回路１より同期パルスｐ（ｔ）が入力されて伝播
される。
【００３８】図４は同期パルスｐ（ｔ）が遅延素子７０
を伝播している状態を示したものであり、横軸が素子番
号である。また、仮定したように、ｐ（ｔ）は３サンプ
リングパルスの幅を有している。図２で示すカウンタ４
１のカウント値は、図４で示す同期パルスｐ（ｔ）の最
初に存在する素子番号ｋに対応する。また、アドレス発
生回路４３はｋをもとにｋ、ｋ−１およびｋ−２を発生
させている。
を伝播している状態を示したものであり、横軸が素子番
号である。また、仮定したように、ｐ（ｔ）は３サンプ
リングパルスの幅を有している。図２で示すカウンタ４
１のカウント値は、図４で示す同期パルスｐ（ｔ）の最
初に存在する素子番号ｋに対応する。また、アドレス発
生回路４３はｋをもとにｋ、ｋ−１およびｋ−２を発生
させている。
【００３９】したがって、加算回路４５より出力される
出力値ｙ（ｎ）は、図５に示すように、図８で示す適応
フィルタのタップ値ｗ0 よりｗZ をｗI で打切り、Ｗk
よりＷk-2 のタップ値を加算したと同じ演算を行なわせ
ている。加算回路４５でｙ（ｎ）の算出が終了するとタ
ップ値メモリ４４に格納されているタップ値の更新を開
始する。
出力値ｙ（ｎ）は、図５に示すように、図８で示す適応
フィルタのタップ値ｗ0 よりｗZ をｗI で打切り、Ｗk
よりＷk-2 のタップ値を加算したと同じ演算を行なわせ
ている。加算回路４５でｙ（ｎ）の算出が終了するとタ
ップ値メモリ４４に格納されているタップ値の更新を開
始する。
【００４０】アドレス発生回路６１は、カウンタ４１よ
り出力されるカウント値が変化すると、式（７）で示し
たｋに対応する０よりＪのアドレス信号を時分割で発生
させる。アドレス発生回路６１で発生したアドレス信号
をアドレスとしてメモリ５１より伝達特性ＨＣk が読出
され、乗算器６１に入力され、μ・ｅ（ｎ）・ＨＣk な
る演算出力を得る。
り出力されるカウント値が変化すると、式（７）で示し
たｋに対応する０よりＪのアドレス信号を時分割で発生
させる。アドレス発生回路６１で発生したアドレス信号
をアドレスとしてメモリ５１より伝達特性ＨＣk が読出
され、乗算器６１に入力され、μ・ｅ（ｎ）・ＨＣk な
る演算出力を得る。
【００４１】一方、アドレス発生回路６１より発生した
アドレス信号は加算器６２でカウンタ４１のカウント値
より減算されてＭＯＤ（Ｉ）回路６３に入力される。Ｍ
ＯＤ（Ｉ）回路６３の出力はタップ値が格納されている
メモリ４４にアドレス信号として供給され、タップ値Ｗ
k （ｎ）が読出され、加算回路６６に入力される。
アドレス信号は加算器６２でカウンタ４１のカウント値
より減算されてＭＯＤ（Ｉ）回路６３に入力される。Ｍ
ＯＤ（Ｉ）回路６３の出力はタップ値が格納されている
メモリ４４にアドレス信号として供給され、タップ値Ｗ
k （ｎ）が読出され、加算回路６６に入力される。
【００４２】加算回路６６では、乗算回路６５より出力
と減算され、 Ｗk （ｎ＋１）＝Ｗk （ｎ）−μ・ｅ（ｎ）・ＨＣk …（９） なるタップ値Ｗk （ｎ＋１）がｋなるアドレスのメモリ
４４に格納されて、タップ値を更新する。
と減算され、 Ｗk （ｎ＋１）＝Ｗk （ｎ）−μ・ｅ（ｎ）・ＨＣk …（９） なるタップ値Ｗk （ｎ＋１）がｋなるアドレスのメモリ
４４に格納されて、タップ値を更新する。
【００４３】タップ値の更新は、アドレス発生回路６１
で０よりＪのアドレスが発生されるため、カウンタ４１
のカウント値をｋとすると、ｋよりｋ−Ｊに対応するア
ドレスのメモリ４４のデータが更新される。すなわち、
図６に示すように、図８の従来例で示す適応フィルタの
タップＷk よりＷk-J の更新が行なわれる。
で０よりＪのアドレスが発生されるため、カウンタ４１
のカウント値をｋとすると、ｋよりｋ−Ｊに対応するア
ドレスのメモリ４４のデータが更新される。すなわち、
図６に示すように、図８の従来例で示す適応フィルタの
タップＷk よりＷk-J の更新が行なわれる。
【００４４】なお実施例では、スピーカおよびマイクロ
ホーンが各々１個の場合について説明したが、これらが
複数個設置された場合の騒音低減装置にも適用すること
ができる。以上、本発明の一実施例について説明した
が、本発明はこの実施例に限定されるものではなく、そ
の発明の主旨に従った各種変形が可能である。
ホーンが各々１個の場合について説明したが、これらが
複数個設置された場合の騒音低減装置にも適用すること
ができる。以上、本発明の一実施例について説明した
が、本発明はこの実施例に限定されるものではなく、そ
の発明の主旨に従った各種変形が可能である。
【００４５】
【発明の効果】以上説明したように、本発明によれば次
の諸効果が得られる。 騒音の周期に同期したパルスを発生させて適応フィル
タに入力し、適応フィルタのタップ付遅延線のタップ数
を、入力したパルスの間隔に等しい遅延量となるタップ
数で打切るようにさせたので、適応フィルタでの演算処
理回数を大幅に低減させることができ、装置構成を簡易
化することができる。 伝達特性を補償する信号を予めメモリに記録させ、同
期パルス発生回路より発生するパルスに同期して読出す
ようにしたので、演算処理を行なうことなく、容易に得
ることができる。
の諸効果が得られる。 騒音の周期に同期したパルスを発生させて適応フィル
タに入力し、適応フィルタのタップ付遅延線のタップ数
を、入力したパルスの間隔に等しい遅延量となるタップ
数で打切るようにさせたので、適応フィルタでの演算処
理回数を大幅に低減させることができ、装置構成を簡易
化することができる。 伝達特性を補償する信号を予めメモリに記録させ、同
期パルス発生回路より発生するパルスに同期して読出す
ようにしたので、演算処理を行なうことなく、容易に得
ることができる。
【図１】本発明の一実施例の構成図である。
【図２】同実施例のタップ切替部、適応フィルタ、伝達
特性補償部およびタップ値更新部の具体例である。
特性補償部およびタップ値更新部の具体例である。
【図３】伝達特性補償部のタップ値の具体例である。
【図４】同期パルスｐ（ｔ）の遅延素子上の説明図であ
る。
る。
【図５】適応フィルタの出力値算出説明図である。
【図６】適応フィルタのタップ値更新説明図である。
【図７】従来例の構成図である。
【図８】従来例の適応フィルタおよびタップ値更新部の
構成図である。
構成図である。
【図９】従来例の伝達特性補償部の構成図である。
１ 同期パルス発生回路 ２ パルス間隔検出回路 ３ タップ切替部 ４，７ 適応フィルタ ５，８ 伝達特性補償部 ６，９ タップ値更新部 １１ ピックアップ回路 １２，１６ アナログディジタル変換器 １３ ディジタルアナログ変換器 １４ スピーカ ３１，６３ ＭＯＤ（Ｉ）回路 ４１ カウンタ ４２ 微分回路 ４３，６１ アドレス発生回路 ４４，５１ メモリ ４５，６２，６５，７２，８２，９３ 加算回路 ６４，６５，９１，９２ 乗算器
Claims (3)
- 【請求項１】 マイクロホーンに入力される騒音を低減
させる信号を発生する適応フィルタのタップ値を、前記
マイクロホーンよりの出力と前記適応フィルタで発生し
た信号が前記マイクロホーンに到達するまでの伝達特性
を補償する信号とにより適応制御して前記マイクロホー
ンよりの騒音信号を低減するようにした騒音低減装置に
おいて、 前記適応フィルタで発生する信号および前記伝達特性を
補償する信号を発生させるための騒音の周期に同期した
パルスを発生させる同期パルス発生回路と、 前記同期パルス発生回路で発生したパルスの発生間隔を
検出するパルス間隔検出回路と、 前記パルス間隔検出回路で検出された間隔に等くなるよ
うに前記適応フィルタのタップ付遅延線の遅延量となる
タップ数に切替えるタップ数切替部と、を備えたことを
特徴とする騒音低減装置。 - 【請求項２】 前記伝達特性を補償する信号の発生を、
前記同期パルス発生回路よりのパルスに同期して不揮発
性メモリより読出して得るようにしたことを特徴とする
請求項１記載の騒音低減装置。 - 【請求項３】 前記適応フィルタのタップ値を、前記伝
達特性を補償するデータ値を格納したメモリに対応する
アドレス数に対応した数のタップ値のみ更新するように
したことを特徴とする請求項２記載の騒音低減装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19546292A JP3502401B2 (ja) | 1992-07-22 | 1992-07-22 | 騒音低減装置 |
| US08/094,449 US5426704A (en) | 1992-07-22 | 1993-07-21 | Noise reducing apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19546292A JP3502401B2 (ja) | 1992-07-22 | 1992-07-22 | 騒音低減装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0635487A true JPH0635487A (ja) | 1994-02-10 |
| JP3502401B2 JP3502401B2 (ja) | 2004-03-02 |
Family
ID=16341482
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19546292A Expired - Fee Related JP3502401B2 (ja) | 1992-07-22 | 1992-07-22 | 騒音低減装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3502401B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004015709A1 (ja) * | 2002-08-07 | 2004-02-19 | Sony Corporation | 適応ノイズ低減方法及び装置 |
-
1992
- 1992-07-22 JP JP19546292A patent/JP3502401B2/ja not_active Expired - Fee Related
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004015709A1 (ja) * | 2002-08-07 | 2004-02-19 | Sony Corporation | 適応ノイズ低減方法及び装置 |
| US7436968B2 (en) | 2002-08-07 | 2008-10-14 | Sony Corporation | Adaptive noise reduction method and device |
| CN100449634C (zh) * | 2002-08-07 | 2009-01-07 | 索尼株式会社 | 自适应噪声减弱方法和设备 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3502401B2 (ja) | 2004-03-02 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20031202 |
|
| A61 | First payment of annual fees (during grant procedure) |
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| R250 | Receipt of annual fees |
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