JPH06332966A - プリント板cadシステム - Google Patents
プリント板cadシステムInfo
- Publication number
- JPH06332966A JPH06332966A JP5116897A JP11689793A JPH06332966A JP H06332966 A JPH06332966 A JP H06332966A JP 5116897 A JP5116897 A JP 5116897A JP 11689793 A JP11689793 A JP 11689793A JP H06332966 A JPH06332966 A JP H06332966A
- Authority
- JP
- Japan
- Prior art keywords
- wiring
- processing
- cpus
- queue
- printed board
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/0005—Apparatus or processes for manufacturing printed circuits for designing circuits by computer
Abstract
本1本の配線の間の依存関係を考慮し、直列計算機で行
なったと同じ結果をより高速に得る。 【構成】配線処理を個別に実行することのできる複数の
CPUと、この複数のCPUが共通にアクセスできる共
有メモリからなるプリント板CADシステムであって、
前記共有メモリは配線の依存関係を示すテーブルと、依
存関係のある先行配線はないが配線が可能な配線を配線
待ちとして登録する配線待ち行列バッファを備え、前記
各CPUの内で1つのCPUだけは前記前処理、配線処
理および後処理を行なうが、他のCPUでは前処理と後
処理は行なわず両処理の間の配線処理だけを行なうよう
にし、前記配線待ち行列に基づく1本ずつの配線処理お
よび配線待ち行列バッファの更新が各CPUで並列的に
行なわれるように構成する。
Description
リント基板配線を並列的に行なわせるCAD(Computer
Aided Design )システムに関し、詳しくは並列計算機
によっても直列計算機と同じ配線処理結果が得られるよ
うにするための改善に関するものである。
を行なう場合は、図4に示すように予め決定した順番に
従って1本ずつの配線処理を繰り返し行なうことによっ
て全体の配線が完成されるような方式を採っていた。こ
の直列計算機による配線処理を高速化するために、複数
の計算機を用意し各計算機が個別に配線処理を行なうよ
うにしたいわゆる並列計算機システムがある。この種の
並列計算機システムによって直列計算機による場合と同
じ結果を得るためには、ある配線を行なうにあたってそ
の配線と依存関係にあるそれ以前の配線結果を必要とす
る。要するに、並列化にあたっては上記のような依存関
係を考慮する必要がある。
並列計算機によるプリント板CADシステムでは、直列
計算機による場合と同じ結果を得ようとする考えがなか
ったため、1本1本の配線の依存関係を考慮しないで配
線が行なわれている。このため並列計算機によって得ら
れるプリント基板配線の結果は、高速化はされるものの
直列計算機の結果と同じ結果が得られないという不具合
があった。
されたもので、並列計算機でプリント基板配線を行なう
際に1本1本の配線の間の依存関係を考慮し、直列計算
機で行なったと同じ結果をより高速に得ることのできる
プリント板CADシステムを実現しようとするものであ
る。
るために本発明では、配線処理を個別に実行することの
できる複数のCPUと、この複数のCPUが共通にアク
セスできる共有メモリからなるプリント板CADシステ
ムであって、前記共有メモリは配線の依存関係を示すテ
ーブルと、依存関係のある先行配線はないが配線が可能
な配線を配線待ちとして登録する配線待ち行列バッファ
を備え、前記各CPUの内で1つのCPUだけは前記前
処理、配線処理および後処理を行なうが、他のCPUで
は前処理と後処理は行なわず両処理の間の配線処理だけ
を行なうようにし、前記配線待ち行列に基づく1本ずつ
の配線処理および配線待ち行列バッファの更新が各CP
Uで並列的に行なわれるように構成したことを特徴とす
る。
配線領域に基づく依存関係により1本ずつの配線をスケ
ジューリング(1台1台のCPUへ割り当てること)を
することにより、直列計算機で行なったのと同じ配線結
果を得る。
本発明は計算機システムに関するものであり、CADの
機能、例えば配線処理等については直接関係がないの
で、その説明は省略する。図1は本発明に係るプリント
板CADシステムの一実施例を示す要部構成図である。
図において、1および2は並列計算機の処理装置(以下
CPUという)であり、それぞれ独立に異なった命令を
処理することができる。なお、ここではCPUが2つの
場合を例にとって説明してある。3は共有メモリであ
り、バス4を介してどのCPUからでもアクセスできる
ようになっている。この共有メモリ3は、各配線の依存
関係を示す表(テーブル)31と、依存関係のある先行
配線はないが配線が可能な配線を登録するバッファ(配
線待ち行列バッファ)32を有す。
図3の動作フローを参照して次に説明する。まず全体的
な動作について説明する。
よび配線待ち行列の初期登録を行なう。 (2) 1本の配線 1本の配線は、図3に示すように、配線待ち行列のチェ
ック、配線処理、配線待ち行列の更新と3つの部分(処
理)からなる。 配線待ち行列のチェックでは、配線可能なものがある
ときはその配線を待ち行列(バッファ32)から取出
し、ない場合はチェックを繰り返す。 配線処理は、プリント基板配線CADシステムが備え
ている配線アルゴリズムに従って配線を行なう。 配線待ち行列更新は、終了した配線について依存関係
を表わす表31を更新して、新たな配線可能な配線を配
線待ち行列バッファ32に登録する。 (3) 後処理 配線の後処理を行なう。
線で囲った部分の処理)が複数のCPUで別々に並列計
算される処理である。定められたある1つのCPUで前
処理を行なった後、処理が分割され複数のCPUで1本
ずつの配線処理が並列に計算される。すべての配線終了
に伴って分割された処理が統合されていき、1つのCP
Uだけが動作している直列状態になったところで後処理
が行なわれ、全体の処理が終了する。
慮しながら各CPUで別々に配線することができるの
で、直列計算機と同じ高品質で高配線率の結果が得られ
ると共に、複数のCPUで並列に配線処理を行なうため
全体としての処理の高速化も図られている。
列計算機でプリント基板配線を行なう場合に各配線の依
存関係を考慮するようにしたため、直列計算機と同じよ
うに高品質で高配線率の結果が得られ、さらに並列計算
の分だけ全体としての処理が高速になるという効果があ
る。
施例を示す要部構成図である。
る。
ーチャートである。
Claims (1)
- 【請求項1】配線処理を個別に実行することのできる複
数のCPUと、この複数のCPUが共通にアクセスでき
る共有メモリからなるプリント板CADシステムであっ
て、 前記共有メモリは配線の依存関係を示すテーブルと、依
存関係のある先行配線はないが配線が可能な配線を配線
待ちとして登録する配線待ち行列バッファを備え、 前記各CPUの内で1つのCPUだけは前記前処理、配
線処理および後処理を行なうが、他のCPUでは前処理
と後処理は行なわず両処理の間の配線処理だけを行なう
ようにし、前記配線待ち行列に基づく1本ずつの配線処
理および配線待ち行列バッファの更新が各CPUで並列
的に行なわれるように構成したことを特徴とするプリン
ト板CADシステム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5116897A JPH06332966A (ja) | 1993-05-19 | 1993-05-19 | プリント板cadシステム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5116897A JPH06332966A (ja) | 1993-05-19 | 1993-05-19 | プリント板cadシステム |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH06332966A true JPH06332966A (ja) | 1994-12-02 |
Family
ID=14698354
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5116897A Pending JPH06332966A (ja) | 1993-05-19 | 1993-05-19 | プリント板cadシステム |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH06332966A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007220114A (ja) * | 2006-02-13 | 2007-08-30 | Altera Corp | 集積回路のコンピュータ支援設計ソフトウェアをパラレル化する装置および方法 |
-
1993
- 1993-05-19 JP JP5116897A patent/JPH06332966A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007220114A (ja) * | 2006-02-13 | 2007-08-30 | Altera Corp | 集積回路のコンピュータ支援設計ソフトウェアをパラレル化する装置および方法 |
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Legal Events
Date | Code | Title | Description |
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Effective date: 20050315 Free format text: JAPANESE INTERMEDIATE CODE: A971007 |
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A521 | Written amendment |
Effective date: 20051026 Free format text: JAPANESE INTERMEDIATE CODE: A523 |
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A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20051129 |
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A521 | Written amendment |
Effective date: 20051228 Free format text: JAPANESE INTERMEDIATE CODE: A523 |
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Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20060208 |
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