JPH06311486A - 信号処理回路 - Google Patents
信号処理回路Info
- Publication number
- JPH06311486A JPH06311486A JP5094145A JP9414593A JPH06311486A JP H06311486 A JPH06311486 A JP H06311486A JP 5094145 A JP5094145 A JP 5094145A JP 9414593 A JP9414593 A JP 9414593A JP H06311486 A JPH06311486 A JP H06311486A
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- JP
- Japan
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- sampling
- signal
- lines
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Abstract
(57)【要約】
【目的】 画像表示期間のライン数が 400本の画像を、
縦 480ライン、横 640画素のＰＤＰ等に表示するに際
し、画像の縦横比がＰＤＰ等の縦横比に合うように画像
の横幅を圧縮する。 【構成】 同期信号入力部２よりの同期信号を基準と
し、サンプリング信号発生部３により、入力される映像
信号の画像表示期間のライン数を、表示部６の表示ライ
ン数で除した値に、表示器の１ラインの画素数を乗じた
数の画素数をサンプリングするためのサンプリング信号
を発生する。このサンプリング信号を制御部７を介しサ
ンプリング・Ａ／Ｄ変換部４に印加し、映像信号入力部
１よりの映像信号をサンプリングし、ディジタル信号に
変換する。ディジタル変換された画像データをフレーム
メモリ５に書き込み、同期信号入力部よりの同期信号を
基準としてこの画像データを読み出し、表示部６に入力
し画面に表示する。
縦 480ライン、横 640画素のＰＤＰ等に表示するに際
し、画像の縦横比がＰＤＰ等の縦横比に合うように画像
の横幅を圧縮する。 【構成】 同期信号入力部２よりの同期信号を基準と
し、サンプリング信号発生部３により、入力される映像
信号の画像表示期間のライン数を、表示部６の表示ライ
ン数で除した値に、表示器の１ラインの画素数を乗じた
数の画素数をサンプリングするためのサンプリング信号
を発生する。このサンプリング信号を制御部７を介しサ
ンプリング・Ａ／Ｄ変換部４に印加し、映像信号入力部
１よりの映像信号をサンプリングし、ディジタル信号に
変換する。ディジタル変換された画像データをフレーム
メモリ５に書き込み、同期信号入力部よりの同期信号を
基準としてこの画像データを読み出し、表示部６に入力
し画面に表示する。
Description
【０００１】
【産業上の利用分野】本発明は信号処理回路に係り、表
示画面より垂直サイズの小さい画像を表示画面に相応す
る縦横比の画像に変換するものに関する。
示画面より垂直サイズの小さい画像を表示画面に相応す
る縦横比の画像に変換するものに関する。
【０００２】
【従来の技術】垂直方向に 480ラインで、１ラインに 6
40画素を表示する、例えば、プラズマディスプレイパネ
ル（ＰＤＰ）等でなる表示器に、画像表示期間のライン
数が 400本の映像信号を入力した場合、図２（ロ）に示
す例のように、表示画面の下部に80ラインの無画像部分
が生ずる。すなわち、ＰＤＰ等の画面の縦横比が３対４
(480対640)であるのに対し、表示される画像の縦横比は
400対640 ＝３対4.8 の横長のものとなる。
40画素を表示する、例えば、プラズマディスプレイパネ
ル（ＰＤＰ）等でなる表示器に、画像表示期間のライン
数が 400本の映像信号を入力した場合、図２（ロ）に示
す例のように、表示画面の下部に80ラインの無画像部分
が生ずる。すなわち、ＰＤＰ等の画面の縦横比が３対４
(480対640)であるのに対し、表示される画像の縦横比は
400対640 ＝３対4.8 の横長のものとなる。
【０００３】
【発明が解決しようとする課題】本発明はこのような点
に鑑み、垂直方向に 480ライン、１ラインに 640画素を
表示する表示器に、画像表示期間のライン数が 400本の
映像信号を入力する場合、図２（イ）の如く、画像の横
幅を圧縮し、画像の縦横比を表示画面の縦横比に合わ
せ、違和感のない画像で表示できるものを提供すること
にある。
に鑑み、垂直方向に 480ライン、１ラインに 640画素を
表示する表示器に、画像表示期間のライン数が 400本の
映像信号を入力する場合、図２（イ）の如く、画像の横
幅を圧縮し、画像の縦横比を表示画面の縦横比に合わ
せ、違和感のない画像で表示できるものを提供すること
にある。
【０００４】
【課題を解決するための手段】本発明は上述の課題を解
決するため、画像表示期間のライン数が表示画面のライ
ン数より少ない映像信号を入力するものにおいて、前記
画像表示期間のライン数を表示画面のライン数で除した
値に表示画面の１ラインの画素数を乗じた数の画素数を
ンプリングするためのサンプリング信号を発生するサン
プリング信号発生部と、サンプリング信号発生部よりの
信号により前記映像信号をサンプリングしディジタル信
号に変換するサンプリング・Ａ／Ｄ変換部と、サンプリ
ング・Ａ／Ｄ変換部よりの信号を表示部に入力するよう
にした信号処理回路を提供するものである。
決するため、画像表示期間のライン数が表示画面のライ
ン数より少ない映像信号を入力するものにおいて、前記
画像表示期間のライン数を表示画面のライン数で除した
値に表示画面の１ラインの画素数を乗じた数の画素数を
ンプリングするためのサンプリング信号を発生するサン
プリング信号発生部と、サンプリング信号発生部よりの
信号により前記映像信号をサンプリングしディジタル信
号に変換するサンプリング・Ａ／Ｄ変換部と、サンプリ
ング・Ａ／Ｄ変換部よりの信号を表示部に入力するよう
にした信号処理回路を提供するものである。
【０００５】
【作用】以上のように構成したので、本発明による信号
処理回路においては、サンプリング信号発生部により、
映像信号と同時に入力される同期信号を基準として、画
像表示期間のライン数を表示画面のライン数で除した値
を表示器の１ラインの画素数に乗じた数の画素をサンプ
リングするためのサンプリング信号を発生し、入力され
る映像信号をサンプリングし、ディジタル信号に変換
し、表示器の駆動回路に入力し、前記同期信号により同
期をとって表示器に表示する。
処理回路においては、サンプリング信号発生部により、
映像信号と同時に入力される同期信号を基準として、画
像表示期間のライン数を表示画面のライン数で除した値
を表示器の１ラインの画素数に乗じた数の画素をサンプ
リングするためのサンプリング信号を発生し、入力され
る映像信号をサンプリングし、ディジタル信号に変換
し、表示器の駆動回路に入力し、前記同期信号により同
期をとって表示器に表示する。
【０００６】
【実施例】以下、図面に基づいて本発明による信号処理
回路の実施例を詳細に説明する。図１は本発明による信
号処理回路の一実施例の要部ブロック図である。図にお
いて、１は映像信号入力部で、画像表示期間のライン数
が 400の映像信号を入力する。２は同期信号入力部で、
前記映像信号と共に入力される同期信号を入力する。３
はサンプリング信号発生部で、同期信号入力部２よりの
水平同期信号を基準として、表示部６の表示画面の１ラ
インの画素数、例えば、 640の 5/6に相当する約 533画
素数をサンプリングするためのサンプリング信号を発生
する。４はサンプリング・Ａ／Ｄ変換部で、サンプリン
グ信号発生部３よりの信号により映像信号入力部１より
の映像信号をサンプリングし、ディジタル信号に変換す
る。５はフレームメモリで、サンプリング・Ａ／Ｄ変換
部４よりのフレームデータを記録する。表示部６は、フ
レームメモリ５より読み出したデータに基づいて画面に
表示する。７は制御部で、各部を制御する。
回路の実施例を詳細に説明する。図１は本発明による信
号処理回路の一実施例の要部ブロック図である。図にお
いて、１は映像信号入力部で、画像表示期間のライン数
が 400の映像信号を入力する。２は同期信号入力部で、
前記映像信号と共に入力される同期信号を入力する。３
はサンプリング信号発生部で、同期信号入力部２よりの
水平同期信号を基準として、表示部６の表示画面の１ラ
インの画素数、例えば、 640の 5/6に相当する約 533画
素数をサンプリングするためのサンプリング信号を発生
する。４はサンプリング・Ａ／Ｄ変換部で、サンプリン
グ信号発生部３よりの信号により映像信号入力部１より
の映像信号をサンプリングし、ディジタル信号に変換す
る。５はフレームメモリで、サンプリング・Ａ／Ｄ変換
部４よりのフレームデータを記録する。表示部６は、フ
レームメモリ５より読み出したデータに基づいて画面に
表示する。７は制御部で、各部を制御する。
【０００７】次に、本発明による信号処理回路の動作を
説明する。映像信号入力部１より画像表示期間のライン
数が 400本の映像信号が入力する。この映像信号と同時
に同期信号入力部２を介し入力する同期信号を基準とし
て、サンプリング信号発生部３により、画像表示期間の
ライン数 400を表示画面のライン数 480で除した値、す
なわち、5/6 に、表示部６の表示画面の１ラインの画素
数 640を乗じた、約 533画素数をサンプリングするため
のサンプリング信号を発生する。このサンプリング信号
により、制御部７を介しサンプリング・Ａ／Ｄ変換部４
において、映像信号入力部１よりの映像信号をサンプリ
ングし、ディジタル信号に変換する。ディジタル変換さ
れたデータをフレームメモリ５に書き込み、同期信号入
力部２よりの同期信号で同期をとってフレームメモリ５
よりデータを読み出し、表示部６に入力し、所要の信号
処理を行いＰＤＰ等に表示する。
説明する。映像信号入力部１より画像表示期間のライン
数が 400本の映像信号が入力する。この映像信号と同時
に同期信号入力部２を介し入力する同期信号を基準とし
て、サンプリング信号発生部３により、画像表示期間の
ライン数 400を表示画面のライン数 480で除した値、す
なわち、5/6 に、表示部６の表示画面の１ラインの画素
数 640を乗じた、約 533画素数をサンプリングするため
のサンプリング信号を発生する。このサンプリング信号
により、制御部７を介しサンプリング・Ａ／Ｄ変換部４
において、映像信号入力部１よりの映像信号をサンプリ
ングし、ディジタル信号に変換する。ディジタル変換さ
れたデータをフレームメモリ５に書き込み、同期信号入
力部２よりの同期信号で同期をとってフレームメモリ５
よりデータを読み出し、表示部６に入力し、所要の信号
処理を行いＰＤＰ等に表示する。
【０００８】フレームメモリ５に書き込まれる画像デー
タは、１ラインの画素数が約 533で、ライン数が 400の
ものである。この画像データを、映像信号と同時に入力
される同期信号を基準としてフレームメモリ５より読み
出すことにより、表示部６のＰＤＰ等の画面には、例え
ば、図２（イ）の如く、縦400 対横533 、すなわち縦横
比３対４の画像が表示される。
タは、１ラインの画素数が約 533で、ライン数が 400の
ものである。この画像データを、映像信号と同時に入力
される同期信号を基準としてフレームメモリ５より読み
出すことにより、表示部６のＰＤＰ等の画面には、例え
ば、図２（イ）の如く、縦400 対横533 、すなわち縦横
比３対４の画像が表示される。
【０００９】
【発明の効果】以上に説明したように、本発明による信
号処理回路によれば、例えば、縦 480ライン、横 640画
素のＰＤＰ等の画面に、画像表示期間のライン数が 400
本の画像を表示する際、画像の横方向をＰＤＰ等の縦横
比に合うように圧縮するものであるから、ＰＤＰ等の画
面には違和感のない画像を表示できる。
号処理回路によれば、例えば、縦 480ライン、横 640画
素のＰＤＰ等の画面に、画像表示期間のライン数が 400
本の画像を表示する際、画像の横方向をＰＤＰ等の縦横
比に合うように圧縮するものであるから、ＰＤＰ等の画
面には違和感のない画像を表示できる。
【図１】本発明による信号処理回路の一実施例の要部ブ
ロック図である。
ロック図である。
【図２】画像サイズの縮小を説明するための概念図であ
る。
る。
１ 映像信号入力部 ２ 同期信号入力部 ３ サンプリング信号発生部 ４ サンプリング・Ａ／Ｄ変換部 ５ フレームメモリ ６ 表示部 ７ 制御部
Claims (2)
- 【請求項１】 画像表示期間のライン数が表示画面のラ
イン数より少ない映像信号を入力するものにおいて、前
記画像表示期間のライン数を表示画面のライン数で除し
た値に表示画面の１ラインの画素数を乗じた数の画素数
でサンプリングするためのサンプリング信号を発生する
サンプリング信号発生部と、サンプリング信号発生部よ
りの信号により前記映像信号をサンプリングしディジタ
ル信号に変換するサンプリング・Ａ／Ｄ変換部と、サン
プリング・Ａ／Ｄ変換部よりの信号を表示部に入力する
ようにした信号処理回路。 - 【請求項２】 画像表示期間のライン数が 400本の映像
信号をライン数が 480本で１ラインの画素数が 640の画
面に表示するものにおいて、前記画像表示期間のライン
数 400を表示画面のライン数 480で除した値に表示画面
の１ラインの画素数 640に乗じた約 533画素数でサンプ
リングするためのサンプリング信号を発生するサンプリ
ング信号発生部と、サンプリング信号発生部よりの信号
により前記映像信号をサンプリングしディジタル信号に
変換するサンプリング・Ａ／Ｄ変換部と、サンプリング
・Ａ／Ｄ変換部よりの信号をプラズマディスプレイパネ
ル等でなる表示部に入力するようにした信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5094145A JPH06311486A (ja) | 1993-04-21 | 1993-04-21 | 信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5094145A JPH06311486A (ja) | 1993-04-21 | 1993-04-21 | 信号処理回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06311486A true JPH06311486A (ja) | 1994-11-04 |
Family
ID=14102221
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5094145A Pending JPH06311486A (ja) | 1993-04-21 | 1993-04-21 | 信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06311486A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100416849B1 (ko) * | 1997-06-20 | 2004-06-04 | 주식회사 대우일렉트로닉스 | Pdp-tv의구동장치및방법 |
-
1993
- 1993-04-21 JP JP5094145A patent/JPH06311486A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100416849B1 (ko) * | 1997-06-20 | 2004-06-04 | 주식회사 대우일렉트로닉스 | Pdp-tv의구동장치및방법 |
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