JPH06284056A - 位相制御回路 - Google Patents
位相制御回路Info
- Publication number
- JPH06284056A JPH06284056A JP5089256A JP8925693A JPH06284056A JP H06284056 A JPH06284056 A JP H06284056A JP 5089256 A JP5089256 A JP 5089256A JP 8925693 A JP8925693 A JP 8925693A JP H06284056 A JPH06284056 A JP H06284056A
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- JP
- Japan
- Prior art keywords
- phase
- output
- level
- control circuit
- distortion
- Prior art date
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B7/00—Radio transmission systems, i.e. using radiation field
- H04B7/02—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas
- H04B7/04—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas
- H04B7/08—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas at the receiving station
- H04B7/0837—Diversity systems; Multi-antenna system, i.e. transmission or reception using multiple antennas using two or more spaced independent antennas at the receiving station using pre-detection combining
- H04B7/084—Equal gain combining, only phase adjustments
Abstract
(57)【要約】
【目的】 スペースダイバーシティ受信装置で２つの入
力信号を合成する場合に、合成出力のレベル特性や波形
歪特性が良好となる様な位相で両入力信号を合成する。 【構成】 第１の入力信号の移相を行う第１の移相器４
をリセットしておき、第２の移相器９の移相量を±１８
０゜の範囲でスイープ制御する。そのときの合成器８の
出力のレベルＬ及び波形歪Ｄを各検波器１１，１２で夫
々検出し、位相対応にＬ及びＤを制御回路１３で記憶し
ておく。このＬ，Ｄが良好となる様な位相を求め、この
位相になる様第１の移相器４を制御すれば、合成器７の
合成出力はレベル特性、歪特性が共に良好となる。
力信号を合成する場合に、合成出力のレベル特性や波形
歪特性が良好となる様な位相で両入力信号を合成する。 【構成】 第１の入力信号の移相を行う第１の移相器４
をリセットしておき、第２の移相器９の移相量を±１８
０゜の範囲でスイープ制御する。そのときの合成器８の
出力のレベルＬ及び波形歪Ｄを各検波器１１，１２で夫
々検出し、位相対応にＬ及びＤを制御回路１３で記憶し
ておく。このＬ，Ｄが良好となる様な位相を求め、この
位相になる様第１の移相器４を制御すれば、合成器７の
合成出力はレベル特性、歪特性が共に良好となる。
Description
【０００１】
【産業上の利用分野】本発明は位相制御回路に関し、特
にスペースダイバーシティ受信装置における信号合成回
路に用いられる位相制御回路に関するものである。
にスペースダイバーシティ受信装置における信号合成回
路に用いられる位相制御回路に関するものである。
【０００２】
【従来の技術】従来のこの種の位相制御回路の例を図４
に示す。図において、合成されるべき２つの入力信号は
入力端子１，２へ夫々供給され、その合成出力信号は出
力端子３から導出されるようになっている。
に示す。図において、合成されるべき２つの入力信号は
入力端子１，２へ夫々供給され、その合成出力信号は出
力端子３から導出されるようになっている。
【０００３】入力端子１へ供給された一方の入力信号は
無限移相器（ＥＰＳ：Ｅｎｄｌｅｓｓ Ｐｈａｓｅ Ｓ
ｈｉｆｔｅｒ，以下単に移相器と称す）４を介して分波
器５へ印加される。また、入力端子２へ供給された他方
の入力信号は分波器６へ直接印加され、両分波器５，６
の各分波出力の一つ同士が合成器７により合成されて出
力端子３から合成出力信号として導出される。
無限移相器（ＥＰＳ：Ｅｎｄｌｅｓｓ Ｐｈａｓｅ Ｓ
ｈｉｆｔｅｒ，以下単に移相器と称す）４を介して分波
器５へ印加される。また、入力端子２へ供給された他方
の入力信号は分波器６へ直接印加され、両分波器５，６
の各分波出力の一つ同士が合成器７により合成されて出
力端子３から合成出力信号として導出される。
【０００４】両分波器５，６の各分波出力の他の一つ同
士が位相検波器14へ入力されて両信号の位相差情報が、
この位相検波器14から生成される。この位相差情報に応
じて制御回路15は移相器４の移相状態を制御するように
なっている。
士が位相検波器14へ入力されて両信号の位相差情報が、
この位相検波器14から生成される。この位相差情報に応
じて制御回路15は移相器４の移相状態を制御するように
なっている。
【０００５】すなわち，合成すべき２つの入力信号の位
相差を位相検波器14にて検出し、この位相差が零となる
様に一つの入力信号の位相を移相器４にて制御してお
り、これにより両入力信号が同相で合成器７で合成され
るように構成されているのである。
相差を位相検波器14にて検出し、この位相差が零となる
様に一つの入力信号の位相を移相器４にて制御してお
り、これにより両入力信号が同相で合成器７で合成され
るように構成されているのである。
【０００６】
【発明が解決しようとする課題】従来のこの様な位相制
御回路では、両入力信号の位相差情報のみを移相器の制
御情報として使用する構成であるために、２つの入力信
号の合成出力が最良の特性を有するかどうかわからない
という欠点がある。すなわち、合成信号のＣ／Ｎ（ノイ
ズ対キャリア比）や波形歪が良好になる様に、両入力信
号が合成されるかどうか不確定であるという欠点があ
る。
御回路では、両入力信号の位相差情報のみを移相器の制
御情報として使用する構成であるために、２つの入力信
号の合成出力が最良の特性を有するかどうかわからない
という欠点がある。すなわち、合成信号のＣ／Ｎ（ノイ
ズ対キャリア比）や波形歪が良好になる様に、両入力信
号が合成されるかどうか不確定であるという欠点があ
る。
【０００７】そこで、本発明はこの様な従来技術の欠点
を解決すべくなされたものであって、その目的とすると
ころは、合成出力信号のＣ／Ｎや波形歪が良好となる様
に両入力信号の位相状態を制御して合成することが可能
な位相制御回路を提供することにある。
を解決すべくなされたものであって、その目的とすると
ころは、合成出力信号のＣ／Ｎや波形歪が良好となる様
に両入力信号の位相状態を制御して合成することが可能
な位相制御回路を提供することにある。
【０００８】
【課題を解決するための手段】本発明による位相制御回
路は、第１の入力信号の位相を制御する第１の移相手段
と、この移相手段の出力と第２の入力信号とを合成して
出力する第１の合成手段と、前記第１の移相手段の出力
を更に移相制御する第２の移相手段と、この第２の移相
手段の出力と前記第２の入力信号とを合成する第２の合
成手段と、この第２の合成手段の出力レベル及び出力波
形歪を夫々検出するレベル検出手段及び歪検出手段と、
前記第２の移相手段の移相状態をスイープ制御してその
ときの前記レベル検出手段及び歪検出手段の各検出結果
を参照して前記第１の移相手段の移相状態を制御する制
御手段とを含むことを特徴とする。
路は、第１の入力信号の位相を制御する第１の移相手段
と、この移相手段の出力と第２の入力信号とを合成して
出力する第１の合成手段と、前記第１の移相手段の出力
を更に移相制御する第２の移相手段と、この第２の移相
手段の出力と前記第２の入力信号とを合成する第２の合
成手段と、この第２の合成手段の出力レベル及び出力波
形歪を夫々検出するレベル検出手段及び歪検出手段と、
前記第２の移相手段の移相状態をスイープ制御してその
ときの前記レベル検出手段及び歪検出手段の各検出結果
を参照して前記第１の移相手段の移相状態を制御する制
御手段とを含むことを特徴とする。
【０００９】
【実施例】図１は本発明の実施例を示す回路ブロック図
である。図において、合成されるべき２つの入力信号は
入力端子１，２へ夫々供給され，その合成出力信号は出
力端子３から導出されるようになっている。
である。図において、合成されるべき２つの入力信号は
入力端子１，２へ夫々供給され，その合成出力信号は出
力端子３から導出されるようになっている。
【００１０】入力端子１へ供給された一方の入力信号は
移相器４を介して分波器５へ印加される。また、入力端
子２へ供給された他方の入力信号は分波器６へ直接印加
され、両分波器５，６の各分波出力の一つ同士が合成器
７により合成されて出力端子３から合成出力信号として
導出される。
移相器４を介して分波器５へ印加される。また、入力端
子２へ供給された他方の入力信号は分波器６へ直接印加
され、両分波器５，６の各分波出力の一つ同士が合成器
７により合成されて出力端子３から合成出力信号として
導出される。
【００１１】分波器５の他の分波出力は第２の移相器
（ＥＰＳ）９を介して第２の合成器８の一入力となって
おり、その他入力には分波器６の他の分波出力が印加さ
れて、これ等両入力同士がこの合成器８にて合成され
る。この合成出力は分波器１０へ入力されて２つに分波
される。
（ＥＰＳ）９を介して第２の合成器８の一入力となって
おり、その他入力には分波器６の他の分波出力が印加さ
れて、これ等両入力同士がこの合成器８にて合成され
る。この合成出力は分波器１０へ入力されて２つに分波
される。
【００１２】この分波出力の一つはレベル検波器１１へ
入力され、他の一つは歪検波器１２へ入力される。レベ
ル検波器１１は合成器８の合成信号のレベルを検出する
ものであり、歪検波器１２はこの合成信号の波形歪を検
出するものである。尚、これ等レベル検波器１１及び歪
検波器１２は共に周知の構成の検波器を用いることがで
きるので、ここでは特に開示しない。
入力され、他の一つは歪検波器１２へ入力される。レベ
ル検波器１１は合成器８の合成信号のレベルを検出する
ものであり、歪検波器１２はこの合成信号の波形歪を検
出するものである。尚、これ等レベル検波器１１及び歪
検波器１２は共に周知の構成の検波器を用いることがで
きるので、ここでは特に開示しない。
【００１３】制御回路１３は第１及び第２の移相器４及
び９の移相状態の制御を行うものであり、第２の移相器
９の移相状態を±180 ゜の範囲でスイープ制御してその
ときのレベル検波器１１及び歪検波器１２の各検出結果
を参照し、第１の移相器４の移相状態の制御を行うもの
である。
び９の移相状態の制御を行うものであり、第２の移相器
９の移相状態を±180 ゜の範囲でスイープ制御してその
ときのレベル検波器１１及び歪検波器１２の各検出結果
を参照し、第１の移相器４の移相状態の制御を行うもの
である。
【００１４】この制御回路１３の制御動作につて図２及
び図３を参照しつつ詳細に説明する。図３を参照する
と、制御回路１３の動作フローチャートであり、先ず第
１の移相器４を初期移相状態にリセットする。例えば、
移相器４の移相量を“０”にリセットする（ステップ３
１）。
び図３を参照しつつ詳細に説明する。図３を参照する
と、制御回路１３の動作フローチャートであり、先ず第
１の移相器４を初期移相状態にリセットする。例えば、
移相器４の移相量を“０”にリセットする（ステップ３
１）。
【００１５】この状態で、第２の移相器９の移相状態
を、図２に示す如く、入力信号が−１８０゜から＋１８
０゜の範囲で連続的に変化する様にスイープ（掃引）制
御する（ステップ３２）。このスイープ制御中において
は、レベル検波器１１及び歪検波器１２の各検出結果
を、そのときの位相量と共に図示せぬメモリへ格納する
（ステップ３３，３４）。この格納処理が±１８０゜の
全範囲に亘って行われる（ステップ３５）。
を、図２に示す如く、入力信号が−１８０゜から＋１８
０゜の範囲で連続的に変化する様にスイープ（掃引）制
御する（ステップ３２）。このスイープ制御中において
は、レベル検波器１１及び歪検波器１２の各検出結果
を、そのときの位相量と共に図示せぬメモリへ格納する
（ステップ３３，３４）。この格納処理が±１８０゜の
全範囲に亘って行われる（ステップ３５）。
【００１６】このときのレベル検波器１１の検出結果が
図２のＬで示す曲線であり。歪検波器１２の検出結果が
図２のＤで示す曲線であるとすると、これ等検出データ
がメモリ内に一時的に格納されることになる。
図２のＬで示す曲線であり。歪検波器１２の検出結果が
図２のＤで示す曲線であるとすると、これ等検出データ
がメモリ内に一時的に格納されることになる。
【００１７】スイープ終了後、メモリ内の検出データ
Ｌ，Ｄが各位相対応に読出されて加算され、Ｌ＋Ｄなる
値が各位相毎に算出される。このＬ＋Ｄの値が図２のＬ
＋Ｄで示す曲線となる。図２の例では、Ｌのデータは縦
軸上方が大きなレベルであることを示し、Ｄのデータは
縦軸上方が小さな波形歪率であることを示す。従って、
Ｌ＋Ｄの最大となる位相点が、合成信号のレベル及び波
形歪の各特性が最良となる点とみなせるので、Ｌ＋Ｄが
最大となる位相が求められる（ステップ３６）。
Ｌ，Ｄが各位相対応に読出されて加算され、Ｌ＋Ｄなる
値が各位相毎に算出される。このＬ＋Ｄの値が図２のＬ
＋Ｄで示す曲線となる。図２の例では、Ｌのデータは縦
軸上方が大きなレベルであることを示し、Ｄのデータは
縦軸上方が小さな波形歪率であることを示す。従って、
Ｌ＋Ｄの最大となる位相点が、合成信号のレベル及び波
形歪の各特性が最良となる点とみなせるので、Ｌ＋Ｄが
最大となる位相が求められる（ステップ３６）。
【００１８】そして、入力端子１に印加される入力信号
の位相が、このステップ３６にて得られた位相になる様
に第１の移相器４の移相状態を制御してセットする（ス
テップ３７）。
の位相が、このステップ３６にて得られた位相になる様
に第１の移相器４の移相状態を制御してセットする（ス
テップ３７）。
【００１９】尚、第２の移相器９は通常時は移相量が零
となる様にリセットされるものとする。
となる様にリセットされるものとする。
【００２０】本例では、Ｌ＋Ｄの値が最大となる点の位
相を求めているが、一般にはＬとＤとの両項目が最良に
近い位相点、すなわちディジタル伝送の場合にはＢＥＲ
特性（ビットエラーレート特性）が略最良となる位相点
を検出すれば良い。
相を求めているが、一般にはＬとＤとの両項目が最良に
近い位相点、すなわちディジタル伝送の場合にはＢＥＲ
特性（ビットエラーレート特性）が略最良となる位相点
を検出すれば良い。
【００２１】合成すべき入力信号の条件が変化すれば、
再び図３のフローチャートの処理を繰返し行うようにす
ることで、常に最良の合成信号が出力端子３から得られ
ることになる。
再び図３のフローチャートの処理を繰返し行うようにす
ることで、常に最良の合成信号が出力端子３から得られ
ることになる。
【００２２】
【発明の効果】以上述べた如く、本発明によれば、合成
すべき２つの入力信号の合成後の位相に対するレベルと
波形歪との各検出結果に従って無限移相器を制御するよ
うにしたので、常に最良の特性を有する合成信号が得ら
れるという効果がある。
すべき２つの入力信号の合成後の位相に対するレベルと
波形歪との各検出結果に従って無限移相器を制御するよ
うにしたので、常に最良の特性を有する合成信号が得ら
れるという効果がある。
【図１】本発明の実施例の回路ブロック図である。
【図２】本発明の実施例のレベル検波特性及び波形歪検
波特性の各例を夫々に示す図である。
波特性の各例を夫々に示す図である。
【図３】本発明の実施例の制御回路の動作例を示すフロ
ーチャートである。
ーチャートである。
【図４】従来のスペースダイバシティ受信装置に用いら
れる位相制御回路のブロック図である。
れる位相制御回路のブロック図である。
１，２ 信号入力端 ３ 合成信号出力端子 ４，９ 無限移相器 ５，６，１０ 分波器 ７，８ 合成器 １１ レベル検波器 １２ 歪検波器 １３ 制御回路
Claims (2)
- 【請求項１】 第１の入力信号の位相を制御する第１の
移相手段と、この移相手段の出力と第２の入力信号とを
合成して出力する第１の合成手段と、前記第１の移相手
段の出力を更に移相制御する第２の移相手段と、この第
２の移相手段の出力と前記第２の入力信号とを合成する
第２の合成手段と、この第２の合成手段の出力レベル及
び出力波形歪を夫々検出するレベル検出手段及び歪検出
手段と、前記第２の移相手段の移相状態をスイープ制御
してそのときの前記レベル検出手段及び歪検出手段の各
検出結果を参照して前記第１の移相手段の移相状態を制
御する制御手段とを含むことを特徴とする位相制御回
路。 - 【請求項２】 前記制御手段は、前記第２の移相手段の
出力位相が±180 ゜の範囲で変化するようにこの第２の
移相手段を制御しつつそのときの前記レベル検出手段及
び歪検出手段の各検出結果に基きレベル及び波形歪が良
好となる前記第２の合成手段の合成出力位相を検出し、
この検出位相に前記第１の移相手段の移相状態を設定す
るよう構成されていることを特徴とする請求項１記載の
位相制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5089256A JPH0748688B2 (ja) | 1993-03-24 | 1993-03-24 | 位相制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5089256A JPH0748688B2 (ja) | 1993-03-24 | 1993-03-24 | 位相制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06284056A true JPH06284056A (ja) | 1994-10-07 |
| JPH0748688B2 JPH0748688B2 (ja) | 1995-05-24 |
Family
ID=13965688
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5089256A Expired - Fee Related JPH0748688B2 (ja) | 1993-03-24 | 1993-03-24 | 位相制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0748688B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1447926A1 (en) * | 2001-10-30 | 2004-08-18 | NEC Corporation | SPACE DIVERSITY RECEIVER, OPERATION CONTROL METHOD THEREOF, AND PROGRAM |
-
1993
- 1993-03-24 JP JP5089256A patent/JPH0748688B2/ja not_active Expired - Fee Related
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1447926A1 (en) * | 2001-10-30 | 2004-08-18 | NEC Corporation | SPACE DIVERSITY RECEIVER, OPERATION CONTROL METHOD THEREOF, AND PROGRAM |
| US7130593B2 (en) | 2001-10-30 | 2006-10-31 | Nec Corporation | Space diversity receiver, operation controll method thereof, and program |
| EP1447926A4 (en) * | 2001-10-30 | 2010-10-27 | Nec Corp | ROOM DIVERSITY RECEIVER, OPERATING PROCESS THEREFOR AND PROGRAM |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0748688B2 (ja) | 1995-05-24 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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