JPH06253331A - 可変長符号化信号に対応した編集装置 - Google Patents
可変長符号化信号に対応した編集装置Info
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- JPH06253331A JPH06253331A JP5039946A JP3994693A JPH06253331A JP H06253331 A JPH06253331 A JP H06253331A JP 5039946 A JP5039946 A JP 5039946A JP 3994693 A JP3994693 A JP 3994693A JP H06253331 A JPH06253331 A JP H06253331A
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Abstract
(57)【要約】
【目的】編集の際にデコ−ド、エンコードされる期間を
少なくして画質劣化を軽減する。 【構成】例えばＶＴＲ１からの第１の圧縮ビデオ信号の
次にＶＴＲ２からの第２の圧縮ビデオ信号を、ＶＴＲ４
に繋げて記録する。編集制御部１０３は、第１の圧縮ビ
デオ信号の編集点の直前の信号のエンコード、デコード
処理遅延時間ＤＬＡを計測し、また編集点から第２の圧
縮ビデオ信号のリフレッシュ期間までのデコード、エン
コード処理遅延時間ＤＬＢを計測し、それぞれ遅延回路
１０１、１０２に設定する。編集時には、スイッチャー
ＳＷ１を編集点で切り換え、エンコーダ３ｃから第２の
圧縮ビデオ信号（編集済み）のリフレッシュ処理信号が
得られるまで、スイッチャーＳＷ２に、そのエンコード
出力を選択させ、その後は直接遅延回路１０２から得ら
れてる第２の圧縮ビデオ信号を選択せしめる。
少なくして画質劣化を軽減する。 【構成】例えばＶＴＲ１からの第１の圧縮ビデオ信号の
次にＶＴＲ２からの第２の圧縮ビデオ信号を、ＶＴＲ４
に繋げて記録する。編集制御部１０３は、第１の圧縮ビ
デオ信号の編集点の直前の信号のエンコード、デコード
処理遅延時間ＤＬＡを計測し、また編集点から第２の圧
縮ビデオ信号のリフレッシュ期間までのデコード、エン
コード処理遅延時間ＤＬＢを計測し、それぞれ遅延回路
１０１、１０２に設定する。編集時には、スイッチャー
ＳＷ１を編集点で切り換え、エンコーダ３ｃから第２の
圧縮ビデオ信号（編集済み）のリフレッシュ処理信号が
得られるまで、スイッチャーＳＷ２に、そのエンコード
出力を選択させ、その後は直接遅延回路１０２から得ら
れてる第２の圧縮ビデオ信号を選択せしめる。
Description
【０００１】
【産業上の利用分野】この発明は、高能率符号化されて
記録されているビデオ信号を再生する複数の信号源（Ｖ
ＴＲ等）からの出力を編集するのに使用される編集装置
に関する。
記録されているビデオ信号を再生する複数の信号源（Ｖ
ＴＲ等）からの出力を編集するのに使用される編集装置
に関する。
【０００２】
【従来の技術】最近、フレーム間圧縮技術を用いてビデ
オ信号を数十分の一に圧縮するシステムが開発されてい
る。例えばＭＰＥＧの規格や米国のＡＴＶ方式の一提案
であるDigiCipher方式（商標）がある。このようなシス
テムでは、可変長符号化方式が採用されており、圧縮さ
れたビデオ信号の１フレーム分のデータ長は、固定では
なく可変長となる。
オ信号を数十分の一に圧縮するシステムが開発されてい
る。例えばＭＰＥＧの規格や米国のＡＴＶ方式の一提案
であるDigiCipher方式（商標）がある。このようなシス
テムでは、可変長符号化方式が採用されており、圧縮さ
れたビデオ信号の１フレーム分のデータ長は、固定では
なく可変長となる。
【０００３】このように可変長で圧縮された複数のビデ
オ信号を編集する場合、従来の編集装置の方法では任意
のフレーム単位での編集ができない。そこで、通常は、
複数の圧縮ビデオ信号を一旦それぞれデコードし、ベー
スバンドビデオ信号に変換し、各ベースバンドビデオ信
号を同期させて、スイッチャーにより選択導出して、１
本のベースバンドビデオ信号に編集して繋ぎ、その後、
再度エンコーダにより圧縮して保存用のＶＴＲに記録す
るという手法が取られる。図３は、従来の編集システム
を示している。
オ信号を編集する場合、従来の編集装置の方法では任意
のフレーム単位での編集ができない。そこで、通常は、
複数の圧縮ビデオ信号を一旦それぞれデコードし、ベー
スバンドビデオ信号に変換し、各ベースバンドビデオ信
号を同期させて、スイッチャーにより選択導出して、１
本のベースバンドビデオ信号に編集して繋ぎ、その後、
再度エンコーダにより圧縮して保存用のＶＴＲに記録す
るという手法が取られる。図３は、従来の編集システム
を示している。
【０００４】第１のＶＴＲ１から再生された第１の圧縮
ビデオ信号と、第２のＶＴＲ２から再生された第２の圧
縮ビデオ信号は、編集装置３に入力される。編集装置３
は、それぞれの圧縮ビデオ信号をデコーダ３ａ、３ｂに
より、一旦ベースバンドビデオ信号に変換する。それぞ
れのベースバンドビデオ信号は、スイッチャーＳＷにお
いて一方から他方に切り換えられ繋げられ編集された
後、エンコーダ３ｃに入力される。これにより、エンコ
ーダ３ｃからは、編集された第３の圧縮ビデオ信号が得
られ、第３のＶＴＲ４に記録される。
ビデオ信号と、第２のＶＴＲ２から再生された第２の圧
縮ビデオ信号は、編集装置３に入力される。編集装置３
は、それぞれの圧縮ビデオ信号をデコーダ３ａ、３ｂに
より、一旦ベースバンドビデオ信号に変換する。それぞ
れのベースバンドビデオ信号は、スイッチャーＳＷにお
いて一方から他方に切り換えられ繋げられ編集された
後、エンコーダ３ｃに入力される。これにより、エンコ
ーダ３ｃからは、編集された第３の圧縮ビデオ信号が得
られ、第３のＶＴＲ４に記録される。
【０００５】図４は、図３の第１のデコーダ３ａと、エ
ンコーダ３ｃを具体的に示している。ＶＴＲ１からの再
生圧縮ビデオ信号は、メモリ１１に入力され蓄積され
る。伝送上のフレーム長分が纏まりデータ判別がなされ
ると、復号化回路１２に入力されて可変長符号化信号が
復号される。復号された信号は、逆量子化回路１３に入
力されて逆量子化され、さらに逆ＤＣＴ回路１４に入力
されて逆ＤＣＴ処理され、ベースバンドビデオ信号のフ
レーム間差分信号、あるいはフレーム内信号に変換さ
れ、加算器１５に入力される。加算器１５では、フレー
ム間差分信号に対しては、動き補償回路１７からの１フ
レーム前の信号がスイッチ１６を介して加算される。こ
れにより、加算器１５からは再現された原フレームのベ
ースバンドビデオ信号が得られる。逆ＤＣＴ回路１４か
ら出力された信号がフレーム内処理された信号であった
場合、この信号は１フレーム分の全データを有するの
で、スイッチ１６はオフされ、そのまま加算器１５から
導出される。ベースバンド信号は、フレームメモリ１８
に入力され、次のフレーム間差分信号に加算するために
１フレーム遅延された動き補償回路１７に入力される。
ンコーダ３ｃを具体的に示している。ＶＴＲ１からの再
生圧縮ビデオ信号は、メモリ１１に入力され蓄積され
る。伝送上のフレーム長分が纏まりデータ判別がなされ
ると、復号化回路１２に入力されて可変長符号化信号が
復号される。復号された信号は、逆量子化回路１３に入
力されて逆量子化され、さらに逆ＤＣＴ回路１４に入力
されて逆ＤＣＴ処理され、ベースバンドビデオ信号のフ
レーム間差分信号、あるいはフレーム内信号に変換さ
れ、加算器１５に入力される。加算器１５では、フレー
ム間差分信号に対しては、動き補償回路１７からの１フ
レーム前の信号がスイッチ１６を介して加算される。こ
れにより、加算器１５からは再現された原フレームのベ
ースバンドビデオ信号が得られる。逆ＤＣＴ回路１４か
ら出力された信号がフレーム内処理された信号であった
場合、この信号は１フレーム分の全データを有するの
で、スイッチ１６はオフされ、そのまま加算器１５から
導出される。ベースバンド信号は、フレームメモリ１８
に入力され、次のフレーム間差分信号に加算するために
１フレーム遅延された動き補償回路１７に入力される。
【０００６】動き補償回路１７では、伝送されてくる次
のフレームの画像の動きベクトルを受けとり、前のフレ
ームの画像を原フレームの差分情報に合わせる方に補償
している。またスイッチ１６は、圧縮ビデオ信号から再
現した制御情報に基づき、原信号がフレーム間差分信号
であるかフレーム内信号であるかに応じてオン、オフ制
御される。原信号がフレーム内処理された信号が到来す
るのは、画像動きが極端に大きい場合、パンニングがあ
った場合があるが、一定の規則のもとにリフレッシュ期
間が設定されており、この期間はフレーム内処理された
信号となるように構築されている。なお動き補償回路１
７で使用される動き制御情報も、圧縮ビデオ信号から再
生された制御情報に含まれており、これらの制御情報
は、システム制御部（図示せず）から与えられている。
のフレームの画像の動きベクトルを受けとり、前のフレ
ームの画像を原フレームの差分情報に合わせる方に補償
している。またスイッチ１６は、圧縮ビデオ信号から再
現した制御情報に基づき、原信号がフレーム間差分信号
であるかフレーム内信号であるかに応じてオン、オフ制
御される。原信号がフレーム内処理された信号が到来す
るのは、画像動きが極端に大きい場合、パンニングがあ
った場合があるが、一定の規則のもとにリフレッシュ期
間が設定されており、この期間はフレーム内処理された
信号となるように構築されている。なお動き補償回路１
７で使用される動き制御情報も、圧縮ビデオ信号から再
生された制御情報に含まれており、これらの制御情報
は、システム制御部（図示せず）から与えられている。
【０００７】ベースバンドビデオ信号は、モニタ側の信
号処理部（図示せず）に送られると共に、スイッチャー
ＳＷにより選択されて、エンコーダ３ｃに入力される。
エンコーダ３ｃに導入されたベースバンドビデオ信号
は、スイッチ２１を介して減算器２２に入力される。な
お減算器２２に入力される前にブロック分割される。
号処理部（図示せず）に送られると共に、スイッチャー
ＳＷにより選択されて、エンコーダ３ｃに入力される。
エンコーダ３ｃに導入されたベースバンドビデオ信号
は、スイッチ２１を介して減算器２２に入力される。な
お減算器２２に入力される前にブロック分割される。
【０００８】減算器２２では、ベースバンドビデオ信号
に対して原フレーム信号と、その前のフレーム信号との
減算処理が行われ、フレーム間差分信号がとられる（フ
レーム間処理）。前フレームの信号は、動き補償回路３
２からスイッチ３３を介して加算器２２に供給されてい
る。フレーム内処理が行われる場合は、スイッチ３３が
オフされ、そのままベースバンド信号は加算器２２から
出力される。
に対して原フレーム信号と、その前のフレーム信号との
減算処理が行われ、フレーム間差分信号がとられる（フ
レーム間処理）。前フレームの信号は、動き補償回路３
２からスイッチ３３を介して加算器２２に供給されてい
る。フレーム内処理が行われる場合は、スイッチ３３が
オフされ、そのままベースバンド信号は加算器２２から
出力される。
【０００９】加算器２２の出力信号は、ＤＣＴ回路２３
に入力され離散コサイン変換（ＤＣＴ処理）され、さら
にこの出力信号は量子化回路２４に入力されて量子化さ
れる。量子化された信号が可変長符号化回路２５に入力
されて可変長符号化され、メモリ２６に入力される。メ
モリ２６の出力は、圧縮ビデオ信号としてＶＴＲ４に供
給される。
に入力され離散コサイン変換（ＤＣＴ処理）され、さら
にこの出力信号は量子化回路２４に入力されて量子化さ
れる。量子化された信号が可変長符号化回路２５に入力
されて可変長符号化され、メモリ２６に入力される。メ
モリ２６の出力は、圧縮ビデオ信号としてＶＴＲ４に供
給される。
【００１０】量子化回路２４の出力は、逆量子化回路２
７に入力されて逆量子化され、さらにこの出力は逆ＤＣ
Ｔ回路２８に入力されて逆ＤＣＴ処理され、この出力
は、加算器２９に入力される。加算器２９には、スイッ
チ３４を介して動き補償回路３２の出力が入力され、前
フレームの信号に対してフレーム間差分信号が加算され
原フレーム信号（加算器２２の入力信号に対しては前フ
レーム信号となる）が作成され、フレームメモリ３０に
入力される。逆ＤＣＴ回路２８から加算器２９に入力さ
れる信号がフレーム内信号であった場合は、スイッチ３
４はオフされ、当該フレーム内信号はそのままフレーム
メモリ３０に入力される。フレームメモリ３０から出力
される信号は、加算器２２に入力される信号に対する前
フレームの全ベースバンドビデオ信号であり、動き補償
回路３２に入力され動き補償される。動き補償回路３２
は、動き評価回路３１からの動きベクトルに基づいて画
像を修正する。動き評価回路３１は、フレームメモリ３
０の出力と、加算器２２に入力する信号とを比較して、
前フレームの画像に対して原フレームの画像の動き量を
検出し、前フレームの画像位置が原フレームの画像位置
に近付くように動き補償回路３２の信号を修正する。こ
れにより、例えば静止画が入力し続けている時は、減算
器２２からは差分信号はほとんどなく、伝送情報の低減
に有効となる。但し、フレーム内信号を伝送する場合
は、フレーム内のすべてのデータが伝送される。
７に入力されて逆量子化され、さらにこの出力は逆ＤＣ
Ｔ回路２８に入力されて逆ＤＣＴ処理され、この出力
は、加算器２９に入力される。加算器２９には、スイッ
チ３４を介して動き補償回路３２の出力が入力され、前
フレームの信号に対してフレーム間差分信号が加算され
原フレーム信号（加算器２２の入力信号に対しては前フ
レーム信号となる）が作成され、フレームメモリ３０に
入力される。逆ＤＣＴ回路２８から加算器２９に入力さ
れる信号がフレーム内信号であった場合は、スイッチ３
４はオフされ、当該フレーム内信号はそのままフレーム
メモリ３０に入力される。フレームメモリ３０から出力
される信号は、加算器２２に入力される信号に対する前
フレームの全ベースバンドビデオ信号であり、動き補償
回路３２に入力され動き補償される。動き補償回路３２
は、動き評価回路３１からの動きベクトルに基づいて画
像を修正する。動き評価回路３１は、フレームメモリ３
０の出力と、加算器２２に入力する信号とを比較して、
前フレームの画像に対して原フレームの画像の動き量を
検出し、前フレームの画像位置が原フレームの画像位置
に近付くように動き補償回路３２の信号を修正する。こ
れにより、例えば静止画が入力し続けている時は、減算
器２２からは差分信号はほとんどなく、伝送情報の低減
に有効となる。但し、フレーム内信号を伝送する場合
は、フレーム内のすべてのデータが伝送される。
【００１１】
【発明が解決しようとする課題】上述した編集システム
においては、編集を行う毎にビデオ信号のデコード処理
とエンコード処理が繰り返すことになる。しかし帯域圧
縮方式においては誤差発生メカニズムがもともと存在し
ているために、デコード、エンコード処理を繰り返すと
画質劣化を生じる。
においては、編集を行う毎にビデオ信号のデコード処理
とエンコード処理が繰り返すことになる。しかし帯域圧
縮方式においては誤差発生メカニズムがもともと存在し
ているために、デコード、エンコード処理を繰り返すと
画質劣化を生じる。
【００１２】図５には帯域圧縮方式における誤差発生メ
カニズムを示している。ここで、ＤＣＴ処理と逆ＤＣＴ
処理の演算精度は十分高いものとして無視すると、問題
になるのは、 （ａ）ＤＣＴ処理後の変換係数に対して量子化が行われ
るが、このときの量子化ステップ幅をＱとすると最大で
±Ｑ／２の誤差が生じる。
カニズムを示している。ここで、ＤＣＴ処理と逆ＤＣＴ
処理の演算精度は十分高いものとして無視すると、問題
になるのは、 （ａ）ＤＣＴ処理後の変換係数に対して量子化が行われ
るが、このときの量子化ステップ幅をＱとすると最大で
±Ｑ／２の誤差が生じる。
【００１３】（ｂ）逆ＤＣＴ処理後の変換係数は実数値
であるが、最終的には整数値に戻すために四捨五入を行
う。このときも丸め誤差として、±０．５内の誤差が発
生する。
であるが、最終的には整数値に戻すために四捨五入を行
う。このときも丸め誤差として、±０．５内の誤差が発
生する。
【００１４】２次元ＤＣＴを用いているので、（ｂ）の
±０．５内の誤差は再符号化されてＤＣＴの変換係数に
なったとき、８倍されて±４内の誤差になる（例えばＤ
ＣＴ符号化の繰り返しによる画質劣化の一考案、１９９
１年信学会春期全大Ｄ−３６０）。
±０．５内の誤差は再符号化されてＤＣＴの変換係数に
なったとき、８倍されて±４内の誤差になる（例えばＤ
ＣＴ符号化の繰り返しによる画質劣化の一考案、１９９
１年信学会春期全大Ｄ−３６０）。
【００１５】よって、編集の際にデコード、エンコード
を繰り返すことは再符号化の際のＤＣＴの変換係数に誤
差を累積するために画質劣化を生じ、それが編集テープ
全体にわたるという問題を生じる。
を繰り返すことは再符号化の際のＤＣＴの変換係数に誤
差を累積するために画質劣化を生じ、それが編集テープ
全体にわたるという問題を生じる。
【００１６】そこでこの発明は、編集の際にデコ−ド、
エンコードされる期間を出来るだけ少なくして画質劣化
を軽減することができる可変長符号化信号に対応した編
集装置を提供することを目的とする。
エンコードされる期間を出来るだけ少なくして画質劣化
を軽減することができる可変長符号化信号に対応した編
集装置を提供することを目的とする。
【００１７】
【課題を解決するための手段】この発明は、複数の圧縮
ビデオ信号を繋ぎ合わせて編集済み圧縮ビデオ信号を出
力する編集装置において、編集のために入力切り換え指
示の第１の時点からリフレッシュ信号が入力される第２
の時点までは、入力圧縮ビデオ信号をエンコード、デコ
ードしたものを繋ぎ合わせた編集済み圧縮ビデオ信号と
し、第２の時点以降は、入力圧縮ビデオ信号を直接選択
して、前記編集済み圧縮ビデオ信号に連続させる手段と
を有する。
ビデオ信号を繋ぎ合わせて編集済み圧縮ビデオ信号を出
力する編集装置において、編集のために入力切り換え指
示の第１の時点からリフレッシュ信号が入力される第２
の時点までは、入力圧縮ビデオ信号をエンコード、デコ
ードしたものを繋ぎ合わせた編集済み圧縮ビデオ信号と
し、第２の時点以降は、入力圧縮ビデオ信号を直接選択
して、前記編集済み圧縮ビデオ信号に連続させる手段と
を有する。
【００１８】
【作用】上記の手段により、デコード、エンコードを行
った期間は少ない期間であり、画質劣化が生じるのを抑
えることができる。
った期間は少ない期間であり、画質劣化が生じるのを抑
えることができる。
【００１９】
【実施例】以下、この発明の実施例を図面を参照して説
明する。
明する。
【００２０】図１はこの発明の一実施例である。ＶＴＲ
１からは第１の圧縮ビデオ信号が再生され、ＶＴＲ２か
らは第２の圧縮ビデオ信号が再生され、この再生圧縮ビ
デオ信号は、編集装置１００に入力される。第１の圧縮
ビデオ信号は、可変遅延回路１０１とデコーダ３ａに入
力される。第２の圧縮ビデオ信号は、可変遅延回路１０
２とデコーダ３ｂに入力される。デコーダ３ａと３ｂ
は、図４にて説明した構成と同様な構成である。デコー
ダ３ａ、３ｂの出力（ベースバンドビデオ信号）は、第
１のスイッチャーＳＷ１に供給される。第１のスイッチ
ャーＳＷ１で選択されたベースバンドビデオ信号は、編
集済みの信号としてエンコーダ３ｃに入力され、再び圧
縮ビデオ信号に変換される。エンコーダ３ｃについて
も、図４で説明した通りである。
１からは第１の圧縮ビデオ信号が再生され、ＶＴＲ２か
らは第２の圧縮ビデオ信号が再生され、この再生圧縮ビ
デオ信号は、編集装置１００に入力される。第１の圧縮
ビデオ信号は、可変遅延回路１０１とデコーダ３ａに入
力される。第２の圧縮ビデオ信号は、可変遅延回路１０
２とデコーダ３ｂに入力される。デコーダ３ａと３ｂ
は、図４にて説明した構成と同様な構成である。デコー
ダ３ａ、３ｂの出力（ベースバンドビデオ信号）は、第
１のスイッチャーＳＷ１に供給される。第１のスイッチ
ャーＳＷ１で選択されたベースバンドビデオ信号は、編
集済みの信号としてエンコーダ３ｃに入力され、再び圧
縮ビデオ信号に変換される。エンコーダ３ｃについて
も、図４で説明した通りである。
【００２１】エンコーダ３ｃの出力は、第２のスイッチ
ャーＳＷ２に入力される。第２のスイッチャーＳＷ２に
は、先の遅延回路１０１、１０２の出力も供給されてい
る。第２のスイッチャーＳＷ２は、後述されるように、
編集点（スイッチャーＳＷ１の信号選択が、例えば第１
のデコーダ出力から第２のデコーダ出力の選択に切替わ
った時点）から、第２の圧縮ビデオ信号のリフレッシュ
信号期間までは、エンコーダ３ｃの出力を選択し、その
後は、直接、第２の圧縮ビデオ信号（遅延回路１０２の
出力）を選択導出するようになっている。逆に、スイッ
チャーＳＷ１の信号選択が、例えば第２のデコーダ出力
から第１のデコーダ出力の選択に切替わった場合は、そ
の時点（編集点）から、第１の圧縮ビデオ信号のリフレ
ッシュ信号期間が到来するまでは、エンコーダ３ｃの出
力を選択し、その後は、直接、第１の圧縮ビデオ信号
（遅延回路１０１の出力）を選択導出するようになって
いる。第２のスイッチャーＳＷ２で選択された信号（編
集済みの圧縮ビデオ信号）は、ＶＴＲ４に入力されて記
録される。上記した遅延回路１０１、１０２の遅延量の
設定及びスイッチャーＳＷ１、ＳＷ２の切り換え制御
は、編集制御部１０３からの制御信号によって行われ
る。図２は、上記のシステムの動作を説明するために示
したタイミングチャートである。
ャーＳＷ２に入力される。第２のスイッチャーＳＷ２に
は、先の遅延回路１０１、１０２の出力も供給されてい
る。第２のスイッチャーＳＷ２は、後述されるように、
編集点（スイッチャーＳＷ１の信号選択が、例えば第１
のデコーダ出力から第２のデコーダ出力の選択に切替わ
った時点）から、第２の圧縮ビデオ信号のリフレッシュ
信号期間までは、エンコーダ３ｃの出力を選択し、その
後は、直接、第２の圧縮ビデオ信号（遅延回路１０２の
出力）を選択導出するようになっている。逆に、スイッ
チャーＳＷ１の信号選択が、例えば第２のデコーダ出力
から第１のデコーダ出力の選択に切替わった場合は、そ
の時点（編集点）から、第１の圧縮ビデオ信号のリフレ
ッシュ信号期間が到来するまでは、エンコーダ３ｃの出
力を選択し、その後は、直接、第１の圧縮ビデオ信号
（遅延回路１０１の出力）を選択導出するようになって
いる。第２のスイッチャーＳＷ２で選択された信号（編
集済みの圧縮ビデオ信号）は、ＶＴＲ４に入力されて記
録される。上記した遅延回路１０１、１０２の遅延量の
設定及びスイッチャーＳＷ１、ＳＷ２の切り換え制御
は、編集制御部１０３からの制御信号によって行われ
る。図２は、上記のシステムの動作を説明するために示
したタイミングチャートである。
【００２２】図２（ａ）はベースバンドビデオ信号のフ
レーム周期を示す。図２（ｂ）は第１のＶＴＲ１から出
力される圧縮ビデオ信号、図２（ｃ）はＶＴＲ２から出
力される圧縮ビデオ信号である。図２（ｄ）は第１のデ
コーダから出力される第１のベースバンドビデオ信号、
図２（ｅ）は第２のデコーダから出力される第２のベー
スバンドビデオ信号である。図２（ｆ）は第１のスイッ
チャーＳＷ１の出力、図２（ｇ）はエンコーダ３ｃから
出力される圧縮ビデオ信号である。図２（ｈ）は第１の
可変遅延回路１０１の出力、図２（ｉ）は第２の可変遅
延回路１０２の出力であり、図２（ｊ）は第２のスイッ
チャーＳＷ２の出力である。今、編集点Ｘ１を、第１の
ＶＴＲ出力のＡ３の直後にし、この後に第２のＶＴＲの
出力Ｂ１を繋ぐものとする。
レーム周期を示す。図２（ｂ）は第１のＶＴＲ１から出
力される圧縮ビデオ信号、図２（ｃ）はＶＴＲ２から出
力される圧縮ビデオ信号である。図２（ｄ）は第１のデ
コーダから出力される第１のベースバンドビデオ信号、
図２（ｅ）は第２のデコーダから出力される第２のベー
スバンドビデオ信号である。図２（ｆ）は第１のスイッ
チャーＳＷ１の出力、図２（ｇ）はエンコーダ３ｃから
出力される圧縮ビデオ信号である。図２（ｈ）は第１の
可変遅延回路１０１の出力、図２（ｉ）は第２の可変遅
延回路１０２の出力であり、図２（ｊ）は第２のスイッ
チャーＳＷ２の出力である。今、編集点Ｘ１を、第１の
ＶＴＲ出力のＡ３の直後にし、この後に第２のＶＴＲの
出力Ｂ１を繋ぐものとする。
【００２３】編集制御部１０３は、編集点Ｘ１となるＡ
３の終点に着目して、ＶＴＲ１からエンコーダ３ｃまで
の遅延量ＤＬＡを計測する。同様に編集制御部１０３
は、編集点Ｘ１となるＢ１の始点からリフレッシュ周期
分だけ遅れたＢ３の終端に着目して、ＶＴＲ２からエン
コーダ３ｃ出力までの遅延量ＤＬＢを計測する。このよ
うに求めた遅延量ＤＬＡとＤＬＢを編集制御部１０３そ
れぞれ遅延回路１０１と１０２に設定する。
３の終点に着目して、ＶＴＲ１からエンコーダ３ｃまで
の遅延量ＤＬＡを計測する。同様に編集制御部１０３
は、編集点Ｘ１となるＢ１の始点からリフレッシュ周期
分だけ遅れたＢ３の終端に着目して、ＶＴＲ２からエン
コーダ３ｃ出力までの遅延量ＤＬＢを計測する。このよ
うに求めた遅延量ＤＬＡとＤＬＢを編集制御部１０３そ
れぞれ遅延回路１０１と１０２に設定する。
【００２４】この遅延量の設定は、編集準備段階であ
り、ユーザは、ＶＴＲ１、ＶＴＲ２の再生出力をモニタ
しながら、編集点Ｘ１を決める。編集点Ｘ１を決める方
法としては、編集制御部１０３の機能や、ＶＴＲの機能
により各種の方法がある。例えばＶＴＲ１を再生して、
モニタを見ながら編集点指定スイッチを押すと、その時
の例えばテープ位置アドレスが編集制御部１０３に記憶
される。またＶＴＲ２の再生出力をモニタしながら、編
集点指定スイッチを押すと、その時の例えばテープ位置
アドレスが編集制御部１０３に記憶される。またこのと
き、編集点の前後が再生されるので、編集制御部１０３
では、先の遅延量ＤＬＡ、ＤＬＢを求めることができ
る。
り、ユーザは、ＶＴＲ１、ＶＴＲ２の再生出力をモニタ
しながら、編集点Ｘ１を決める。編集点Ｘ１を決める方
法としては、編集制御部１０３の機能や、ＶＴＲの機能
により各種の方法がある。例えばＶＴＲ１を再生して、
モニタを見ながら編集点指定スイッチを押すと、その時
の例えばテープ位置アドレスが編集制御部１０３に記憶
される。またＶＴＲ２の再生出力をモニタしながら、編
集点指定スイッチを押すと、その時の例えばテープ位置
アドレスが編集制御部１０３に記憶される。またこのと
き、編集点の前後が再生されるので、編集制御部１０３
では、先の遅延量ＤＬＡ、ＤＬＢを求めることができ
る。
【００２５】次に実際の編集動作が行われる。ＶＴＲ
１、ＶＴＲ２は、例えば編集制御部１０３により同期し
てスタート制御されるが、そのスタートタイミングは、
テープアドレスを基準にしてテープ巻き戻しを行い、図
２のタイムチャートの関係が成立する状態でスタートさ
れる。編集点Ｘ１では、編集制御部１０３によりスイッ
チャーＳＷ１が制御され、図２（ｆ）のような出力がス
イッチャーＳＷ１から得られ、この信号がエンコーダ３
ｃでエンコードされる（図２（ｇ））。
１、ＶＴＲ２は、例えば編集制御部１０３により同期し
てスタート制御されるが、そのスタートタイミングは、
テープアドレスを基準にしてテープ巻き戻しを行い、図
２のタイムチャートの関係が成立する状態でスタートさ
れる。編集点Ｘ１では、編集制御部１０３によりスイッ
チャーＳＷ１が制御され、図２（ｆ）のような出力がス
イッチャーＳＷ１から得られ、この信号がエンコーダ３
ｃでエンコードされる（図２（ｇ））。
【００２６】スイッチャーＳＷ２では、時点Ｘ２（図２
（ｊ））、つまり第１の圧縮ビデオ信号（遅延されてい
る）のＡ３の終端までは、遅延回路１０１の出力を選択
するが、この終端は編集点であるから、エンコーダ３ｃ
からの圧縮ビデオ信号Ｂ１''、Ｂ２''…を選択する。ス
イッチャーＳＷ２の切り換えタイミングは、先に説明し
たように予め編集制御部１０３がテープアドレスを把握
し、テープ巻き戻し制御も行っているので容易に決定で
きる。このエンコーダ３ｃからの圧縮ビデオ信号Ｂ
１''、Ｂ２''…を選択を続ける期間は、先のように遅延
量ＤＢＬを求めているので、遅延回路１０２から、Ｂ４
の始点が出力されるまでである。以降は、スイッチャー
ＳＷ２は、遅延回路１０２からの圧縮ビデオ信号を直接
選択導出してＶＴＲ４に入力する。
（ｊ））、つまり第１の圧縮ビデオ信号（遅延されてい
る）のＡ３の終端までは、遅延回路１０１の出力を選択
するが、この終端は編集点であるから、エンコーダ３ｃ
からの圧縮ビデオ信号Ｂ１''、Ｂ２''…を選択する。ス
イッチャーＳＷ２の切り換えタイミングは、先に説明し
たように予め編集制御部１０３がテープアドレスを把握
し、テープ巻き戻し制御も行っているので容易に決定で
きる。このエンコーダ３ｃからの圧縮ビデオ信号Ｂ
１''、Ｂ２''…を選択を続ける期間は、先のように遅延
量ＤＢＬを求めているので、遅延回路１０２から、Ｂ４
の始点が出力されるまでである。以降は、スイッチャー
ＳＷ２は、遅延回路１０２からの圧縮ビデオ信号を直接
選択導出してＶＴＲ４に入力する。
【００２７】上記の編集システムによると、編集後の圧
縮ビデオ信号は、編集装置１００においてデコード、エ
ンコードされた部分はＢ１''〜Ｂ３''である。このため
に、デコード、エンコードにより画質劣化が生じる部分
は、リフレッシュ期間内に抑えることができ全体的な画
質劣化を防止することができる。また、この方式では、
編集点の制限はなくフレーム単位での任意の点でも編集
が可能となりその効果は大きい。
縮ビデオ信号は、編集装置１００においてデコード、エ
ンコードされた部分はＢ１''〜Ｂ３''である。このため
に、デコード、エンコードにより画質劣化が生じる部分
は、リフレッシュ期間内に抑えることができ全体的な画
質劣化を防止することができる。また、この方式では、
編集点の制限はなくフレーム単位での任意の点でも編集
が可能となりその効果は大きい。
【００２８】なお上記の編集方式は、一例を述べたもの
で、編集のために編集点を決める方法としては各種の実
施例が可能である。例えば、再生テープ自体にテープ位
置アドレスが記録されているものであれば、これを利用
して編集点データを編集制御部に記憶させるようにして
も良い。即ち、モニタを見ながら再生を行い、編集すべ
き画面が現れ時にユーザが指示操作すると、自動的にそ
の画面位置のアドレスが記憶され、遅延回路１０１や１
０２の遅延量を計算できるようにしても良い。また、圧
縮ビデオ信号のデコード、エンコード遅延時間は、可変
長符号化信号であるから編集点の前後の信号の符号長に
より異なる。しかし例えばリフレッシュ期間までの遅延
時間を計測する場合は、各フレーム分の符号長とフレー
ム数、さらにデコード出力が一定のフレーム周波数であ
ることから判定できることになる。例えば、図２の例で
説明すると、編集点（Ａ３の後にＢ１を繋げる）が決ま
れば、Ａ３がエンコーダ３ｃからどの位遅延して出力さ
れるかを計測し、次に、Ｂ１がどの位遅延して出力され
るかを計測する。次に、編集の際に、ＶＴＲ１と２をス
タートさせるときに、同期させてスタートさせ、スイッ
チャーＳＷ１を切り換えて繋げれば、図２（ｊ）のよう
に、エンコーダ３ｃの出力はＡ３、Ｂ１''というふうに
繋がる。次にスイッチャーＳＷ２をエンコーダ３ｃから
遅延回路１０２に切り換えるタイミングであるが、これ
は、図２（ｊ）ではＢ４（リフレッシュ信号）を繋げて
いるが必ずしもこれに限定されるものではない。これは
例えばＭＰＥＧの様にＩフレームを含む圧縮方式の場
合、Ｂ１がリフレッシュ信号であれば良い。第２の圧縮
ビデオ信号の編集点では、先頭の信号Ｂ１としてリフレ
ッシュ信号が都合良く選定されている。リフレッシュ信
号であるかどうかを見分けるには、予め圧縮ビデオ信号
（可変長符号化信号）にリフレッシュ識別情報を含んで
いるので、編集準備段階にモニタする時に編集装置１０
３において判定することができる。
で、編集のために編集点を決める方法としては各種の実
施例が可能である。例えば、再生テープ自体にテープ位
置アドレスが記録されているものであれば、これを利用
して編集点データを編集制御部に記憶させるようにして
も良い。即ち、モニタを見ながら再生を行い、編集すべ
き画面が現れ時にユーザが指示操作すると、自動的にそ
の画面位置のアドレスが記憶され、遅延回路１０１や１
０２の遅延量を計算できるようにしても良い。また、圧
縮ビデオ信号のデコード、エンコード遅延時間は、可変
長符号化信号であるから編集点の前後の信号の符号長に
より異なる。しかし例えばリフレッシュ期間までの遅延
時間を計測する場合は、各フレーム分の符号長とフレー
ム数、さらにデコード出力が一定のフレーム周波数であ
ることから判定できることになる。例えば、図２の例で
説明すると、編集点（Ａ３の後にＢ１を繋げる）が決ま
れば、Ａ３がエンコーダ３ｃからどの位遅延して出力さ
れるかを計測し、次に、Ｂ１がどの位遅延して出力され
るかを計測する。次に、編集の際に、ＶＴＲ１と２をス
タートさせるときに、同期させてスタートさせ、スイッ
チャーＳＷ１を切り換えて繋げれば、図２（ｊ）のよう
に、エンコーダ３ｃの出力はＡ３、Ｂ１''というふうに
繋がる。次にスイッチャーＳＷ２をエンコーダ３ｃから
遅延回路１０２に切り換えるタイミングであるが、これ
は、図２（ｊ）ではＢ４（リフレッシュ信号）を繋げて
いるが必ずしもこれに限定されるものではない。これは
例えばＭＰＥＧの様にＩフレームを含む圧縮方式の場
合、Ｂ１がリフレッシュ信号であれば良い。第２の圧縮
ビデオ信号の編集点では、先頭の信号Ｂ１としてリフレ
ッシュ信号が都合良く選定されている。リフレッシュ信
号であるかどうかを見分けるには、予め圧縮ビデオ信号
（可変長符号化信号）にリフレッシュ識別情報を含んで
いるので、編集準備段階にモニタする時に編集装置１０
３において判定することができる。
【００２９】
【発明の効果】以上説明したようにこの発明によれば、
編集の際にデコ−ド、エンコードされる期間を出来るだ
け少なくして画質劣化を軽減することができる。
編集の際にデコ−ド、エンコードされる期間を出来るだ
け少なくして画質劣化を軽減することができる。
【図１】この発明の一実施例を示すブロック図。
【図２】図１の装置の動作例を示すタイミングチャー
ト。
ト。
【図３】図３は従来考えられる編集装置のブロック図。
【図４】図３のデコーダ及びエンコーダを詳しく示す
図。
図。
【図５】デコードとエンコードによる画質劣化を説明す
るための図。
るための図。
１、２、４…ＶＴＲ、３ａ、３ｂ…デコーダ、３ｃ…エ
ンコーダ、１００…編集装置、１０１、１０２…遅延回
路、１０３…編集制御部。
ンコーダ、１００…編集装置、１０１、１０２…遅延回
路、１０３…編集制御部。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 9/81 Ａ 7916−5Ｃ
Claims (3)
- 【請求項１】可変長符号化され圧縮された第１、第２の
圧縮ビデオ信号をそれぞれ元のベースバンドビデオ信号
に戻す第１、第２のデコーダと、 デコードした第１のベースバンドビデオ信号の選択状態
から第２のベースバンドビデオ信号の選択状態に切り換
えて第３のベースバンドビデオ信号として導出する第１
の切り換え制御手段と、 前記第１の切り換え制御信号から出力された第３のベー
スバンドビデオ信号を再度可変長符号化した第３の圧縮
ビデオ信号にエンコードするエンコーダと、 前記エンコーダからの第３の圧縮ビデオ信号を選択した
状態から前記第２の圧縮ビデオ信号を直接選択する際、
前記第３の圧縮ビデオ信号を選択した時点から前記直接
選択する時点までの期間を前記第２の圧縮ビデオ信号の
少なくともリフレッシュ期間に設定する第２の切り換え
制御手段とを具備したことを特徴とする可変長符号化信
号に対応した編集装置。 - 【請求項２】可変長符号化され圧縮された第１、第２の
圧縮ビデオ信号をそれぞれ元のベースバンドビデオ信号
に戻す第１、第２のデコーダと、 デコードした第１のベースバンドビデオ信号の選択状態
から第２のベースバンドビデオ信号の選択状態に切り換
える際、その切り換えポイントをフレーム内処理された
圧縮ビデオ信号をデコードした第２のベースバンドの先
頭として切り換え第３のベースバンドビデオ信号とする
第１の切り換え制御手段と、 前記第１の切り換え制御手段から出力された第３のベー
スバンドビデオ信号を再度可変長符号化した第３の圧縮
ビデオ信号にエンコードするエンコーダと、 前記エンコーダからの第３の圧縮ビデオ信号を選択した
状態から、任意の同期位置タイミングで前記第２の圧縮
ビデオ信号を直接選択する第２の切り換え制御手段とを
具備したことを特徴とする可変長符号化信号に対応した
編集装置。 - 【請求項３】可変長符号化され圧縮された第１、第２の
圧縮ビデオ信号をそれぞれ元のベースバンドビデオ信号
に戻す第１、第２のデコーダと、 デコードした第１のベースバンドビデオ信号の選択状態
から第２のベースバンドビデオ信号の選択状態に切り換
えて第３のベースバンドビデオ信号として導出する第１
の切り換え制御手段と、 前記第１の切り換え制御信号から出力された第３のベー
スバンドビデオ信号を再度可変長符号化した第３の圧縮
ビデオ信号にエンコードするエンコーダと、 前記第１の切り換え制御手段により切り換えられる前の
フレームの第１の圧縮ビデオ信号が前記デコード、エン
コードされる遅延時間と、前記第１の切り換え制御手段
により切り換えられた後のフレームの第２の圧縮ビデオ
信号が前記デコード、エンコードされる遅延時間とをも
ち、前記第１、第２の圧縮ビデオ信号をそれぞれ遅延す
る遅延手段と、 前記遅延手段からの遅延された第１、第２の圧縮ビデオ
信号が供給され、かつ前記エンコーダからの第３の圧縮
ビデオ信号を選択した状態から前記第２の圧縮ビデオ信
号を直接選択する際、前記第３の圧縮ビデオ信号を選択
した時点から前記直接選択する時点までの期間を前記第
２の圧縮ビデオ信号の少なくともリフレッシュ期間に設
定する第２の切り換え制御手段とを具備したことを特徴
とする可変長符号化信号に対応した編集装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5039946A JPH06253331A (ja) | 1993-03-01 | 1993-03-01 | 可変長符号化信号に対応した編集装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5039946A JPH06253331A (ja) | 1993-03-01 | 1993-03-01 | 可変長符号化信号に対応した編集装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06253331A true JPH06253331A (ja) | 1994-09-09 |
Family
ID=12567128
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5039946A Pending JPH06253331A (ja) | 1993-03-01 | 1993-03-01 | 可変長符号化信号に対応した編集装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06253331A (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0846975A (ja) * | 1994-07-29 | 1996-02-16 | Matsushita Electric Ind Co Ltd | 圧縮画像符号列編集装置 |
| WO1999005864A1 (fr) * | 1997-07-25 | 1999-02-04 | Sony Corporation | Dispositif d'edition, procede d'edition, dispositif d'epissage, procede d'epissage, dispositif de codage et procede de codage |
| WO1999036912A1 (fr) * | 1998-01-19 | 1999-07-22 | Sony Corporation | Systeme d'edition, dispositif de commande d'edition et procede de commande d'edition |
| JP2002281433A (ja) * | 2001-03-15 | 2002-09-27 | Kddi Corp | 動画像検索閲覧編集装置および記録媒体 |
| WO2006001331A1 (ja) * | 2004-06-25 | 2006-01-05 | Matsushita Electric Industrial Co., Ltd. | 記録装置、記録方法、プログラム、集積回路 |
| JP2009093789A (ja) * | 2005-07-15 | 2009-04-30 | Sony Corp | データ、記録媒体、記録装置、製造方法 |
| JP2011139478A (ja) * | 2011-01-14 | 2011-07-14 | Hitachi Ltd | ディジタル信号処理装置 |
| US9076495B2 (en) | 2005-07-15 | 2015-07-07 | Sony Corporation | Reproducing apparatus, reproducing method, computer program, program storage medium, data structure, recording medium, recording device, and manufacturing method of recording medium |
-
1993
- 1993-03-01 JP JP5039946A patent/JPH06253331A/ja active Pending
Cited By (16)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0846975A (ja) * | 1994-07-29 | 1996-02-16 | Matsushita Electric Ind Co Ltd | 圧縮画像符号列編集装置 |
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| US8798143B2 (en) | 1997-07-25 | 2014-08-05 | Sony Corporation | System method and apparatus for seamlessly splicing data |
| EP0923243A4 (en) * | 1997-07-25 | 2002-12-04 | Sony Corp | EDITING DEVICE, EDITING METHOD, SPLICING DEVICE, SPLICING METHOD, ENCODING DEVICE AND ENCODING METHOD |
| US6567471B1 (en) | 1997-07-25 | 2003-05-20 | Sony Corporation | System method and apparatus for seamlessly splicing data |
| EP1467563A1 (en) * | 1997-07-25 | 2004-10-13 | Sony Corporation | Editing device and method |
| WO1999005864A1 (fr) * | 1997-07-25 | 1999-02-04 | Sony Corporation | Dispositif d'edition, procede d'edition, dispositif d'epissage, procede d'epissage, dispositif de codage et procede de codage |
| US7711051B2 (en) | 1997-07-25 | 2010-05-04 | Sony Corporation | System method and apparatus for seamlessly splicing data |
| US8923409B2 (en) | 1997-07-25 | 2014-12-30 | Sony Coporation | System method and apparatus for seamlessly splicing data |
| US8223847B2 (en) | 1997-07-25 | 2012-07-17 | Sony Corporation | Editing device, editing method, splicing device, splicing method, encoding device, and encoding method |
| WO1999036912A1 (fr) * | 1998-01-19 | 1999-07-22 | Sony Corporation | Systeme d'edition, dispositif de commande d'edition et procede de commande d'edition |
| JP2002281433A (ja) * | 2001-03-15 | 2002-09-27 | Kddi Corp | 動画像検索閲覧編集装置および記録媒体 |
| WO2006001331A1 (ja) * | 2004-06-25 | 2006-01-05 | Matsushita Electric Industrial Co., Ltd. | 記録装置、記録方法、プログラム、集積回路 |
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| JP2011139478A (ja) * | 2011-01-14 | 2011-07-14 | Hitachi Ltd | ディジタル信号処理装置 |
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