JPH0622399A - 無相関化装置 - Google Patents
無相関化装置Info
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- JPH0622399A JPH0622399A JP4178034A JP17803492A JPH0622399A JP H0622399 A JPH0622399 A JP H0622399A JP 4178034 A JP4178034 A JP 4178034A JP 17803492 A JP17803492 A JP 17803492A JP H0622399 A JPH0622399 A JP H0622399A
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Abstract
(57)【要約】
【目的】 モノラル音声信号から拡がり感のある２チャ
ンネルの音声信号を作り出す無相関化装置において、ス
ピーカ再生時の音像移動をなくす。 【構成】 音程変換装置１０２は入力信号を所定の書き
込み周波数で記憶装置に書き込み、書き込み周波数と異
なる読み出し周波数で記憶装置からデータを読み出し、
書き込み周波数と読み出し周波数の比に対応して入力信
号の時間軸を変換する。利得調整手段１０３は書き込み
周波数と読み出し周波数との違いにより発生する、連続
的に変化する入力信号と出力信号との遅延時間に応じ
て、音程変換装置１０２の出力信号の利得を調整する。
ンネルの音声信号を作り出す無相関化装置において、ス
ピーカ再生時の音像移動をなくす。 【構成】 音程変換装置１０２は入力信号を所定の書き
込み周波数で記憶装置に書き込み、書き込み周波数と異
なる読み出し周波数で記憶装置からデータを読み出し、
書き込み周波数と読み出し周波数の比に対応して入力信
号の時間軸を変換する。利得調整手段１０３は書き込み
周波数と読み出し周波数との違いにより発生する、連続
的に変化する入力信号と出力信号との遅延時間に応じ
て、音程変換装置１０２の出力信号の利得を調整する。
Description
【０００１】
【産業上の利用分野】本発明は入力信号との相関の低い
信号を作り出す無相関化装置に関するものである。
信号を作り出す無相関化装置に関するものである。
【０００２】
【従来の技術】モノラル音声信号から拡がり感のある２
チャンネルの音声信号を作り出すためには、２チャンネ
ルの信号が無相関になるようにすれば良い（例えば、安
藤四一：コンサートホール音響学、第４章(シュプリン
ガー・フェアラーク東京，1987)など）。モノラル音声
信号から拡がり感のある２チャンネルの音声信号を作り
出す技術は、たとえばモノラル信号のバックグラウンド
ミュージックを拡がり感のあるサラウンド信号に用いる
場合などに応用できる。この様子を図３に示す。図３に
おいて、３０１は信号入力端子、３０２は無相関化装
置、３０３はリスニングルーム、３０４はそのままの入
力信号を再生するスピーカ、３０５は無相関化装置３０
２の出力信号を再生するスピーカである。図３に点線で
示したスピーカはスピーカ３０４と３０５が作る音像を
示す。この音像については後で説明する。
チャンネルの音声信号を作り出すためには、２チャンネ
ルの信号が無相関になるようにすれば良い（例えば、安
藤四一：コンサートホール音響学、第４章(シュプリン
ガー・フェアラーク東京，1987)など）。モノラル音声
信号から拡がり感のある２チャンネルの音声信号を作り
出す技術は、たとえばモノラル信号のバックグラウンド
ミュージックを拡がり感のあるサラウンド信号に用いる
場合などに応用できる。この様子を図３に示す。図３に
おいて、３０１は信号入力端子、３０２は無相関化装
置、３０３はリスニングルーム、３０４はそのままの入
力信号を再生するスピーカ、３０５は無相関化装置３０
２の出力信号を再生するスピーカである。図３に点線で
示したスピーカはスピーカ３０４と３０５が作る音像を
示す。この音像については後で説明する。
【０００３】従来、無相関な信号を発生させる手段とし
ては、たとえば特開平２−２５１９９７号公報に示され
ている音程変換装置が用いられている。
ては、たとえば特開平２−２５１９９７号公報に示され
ている音程変換装置が用いられている。
【０００４】以下に、従来の無相関化装置として利用さ
れている音程変換装置について説明する。
れている音程変換装置について説明する。
【０００５】図４は音程変換装置の構成を示すブロック
図である。図４において、４０１はアナログ信号をＰＣ
Ｍディジタル信号に変換するＡ／Ｄコンバータ、４０２
はメモリ、４０３はメモリ書き込みアドレス発生回路、
４０４は第１のメモリ読み出しアドレス発生回路、４０
５は第２のメモリ読み出しアドレス発生回路、４０６は
第１のメモリ読み出しアドレス発生回路４０４で読み出
されるデータをラッチする第１のラッチ回路、４０７は
第２のメモリ読み出しアドレス発生回路４０５で読み出
されるデータをラッチする第２のラッチ回路、４０８は
ラッチ回路４０６または４０７のデータを選択する第１
のセレクタ回路、４０９は第１のセレクタ回路４０８の
ディジタルデータをアナログに変換するＤ／Ａコンバー
タ、４１０はメモリ読み出しアドレス発生回路４０４ま
たは４０５のうち、現在最終出力しているアナログデー
タを読み出している側の読み出しアドレスを選択する第
２のセレクタ回路、４１１はメモリ書き込みアドレス発
生回路４０３とセレクタ回路４１０により選択された読
み出しアドレスとの差を検出する差分差検出回路、４１
２は差分検出回路４１１により制御されるデータ反転用
フリップフロップ回路、４１３はラッチ回路４０６およ
び４０７の最上位ビットのうち、これから移行する側の
最上位ビットを選択する第３のセレクタ回路、４１４は
フリップフロップ回路４１２の出力をデータ入力とし、
セレクタ回路４１３の出力をクロック入力とするフリッ
プフロップ回路、４１５はフリップフロップ回路４１３
の出力をデータ入力とし、セレクタ回路４１３の出力を
クロック入力とするフリップフロップ回路、４１６はフ
リップフロップ回路４１４の反転出力とフリップフロッ
プ回路４１５の出力との論理積をとるＮＡＮＤ回路、４
１７はフリップフロップ回路４１４の出力とフリップフ
ロップ回路４１５の反転出力との論理積をとるＮＡＮＤ
回路であり、ＮＡＮＤ回路４１６および４１７の出力
は、それぞれメモリ読み出しアドレス発生回路４０４お
よび４０５のアドレス増加を制御するものである。
図である。図４において、４０１はアナログ信号をＰＣ
Ｍディジタル信号に変換するＡ／Ｄコンバータ、４０２
はメモリ、４０３はメモリ書き込みアドレス発生回路、
４０４は第１のメモリ読み出しアドレス発生回路、４０
５は第２のメモリ読み出しアドレス発生回路、４０６は
第１のメモリ読み出しアドレス発生回路４０４で読み出
されるデータをラッチする第１のラッチ回路、４０７は
第２のメモリ読み出しアドレス発生回路４０５で読み出
されるデータをラッチする第２のラッチ回路、４０８は
ラッチ回路４０６または４０７のデータを選択する第１
のセレクタ回路、４０９は第１のセレクタ回路４０８の
ディジタルデータをアナログに変換するＤ／Ａコンバー
タ、４１０はメモリ読み出しアドレス発生回路４０４ま
たは４０５のうち、現在最終出力しているアナログデー
タを読み出している側の読み出しアドレスを選択する第
２のセレクタ回路、４１１はメモリ書き込みアドレス発
生回路４０３とセレクタ回路４１０により選択された読
み出しアドレスとの差を検出する差分差検出回路、４１
２は差分検出回路４１１により制御されるデータ反転用
フリップフロップ回路、４１３はラッチ回路４０６およ
び４０７の最上位ビットのうち、これから移行する側の
最上位ビットを選択する第３のセレクタ回路、４１４は
フリップフロップ回路４１２の出力をデータ入力とし、
セレクタ回路４１３の出力をクロック入力とするフリッ
プフロップ回路、４１５はフリップフロップ回路４１３
の出力をデータ入力とし、セレクタ回路４１３の出力を
クロック入力とするフリップフロップ回路、４１６はフ
リップフロップ回路４１４の反転出力とフリップフロッ
プ回路４１５の出力との論理積をとるＮＡＮＤ回路、４
１７はフリップフロップ回路４１４の出力とフリップフ
ロップ回路４１５の反転出力との論理積をとるＮＡＮＤ
回路であり、ＮＡＮＤ回路４１６および４１７の出力
は、それぞれメモリ読み出しアドレス発生回路４０４お
よび４０５のアドレス増加を制御するものである。
【０００６】図５は図４の各部分の動作を説明する波形
図である。図５において、（ａ），（ｃ）はディジタル
データであるが、説明のため、アナログ波形表示したも
のである。
図である。図５において、（ａ），（ｃ）はディジタル
データであるが、説明のため、アナログ波形表示したも
のである。
【０００７】以上のように構成された従来の無相関器
（音程変換装置）について、以下その動作について説明
する。
（音程変換装置）について、以下その動作について説明
する。
【０００８】まず、リセットでクリアされたフリップフ
ロップ回路４１２のＱ出力は“Ｌ”となり、セレクタ４
１３のセレクト信号ｓｅｌ（以下、セルという）は、立
ち上がり時不定であるが、最初の信号パルスが入力され
るのでフリップフロップ回路４１４の出力は“Ｌ”とな
り、セルは“Ｌ”、出力は図５（ｄ）が選択される。ラ
ッチ回路４０６で読み出されたリードアドレスＲｅａｄ
ａｄｄ１のデータとラッチ回路４０７で読み出された
リードアドレスＲｅａｄ ａｄｄ２のデータは、Ｄ／Ａ
変換したと仮定すれば、各々図５（ａ），（ｃ）の波形
が得られ、この時の図５（ａ），（ｃ）の最上位ビット
データは、２の補数コードであるので、図５（ｂ），
（ｄ）に示すように、負の半波が“Ｈ”、正の半波が
“Ｌ”のパルスとなる。
ロップ回路４１２のＱ出力は“Ｌ”となり、セレクタ４
１３のセレクト信号ｓｅｌ（以下、セルという）は、立
ち上がり時不定であるが、最初の信号パルスが入力され
るのでフリップフロップ回路４１４の出力は“Ｌ”とな
り、セルは“Ｌ”、出力は図５（ｄ）が選択される。ラ
ッチ回路４０６で読み出されたリードアドレスＲｅａｄ
ａｄｄ１のデータとラッチ回路４０７で読み出された
リードアドレスＲｅａｄ ａｄｄ２のデータは、Ｄ／Ａ
変換したと仮定すれば、各々図５（ａ），（ｃ）の波形
が得られ、この時の図５（ａ），（ｃ）の最上位ビット
データは、２の補数コードであるので、図５（ｂ），
（ｄ）に示すように、負の半波が“Ｈ”、正の半波が
“Ｌ”のパルスとなる。
【０００９】ピッチシフトを繰り返し、周回遅れが発生
しそうな領域になると、フリップフロップ回路４１２に
はクロックパルスが印加され、フリップフロップ回路４
１２の出力（ｅ）は“Ｈ”となる。この時、図５（ｆ）
に示すフリップフロップ回路４１４の出力は“Ｌ”であ
り、ラッチ回路４０７の出力ＩＹ出力は図５（ｄ）が出
力されており、図５（ｅ）が“Ｈ”になった所から、最
初の図５（ｄ）の立ち上がりパルスで図５（ｆ）が
“Ｈ”となり、今度は、ラッチ回路４０６のＩＹ出力
は、図５（ｂ）が出力される。図５（ｆ）が“Ｈ”にな
った所から、今度は、最初の図５（ｂ）の立ち上がりパ
ルスで図５（ｇ）が“Ｈ”となり、データセレクタ４０
８は、図５（ａ）から図５（ｃ）のデータを出力する。
これがＲｅａｄＡｄｄ１からＲｅａｄ Ａｄｄ２へのデ
ータ切り換え点であり、図５（ｆ）と図５（ｇ）のＮＡ
ＮＤをＮＡＮＤ回路４１７でとるとＳＴＯＰ２信号を得
る。
しそうな領域になると、フリップフロップ回路４１２に
はクロックパルスが印加され、フリップフロップ回路４
１２の出力（ｅ）は“Ｈ”となる。この時、図５（ｆ）
に示すフリップフロップ回路４１４の出力は“Ｌ”であ
り、ラッチ回路４０７の出力ＩＹ出力は図５（ｄ）が出
力されており、図５（ｅ）が“Ｈ”になった所から、最
初の図５（ｄ）の立ち上がりパルスで図５（ｆ）が
“Ｈ”となり、今度は、ラッチ回路４０６のＩＹ出力
は、図５（ｂ）が出力される。図５（ｆ）が“Ｈ”にな
った所から、今度は、最初の図５（ｂ）の立ち上がりパ
ルスで図５（ｇ）が“Ｈ”となり、データセレクタ４０
８は、図５（ａ）から図５（ｃ）のデータを出力する。
これがＲｅａｄＡｄｄ１からＲｅａｄ Ａｄｄ２へのデ
ータ切り換え点であり、図５（ｆ）と図５（ｇ）のＮＡ
ＮＤをＮＡＮＤ回路４１７でとるとＳＴＯＰ２信号を得
る。
【００１０】つまり、図５（ｆ）と図５（ｇ）の時間遅
れ分だけ、Ｒｅａｄ Ａｄｄ２のアドレス増加を停止
し、切り替わった点より再びＲｅａｄ Ａｄｄ２のアド
レスを増加させれば、ｔ１のポイントで同相で接続でき
る。次に、Ｒｅａｄ Ａｄｄ２がピッチシフトを繰り返
し、ＷＲＩＴＥ Ａｄｄ１と周回遅れが発生しそうな領
域になると、フリップフロップ回路４１２にはクロック
パルスが印加され、フリップフロップ回路４１２出力は
反転し、フリップフロップ回路４１２の出力（ｅ）は
“Ｌ”となる。ラッチ回路４０６のＩＹ出力は図５
（ｂ）を出力しており、フリップフロップ回路４１２の
出力（ｅ）が“Ｌ”になった所から、最初の図５（ｂ）
の立ち上がりパルスで図５（ｆ）が“Ｌ”となり、ラッ
チ回路４０７のＩＹ出力は図５（ｄ）が出力される。図
５（ｆ）が“Ｌ”となった所から、図５（ｄ）の最初の
立ち上がりパルスでフリップフロップ回路４１２の出力
は“Ｌ”となり、セルは“Ｌ”、データは図５（ａ）の
信号が出力される。この時も同様にセルと図５（ｆ）の
ＮＡＮＤをＮＡＮＤ回路４１６でとりＳＴＯＰ１信号を
得、Ｒｅａｄ Ａｄｄ１のアドレス増加を図５（ｆ）と
図５（ｇ）の遅延分だけ停止しておくと、ｔ４のポイン
トで同相接続できる。
れ分だけ、Ｒｅａｄ Ａｄｄ２のアドレス増加を停止
し、切り替わった点より再びＲｅａｄ Ａｄｄ２のアド
レスを増加させれば、ｔ１のポイントで同相で接続でき
る。次に、Ｒｅａｄ Ａｄｄ２がピッチシフトを繰り返
し、ＷＲＩＴＥ Ａｄｄ１と周回遅れが発生しそうな領
域になると、フリップフロップ回路４１２にはクロック
パルスが印加され、フリップフロップ回路４１２出力は
反転し、フリップフロップ回路４１２の出力（ｅ）は
“Ｌ”となる。ラッチ回路４０６のＩＹ出力は図５
（ｂ）を出力しており、フリップフロップ回路４１２の
出力（ｅ）が“Ｌ”になった所から、最初の図５（ｂ）
の立ち上がりパルスで図５（ｆ）が“Ｌ”となり、ラッ
チ回路４０７のＩＹ出力は図５（ｄ）が出力される。図
５（ｆ）が“Ｌ”となった所から、図５（ｄ）の最初の
立ち上がりパルスでフリップフロップ回路４１２の出力
は“Ｌ”となり、セルは“Ｌ”、データは図５（ａ）の
信号が出力される。この時も同様にセルと図５（ｆ）の
ＮＡＮＤをＮＡＮＤ回路４１６でとりＳＴＯＰ１信号を
得、Ｒｅａｄ Ａｄｄ１のアドレス増加を図５（ｆ）と
図５（ｇ）の遅延分だけ停止しておくと、ｔ４のポイン
トで同相接続できる。
【００１１】
【発明が解決しようとする課題】しかしながら上記の従
来の構成では、原信号と、無相関化した信号を左右のス
ピーカから再生した場合、左右のスピーカ間に合成され
る音像が移動してしまう、という問題点がある。
来の構成では、原信号と、無相関化した信号を左右のス
ピーカから再生した場合、左右のスピーカ間に合成され
る音像が移動してしまう、という問題点がある。
【００１２】たとえば、図３に示す様に受聴者の後方に
２個のスピーカ３０４，３０５を設け、これら２個のス
ピーカから原信号と、無相関化した信号とを再生される
場合を考える。図６（ブラウエルト、森本、後藤：空間
音響(鹿島出版会，東京，1986)，pp.128-132）に２つの
再生音の間に遅延時間がある場合の、遅延時間とスピー
カ間に生ずる音像の方向との関係を示す。図６によれ
ば、２個のスピーカから再生される音に遅延時間がない
場合には音像は０゜方向（図３では後方）に定位する
が、遅延時間がある場合には再生音に遅延があるスピー
カと反対方向（図３ではスピーカ３０４の方向）に定位
する。従来の構成では、無相関器の出力信号の遅延時間
は記憶装置ヘの書き込み周波数と読み出し周波数の比に
応じて少しづつ長くなってゆく。遅延時間がある値以上
になると書き込みアドレスが読み出しアドレスを追い越
すのを防ぐため、読み出しアドレスを進める。したがっ
て、２個のスピーカ３０４，３０５の間にできる音像は
図３に点線で示したように、中央から原信号を再生して
いるスピーカ３０４の方向へと連続的に移動してゆく。
そして、読み出しアドレスを進ませるタイミングで瞬間
的に中央へ飛ぶことになる。
２個のスピーカ３０４，３０５を設け、これら２個のス
ピーカから原信号と、無相関化した信号とを再生される
場合を考える。図６（ブラウエルト、森本、後藤：空間
音響(鹿島出版会，東京，1986)，pp.128-132）に２つの
再生音の間に遅延時間がある場合の、遅延時間とスピー
カ間に生ずる音像の方向との関係を示す。図６によれ
ば、２個のスピーカから再生される音に遅延時間がない
場合には音像は０゜方向（図３では後方）に定位する
が、遅延時間がある場合には再生音に遅延があるスピー
カと反対方向（図３ではスピーカ３０４の方向）に定位
する。従来の構成では、無相関器の出力信号の遅延時間
は記憶装置ヘの書き込み周波数と読み出し周波数の比に
応じて少しづつ長くなってゆく。遅延時間がある値以上
になると書き込みアドレスが読み出しアドレスを追い越
すのを防ぐため、読み出しアドレスを進める。したがっ
て、２個のスピーカ３０４，３０５の間にできる音像は
図３に点線で示したように、中央から原信号を再生して
いるスピーカ３０４の方向へと連続的に移動してゆく。
そして、読み出しアドレスを進ませるタイミングで瞬間
的に中央へ飛ぶことになる。
【００１３】本発明は上記従来の問題点を解決するもの
で、左右のスピーカ間に合成される音像が移動しない無
相関化装置を提供することを目的とする。
で、左右のスピーカ間に合成される音像が移動しない無
相関化装置を提供することを目的とする。
【００１４】
【課題を解決するための手段】この目的を達成するため
に本発明の無相関化装置は、入力信号を所定の書き込み
周波数で記憶装置に書き込み、書き込み周波数と異なる
読み出し周波数で記憶装置からデータを読み出し、書き
込み周波数と読み出し周波数の比に対応して入力信号の
時間軸を変換する時間軸変換手段を備え、入力信号のゼ
ロクロス点を始点として検出する始点検出手段と、入力
信号を順次連続的に記憶装置に書き込む書き込み手段
と、記憶装置からゼロクロス点単位で選択的に読み出す
読み出し手段を具備し、出力信号に空白時間、不連続
点、反復読み出しが発生しないようにゼロクロス点単位
で選択的に読み出すことを特徴とする音程変換装置と、
前記書き込み周波数と前記読み出し周波数との違いによ
り発生する、連続的に変化する入力信号と出力信号との
遅延時間に応じて、前記音程変換装置の出力信号の利得
を調整する利得調整手段とを備えている。
に本発明の無相関化装置は、入力信号を所定の書き込み
周波数で記憶装置に書き込み、書き込み周波数と異なる
読み出し周波数で記憶装置からデータを読み出し、書き
込み周波数と読み出し周波数の比に対応して入力信号の
時間軸を変換する時間軸変換手段を備え、入力信号のゼ
ロクロス点を始点として検出する始点検出手段と、入力
信号を順次連続的に記憶装置に書き込む書き込み手段
と、記憶装置からゼロクロス点単位で選択的に読み出す
読み出し手段を具備し、出力信号に空白時間、不連続
点、反復読み出しが発生しないようにゼロクロス点単位
で選択的に読み出すことを特徴とする音程変換装置と、
前記書き込み周波数と前記読み出し周波数との違いによ
り発生する、連続的に変化する入力信号と出力信号との
遅延時間に応じて、前記音程変換装置の出力信号の利得
を調整する利得調整手段とを備えている。
【００１５】
【作用】本発明は上記した構成により、音程変換手段で
発生する遅延時間により移動する音像を、利得調整手段
により中央へ定位するように補正する。すなわち、遅延
のない信号を再生するスピーカ側へ移動してしまった音
像を、遅延した信号のレベルを上げることにより、中央
へもどす。
発生する遅延時間により移動する音像を、利得調整手段
により中央へ定位するように補正する。すなわち、遅延
のない信号を再生するスピーカ側へ移動してしまった音
像を、遅延した信号のレベルを上げることにより、中央
へもどす。
【００１６】
【実施例】以下、本発明の一実施例について、図面を参
照しながら説明する。
照しながら説明する。
【００１７】図１は本発明の１実施例における無相関化
装置の構成を示すブロック図である。図１において、１
０１は信号入力端子、１０２は音程変換装置、１０３は
音程変換装置１０２の出力信号を入力し、音程変換装置
１０２の出力する書き込み読み出しアドレス差分に応じ
て利得を調整する利得調整手段である。音程変換装置１
０２は従来例で示したものと同様の構成である。書き込
み読み出しアドレス差分は、図４に示した音程変換装置
の差分検出回路４１１の出力である。
装置の構成を示すブロック図である。図１において、１
０１は信号入力端子、１０２は音程変換装置、１０３は
音程変換装置１０２の出力信号を入力し、音程変換装置
１０２の出力する書き込み読み出しアドレス差分に応じ
て利得を調整する利得調整手段である。音程変換装置１
０２は従来例で示したものと同様の構成である。書き込
み読み出しアドレス差分は、図４に示した音程変換装置
の差分検出回路４１１の出力である。
【００１８】以上のように構成された本実施例の無相関
化装置について、以下その動作について説明する。
化装置について、以下その動作について説明する。
【００１９】音程変換装置１０２の動作は従来例で述べ
たものと同様である。つぎに、利得調整手段１０３の動
作について説明する。利得調整手段１０３は音程変換装
置１０２の出力信号の遅延時間にかかわらず、原信号と
無相関化信号との作る音像がこれらを再生するスピーカ
の中央に定位するように音程変換装置１０２の出力信号
の利得を調整する。２つの信号の間の遅延時間と中央に
音像定位するために必要な利得との関係は図２に示すと
おりである（ブラウエルト、森本、後藤：空間音響(鹿
島出版会，東京，1986)，pp.128-132）。２つの信号の
間の遅延時間は、音程変換装置１０２から出力される書
き込み読み出しアドレス差分を書き込み周波数で割った
値となる。この遅延時間と図２から必要な利得が分かる
ので、この利得を利得調整手段１０３で与えればよい。
たものと同様である。つぎに、利得調整手段１０３の動
作について説明する。利得調整手段１０３は音程変換装
置１０２の出力信号の遅延時間にかかわらず、原信号と
無相関化信号との作る音像がこれらを再生するスピーカ
の中央に定位するように音程変換装置１０２の出力信号
の利得を調整する。２つの信号の間の遅延時間と中央に
音像定位するために必要な利得との関係は図２に示すと
おりである（ブラウエルト、森本、後藤：空間音響(鹿
島出版会，東京，1986)，pp.128-132）。２つの信号の
間の遅延時間は、音程変換装置１０２から出力される書
き込み読み出しアドレス差分を書き込み周波数で割った
値となる。この遅延時間と図２から必要な利得が分かる
ので、この利得を利得調整手段１０３で与えればよい。
【００２０】以上が利得調整手段１０３の動作である。
なお、本実施例では音程変換装置はアナログ信号を出力
する構成であるが、ディジタル信号を出力する構成でも
かまわない。この場合には、利得調整手段はディジタル
乗算器となり、この後段にＤ／Ａ変換器を設ける構成と
なる。
なお、本実施例では音程変換装置はアナログ信号を出力
する構成であるが、ディジタル信号を出力する構成でも
かまわない。この場合には、利得調整手段はディジタル
乗算器となり、この後段にＤ／Ａ変換器を設ける構成と
なる。
【００２１】
【発明の効果】以上のように本発明は、音程変換装置で
生ずる遅延による音像移動を利得調整手段により補正す
るので、音程変換装置の遅延時間にかかわらず音像が中
央に定位するという、実用上優れた効果を有するもので
ある。
生ずる遅延による音像移動を利得調整手段により補正す
るので、音程変換装置の遅延時間にかかわらず音像が中
央に定位するという、実用上優れた効果を有するもので
ある。
【図１】本発明の一実施例における無相関化装置の構成
を示すブロック図
を示すブロック図
【図２】２つの信号の間の遅延時間と中央に音像定位す
るために必要な利得との関係を示す説明図
るために必要な利得との関係を示す説明図
【図３】無相関化装置を用いて拡がり感のあるサラウン
ド信号を再生する様子の説明図
ド信号を再生する様子の説明図
【図４】従来の無相関化装置（音程変換装置）の構成を
示すブロック図
示すブロック図
【図５】従来の無相関化装置の動作を説明するための波
形図
形図
【図６】遅延時間とスピーカ間に生ずる音像の方向との
関係を示す特性図
関係を示す特性図
１０１，２０１，３０１ 信号入力端子 １０２，３０２ 無相関化装置 １０３ 利得調整手段 １０４ 信号出力端子 ４０１ Ａ／Ｄコンバータ ４０２ メモリ ４０３ メモリ書き込みアドレス発生回路 ４０４，４０５ メモリ読み出しアドレス発生回路 ４０６，４０７ ラッチ回路 ４０８，４１０，４１３ セレクタ回路 ４０９ Ｄ／Ａ変換器 ４１１ 差分差検出回路 ４１２，１４１，４１５ フリップフロップ回路
Claims (2)
- 【請求項１】 入力信号を所定の書き込み周波数で記憶
装置に書き込み、前記書き込み周波数と異なる読み出し
周波数で記憶装置からデータを読み出し、前記書き込み
周波数と前記読み出し周波数の比に対応して入力信号の
周波数を変換する音程変換装置と、 連続的に変化する入力信号と出力信号との遅延時間に応
じて、前記音程変換装置の出力信号の利得を調整する利
得調整手段とを備えた無相関化装置。 - 【請求項２】 音程変換装置は、入力信号を所定の書き
込み周波数で記憶装置に書き込み、書き込み周波数と異
なる読み出し周波数で記憶装置からデータを読み出し、
書き込み周波数と読み出し周波数の比に対応して入力信
号の時間軸を変換する時間軸変換手段を備え、入力信号
のゼロクロス点を始点として検出する始点検出手段と、
入力信号を順次連続的に記憶装置に書き込む書き込み手
段と、記憶装置からゼロクロス点単位で選択的に読み出
す読み出し手段を具備し、出力信号に空白時間、不連続
点、反復読み出しが発生しないようにゼロクロス点単位
で選択的に読み出す様に構成したことを特徴とする請求
項１記載の無相関化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4178034A JPH0622399A (ja) | 1992-07-06 | 1992-07-06 | 無相関化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4178034A JPH0622399A (ja) | 1992-07-06 | 1992-07-06 | 無相関化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0622399A true JPH0622399A (ja) | 1994-01-28 |
Family
ID=16041433
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4178034A Pending JPH0622399A (ja) | 1992-07-06 | 1992-07-06 | 無相関化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0622399A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007010810A (ja) * | 2005-06-29 | 2007-01-18 | Yamaha Corp | 車室内音場制御装置 |
| US8958585B2 (en) | 2004-06-29 | 2015-02-17 | Sony Corporation | Sound image localization apparatus |
-
1992
- 1992-07-06 JP JP4178034A patent/JPH0622399A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8958585B2 (en) | 2004-06-29 | 2015-02-17 | Sony Corporation | Sound image localization apparatus |
| JP2007010810A (ja) * | 2005-06-29 | 2007-01-18 | Yamaha Corp | 車室内音場制御装置 |
| JP4508008B2 (ja) * | 2005-06-29 | 2010-07-21 | ヤマハ株式会社 | 車室内音場制御装置 |
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