JPH05110142A - 発光素子駆動回路 - Google Patents
発光素子駆動回路Info
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- JPH05110142A JPH05110142A JP29837791A JP29837791A JPH05110142A JP H05110142 A JPH05110142 A JP H05110142A JP 29837791 A JP29837791 A JP 29837791A JP 29837791 A JP29837791 A JP 29837791A JP H05110142 A JPH05110142 A JP H05110142A
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Abstract
(57)【要約】
【目的】 簡潔な構成でパルス幅歪の低減と遷移特性の
改善を実現した消費電流の少ない発光素子駆動回路を提
供する。 【構成】 入力信号の遅延信号を発生する遅延回路２ａ
および入力信号と遅延信号との論理和信号を発生するＯ
Ｒ回路２ｂを含むパルス幅歪補償回路２と、論理和信号
またはその反転信号を制御端子に受け一端を共通に第１
電圧源に接続された第１および第２の１対のトランジス
タＱ1 、Ｑ2 と、第１のトランジスタＱ1 と第２電圧源
との間に負荷として挿入された発光素子ＬＥＤと、入力
信号と遅延信号との論理積信号を発生するＡＮＤ回路３
と、ＡＮＤ回路３の出力信号により制御されるスイッチ
ング回路Ｓ2 とを備える。
改善を実現した消費電流の少ない発光素子駆動回路を提
供する。 【構成】 入力信号の遅延信号を発生する遅延回路２ａ
および入力信号と遅延信号との論理和信号を発生するＯ
Ｒ回路２ｂを含むパルス幅歪補償回路２と、論理和信号
またはその反転信号を制御端子に受け一端を共通に第１
電圧源に接続された第１および第２の１対のトランジス
タＱ1 、Ｑ2 と、第１のトランジスタＱ1 と第２電圧源
との間に負荷として挿入された発光素子ＬＥＤと、入力
信号と遅延信号との論理積信号を発生するＡＮＤ回路３
と、ＡＮＤ回路３の出力信号により制御されるスイッチ
ング回路Ｓ2 とを備える。
Description
【０００１】
【産業上の利用分野】本発明は、発光素子駆動回路に関
する。より詳細には、本発明は、光通信システム等で使
用される発光素子駆動回路の新規な構成に関する。
する。より詳細には、本発明は、光通信システム等で使
用される発光素子駆動回路の新規な構成に関する。
【０００２】
【従来の技術】光ＰＣＭ通信等に使用する光送信器で
は、送信すべきデータに対応して変調した駆動電流を発
光素子に供給するように構成された発光素子駆動回路を
使用して、送信すべきデータに対応した光信号を発生し
ている。また、発光素子の温度特性や経時劣化による光
信号出力の変動の抑圧も、実際に使用される発光素子駆
動回路の重要な機能のひとつである。
は、送信すべきデータに対応して変調した駆動電流を発
光素子に供給するように構成された発光素子駆動回路を
使用して、送信すべきデータに対応した光信号を発生し
ている。また、発光素子の温度特性や経時劣化による光
信号出力の変動の抑圧も、実際に使用される発光素子駆
動回路の重要な機能のひとつである。
【０００３】図４は、上述のような発光素子駆動回路の
典型的な構成を示す図である。
典型的な構成を示す図である。
【０００４】同図に示すように、この光出力補償回路
は、発光素子ＬＥＤに供給する電流を切り換えるための
１対のスイッチングトランジスタＱ1 、Ｑ2 を含んで構
成された差動回路Ｓ1 と、発光素子ＬＥＤの前後に接続
された立ち下がりスピードアップ回路ＳＣ1 および立ち
上がりスピードアップ回路ＳＣ2 と、各スイッチングト
ランジスタＱ1 、Ｑ2 のベースに印加する信号を補正す
るためのパルス幅歪補償回路２と、入力信号を波形整形
するための入力バッファ回路１とから主に構成されてい
る。
は、発光素子ＬＥＤに供給する電流を切り換えるための
１対のスイッチングトランジスタＱ1 、Ｑ2 を含んで構
成された差動回路Ｓ1 と、発光素子ＬＥＤの前後に接続
された立ち下がりスピードアップ回路ＳＣ1 および立ち
上がりスピードアップ回路ＳＣ2 と、各スイッチングト
ランジスタＱ1 、Ｑ2 のベースに印加する信号を補正す
るためのパルス幅歪補償回路２と、入力信号を波形整形
するための入力バッファ回路１とから主に構成されてい
る。
【０００５】スイッチングトランジスタＱ1 、Ｑ2 のエ
ミッタは共通に接続されて、電流源Ｉを介して低電圧側
に接続されている。トランジスタＱ1 のコレクタは発光
素子ＬＥＤを介して、トランジスタＱ2 のコレクタは直
接に、それぞれ高電圧側に接続されている。また、立ち
上がりスピードアップ回路ＳＣ2 は、発光素子ＬＥＤの
カソード側に接続され、立ち下がりスピードアップ回路
ＳＣ1 は、発光素子ＬＥＤのアノードとカソードとの間
に接続されている。
ミッタは共通に接続されて、電流源Ｉを介して低電圧側
に接続されている。トランジスタＱ1 のコレクタは発光
素子ＬＥＤを介して、トランジスタＱ2 のコレクタは直
接に、それぞれ高電圧側に接続されている。また、立ち
上がりスピードアップ回路ＳＣ2 は、発光素子ＬＥＤの
カソード側に接続され、立ち下がりスピードアップ回路
ＳＣ1 は、発光素子ＬＥＤのアノードとカソードとの間
に接続されている。
【０００６】以上のように構成された発光素子駆動回路
の動作を、図５に示す信号波形を参照しながら説明す
る。
の動作を、図５に示す信号波形を参照しながら説明す
る。
【０００７】発光素子駆動回路に対する入力信号ＩＮと
その反転信号とは、バッファ回路１を介して、まずパル
ス幅歪補償回路２に入力される。このときの入力信号Ｉ
Ｎは、図５(a) に示すように、各ビット毎に所定のパル
ス幅を有する信号である。この入力信号ＩＮは、パルス
幅歪補償回路２において、発光素子の立上がりの遅れを
補償するために、図５(b) に示すようにパルス幅を伸長
される。このパルス幅を伸長された信号により、スイッ
チングトランジスタＱ1 、Ｑ2 が駆動される。ここで、
発光素子の特性と立ち下がりスピードアップ回路ＳＣ1
の作用とにより、発光素子ＬＥＤから実際に出力される
光信号の立ち上がりが遅れ、光信号のパルス幅は、図５
(c) に示すように幾分短くなっている。
その反転信号とは、バッファ回路１を介して、まずパル
ス幅歪補償回路２に入力される。このときの入力信号Ｉ
Ｎは、図５(a) に示すように、各ビット毎に所定のパル
ス幅を有する信号である。この入力信号ＩＮは、パルス
幅歪補償回路２において、発光素子の立上がりの遅れを
補償するために、図５(b) に示すようにパルス幅を伸長
される。このパルス幅を伸長された信号により、スイッ
チングトランジスタＱ1 、Ｑ2 が駆動される。ここで、
発光素子の特性と立ち下がりスピードアップ回路ＳＣ1
の作用とにより、発光素子ＬＥＤから実際に出力される
光信号の立ち上がりが遅れ、光信号のパルス幅は、図５
(c) に示すように幾分短くなっている。
【０００８】即ち、前述のパルス幅歪補償回路２は、発
光素子の立ち上がりの遅れとスピードアップ回路の作用
とに起因するパルス幅歪を予め補償するものである。ま
た、スピードアップ回路は、発光素子の容量に起因する
信号パルスの立ち下がり特性および立ち上がり特性の劣
化を改善せんとするものである。
光素子の立ち上がりの遅れとスピードアップ回路の作用
とに起因するパルス幅歪を予め補償するものである。ま
た、スピードアップ回路は、発光素子の容量に起因する
信号パルスの立ち下がり特性および立ち上がり特性の劣
化を改善せんとするものである。
【０００９】
【発明が解決しようとする課題】以上説明したように、
発光ダイオードまたはレーザダイオード等の発光素子を
100％変調で高速駆動するためには、発光素子の容量に
起因するパルス波形の劣化を緩和するスピードアップ回
路が必要になる。また、発光素子の非線型特性のため
に、光出力の立ち上がりスピードアップ回路と立ち下が
りスピードアップ回路とを個別に設ける必要がある。し
かしながら、スピードアップ回路の使用により信号波形
にパルス幅歪が生じるので、これを解消するためにパル
ス幅歪補償回路が必要になる。
発光ダイオードまたはレーザダイオード等の発光素子を
100％変調で高速駆動するためには、発光素子の容量に
起因するパルス波形の劣化を緩和するスピードアップ回
路が必要になる。また、発光素子の非線型特性のため
に、光出力の立ち上がりスピードアップ回路と立ち下が
りスピードアップ回路とを個別に設ける必要がある。し
かしながら、スピードアップ回路の使用により信号波形
にパルス幅歪が生じるので、これを解消するためにパル
ス幅歪補償回路が必要になる。
【００１０】従って、従来の発光素子駆動回路は、その
高速動作と引換えに、回路規模並びに消費電流が極めて
大きくなることが避けられないという問題があった。
高速動作と引換えに、回路規模並びに消費電流が極めて
大きくなることが避けられないという問題があった。
【００１１】そこで、本発明は、上記従来技術の問題点
を解決し、回路の消費電流を増加させることなく、品質
の高い光信号を効率良く発生することができる新規な発
光素子駆動回路を提供することをその目的としている。
を解決し、回路の消費電流を増加させることなく、品質
の高い光信号を効率良く発生することができる新規な発
光素子駆動回路を提供することをその目的としている。
【００１２】
【課題を解決するための手段】本発明に従うと、入力信
号の遅延信号を発生する遅延回路および入力信号と遅延
信号との論理和信号を発生するＯＲ回路を含むパルス幅
歪補償回路と、該論理和信号またはその反転信号を制御
端子に受け一端を共通に第１電圧源に接続された第１お
よび第２の１対のトランジスタと、該第１のトランジス
タと第２電圧源との間に負荷として挿入された発光素子
とを備えた発光素子駆動回路において、更に、該入力信
号と該遅延信号との論理積信号を発生するＡＮＤ回路
と、該論理積信号および／またはその反転信号により制
御される、該発光素子に接続されたスイッチング回路と
を備え、該スイッチング回路は、該発光素子の発光時に
は該発光素子に対して供給される駆動電流を増加させる
ように、且つ／または、該発光素子の消光時には該発光
素子からの電荷の放出を促進するように、該スイッチン
グ回路を含む放電路が該発光素子に接続されるように動
作することを特徴とする発光素子駆動回路が提供され
る。
号の遅延信号を発生する遅延回路および入力信号と遅延
信号との論理和信号を発生するＯＲ回路を含むパルス幅
歪補償回路と、該論理和信号またはその反転信号を制御
端子に受け一端を共通に第１電圧源に接続された第１お
よび第２の１対のトランジスタと、該第１のトランジス
タと第２電圧源との間に負荷として挿入された発光素子
とを備えた発光素子駆動回路において、更に、該入力信
号と該遅延信号との論理積信号を発生するＡＮＤ回路
と、該論理積信号および／またはその反転信号により制
御される、該発光素子に接続されたスイッチング回路と
を備え、該スイッチング回路は、該発光素子の発光時に
は該発光素子に対して供給される駆動電流を増加させる
ように、且つ／または、該発光素子の消光時には該発光
素子からの電荷の放出を促進するように、該スイッチン
グ回路を含む放電路が該発光素子に接続されるように動
作することを特徴とする発光素子駆動回路が提供され
る。
【００１３】
【作用】本発明に係る発光素子駆動回路は、駆動電流の
立ち上がり波形および立ち下がり波形の劣化を緩和する
ために、論理回路により制御されるスイッチング回路を
使用している点にその主要な特徴がある。
立ち上がり波形および立ち下がり波形の劣化を緩和する
ために、論理回路により制御されるスイッチング回路を
使用している点にその主要な特徴がある。
【００１４】即ち、前述のように、従来の発光素子駆動
回路においては、駆動電流の立ち上がり特性および立ち
下がり特性の劣化を改善するために、それぞれにスピー
ドアップ回路を設け、更に、これらのスピードアップ回
路の作用に起因するパルス幅歪を補正するための補償回
路を付加していた。
回路においては、駆動電流の立ち上がり特性および立ち
下がり特性の劣化を改善するために、それぞれにスピー
ドアップ回路を設け、更に、これらのスピードアップ回
路の作用に起因するパルス幅歪を補正するための補償回
路を付加していた。
【００１５】これに対して、本発明に係る発光素子駆動
回路においては、パルス幅歪補償回路によりパルス長の
長い信号波形を発生させ、これと元の入力信号とのＡＮ
Ｄ演算を行って、入力信号の微分パルスを得ている。こ
の微分パルスにより駆動されるスイッチング回路を、発
光素子と並列または直列に接続することにより、発光素
子の出力する光信号の立ち上がり特性および立ち下がり
特性を効果的に改善している。
回路においては、パルス幅歪補償回路によりパルス長の
長い信号波形を発生させ、これと元の入力信号とのＡＮ
Ｄ演算を行って、入力信号の微分パルスを得ている。こ
の微分パルスにより駆動されるスイッチング回路を、発
光素子と並列または直列に接続することにより、発光素
子の出力する光信号の立ち上がり特性および立ち下がり
特性を効果的に改善している。
【００１６】このような構成によれば、回路の規模並び
に消費電流を徒に増加させることなく、高品質な光信号
を出力する発光素子駆動回路を構成することができる。
また、必要に応じて、出力光信号の立ち上がり特性また
は立ち下がり特性を選択的に補正したり、微分パルス幅
や付加的なスイッチング回路の特性を変化させることに
より、出力光信号の補正量を任意に設定することがで
き、その設計の自由度も極めて高い。
に消費電流を徒に増加させることなく、高品質な光信号
を出力する発光素子駆動回路を構成することができる。
また、必要に応じて、出力光信号の立ち上がり特性また
は立ち下がり特性を選択的に補正したり、微分パルス幅
や付加的なスイッチング回路の特性を変化させることに
より、出力光信号の補正量を任意に設定することがで
き、その設計の自由度も極めて高い。
【００１７】以下、実施例を挙げて本発明をより具体的
に説明するが、以下の開示は本発明の一実施例に過ぎ
ず、本発明の技術的範囲を何ら限定するものではない。
に説明するが、以下の開示は本発明の一実施例に過ぎ
ず、本発明の技術的範囲を何ら限定するものではない。
【００１８】
【実施例】図１は、本発明に従う発光素子駆動回路の基
本的な構成を示す図である。
本的な構成を示す図である。
【００１９】図１(a) に示すように、この発光素子駆動
回路は、入力バッファ回路１と、パルス幅歪補償回路２
と、ＡＮＤ回路３と、１対の電流スイッチＳＷ1 、ＳＷ
2 と、１対のトランジスタＱ1 、Ｑ2 および発光素子Ｌ
ＥＤを含んで構成されたスイッチング回路Ｓ1 とから主
に構成されている。
回路は、入力バッファ回路１と、パルス幅歪補償回路２
と、ＡＮＤ回路３と、１対の電流スイッチＳＷ1 、ＳＷ
2 と、１対のトランジスタＱ1 、Ｑ2 および発光素子Ｌ
ＥＤを含んで構成されたスイッチング回路Ｓ1 とから主
に構成されている。
【００２０】入力バッファ回路１の出力は、後述するパ
ルス幅歪補償回路２に入力されている。また、ＡＮＤ回
路３は１対の正相出力を備えており、一方の出力は電流
スイッチＳＷ1 に、他方の出力は電流スイッチＳＷ2 に
それぞれ接続されている。電流スイッチＳＷ1 は、発光
素子ＬＥＤと並列に接続されており、電流スイッチＳＷ
2 は、発光素子ＬＥＤのカソード側に接続されている。
ルス幅歪補償回路２に入力されている。また、ＡＮＤ回
路３は１対の正相出力を備えており、一方の出力は電流
スイッチＳＷ1 に、他方の出力は電流スイッチＳＷ2 に
それぞれ接続されている。電流スイッチＳＷ1 は、発光
素子ＬＥＤと並列に接続されており、電流スイッチＳＷ
2 は、発光素子ＬＥＤのカソード側に接続されている。
【００２１】パルス幅歪補償回路２は、バッファ回路１
の１対の出力を受ける遅延回路２ａと、バッファ回路１
の一方の出力と遅延回路２の出力とを受けるＯＲ回路２
ｂとから構成されている。ＯＲ回路２ｂの正相出力はス
イッチング回路Ｓ1 のトランジスタＱ1 のベースに、Ｏ
Ｒ回路２ｂの逆相出力はスイッチング回路Ｓ1 のトラン
ジスタＱ2 のベースに、それぞれ接続されている。
の１対の出力を受ける遅延回路２ａと、バッファ回路１
の一方の出力と遅延回路２の出力とを受けるＯＲ回路２
ｂとから構成されている。ＯＲ回路２ｂの正相出力はス
イッチング回路Ｓ1 のトランジスタＱ1 のベースに、Ｏ
Ｒ回路２ｂの逆相出力はスイッチング回路Ｓ1 のトラン
ジスタＱ2 のベースに、それぞれ接続されている。
【００２２】図２は、図１(a) に示した発光素子駆動回
路の動作を説明する信号波形図である。尚、各波形図の
左に表示されている符号は、その信号波形図が、図１
(a) 中の同じ符号で示されたノードにおける信号波形で
あることを示している。
路の動作を説明する信号波形図である。尚、各波形図の
左に表示されている符号は、その信号波形図が、図１
(a) 中の同じ符号で示されたノードにおける信号波形で
あることを示している。
【００２３】図２（Ａ）に示すように、この発光素子駆
動回路に対する入力信号は、１ビットのデータに対して
所定のパルス幅を有する信号である。この入力信号がパ
ルス幅歪補償回路に入力されると、入力信号自体と、遅
延回路２ａにより発生された遅延信号とがＯＲ回路２ｂ
において重畳され、図２（Ｂ）に示すように、入力信号
よりもパルス幅の長い信号が発生する。
動回路に対する入力信号は、１ビットのデータに対して
所定のパルス幅を有する信号である。この入力信号がパ
ルス幅歪補償回路に入力されると、入力信号自体と、遅
延回路２ａにより発生された遅延信号とがＯＲ回路２ｂ
において重畳され、図２（Ｂ）に示すように、入力信号
よりもパルス幅の長い信号が発生する。
【００２４】一方、入力信号と同相の信号であるバッフ
ァ回路１の正相出力からの信号は、ＡＮＤ回路３の一方
の入力に入力される。また、遅延回路２ａから反転遅延
信号もＡＮＤ回路３に入力される。従って、ＡＮＤ回路
３は、これらの信号をＮＯＲ演算およびＡＮＤ演算する
ことにより、図２（Ｃ）および図２（Ｄ）に示すよう
に、入力信号の立ち上がり時および立ち下がり時に対応
した微分パルスＴ1 、Ｔ2 を出力する。
ァ回路１の正相出力からの信号は、ＡＮＤ回路３の一方
の入力に入力される。また、遅延回路２ａから反転遅延
信号もＡＮＤ回路３に入力される。従って、ＡＮＤ回路
３は、これらの信号をＮＯＲ演算およびＡＮＤ演算する
ことにより、図２（Ｃ）および図２（Ｄ）に示すよう
に、入力信号の立ち上がり時および立ち下がり時に対応
した微分パルスＴ1 、Ｔ2 を出力する。
【００２５】電流スイッチＳＷ1 は、ＡＮＤ回路３から
出力される微分パルスのうち入力信号の立ち下がりに対
応した微分パルスＴ1 により駆動される。また、電流ス
イッチＳＷ2 は、ＡＮＤ回路３から出力される微分パル
スのうち入力信号の立ち上がりに対応した微分パルスＴ
2 により駆動される。従って、図２（Ｂ）に示したパル
ス幅の長い信号と図２（Ｃ）および図２（Ｄ）に示した
１対の微分パルスＴ1 、Ｔ2 とを重畳した波形の電流信
号が、発光素子ＬＥＤに駆動電流として供給される。
出力される微分パルスのうち入力信号の立ち下がりに対
応した微分パルスＴ1 により駆動される。また、電流ス
イッチＳＷ2 は、ＡＮＤ回路３から出力される微分パル
スのうち入力信号の立ち上がりに対応した微分パルスＴ
2 により駆動される。従って、図２（Ｂ）に示したパル
ス幅の長い信号と図２（Ｃ）および図２（Ｄ）に示した
１対の微分パルスＴ1 、Ｔ2 とを重畳した波形の電流信
号が、発光素子ＬＥＤに駆動電流として供給される。
【００２６】ここで、図１(b) に示すように、電流スイ
ッチＳＷ1を駆動するＡＮＤ回路３の出力の極性を適切
に設定することにより、図２（ＬＥＤ）に示すように、
信号波形の立ち上がりおよび立ち下がりに、それぞれオ
ーバーシュートが付加された電流信号が、駆動電流とし
て発光素子ＬＥＤに印加される。即ち、図１(b) に示し
た構成では、ＡＮＤ回路３を、バッファ回路１の出力の
反転信号と、遅延回路２の正相遅延信号とを受けるＡＮ
Ｄゲート３ａとＮＯＲゲート３ｂとから構成し、電流ス
イッチＳＷ1 は、ＡＮＤゲート３ａの出力を入力し、電
流スイッチＳＷ2 には、ＮＯＲゲート３ｂの出力を入力
することもできる。
ッチＳＷ1を駆動するＡＮＤ回路３の出力の極性を適切
に設定することにより、図２（ＬＥＤ）に示すように、
信号波形の立ち上がりおよび立ち下がりに、それぞれオ
ーバーシュートが付加された電流信号が、駆動電流とし
て発光素子ＬＥＤに印加される。即ち、図１(b) に示し
た構成では、ＡＮＤ回路３を、バッファ回路１の出力の
反転信号と、遅延回路２の正相遅延信号とを受けるＡＮ
Ｄゲート３ａとＮＯＲゲート３ｂとから構成し、電流ス
イッチＳＷ1 は、ＡＮＤゲート３ａの出力を入力し、電
流スイッチＳＷ2 には、ＮＯＲゲート３ｂの出力を入力
することもできる。
【００２７】図２（ＬＥＤ）に示すような波形の駆動電
流を供給された発光素子ＬＥＤは、その立ち上がり時お
よび立ち下がり時に大量の電流を供給されるので、出力
する光信号波形の立ち上がりおよび立ち下がりも急峻な
ものとなる。
流を供給された発光素子ＬＥＤは、その立ち上がり時お
よび立ち下がり時に大量の電流を供給されるので、出力
する光信号波形の立ち上がりおよび立ち下がりも急峻な
ものとなる。
【００２８】図３は図１に示した発光素子駆動回路のよ
り具体的な構成例を示す図である。尚、図１と同じ構成
要素には同じ参照番号を付している。
り具体的な構成例を示す図である。尚、図１と同じ構成
要素には同じ参照番号を付している。
【００２９】同図に示すように、この回路も、入力バッ
ファ回路１、パルス幅歪補償回路２、ＡＮＤ回路３およ
びスイッチング回路Ｓ1 を備えているという点では、図
１に示した発光素子駆動回路と同じ構成となっている。
また、パルス幅歪補償回路２が、遅延回路ａおよびＯＲ
回路ｂにより構成されている点も図１に示した回路と同
じ構成となっている。更に、ＡＮＤ回路３は、正相およ
び逆相の１対の出力を備えている。
ファ回路１、パルス幅歪補償回路２、ＡＮＤ回路３およ
びスイッチング回路Ｓ1 を備えているという点では、図
１に示した発光素子駆動回路と同じ構成となっている。
また、パルス幅歪補償回路２が、遅延回路ａおよびＯＲ
回路ｂにより構成されている点も図１に示した回路と同
じ構成となっている。更に、ＡＮＤ回路３は、正相およ
び逆相の１対の出力を備えている。
【００３０】図３に示した回路の特徴的な構成は、図１
に示した回路において使用されていた１対の電流スイッ
チＳＷ1 、ＳＷ2 に代えて、第２のスイッチング回路Ｓ
2 を使用している点にある。即ち、図３に示した発光素
子駆動回路は、スイッチング回路Ｓ1 とほぼ並列に接続
された第２のスイッチング回路Ｓ2 を備えている。
に示した回路において使用されていた１対の電流スイッ
チＳＷ1 、ＳＷ2 に代えて、第２のスイッチング回路Ｓ
2 を使用している点にある。即ち、図３に示した発光素
子駆動回路は、スイッチング回路Ｓ1 とほぼ並列に接続
された第２のスイッチング回路Ｓ2 を備えている。
【００３１】このスイッチング回路Ｓ2 は、１対のトラ
ンジスタＱ3 およびＱ4 から構成されている。トランジ
スタＱ3 およびＱ4 のエミッタは、共通に接続されて、
電流源Ｉ2 を介して低電圧側に接続されている。トラン
ジスタＱ3 のコレクタは発光素子ＬＥＤのアノード側
に、トランジスタＱ4 のコレクタは発光素子ＬＥＤのカ
ソード側にそれぞれ接続されており、各コレクタの間に
は抵抗Ｒが挿入されている。また、トランジスタＱ3 の
ベースにはＡＮＤ回路３の逆相出力が、トランジスタＱ
4 のベースにはＡＮＤ回路３の正相出力がそれそれ印加
されている。
ンジスタＱ3 およびＱ4 から構成されている。トランジ
スタＱ3 およびＱ4 のエミッタは、共通に接続されて、
電流源Ｉ2 を介して低電圧側に接続されている。トラン
ジスタＱ3 のコレクタは発光素子ＬＥＤのアノード側
に、トランジスタＱ4 のコレクタは発光素子ＬＥＤのカ
ソード側にそれぞれ接続されており、各コレクタの間に
は抵抗Ｒが挿入されている。また、トランジスタＱ3 の
ベースにはＡＮＤ回路３の逆相出力が、トランジスタＱ
4 のベースにはＡＮＤ回路３の正相出力がそれそれ印加
されている。
【００３２】以上のように構成された発光素子駆動回路
において、ＡＮＤ回路３が入力信号の立ち上がりに対応
した微分パルスＴ2 を出力したとき、トランジスタＱ4
が導通して、発光素子ＬＥＤのカソード側により大きな
電流が流れる。また、ＡＮＤ回路３が入力信号の立ち下
がりに対応した微分パルスＴ1 を出力したとき、トラン
ジスタＱ3 が導通して、発光素子ＬＥＤのアノード側に
より大きな電流が流れる。このため、発光素子ＬＥＤの
発光時にはより大きな駆動電流が供給され、発光素子Ｌ
ＥＤの消光時にはより大きな電流が流出する。従って、
発光素子ＬＥＤの出力光信号の立ち上がり特性および立
ち下がり特性はいずれも急峻になる。なお、発光素子Ｌ
ＥＤに対する駆動電流は、発光の瞬間のみトランジスタ
Ｑ4 を流れ、以降の発光期間中はトランジスタＱ3 を流
れる。
において、ＡＮＤ回路３が入力信号の立ち上がりに対応
した微分パルスＴ2 を出力したとき、トランジスタＱ4
が導通して、発光素子ＬＥＤのカソード側により大きな
電流が流れる。また、ＡＮＤ回路３が入力信号の立ち下
がりに対応した微分パルスＴ1 を出力したとき、トラン
ジスタＱ3 が導通して、発光素子ＬＥＤのアノード側に
より大きな電流が流れる。このため、発光素子ＬＥＤの
発光時にはより大きな駆動電流が供給され、発光素子Ｌ
ＥＤの消光時にはより大きな電流が流出する。従って、
発光素子ＬＥＤの出力光信号の立ち上がり特性および立
ち下がり特性はいずれも急峻になる。なお、発光素子Ｌ
ＥＤに対する駆動電流は、発光の瞬間のみトランジスタ
Ｑ4 を流れ、以降の発光期間中はトランジスタＱ3 を流
れる。
【００３３】
【発明の効果】以上説明したように、本発明に係る発光
素子駆動回路は、パルス幅歪補償回路とＡＮＤ回路とに
よる簡潔な構成で、高品質な光信号、即ち、、パルス幅
歪が補償され且つ信号の立ち上がり特性および立ち下が
り特性が急峻な光信号を発生することができる。また、
構成が簡潔なので消費電流も少なく、光ＰＣＭ通信等の
高速光通信器に有利に使用することができる。
素子駆動回路は、パルス幅歪補償回路とＡＮＤ回路とに
よる簡潔な構成で、高品質な光信号、即ち、、パルス幅
歪が補償され且つ信号の立ち上がり特性および立ち下が
り特性が急峻な光信号を発生することができる。また、
構成が簡潔なので消費電流も少なく、光ＰＣＭ通信等の
高速光通信器に有利に使用することができる。
【図１】本発明に係る発光素子駆動回路の基本的な構成
を示す図である。
を示す図である。
【図２】図１に示した回路の動作を説明するための図で
ある。
ある。
【図３】本発明に係る発光素子駆動回路のより具体的な
構成例を示す図である。
構成例を示す図である。
【図４】従来の発光素子駆動回路の典型的な構成を示す
図である。
図である。
【図５】図４に示した回路の動作を説明するための図で
ある。
ある。
１ 入力バッファ回路、 ２ パルス幅歪補償回路、 ２ａ 遅延回路、 ２ｂ ＯＲ回路、 ３、３ａ、３ｂ ＡＮＤ回路、 ＬＥＤ 発光素子、 Ｑ1〜Ｑ4 トランジスタ、 Ｒ 抵抗、 Ｓ0、Ｓ1、Ｓ2 スイッチング回路、 ＳＣ1、ＳＣ2 スピードアップ回路、 ＳＷ1、ＳＷ2 電流スイッチ、 Ｉ0、Ｉ1、Ｉ2 電流源
Claims (2)
- 【請求項１】入力信号の遅延信号を発生する遅延回路お
よび入力信号と遅延信号との論理和信号を発生するＯＲ
回路を含むパルス幅歪補償回路と、該論理和信号または
その反転信号を制御端子に受け一端を共通に第１電圧源
に接続された第１および第２の１対のトランジスタと、
該第１のトランジスタと第２電圧源との間に負荷として
挿入された発光素子とを備えた発光素子駆動回路におい
て、 更に、該入力信号と該遅延信号との論理積信号を発生す
るＡＮＤ回路と、該論理積信号および／またはその反転
信号により制御される、該発光素子に接続されたスイッ
チング回路とを備え、該スイッチング回路は、該発光素
子の発光時には該発光素子に対して供給される駆動電流
を増加させるように、且つ／または、該発光素子の消光
時には該発光素子からの電荷の放出を促進するように、
該スイッチング回路を含む放電路が該発光素子に接続さ
れるように動作することを特徴とする発光素子駆動回
路。 - 【請求項２】請求項１に記載された発光素子駆動回路に
おいて、前記スイッチング回路が、前記論理積信号また
はその反転信号を制御端子に受け一端を共通に第１電圧
源に接続された第３および第４の１対のトランジスタを
含んで構成されていることをグ回路と特徴とする発光素
子駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29837791A JPH05110142A (ja) | 1991-10-17 | 1991-10-17 | 発光素子駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29837791A JPH05110142A (ja) | 1991-10-17 | 1991-10-17 | 発光素子駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05110142A true JPH05110142A (ja) | 1993-04-30 |
Family
ID=17858908
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29837791A Withdrawn JPH05110142A (ja) | 1991-10-17 | 1991-10-17 | 発光素子駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05110142A (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08316909A (ja) * | 1995-05-16 | 1996-11-29 | Toshiba Corp | 光伝送システム、光送信モジュール、及び光変調器の駆動方法 |
| JP2000299498A (ja) * | 1999-04-14 | 2000-10-24 | Hitachi Ltd | 光送信器及び光通信システム |
| EP1381036A2 (en) * | 2002-07-03 | 2004-01-14 | Ricoh Company, Ltd. | Light source drive circuit, optical information recording apparatus and optical information recording method |
| JP2005234487A (ja) * | 2004-02-23 | 2005-09-02 | Tohoku Pioneer Corp | 発光表示装置およびこれを搭載した電子機器 |
| JP2005303974A (ja) * | 2004-03-19 | 2005-10-27 | Fujitsu Ltd | 光変調器の駆動方法、並びに、それを用いた光送信機および光伝送システム |
| JP2006165545A (ja) * | 2004-12-07 | 2006-06-22 | Dianjing Science & Technology Co Ltd | 発光ダイオードの高速点滅回路 |
| JP2019169475A (ja) * | 2019-05-16 | 2019-10-03 | ネオフォーカル システムズ、インコーポレイテッドＮｅｏｆｏｃａｌ Ｓｙｓｔｅｍｓ，Ｉｎｃ． | デジタル式に制御される直列構成のシステム |
-
1991
- 1991-10-17 JP JP29837791A patent/JPH05110142A/ja not_active Withdrawn
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08316909A (ja) * | 1995-05-16 | 1996-11-29 | Toshiba Corp | 光伝送システム、光送信モジュール、及び光変調器の駆動方法 |
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| JP2019169475A (ja) * | 2019-05-16 | 2019-10-03 | ネオフォーカル システムズ、インコーポレイテッドＮｅｏｆｏｃａｌ Ｓｙｓｔｅｍｓ，Ｉｎｃ． | デジタル式に制御される直列構成のシステム |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990107 |