JPH045037Y2 - - Google Patents
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- Publication number
- JPH045037Y2 JPH045037Y2 JP13256286U JP13256286U JPH045037Y2 JP H045037 Y2 JPH045037 Y2 JP H045037Y2 JP 13256286 U JP13256286 U JP 13256286U JP 13256286 U JP13256286 U JP 13256286U JP H045037 Y2 JPH045037 Y2 JP H045037Y2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- signal
- alarm
- output
- terminals
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- 239000004065 semiconductor Substances 0.000 claims description 10
- 238000001514 detection method Methods 0.000 claims description 2
- 230000006870 function Effects 0.000 description 8
- 230000010355 oscillation Effects 0.000 description 6
- 238000010586 diagram Methods 0.000 description 3
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
- 230000009131 signaling function Effects 0.000 description 1
Landscapes
- Electromechanical Clocks (AREA)
Description
【考案の詳細な説明】
産業上の利用分野
本考案はアナログ時計回路に係り、駆動信号を
生成して外付けのステツプモータに供給し、ステ
ツプモータの回転で指針を駆動するアナログ時計
回路に関する。
生成して外付けのステツプモータに供給し、ステ
ツプモータの回転で指針を駆動するアナログ時計
回路に関する。
従来の技術
従来より、発振回路の出力する一定周波数の発
振信号を分周して、駆動信号を生成し、この駆動
信号でステツプモータを駆動し指針を回転させる
アナログ時計回路がある。
振信号を分周して、駆動信号を生成し、この駆動
信号でステツプモータを駆動し指針を回転させる
アナログ時計回路がある。
考案が解決しようとする問題点
また、従来より時報機能又は目覚機能を有する
アナログ時計がある。このようなアナログ時計に
おいては、駆動信号を生成する半導体集積回路、
時報又は目覚機能の半導体集積回路とが設けら
れ、大形化してしまうという問題点があつた。
アナログ時計がある。このようなアナログ時計に
おいては、駆動信号を生成する半導体集積回路、
時報又は目覚機能の半導体集積回路とが設けら
れ、大形化してしまうという問題点があつた。
上記駆動信号の生成回路に時報又は目覚機能を
組込んだ半導体集積回路を作成することも可能で
はあるが、報時又は目覚信号を入力する端子と、
アラーム信号を出力する端子とを上記集積回路に
追加しなければならず集積回路が大形化してしま
うという問題点があつた。
組込んだ半導体集積回路を作成することも可能で
はあるが、報時又は目覚信号を入力する端子と、
アラーム信号を出力する端子とを上記集積回路に
追加しなければならず集積回路が大形化してしま
うという問題点があつた。
そこで、本考案は、トリガ回路、アラーム回
路、出力回路を設けることで、上記の問題点を解
決したアナログ時計回路を提供することを目的と
する。
路、出力回路を設けることで、上記の問題点を解
決したアナログ時計回路を提供することを目的と
する。
問題点を解決するための手段
本考案においては、スイツチは、一対の端子の
うちの一方の端子に外付けされており指針が所定
位置となつたとき閉成して一方の端子を所定レベ
ルとする。
うちの一方の端子に外付けされており指針が所定
位置となつたとき閉成して一方の端子を所定レベ
ルとする。
トリガ回路は、駆動信号が出力されてない期間
を指示する信号と、一方の端子が所定レベルであ
ることの検出信号とからトリガ信号を生成する。
を指示する信号と、一方の端子が所定レベルであ
ることの検出信号とからトリガ信号を生成する。
アラーム回路は、トリガ信号を供給されて互い
に同相のアラーム信号を生成する。
に同相のアラーム信号を生成する。
出力回路は、駆動信号が出力されてない期間に
アラーム信号を上記一対の端子より出力する。
アラーム信号を上記一対の端子より出力する。
作 用
本考案においては、一対の端子から、互いに逆
相の駆動信号と互いに同相のアラーム信号とが期
間を分けて出力される。このため半導体集積回路
の出力端子が増加することがない。
相の駆動信号と互いに同相のアラーム信号とが期
間を分けて出力される。このため半導体集積回路
の出力端子が増加することがない。
実施例
第１図は本考案になるアナログ時計回路の一実
施例の回路構成図を示す。同図中、１０は発振回
路であり、例えば繰返し周波数略4MHzで発振し
て、その発振信号を分周回路１１に供給する。
施例の回路構成図を示す。同図中、１０は発振回
路であり、例えば繰返し周波数略4MHzで発振し
て、その発振信号を分周回路１１に供給する。
分周回路１１は上記発振信号を分周して繰り返
し周波数１Hzの第２図Ａに示す如くデユーテイ比
略96％のパルス信号ａを生成すると共に、繰り返
し周波数例えば10kHzのパルス信号を生成する。
パルス信号ａは1/2分周器１２、インバータ１３
等に供給され、10kHzのパルス信号はアラーム回
路１４に供給される。
し周波数１Hzの第２図Ａに示す如くデユーテイ比
略96％のパルス信号ａを生成すると共に、繰り返
し周波数例えば10kHzのパルス信号を生成する。
パルス信号ａは1/2分周器１２、インバータ１３
等に供給され、10kHzのパルス信号はアラーム回
路１４に供給される。
1/2分周回路１２はパルス信号ａを1/2分周して
第２図Ｂに示す繰り返し周波数1/2Hzのパルス信
号ｂに生成すると共に、これを反転したパルス信
号を生成し、パルス信号をオア回路１５ａ，
１６ａに供給し、パルス信号をオア回路１７
ａ，１８ａに供給する。
第２図Ｂに示す繰り返し周波数1/2Hzのパルス信
号ｂに生成すると共に、これを反転したパルス信
号を生成し、パルス信号をオア回路１５ａ，
１６ａに供給し、パルス信号をオア回路１７
ａ，１８ａに供給する。
ところで、分周回路１１の出力するパルス信号
ａはオア回路１５ａ，１６ａ，１７ａ，１８ａ及
びナンド回路１９に供給され、インバータ１３で
反転されたパルス信号はオア回路１５ｂ，１６
ｂ，１７ｂ，１８ｂに供給されている。また、オ
ア回路１５ｂ，１６ｂ，１７ｂ，１８ｂにはアラ
ーム回路１４の出力信号が供給され、オア回路１
５ａと１５ｂとの出力がアンド回路１５ｃに供給
され、同様にオア回路１６ａと１６ｂ、１７ａと
１７ｂ、１８ａと１８ｂ夫々の出力がアンド回路
１６ｃ，１７ｃ，１８ｃに供給される。更に、ア
ンド回路１５ｃ，１６ｃ夫々の出力はＰチヤンネ
ルMOSFETQ1及びＮチヤンネルMOSFETQ2
夫々のゲートに供給される。FETQ1，Q2はドレ
インが共通に端子Ａに接続されたＣ−MOS構造
である。アンド回路１７ｃ，１８ｃ夫々の出力は
上記と同様にＣ−MOSを構成するＰチヤンネル
MOSFETQ3、ＮチヤンネルMOSFETQ4夫々の
ゲートに供給される。FETQ3、Q4夫々のドレイ
ンは端子Ｂに接続されている。
ａはオア回路１５ａ，１６ａ，１７ａ，１８ａ及
びナンド回路１９に供給され、インバータ１３で
反転されたパルス信号はオア回路１５ｂ，１６
ｂ，１７ｂ，１８ｂに供給されている。また、オ
ア回路１５ｂ，１６ｂ，１７ｂ，１８ｂにはアラ
ーム回路１４の出力信号が供給され、オア回路１
５ａと１５ｂとの出力がアンド回路１５ｃに供給
され、同様にオア回路１６ａと１６ｂ、１７ａと
１７ｂ、１８ａと１８ｂ夫々の出力がアンド回路
１６ｃ，１７ｃ，１８ｃに供給される。更に、ア
ンド回路１５ｃ，１６ｃ夫々の出力はＰチヤンネ
ルMOSFETQ1及びＮチヤンネルMOSFETQ2
夫々のゲートに供給される。FETQ1，Q2はドレ
インが共通に端子Ａに接続されたＣ−MOS構造
である。アンド回路１７ｃ，１８ｃ夫々の出力は
上記と同様にＣ−MOSを構成するＰチヤンネル
MOSFETQ3、ＮチヤンネルMOSFETQ4夫々の
ゲートに供給される。FETQ3、Q4夫々のドレイ
ンは端子Ｂに接続されている。
上記のインバータ１３、オア回路１５ａ，１５
ｂ，１６ａ，１６ｂ，１７ａ，１７ｂ，１８ａ，
１８ｂ、アンド回路１５ｃ，１６ｃ，１７ｃ，１
８ｃ、FETQ1〜Q4で出力回路が構成されている。
なお、図中、一点鎖線で囲まれる部分は半導体集
積回路化されている。
ｂ，１６ａ，１６ｂ，１７ａ，１７ｂ，１８ａ，
１８ｂ、アンド回路１５ｃ，１６ｃ，１７ｃ，１
８ｃ、FETQ1〜Q4で出力回路が構成されている。
なお、図中、一点鎖線で囲まれる部分は半導体集
積回路化されている。
パルス信号ａがＬレベルの期間において、オア
回路１５ｂ，１６ｂ，１７ｂ，１８ｂ夫々はＨレ
ベル出力であるため、パルス信号ｂがアンド回路
１５ｃ，１６ｃ，１７ｃ，１８ｃより出力され
る。このため、アラーム回路１４が出力オープン
の非動作状態では端子Ａより第２図Ｃに示す駆動
パルスｃが出力され、端子Ｂより第２図Ｄに示す
駆動パルスｄが出力される。駆動パルスｃ，ｄは
互いに逆相であり、これによつて端子Ａ，Ｂ間に
接続されたステツプモータ２０が回転駆動され
る。
回路１５ｂ，１６ｂ，１７ｂ，１８ｂ夫々はＨレ
ベル出力であるため、パルス信号ｂがアンド回路
１５ｃ，１６ｃ，１７ｃ，１８ｃより出力され
る。このため、アラーム回路１４が出力オープン
の非動作状態では端子Ａより第２図Ｃに示す駆動
パルスｃが出力され、端子Ｂより第２図Ｄに示す
駆動パルスｄが出力される。駆動パルスｃ，ｄは
互いに逆相であり、これによつて端子Ａ，Ｂ間に
接続されたステツプモータ２０が回転駆動され
る。
上記ステツプモータ２０で駆動される分針が０
位置となつたとき報時スイツチSWが瞬間的に閉
成せしめられる。報時スイツチSWの一端は端子
Ｂに接続され、他端は抵抗R1を介して接地され
ている。また、端子ＢにはＰチヤンネル
MOSFETQ5及びＮチヤンネルMOSFETQ6のゲ
ートが接続されている。FETQ5、Q6はＣ−MOS
構造でFETQ5のゲート・ソース間にはプルアツ
プ抵抗R2が接続され、FETQ5，Q6のドレインは
ナンド回路１９に接続されている。
位置となつたとき報時スイツチSWが瞬間的に閉
成せしめられる。報時スイツチSWの一端は端子
Ｂに接続され、他端は抵抗R1を介して接地され
ている。また、端子ＢにはＰチヤンネル
MOSFETQ5及びＮチヤンネルMOSFETQ6のゲ
ートが接続されている。FETQ5、Q6はＣ−MOS
構造でFETQ5のゲート・ソース間にはプルアツ
プ抵抗R2が接続され、FETQ5，Q6のドレインは
ナンド回路１９に接続されている。
報時スイツチSWの閉成により端子ＢがＬレベ
ルとなると、FETQ5、Q6の反転動作によりナン
ド回路１９の入力はＨレベルとなる。モータ２０
はパルス信号ａのＬレベル期間に駆動され、これ
によつて分針が回転するため、報時スイツチSW
の瞬間的な閉成はパルス信号ａのＬレベル期間よ
り僅かに遅れてパルス信号ａのＨレベル期間にあ
たる。ナンド回路１９はパルス信号ａのＨレベル
時に上記報時スイツチSWの閉成によつてＬレベ
ルのトリガ信号を生成してアラーム回路１４のト
リガ端子Ｔに供給する。上記のFETQ4，Q5、ナ
ンド回路１９によりトリガ回路が構成されてい
る。
ルとなると、FETQ5、Q6の反転動作によりナン
ド回路１９の入力はＨレベルとなる。モータ２０
はパルス信号ａのＬレベル期間に駆動され、これ
によつて分針が回転するため、報時スイツチSW
の瞬間的な閉成はパルス信号ａのＬレベル期間よ
り僅かに遅れてパルス信号ａのＨレベル期間にあ
たる。ナンド回路１９はパルス信号ａのＨレベル
時に上記報時スイツチSWの閉成によつてＬレベ
ルのトリガ信号を生成してアラーム回路１４のト
リガ端子Ｔに供給する。上記のFETQ4，Q5、ナ
ンド回路１９によりトリガ回路が構成されてい
る。
これによつてアラーム回路１４はアラーム動作
を開始し、繰り返し周波数10kHzのパルス信号を
所定のパターンでパルス幅変調してアラーム信号
を生成し、オア回路１５ｂ，１６ｂ，１７ｂ，１
８ｂに供給する。
を開始し、繰り返し周波数10kHzのパルス信号を
所定のパターンでパルス幅変調してアラーム信号
を生成し、オア回路１５ｂ，１６ｂ，１７ｂ，１
８ｂに供給する。
パルス信号ａがＨレベルの期間において、オア
回路１５ａ，１６ａ，１７ａ，１８ａ夫々はＨレ
ベル出力であるため、上記アラーム信号がアンド
回路１５ｃ，１６ｃ，１７ｃ，１８ｃ夫々より
FETQ1〜Q4に供給される。従つて端子Ａ，Ｂ
夫々から同相のアラーム信号が出力されてイクス
クルーシブオア回路２２に供給される。これによ
つてイクスクルーシブオア回路２２の出力はＬレ
ベルとなり、イクスクルーシブオア回路２２の出
力及び端子Ｂの出力信号が供給されるノア回路２
３より反転されたアラーム信号が取り出され、抵
抗R3を介してトランジスタQ7で増幅されスピー
カ２４が駆動される。従つてスピーカ２４よりア
ラーム音即ち時報が発音される。
回路１５ａ，１６ａ，１７ａ，１８ａ夫々はＨレ
ベル出力であるため、上記アラーム信号がアンド
回路１５ｃ，１６ｃ，１７ｃ，１８ｃ夫々より
FETQ1〜Q4に供給される。従つて端子Ａ，Ｂ
夫々から同相のアラーム信号が出力されてイクス
クルーシブオア回路２２に供給される。これによ
つてイクスクルーシブオア回路２２の出力はＬレ
ベルとなり、イクスクルーシブオア回路２２の出
力及び端子Ｂの出力信号が供給されるノア回路２
３より反転されたアラーム信号が取り出され、抵
抗R3を介してトランジスタQ7で増幅されスピー
カ２４が駆動される。従つてスピーカ２４よりア
ラーム音即ち時報が発音される。
なお端子Ａ，Ｂより出力されるアラーム信号は
同相であるためステツプモータ２０が回転駆動さ
れないことは勿論である。また、駆動パルスｃ，
ｄは逆相であるためイクスクルーシブオア回路２
２の出力はＬレベルとなり、端子Ａ，Ｂがオープ
ン状態であるときと同様にノア回路２３の出力は
Ｈレベルとなつて、スピーカ２４は発音を行なわ
ない。
同相であるためステツプモータ２０が回転駆動さ
れないことは勿論である。また、駆動パルスｃ，
ｄは逆相であるためイクスクルーシブオア回路２
２の出力はＬレベルとなり、端子Ａ，Ｂがオープ
ン状態であるときと同様にノア回路２３の出力は
Ｈレベルとなつて、スピーカ２４は発音を行なわ
ない。
このように、一対の端子Ａ，Ｂより互いに逆相
の駆動信号、及び互いに同相のアラーム信号が
夫々期間を分けて出力される。このため、報時ス
イツチを接続する端子、アラーム信号を出力する
端子を特別に設ける必要がなく、半導体集積回路
の端子数は従来の時報又は目覚機能をもたない時
計回路と同数で済み、集積回路が大形化すること
がない。
の駆動信号、及び互いに同相のアラーム信号が
夫々期間を分けて出力される。このため、報時ス
イツチを接続する端子、アラーム信号を出力する
端子を特別に設ける必要がなく、半導体集積回路
の端子数は従来の時報又は目覚機能をもたない時
計回路と同数で済み、集積回路が大形化すること
がない。
また、上記実施例の半導体集積回路を時報又目
覚機能をもたないアナログ時計に適用することも
可能であり、汎用性が高い。
覚機能をもたないアナログ時計に適用することも
可能であり、汎用性が高い。
考案の効果
上述の如く、本考案のアナログ時計回路は、一
対の端子から駆動信号及びアラーム信号を出力し
て、端子数の増加がなく、半導体集積回路が小型
となり、時報又は目覚機能をもたない時計にも適
用でき汎用性が高い等の特長を有している。
対の端子から駆動信号及びアラーム信号を出力し
て、端子数の増加がなく、半導体集積回路が小型
となり、時報又は目覚機能をもたない時計にも適
用でき汎用性が高い等の特長を有している。
第１図は本考案回路の一実施例の回路構成図、
第２図は第１図示の回路各部の信号波形図であ
る。 １０……発振回路、１１……分周回路、１２…
…1/2分周回路、１３……インバータ、１５ａ〜
１８ａ、１５ｂ〜１８ｂ……オア回路、１５ｃ〜
１８ｃ……アンド回路、１９……ナンド回路、２
０……ステツプモータ、２２……イクスクルーシ
ブオア回路、２３……ノア回路、２４……スピー
カ、Q1〜Q6……FET、SW……スイツチ、Ａ，
Ｂ……端子。
第２図は第１図示の回路各部の信号波形図であ
る。 １０……発振回路、１１……分周回路、１２…
…1/2分周回路、１３……インバータ、１５ａ〜
１８ａ、１５ｂ〜１８ｂ……オア回路、１５ｃ〜
１８ｃ……アンド回路、１９……ナンド回路、２
０……ステツプモータ、２２……イクスクルーシ
ブオア回路、２３……ノア回路、２４……スピー
カ、Q1〜Q6……FET、SW……スイツチ、Ａ，
Ｂ……端子。
Claims (1)
- 【実用新案登録請求の範囲】 一対の端子より一定の時間間隔で互いに逆相の
駆動信号を外付けのステツプモータに供給し、該
ステツプモータの回転で指針を駆動する半導体集
積回路化されたアナログ時計回路において、 該一対の端子のうちの一方の端子に外付けされ
ており該指針が所定位置となつたとき閉成して該
一方の端子を所定レベルとするスイツチと、 該駆動信号が出力されてない期間を指示する信
号と、該一方の端子が所定レベルであることの検
出信号とからトリガ信号を生成するトリガ回路
と、 該トリガ信号を供給されて互いに同相のアラー
ム信号を生成するアラーム回路と、 該駆動信号が出力されてない期間に該アラーム
信号を該一対の端子より出力する出力回路とを設
けてなり、 該一対の端子に外付けされた発音装置で互いに
同相のアラーム信号を採り出して発音を行なうよ
う構成してなるアナログ時計回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13256286U JPH045037Y2 (ja) | 1986-08-29 | 1986-08-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13256286U JPH045037Y2 (ja) | 1986-08-29 | 1986-08-29 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6339694U JPS6339694U (ja) | 1988-03-15 |
| JPH045037Y2 true JPH045037Y2 (ja) | 1992-02-13 |
Family
ID=31032066
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13256286U Expired JPH045037Y2 (ja) | 1986-08-29 | 1986-08-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH045037Y2 (ja) |
-
1986
- 1986-08-29 JP JP13256286U patent/JPH045037Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6339694U (ja) | 1988-03-15 |
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