JPH04352535A - ループ式伝送路制御方式 - Google Patents
ループ式伝送路制御方式Info
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- JPH04352535A JPH04352535A JP3126348A JP12634891A JPH04352535A JP H04352535 A JPH04352535 A JP H04352535A JP 3126348 A JP3126348 A JP 3126348A JP 12634891 A JP12634891 A JP 12634891A JP H04352535 A JPH04352535 A JP H04352535A
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- transmission
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- transmission line
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- 230000005540 biological transmission Effects 0.000 title claims abstract description 103
- 230000001360 synchronised effect Effects 0.000 claims abstract description 11
- 238000000034 method Methods 0.000 claims description 5
- 230000001419 dependent effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
- 108010076504 Protein Sorting Signals Proteins 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
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- Small-Scale Networks (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、ループ式伝送路に伝送
制御装置を直列配置して伝送制御装置が収容する端末の
入出力データおよび伝送路上の転送データの送受信を制
御するループ式伝送路制御方式に関する。
制御装置を直列配置して伝送制御装置が収容する端末の
入出力データおよび伝送路上の転送データの送受信を制
御するループ式伝送路制御方式に関する。
【０００２】
【従来の技術】従来、この種のループ式伝送路制御方式
は、伝送制御装置の複数が一つのマスタ伝送制御装置と
串刺し状で一つのループ式伝送路を形成し、マスタ伝送
制御装置が高精度発振器をもって伝送路上のディジタル
信号によるデータの伝送を制御する。
は、伝送制御装置の複数が一つのマスタ伝送制御装置と
串刺し状で一つのループ式伝送路を形成し、マスタ伝送
制御装置が高精度発振器をもって伝送路上のディジタル
信号によるデータの伝送を制御する。
【０００３】これについて、図２を参照して説明する。
図２は従来の一例を示すブロック図である。
【０００４】図２に示すように、伝送制御装置８０の複
数が一つのマスタ伝送制御装置９０とともに串刺し状に
接続し、ループ式の伝送路２０を形成する。マスタ制御
装置９０はマスタ発振器９１を有し、伝送データの中に
クロック信号を含めてフレーム形成し、送信する。マス
タ伝送制御装置９０はまた、受信した伝送データを、マ
スタ発振器９１で生成するクロック信号によって、改め
てフレーム形成し、伝送路２０上へ送信する。
数が一つのマスタ伝送制御装置９０とともに串刺し状に
接続し、ループ式の伝送路２０を形成する。マスタ制御
装置９０はマスタ発振器９１を有し、伝送データの中に
クロック信号を含めてフレーム形成し、送信する。マス
タ伝送制御装置９０はまた、受信した伝送データを、マ
スタ発振器９１で生成するクロック信号によって、改め
てフレーム形成し、伝送路２０上へ送信する。
【０００５】伝送制御装置８０はフレーム同期部１１，
バッファ部１２，フレーム送出部１３，データ送出部１
４、およびデータ取込部１５を有し、伝送路２０を介し
て受信するクロック信号により、送出データをフレーム
形成し、伝送路２０へ送出する。
バッファ部１２，フレーム送出部１３，データ送出部１
４、およびデータ取込部１５を有し、伝送路２０を介し
て受信するクロック信号により、送出データをフレーム
形成し、伝送路２０へ送出する。
【０００６】フレーム同期部１１は受信するディジタル
信号列からフレームビットおよびクロック信号を検出し
、８ＫＨｚフレーム位置をフレームビット指示によりバ
ッファ部１２に通知する。バッファ部１２は受信するデ
ィジタル信号を一時蓄積し、フレーム同期部１１のフレ
ームビット指示を受ける。フレーム送出部１３はバッフ
ァ部１２に蓄積されたディジタル信号を順次伝送路２０
へ送出する。データ送出部１４は端末から送信するデー
タを、バッファ部１２がフレーム同期部１１から通知さ
れたフレームビット位置から判定した、ディジタル信号
列の所定位置に送出する。データ取込部１５は、バッフ
ァ部１２が蓄積したディジタル信号列の、フレーム同期
部１１から通知されたフレームビット位置から判定した
、所定位置からデータを取り出して端末インタフェイス
を介して端末へ送出する。
信号列からフレームビットおよびクロック信号を検出し
、８ＫＨｚフレーム位置をフレームビット指示によりバ
ッファ部１２に通知する。バッファ部１２は受信するデ
ィジタル信号を一時蓄積し、フレーム同期部１１のフレ
ームビット指示を受ける。フレーム送出部１３はバッフ
ァ部１２に蓄積されたディジタル信号を順次伝送路２０
へ送出する。データ送出部１４は端末から送信するデー
タを、バッファ部１２がフレーム同期部１１から通知さ
れたフレームビット位置から判定した、ディジタル信号
列の所定位置に送出する。データ取込部１５は、バッフ
ァ部１２が蓄積したディジタル信号列の、フレーム同期
部１１から通知されたフレームビット位置から判定した
、所定位置からデータを取り出して端末インタフェイス
を介して端末へ送出する。
【０００７】
【発明が解決しようとする課題】上述の従来のループ式
伝送路制御方式は、高精度のマスタ発振器をもつ一つの
マスタ伝送路制御装置だけがループ式伝送路を一巡する
ディジタル信号によるフレームの中にクロック信号を含
めるように構成されているので、マスタ伝送制御装置、
または前位の伝送制御装置若しくは伝送路の障害でクロ
ック信号の受信が停止したとき、伝送制御装置で送出デ
ータを持っていてもフレーム形成できず、送出できない
という問題点があった。
伝送路制御方式は、高精度のマスタ発振器をもつ一つの
マスタ伝送路制御装置だけがループ式伝送路を一巡する
ディジタル信号によるフレームの中にクロック信号を含
めるように構成されているので、マスタ伝送制御装置、
または前位の伝送制御装置若しくは伝送路の障害でクロ
ック信号の受信が停止したとき、伝送制御装置で送出デ
ータを持っていてもフレーム形成できず、送出できない
という問題点があった。
【０００８】本発明の目的は、それぞれ伝送制御装置が
高精度発振器による位相同期発振器を備え、クロック信
号を伝送路から受信するときは受信クロック信号に同期
し、クロック信号が受信停止したときは内部発振器によ
りクロック信号を生成することによりマスタ伝送制御装
置を廃し、上記問題点を解決するループ式伝送路制御方
式を提供することにある。
高精度発振器による位相同期発振器を備え、クロック信
号を伝送路から受信するときは受信クロック信号に同期
し、クロック信号が受信停止したときは内部発振器によ
りクロック信号を生成することによりマスタ伝送制御装
置を廃し、上記問題点を解決するループ式伝送路制御方
式を提供することにある。
【０００９】
【課題を解決するための手段】本発明によるループ式伝
送路制御方式の基本構成は、ループ式伝送路に伝送制御
装置を直列配置して伝送制御装置が収容する端末の入出
力データおよび伝送路上の転送データの送受信を制御す
るループ式伝送路制御方式において、内部で８ＫＨｚフ
レームおよびクロック信号を生成し、このフレームおよ
びクロック信号で受信するフレームおよびクロック信号
を位相補正する一方、伝送路からの受信がないとき前記
内部生成したフレームおよびクロック信号でデータの送
信タイミングを設定して、伝送路へ送出する伝送制御装
置を有する。
送路制御方式の基本構成は、ループ式伝送路に伝送制御
装置を直列配置して伝送制御装置が収容する端末の入出
力データおよび伝送路上の転送データの送受信を制御す
るループ式伝送路制御方式において、内部で８ＫＨｚフ
レームおよびクロック信号を生成し、このフレームおよ
びクロック信号で受信するフレームおよびクロック信号
を位相補正する一方、伝送路からの受信がないとき前記
内部生成したフレームおよびクロック信号でデータの送
信タイミングを設定して、伝送路へ送出する伝送制御装
置を有する。
【００１０】この伝送制御装置の一つの具体的構成は、
送受信するデータを所定の８ＫＨｚフレーム形式で一時
蓄積するバッファ部と、内蔵する高精度発振器により内
部クロック信号を生成し、伝送路から受信するクロック
信号に従属同期する一方、クロック信号が受信停止する
とき前記内部クロック信号を出力する位相同期発振器と
、この位相同期発振器から出力するクロック信号を入力
して８ＫＨｚフレームを生成出力するフレーム制御部と
、前記内部クロック信号および内部８ＫＨｚフレームを
入力し、この信号およびフレームにより伝送路から受信
した８ＫＨｚフレームおよびクロック信号を位相補正す
る一方、伝送路からクロック信号の受信がないときには
前記内部８ＫＨｚフレームおよび内部クロック信号によ
り、送信タイミングを設定してデータ送出の指示をする
バッファ制御部とを有する。
送受信するデータを所定の８ＫＨｚフレーム形式で一時
蓄積するバッファ部と、内蔵する高精度発振器により内
部クロック信号を生成し、伝送路から受信するクロック
信号に従属同期する一方、クロック信号が受信停止する
とき前記内部クロック信号を出力する位相同期発振器と
、この位相同期発振器から出力するクロック信号を入力
して８ＫＨｚフレームを生成出力するフレーム制御部と
、前記内部クロック信号および内部８ＫＨｚフレームを
入力し、この信号およびフレームにより伝送路から受信
した８ＫＨｚフレームおよびクロック信号を位相補正す
る一方、伝送路からクロック信号の受信がないときには
前記内部８ＫＨｚフレームおよび内部クロック信号によ
り、送信タイミングを設定してデータ送出の指示をする
バッファ制御部とを有する。
【００１１】上述の手段によるループ式伝送路制御方式
は、ループ状の伝送路で複数の伝送制御装置を接続する
とき、各伝送制御装置が高精度発振器を有してクロック
信号を生成できる。従って、伝送路からのクロック信号
の受信がなくても、伝送制御装置のそれぞれでクロック
信号および８ＫＨｚフレームを生成してデータの送出が
できる。
は、ループ状の伝送路で複数の伝送制御装置を接続する
とき、各伝送制御装置が高精度発振器を有してクロック
信号を生成できる。従って、伝送路からのクロック信号
の受信がなくても、伝送制御装置のそれぞれでクロック
信号および８ＫＨｚフレームを生成してデータの送出が
できる。
【００１２】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明の一実施例を示すブロック図である。
る。図１は本発明の一実施例を示すブロック図である。
【００１３】図１に示すように、複数の伝送制御装置１
０は串刺しとなってループ状の伝送路２０により接続さ
れる。図１で、図２に示し既に説明したものと同一の構
成要素には同一の数字符号を付与し、その説明は省略す
る。
０は串刺しとなってループ状の伝送路２０により接続さ
れる。図１で、図２に示し既に説明したものと同一の構
成要素には同一の数字符号を付与し、その説明は省略す
る。
【００１４】伝送制御装置１０は、従来同様の構成要素
のフレーム同期部１１，バッファ部１２，フレーム送出
部１３，データ送出部１４、およびデータ取込部１５に
加え、位相同期発振器１６，フレーム制御部１７、およ
びバッファ制御部１８を有する。
のフレーム同期部１１，バッファ部１２，フレーム送出
部１３，データ送出部１４、およびデータ取込部１５に
加え、位相同期発振器１６，フレーム制御部１７、およ
びバッファ制御部１８を有する。
【００１５】フレーム同期部１１は受信したディジタル
信号列から検出したフレームビットおよびクロック信号
をバッファ制御部１８へ通知する。バッファ部１２はバ
ッファ制御部１８の指示をうけて、一時蓄積したディジ
タル信号を送信フレームに形成する。
信号列から検出したフレームビットおよびクロック信号
をバッファ制御部１８へ通知する。バッファ部１２はバ
ッファ制御部１８の指示をうけて、一時蓄積したディジ
タル信号を送信フレームに形成する。
【００１６】位相同期発振器（ＰＬＯ，Ｐｈａｓｅ−ｌ
ｏｃｋｅｄ Ｏｓｃｉｌｌａｔｏｒ）１６は、伝送路
から受信するクロック信号に従属同期した内部クロック
信号を生成出力する。また、位相同期発振器１６はクロ
ック信号の受信がなくても信号の生成を自走し、独立同
期による内部クロック信号を生成出力する。
ｏｃｋｅｄ Ｏｓｃｉｌｌａｔｏｒ）１６は、伝送路
から受信するクロック信号に従属同期した内部クロック
信号を生成出力する。また、位相同期発振器１６はクロ
ック信号の受信がなくても信号の生成を自走し、独立同
期による内部クロック信号を生成出力する。
【００１７】フレーム制御部１７は位相同期発振器１６
から内部クロック信号を受信し、この内部クロック信号
から伝送制御装置１０での内部８ＫＨｚフレームを生成
しバッファ制御部１８へ通知する。
から内部クロック信号を受信し、この内部クロック信号
から伝送制御装置１０での内部８ＫＨｚフレームを生成
しバッファ制御部１８へ通知する。
【００１８】バッファ制御部１８はフレーム同期部１１
から受信する受信フレームのタイミングと、フレーム制
御部１７から受信する内部生成フレームのタイミングと
をそれぞれのクロック信号により位相補正してバッファ
部１２に送信タイミングを指示する。
から受信する受信フレームのタイミングと、フレーム制
御部１７から受信する内部生成フレームのタイミングと
をそれぞれのクロック信号により位相補正してバッファ
部１２に送信タイミングを指示する。
【００１９】位相同期発振器１６は入力がなくても内部
クロック信号を発生してフレーム制御部１７に内部８Ｋ
Ｈｚフレームの生成を指示する。また、バッファ制御部
１８はフレーム同期部１１から受信フレームによるクロ
ック信号受信がなくても、また受信クロック信号の瞬断
があっても、フレーム制御部１７から受信する内部８Ｋ
Ｈｚフレームおよび内部クロック信号により蓄積データ
送出の送信タイミングを指示することができる。
クロック信号を発生してフレーム制御部１７に内部８Ｋ
Ｈｚフレームの生成を指示する。また、バッファ制御部
１８はフレーム同期部１１から受信フレームによるクロ
ック信号受信がなくても、また受信クロック信号の瞬断
があっても、フレーム制御部１７から受信する内部８Ｋ
Ｈｚフレームおよび内部クロック信号により蓄積データ
送出の送信タイミングを指示することができる。
【００２０】本実施例により、図示し説明したが、機能
ブロックの配備は一例であり、上記説明が本発明を限定
するものではない。
ブロックの配備は一例であり、上記説明が本発明を限定
するものではない。
【００２１】
【発明の効果】以上説明したように、本発明のループ式
伝送路制御方式によれば、端末を収容しループ式伝送路
の接続点となる伝送制御装置のそれぞれが、高精度発振
器をもち、伝送路からクロック信号を受信するときには
従属同期したクロック信号を出力し、クロック信号の受
信がないときには独立同期による内部クロック信号を出
力して内部フレームを生成し送信タイミングを確立する
ことにより、伝送路障害などでクロック信号の受信がな
くても送出データの送信ができるという効果が得られる
。
伝送路制御方式によれば、端末を収容しループ式伝送路
の接続点となる伝送制御装置のそれぞれが、高精度発振
器をもち、伝送路からクロック信号を受信するときには
従属同期したクロック信号を出力し、クロック信号の受
信がないときには独立同期による内部クロック信号を出
力して内部フレームを生成し送信タイミングを確立する
ことにより、伝送路障害などでクロック信号の受信がな
くても送出データの送信ができるという効果が得られる
。
【図１】本発明のループ式伝送路制御方式の一実施例を
示すブロック図である。
示すブロック図である。
【図２】従来の一例を示すブロック図である。
１０ 伝送制御装置
１１ フレーム同期部
１２ バッファ部
１３ フレーム送出部
１６ 位相同期発振器
１７ フレーム制御部
１８ バッファ制御部
Claims (2)
- 【請求項１】 ループ式伝送路に伝送制御装置を直列
配置して伝送制御装置が収容する端末の入出力データお
よび伝送路上の転送データの送受信を制御するループ式
伝送路制御方式において、内部で８ＫＨｚフレームおよ
びクロック信号を生成し、このフレームおよびクロック
信号で受信するフレームおよびクロック信号を位相補正
する一方、伝送路からの受信がないとき前記内部生成し
たフレームおよびクロック信号でデータの送信タイミン
グを設定して、伝送路へ送出する伝送制御装置を有する
ことを特徴とするループ式伝送路制御方式。 - 【請求項２】 前記伝送制御装置が、送受信するデー
タを所定の８ＫＨｚフレーム形式で一時蓄積するバッフ
ァ部と、内蔵する高精度発振器により内部クロック信号
を生成し、伝送路から受信するクロック信号に従属同期
する一方、クロック信号が受信停止するとき前記内部ク
ロック信号を出力する位相同期発振器と、この位相同期
発振器から出力するクロック信号を入力して８ＫＨｚフ
レームを生成出力するフレーム制御部と、前記内部クロ
ック信号および内部８ＫＨｚフレームを入力し、この信
号およびフレームにより伝送路から受信した８ＫＨｚフ
レームおよびクロック信号を位相補正する一方、伝送路
からクロック信号の受信がないときには前記内部８ＫＨ
ｚフレームおよび内部クロック信号により、送信タイミ
ングを設定してデータ送出の指示をするバッファ制御部
とを有することを特徴とする請求項１記載のループ式伝
送路制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3126348A JPH04352535A (ja) | 1991-05-30 | 1991-05-30 | ループ式伝送路制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3126348A JPH04352535A (ja) | 1991-05-30 | 1991-05-30 | ループ式伝送路制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04352535A true JPH04352535A (ja) | 1992-12-07 |
Family
ID=14932950
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3126348A Pending JPH04352535A (ja) | 1991-05-30 | 1991-05-30 | ループ式伝送路制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04352535A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2002030079A1 (fr) * | 2000-10-05 | 2002-04-11 | Matsushita Electric Industrial Co., Ltd. | Reseau local en anneau et emetteur de donnees |
| WO2002030078A1 (fr) * | 2000-10-05 | 2002-04-11 | Matsushita Electric Industrial Co., Ltd. | Procede d'initialisation et emetteur de donnees |
| JP2005160025A (ja) * | 2003-09-04 | 2005-06-16 | Oasis Silicon Systems | 専用クロックマスターのない通信システムが許容可能な範囲外のクロック周波数をつくることを防止するための回路と、システムと、その方法 |
-
1991
- 1991-05-30 JP JP3126348A patent/JPH04352535A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2002030079A1 (fr) * | 2000-10-05 | 2002-04-11 | Matsushita Electric Industrial Co., Ltd. | Reseau local en anneau et emetteur de donnees |
| WO2002030078A1 (fr) * | 2000-10-05 | 2002-04-11 | Matsushita Electric Industrial Co., Ltd. | Procede d'initialisation et emetteur de donnees |
| US7012936B2 (en) | 2000-10-05 | 2006-03-14 | Matsushita Electric Industrial Co., Ltd. | Initializing method and data transmitter |
| US7133936B2 (en) | 2000-10-05 | 2006-11-07 | Matsushita Electric Industrial Co., Ltd. | Ring network and data transmitter |
| JP2005160025A (ja) * | 2003-09-04 | 2005-06-16 | Oasis Silicon Systems | 専用クロックマスターのない通信システムが許容可能な範囲外のクロック周波数をつくることを防止するための回路と、システムと、その方法 |
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