JPH04263387A - プログラム可能なメモリ内に複数のプログラムを受けるように構成されたマイクロプロセッサカードのための集積回路 - Google Patents

プログラム可能なメモリ内に複数のプログラムを受けるように構成されたマイクロプロセッサカードのための集積回路

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JPH04263387A
JPH04263387A JP3282313A JP28231391A JPH04263387A JP H04263387 A JPH04263387 A JP H04263387A JP 3282313 A JP3282313 A JP 3282313A JP 28231391 A JP28231391 A JP 28231391A JP H04263387 A JPH04263387 A JP H04263387A
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    • G06Q20/35765—Access rights to memory zones

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、チップカードまたはＩ
Ｃカードまたはメモリカードと称されるカードに関する
ものであり、さらに詳しく言えば、集積回路チップが、
マイクロプロセッサと（書替えできない）読取専用メモ
リだけでなく、データばかりでなく、マイクロプロセッ
サによって実行できるコードをも格納することのできる
電気的にプログラム可能なメモリも備えるチップカード
に関するものである。
【０００２】
【従来の技術】チップカードは、複数の可能な機能の階
層を有するアプリケーションに特に有用である。例えば
、集積回路チップの製造者は、機能の第１のレベルにマ
イクロプロセッサのオペレーティングプログラムを設定
する。製造者は、特に、恒久的に固定される読取専用メ
モリのプログラムを全部設定する。集積回路をカードに
組み込むチップカード製造者は、第２の機能レベルを設
定する。そのチップカード製造者の顧客である組織（銀
行またはサービス供給者）は、第３の機能レベルを設定
し、最終的なユーザ（サービス供給者の顧客）は、最終
的に、第４の機能レベルを使用することができる。 この理論的な階層は、単に例として示したものである。
【０００３】
【発明が解決しようとする課題】本発明は、異なる使用
レベルでアクセスことのできる複数の異なる機能を有す
ることのできる簡単な手段を実現することを目的とする
。
【０００４】
【課題を解決するための手段】本発明によると、マイク
ロプロセッサと、読取専用メモリと、マイクロプロセッ
サによって実行できるコードを内蔵することのできる電
気的にプログラム可能なメモリとを備える集積回路であ
って、上記電気的にプログラム可能なメモリの第１の指
定アドレス、いわゆる「フィルタアドレス」を読出すた
めに上記マイクロプロセッサによって実行されるフィル
タリング命令として知られている複数の命令が、上記読
取専用メモリ内に格納されており、集積回路は、さらに
、上記フィルタアドレスに置かれている内容が、所定の
制限内に配置された、上記電気的にプログラム可能なメ
モリの、サブプログラムアドレスと呼ばれるアドレスを
示しているかどうかを確認する手段と、上記サブプログ
ラムアドレスが上記の所定の制限内にあるとき、上記電
気的にプログラム可能なメモリの上記サブプログラムア
ドレスに内蔵された命令のサブプログラムを上記マイク
ロプロセッサに実行させる手段と、上記サブプログラム
アドレスが上記の所定の制限内になるとき、上記電気的
にプログラム可能なメモリの異なる各々のフィルタアド
レス及び各フィルタ命令ごとに異なるサブブログラムア
ドレス制限に各々対応する異なる複数の一連のフィルタ
リング命令を含む上記読取専用メモリのプログラムを続
行する手段と、を備えることを特徴とする集積回路が提
供される。
【０００５】従って、本発明は、異なるレベルでの複数
のアプリケーション設定が、極めて単純な方法で望むと
おりに制御できるチップのメモリの全体構成を提案する
ものである。本発明のその他の特徴及び利点は、添付図
面を参照して行う以下の説明によって明らかとなろう。
【０００６】
【実施例】マイクロプロセッサをベースとするチップカ
ードの標準的な集積回路を図１に示した。この集積回路
は、中央処理装置（ＣＰＵ）１０と、付属する周辺装置
資源とを具備している。すなわち、周辺装置資源は、マ
イクロプロセッサによって実行される命令、及び、特に
、メモリを管理し、カードのアクセスを保護するための
プログラムを含む読取専用メモリ（ＲＯＭ）１２と、ラ
ンダムアクセスメモリ（ＲＡＭ）１４と、データだけで
なく、実行できるコード（マイクロプロセッサによって
実行できる命令）も含む、紫外線で消去可能な電気的に
プログラム可能なメモリ（ＥＥＰＲＯＭ）１６、より好
ましくは、ＦＬＡＳＨ　　ＥＰＲＯＭまたは電気的に消
去可能なＥＰＲＯＭと、原則的には、極めて少数の入／
出力コンタクトＩ／Ｏによって、カードの外部との交換
を可能にする入／出力ポート１８と、を含む。
【０００７】本発明は、階層化されたアプリケーション
プログラムをマイクロプロセッサによって実行できるよ
うにしなければならない、すなわち、階層的に高いレベ
ルのプログラムが次の階層レベルのプログラムより前に
必ず実行しなければならない例に特に関するものである
。本発明によると、集積回路及びそのＲＯＭ及びＥＰＲ
ＯＭまたはＥＥＰＯＲＭメモリは、以下のように組織化
される。まず、読出し及び書込みの両モードで、ＥＥＰ
ＲＯＭへのアクセスを許可する場合を管理するのは、読
取専用メモリである。次に、「フィルタリングアドレス
」と呼ばれるアドレスのＥＥＰＲＯＭのゾーンは、「サ
ブプログラムアドレス」と呼ばれる他のアドレスを含む
ために確保される。最後に、１つのサブプログラムアド
レスを介して、ＥＥＰＲＯＭは、マイクロプロセッサに
よって実行されるサブプログラムを内蔵する。本発明に
よって使用を制御するのは、このサブプログラムである
。
【０００８】図２は、この組織を図示したものである。 ＲＯＭは、カウンタ（図示せず）の制御下で逐次的に実
行されるコードを含む。すなわち、命令は、メモリの連
続したアドレスの順序で連続して実行される（様々な分
岐や飛び越しは別にする）。ＲＯＭのゾーンＺ０Ａは、
例えば、カードの初期化プログラム（種々のテスト、安
全性の検査、レジスタの零セット等）を含み、このプロ
グラムは、このカードの使用の開始段階で実行される。 ゾーンＺＯＡの後のゾーンＺ１Ａは、ＥＥＰＲＯＭ中の
第１のサブプログラムの存在（及び使用の可能性）を検
査することのできるフィルタリング命令を含む。フィル
タリング命令は、マイクロプロセッサによって実行する
ことのできる小さいサブプログラムであり、以下の機能
のために手段を規定する。すなわち、特定されたアドレ
ス（ＥＥＰＲＯＭメモリのゾーンＺ１Ｂのアドレス）で
ＥＥＰＲＯＭ内の、１セットの内容に到達して読出すこ
と。このアドレスは、読取専用メモリが規定するので、
固定されている。アドレスＺ１ＢがＥＥＰＲＯＭのアド
レスであることを確認すること。このアドレスは、特に
ＥＥＰＲＯＭのゾーンＺ１Ｃを含む指定制限内に含まれ
る。アドレスＺ１ＢがＥＥＰＲＯＭのアドレスであるこ
とが確認された場合は、指定されたアドレスに行き、そ
うでない場合は、ＲＯＭの次のアドレスＺ２Ａに行くこ
と。その指定アドレスで、ＥＥＰＲＯＭのゾーンＺ１Ｃ
に存在するサブプログラムが実行される。複数の連続し
たフィルタリング命令は、このように、ＲＯＭの連続し
たゾーンに含まれている。その各々は、ＥＥＰＲＯＭメ
モリの各アプリケーションサブプログラムに対応する。
【０００９】図示した実施例では、例えば、ＲＯＭ中に
、このメモリの連続したゾーンＺ１Ａ、Ｚ２Ａ、Ｚ３Ａ
に３つの連続したフィルタリング命令が存在する。ゾー
ンＺ１Ａの命令は、ＥＥＰＲＯＭのフィルタリングアド
レスＺ１Ｂを参照するものであり、この命令は、（読取
専用メモリ中に）先験的に固定された制限を含む。ゾー
ンＺ１Ｂの内容は、この制限内に位置して、このフィル
タリング命令に対応するサブプログラムが実行されるよ
うにしていなければならない。このサブプログラムは、
ゾーンＺ１Ｃに内蔵されている。同様に、次の階層レベ
ルのプログラムに対応するフィルタリング命令Ｚ２Ａ（
ゾーンＺ１Ｃのサブプログラムの実行後または第１のフ
ィルタリングの結果が否定的であった時にだけ実行され
る）は、ゾーンＺ１Ｂとは異なるゾーンＺ２Ｂの読出し
をアクティブにする。このゾーンに対応するサブプログ
ラムは、ゾーンＺ２Ｃに格納されている。しかしながら
、マイクロプロセッサは、アドレスＺ２Ｂの内容がＲＯ
Ｍ内の固定された所定の制限に位置するアドレスを構成
している時だけ、ゾーンＺ２Ｃのプログラムを実行する
。これらの制限は、ゾーンＺ１Ａのフィルタリング命令
の制限とは同じではなく、従って、ＲＯＭ内の固定デー
タをによって複数のブロックが確保される。ブロックの
各々が（ＲＯＭのフィルタリング命令を実行する順位に
おける）階層フィルタリングの所定のレベルに対応する
。また、ゾーンＺ３Ａのフィルタリング命令は、また、
他の制限値、従って、第３のレベルのサブプログラムが
位置するべき別のブロック、すなわち、ＥＥＰＲＯＭの
ゾーンＺ３Ｃ内の別の制限値を決定する。ここで、再度
、ＥＥＰＲＯＭ中のアドレスＺ３Ｂに格納された内容に
よって、肯定的か否定的かどうかテストが行われる。ど
ちらかのサブプログラムの使用を可能にするかどうかの
決定が行われると、残りのすべきことは、ＥＥＰＲＯＭ
内のゾーンＺ１Ｂ、Ｚ２Ｂ、Ｚ３Ｂにアドレス値を格納
することだけである。このアドレス値は、有効に操作さ
れるべきアプリケーションサブプログラムを含むゾーン
の開始に対応する。操作されるべきではないアプリケー
ションサブプログラムについては、サブプログラムアド
レスゾーンＺ１Ｂ、Ｚ２Ｂ、Ｚ３Ｂに零または無効値、
すなわち、いずれの場合ににせよ、許可されないサブプ
ログラムに向かう可能なルートに対応しない値が格納さ
れる。ゾーンＺ１Ｂ、Ｚ２Ｂ、Ｚ３Ｂへのアクセスは、
アクセスの階層によって、特に、暗証コードの使用によ
って（ＲＯＭによるアクセス保護の管理のコンテキスト
において）確保される。従って、原則的には、アクセス
階層の下位レベルのユーザは、もはや、これらのゾーン
を変更することができない。
【００１０】上記の説明では、読取専用メモリによって
決定される機能に、階層的に組織化された補足的な連続
的な機能をあらかじめ加えることのできる集積回路の組
織について記載した。これらの補足的な機能の性能の制
御は、ＥＥＰＲＯＭ内のそれ自体指定されたアドレスに
有効アドレスを単に記録するだけであるので、極めて単
純である。
【図面の簡単な説明】
【図１】マイクロプロセッサをベースとするチップカー
ドの集積回路チップの全体構成の極めて概略的な図面で
ある。
【図２】本発明による集積回路チップのメモリの組織を
図示したものである。
【符号の説明】
１０・・ＣＰＵ　　　　　　　　　　　　１２・・ＲＯ
Ｍ　　　　　　　　　　　　１４・・ＲＡＭ

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】　　マイクロプロセッサと、読取専用メモ
    リと、マイクロプロセッサによって実行できるコードを
    内蔵することのできる電気的にプログラム可能なメモリ
    とを備える集積回路であって、上記電気的にプログラム
    可能なメモリの第１の指定アドレス、いわゆる「フィル
    タアドレス」を読出すために上記マイクロプロセッサに
    よって実行されるフィルタリング命令として知られてい
    る複数の命令が、上記読取専用メモリ内に格納されてお
    り、集積回路は、さらに、上記フィルタアドレスに置か
    れている内容が、所定の制限内に配置された、上記電気
    的にプログラム可能なメモリの、サブプログラムアドレ
    スと呼ばれるアドレスを示しているかどうかを確認する
    手段と、上記サブプログラムアドレスが上記の所定の制
    限内にあるとき、上記電気的にプログラム可能なメモリ
    の上記サブプログラムアドレスに内蔵された命令のサブ
    プログラムを上記マイクロプロセッサに実行させる手段
    と、上記サブプログラムアドレスが上記の所定の制限内
    になるとき、上記電気的にプログラム可能なメモリの異
    なる各々のフィルタアドレス及び各フィルタ命令ごとに
    異なるサブブログラムアドレス制限に各々対応する異な
    る複数の一連のフィルタリング命令を含む上記読取専用
    メモリのプログラムを続行する手段と、を備えることを
    特徴とする集積回路。
JP3282313A 1990-10-02 1991-10-02 プログラム可能なメモリ内に複数のプログラムを受けるように構成されたマイクロプロセッサカードのための集積回路 Expired - Fee Related JPH0769950B2 (ja)

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