JPH04247704A - 雑音発生装置 - Google Patents
雑音発生装置Info
- Publication number
- JPH04247704A JPH04247704A JP3012002A JP1200291A JPH04247704A JP H04247704 A JPH04247704 A JP H04247704A JP 3012002 A JP3012002 A JP 3012002A JP 1200291 A JP1200291 A JP 1200291A JP H04247704 A JPH04247704 A JP H04247704A
- Authority
- JP
- Japan
- Prior art keywords
- pseudo
- shift register
- random number
- number generator
- noise
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 238000001228 spectrum Methods 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 5
- 238000004891 communication Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 238000012360 testing method Methods 0.000 description 2
- 238000009827 uniform distribution Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06J—HYBRID COMPUTING ARRANGEMENTS
- G06J1/00—Hybrid computing arrangements
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
- H03K3/84—Generating pulses having a predetermined statistical distribution of a parameter, e.g. random pulse generators
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Mathematical Physics (AREA)
- Automation & Control Theory (AREA)
- Evolutionary Computation (AREA)
- Fuzzy Systems (AREA)
- General Physics & Mathematics (AREA)
- Software Systems (AREA)
- Analogue/Digital Conversion (AREA)
- Tests Of Electronic Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、通信装置やオーディオ
装置の特性試験等に使用する雑音発生装置に関する。
装置の特性試験等に使用する雑音発生装置に関する。
【０００２】
【従来の技術】通信装置やオーディオ装置の特性を試験
するためには、スペクトルが所定の帯域内に均等に分布
したランダムな雑音の信号源が必要となる。
するためには、スペクトルが所定の帯域内に均等に分布
したランダムな雑音の信号源が必要となる。
【０００３】このような雑音の信号源として使用される
従来の雑音発生装置は、図３に示すように、ＤＳＰ（Ｄ
ｉｇｉｔａｌ Ｓｉｇｎａｌ Ｐｒｏｃｅｓｓｏｒ
）１１とＤ／Ａ変換器１２によって構成されていた。Ｄ
ＳＰ１１は、高速ディジタル演算処理を行うプログラマ
ブルな汎用処理装置であって、擬似乱数を発生するため
の擬似乱数発生器１１ａとこの擬似乱数の帯域を制限す
るためのディジタルフィルタ１１ｂとがプログラムされ
ている。そして、ＤＳＰ１１から出力されたディジタル
データは、Ｄ／Ａ変換器１２によってアナログ信号に変
換されて雑音として出力されることになる。
従来の雑音発生装置は、図３に示すように、ＤＳＰ（Ｄ
ｉｇｉｔａｌ Ｓｉｇｎａｌ Ｐｒｏｃｅｓｓｏｒ
）１１とＤ／Ａ変換器１２によって構成されていた。Ｄ
ＳＰ１１は、高速ディジタル演算処理を行うプログラマ
ブルな汎用処理装置であって、擬似乱数を発生するため
の擬似乱数発生器１１ａとこの擬似乱数の帯域を制限す
るためのディジタルフィルタ１１ｂとがプログラムされ
ている。そして、ＤＳＰ１１から出力されたディジタル
データは、Ｄ／Ａ変換器１２によってアナログ信号に変
換されて雑音として出力されることになる。
【０００４】
【発明が解決しようとする課題】ところが、上記従来の
雑音発生装置は、汎用性はあるが高価なＤＳＰ１１と、
このＤＳＰ１１が出力するディジタルデータをアナログ
信号に変換するためのＤ／Ａ変換器１２とが必要となる
ので、装置のコストが高くなるという問題があった。
雑音発生装置は、汎用性はあるが高価なＤＳＰ１１と、
このＤＳＰ１１が出力するディジタルデータをアナログ
信号に変換するためのＤ／Ａ変換器１２とが必要となる
ので、装置のコストが高くなるという問題があった。
【０００５】本発明は、上記事情に鑑み、雑音発生装置
をシフトレジスタ等からなる擬似乱数発生器とアナログ
フィルタとによる安価なハードウエア構成とすることを
目的としている。
をシフトレジスタ等からなる擬似乱数発生器とアナログ
フィルタとによる安価なハードウエア構成とすることを
目的としている。
【０００６】
【課題を解決するための手段】本発明の雑音発生装置は
、入力段のビットをシフト動作によって順次上位段にシ
フトさせるシフトレジスタ、及び該シフトレジスタの選
択された複数段のビットの排他的論理和をとって入力段
に戻す排他的論理和回路を有する擬似乱数発生器と、該
擬似乱数発生器におけるシフトレジスタの各段のビット
からなるディジタルデータの帯域を制限してアナログ信
号として出力するアナログ素子を有するアナログフィル
タとを備えており、そのことにより上記目的が達成され
る。
、入力段のビットをシフト動作によって順次上位段にシ
フトさせるシフトレジスタ、及び該シフトレジスタの選
択された複数段のビットの排他的論理和をとって入力段
に戻す排他的論理和回路を有する擬似乱数発生器と、該
擬似乱数発生器におけるシフトレジスタの各段のビット
からなるディジタルデータの帯域を制限してアナログ信
号として出力するアナログ素子を有するアナログフィル
タとを備えており、そのことにより上記目的が達成され
る。
【０００７】
【作用】擬似乱数発生器は、シフトレジスタの複数段の
ビットを排他的論理和回路を介して入力段に戻しながら
シフト動作を繰り返すようになっている。従って、この
入力段に戻すビットの段を適当に選べば、Ｍ系列法（最
大周期列法、Ｍａｘｉｍｕｍ−ｌｅｎｇｔｈ ｌｉｎ
ｅａｒｌｙ ｒｅｃｕｒｒｉｎｇ ｓｅｑｕｅｎｃ
ｅ）による擬似乱数を生成することができる。Ｍ系列の
擬似乱数は、シフトレジスタの段数をｍとすると、周期
が２のｍ乗となるランダムなビット列を生成することが
でき、このビット列によるディジタルデータは、多次元
においても一様な分布が得られる適当な雑音の信号源と
なる。
ビットを排他的論理和回路を介して入力段に戻しながら
シフト動作を繰り返すようになっている。従って、この
入力段に戻すビットの段を適当に選べば、Ｍ系列法（最
大周期列法、Ｍａｘｉｍｕｍ−ｌｅｎｇｔｈ ｌｉｎ
ｅａｒｌｙ ｒｅｃｕｒｒｉｎｇ ｓｅｑｕｅｎｃ
ｅ）による擬似乱数を生成することができる。Ｍ系列の
擬似乱数は、シフトレジスタの段数をｍとすると、周期
が２のｍ乗となるランダムなビット列を生成することが
でき、このビット列によるディジタルデータは、多次元
においても一様な分布が得られる適当な雑音の信号源と
なる。
【０００８】アナログフィルタは、抵抗器や演算増幅器
等のアナログ素子によって構成されたフィルタ回路であ
り、上記の擬似乱数発生器におけるシフトレジスタの各
段のビットからなるディジタルデータの帯域を制限して
アナログ信号として出力する。
等のアナログ素子によって構成されたフィルタ回路であ
り、上記の擬似乱数発生器におけるシフトレジスタの各
段のビットからなるディジタルデータの帯域を制限して
アナログ信号として出力する。
【０００９】この結果、本発明によれば、雑音発生装置
をシフトレジスタ等からなる擬似乱数発生器とアナログ
フィルタとによる簡単で安価なハードウエア構成とする
ことができる。
をシフトレジスタ等からなる擬似乱数発生器とアナログ
フィルタとによる簡単で安価なハードウエア構成とする
ことができる。
【００１０】
【実施例】本発明を実施例について以下に説明する。
【００１１】図１及び図２は本発明の一実施例を示すも
のであって、図１は雑音発生装置のブロック図、図２は
雑音発生装置のさらに詳細な回路ブロック図である。
のであって、図１は雑音発生装置のブロック図、図２は
雑音発生装置のさらに詳細な回路ブロック図である。
【００１２】本実施例の雑音発生装置は、図１に示すよ
うに、擬似乱数発生器１とアナログフィルタ２とによっ
て構成されている。
うに、擬似乱数発生器１とアナログフィルタ２とによっ
て構成されている。
【００１３】擬似乱数発生器１は、図２に示すように、
１ビット２３段のシフトレジスタ１ａと排他的論理和回
路１ｂとによって構成された２３ビットスクランブラで
あり、図示しない発振器からのクロック信号に基づいて
入力段のビットを順次上位段にシフトさせるシフト動作
を行うようになっている。擬似乱数発生器１では、シフ
ト動作のたびにシフトレジスタ１ａの最上段ビット（２
３回前の入力）とこれよりも下段側のあるビット（ｐ回
前の入力）とが排他的論理和回路１ｂにより排他的論理
和をとられて最下段ビットに入力され、下記数１の漸化
式によるＭ系列の擬似乱数が生成される。
１ビット２３段のシフトレジスタ１ａと排他的論理和回
路１ｂとによって構成された２３ビットスクランブラで
あり、図示しない発振器からのクロック信号に基づいて
入力段のビットを順次上位段にシフトさせるシフト動作
を行うようになっている。擬似乱数発生器１では、シフ
ト動作のたびにシフトレジスタ１ａの最上段ビット（２
３回前の入力）とこれよりも下段側のあるビット（ｐ回
前の入力）とが排他的論理和回路１ｂにより排他的論理
和をとられて最下段ビットに入力され、下記数１の漸化
式によるＭ系列の擬似乱数が生成される。
【００１４】
【数１】
【００１５】そして、このような擬似乱数発生器１では
、シフトレジスタ１ａの段数によって出力されるビット
列の最大周期が規定され、ここでは２の２３乗から１を
引いたものが最大周期となる。なお、上記ｐは、この最
大周期より短い周期が生じることのないような段数が選
ばれる。
、シフトレジスタ１ａの段数によって出力されるビット
列の最大周期が規定され、ここでは２の２３乗から１を
引いたものが最大周期となる。なお、上記ｐは、この最
大周期より短い周期が生じることのないような段数が選
ばれる。
【００１６】アナログフィルタ２は、図２に示すように
、演算増幅器２ａと多数の抵抗器Ｒとによって構成され
たフィルタ回路である。そして、擬似乱数発生器１にお
けるシフトレジスタ１ａの各段の出力がそれぞれ抵抗器
Ｒ１〜Ｒ２３を介して演算増幅器２ａの非反転入力＋と
反転入力−に交互に入力されるようになっている。これ
らの抵抗器Ｒ１〜Ｒ２３は、シフトレジスタ１ａの２３
段のディジタルデータが演算増幅器２ａの加減算により
所定の通過域を持つように設定された抵抗アレーである
。 また、演算増幅器２ａは、出力が抵抗器Ｒｆを介して反
転入力−に帰還され、非反転入力が抵抗器Ｒａを介して
接地されている。
、演算増幅器２ａと多数の抵抗器Ｒとによって構成され
たフィルタ回路である。そして、擬似乱数発生器１にお
けるシフトレジスタ１ａの各段の出力がそれぞれ抵抗器
Ｒ１〜Ｒ２３を介して演算増幅器２ａの非反転入力＋と
反転入力−に交互に入力されるようになっている。これ
らの抵抗器Ｒ１〜Ｒ２３は、シフトレジスタ１ａの２３
段のディジタルデータが演算増幅器２ａの加減算により
所定の通過域を持つように設定された抵抗アレーである
。 また、演算増幅器２ａは、出力が抵抗器Ｒｆを介して反
転入力−に帰還され、非反転入力が抵抗器Ｒａを介して
接地されている。
【００１７】上記構成による本実施例の雑音発生装置は
、擬似乱数発生器１がシフトレジスタ１ａをシフト動作
させて、Ｍ系列の擬似乱数によるディジタルデータを順
次生成する。そして、このディジタルデータは、アナロ
グフィルタ２によって帯域制限されてアナログ信号とし
て出力される。
、擬似乱数発生器１がシフトレジスタ１ａをシフト動作
させて、Ｍ系列の擬似乱数によるディジタルデータを順
次生成する。そして、このディジタルデータは、アナロ
グフィルタ２によって帯域制限されてアナログ信号とし
て出力される。
【００１８】この結果、本実施例によれば、シフトレジ
スタ１ａ等からなる簡単なハードウエア構成の擬似乱数
発生器１によってランダムなディジタルデータを生成し
、Ｄ／Ａ変換器と同程度のハードウエアからなるアナロ
グフィルタ２によってアナログ信号として出力すること
ができるので、雑音発生装置を安価に製造することがで
きるようになる。
スタ１ａ等からなる簡単なハードウエア構成の擬似乱数
発生器１によってランダムなディジタルデータを生成し
、Ｄ／Ａ変換器と同程度のハードウエアからなるアナロ
グフィルタ２によってアナログ信号として出力すること
ができるので、雑音発生装置を安価に製造することがで
きるようになる。
【００１９】
【発明の効果】以上の説明から明かなように、本発明の
雑音発生装置によれば、シフトレジスタ等からなる擬似
乱数発生器とアナログフィルタとによる簡単なハードウ
エア構成によってスペクトルが一様な雑音を生成するこ
とが可能となるので、装置を安価に製造することができ
るようになる。
雑音発生装置によれば、シフトレジスタ等からなる擬似
乱数発生器とアナログフィルタとによる簡単なハードウ
エア構成によってスペクトルが一様な雑音を生成するこ
とが可能となるので、装置を安価に製造することができ
るようになる。
【図１】本発明の一実施例のブロック図である。
【図２】その実施例のさらに詳細な回路ブロック図であ
る。
る。
【図３】従来例を示すものであって、ＤＳＰを使用した
雑音発生装置のブロック図である。
雑音発生装置のブロック図である。
１ 擬似乱数発生器
１ａ シフトレジスタ
１ｂ 排他的論理和回路
２ アナログフィルタ
２ａ 演算増幅器
Ｒ１〜Ｒ２３、Ｒｆ、Ｒａ 抵抗器
Claims (1)
- 【請求項１】入力段のビットをシフト動作によって順次
上位段にシフトさせるシフトレジスタ、及び該シフトレ
ジスタの選択された複数段のビットの排他的論理和をと
って入力段に戻す排他的論理和回路を有する擬似乱数発
生器と、該擬似乱数発生器におけるシフトレジスタの各
段のビットからなるディジタルデータの帯域を制限して
アナログ信号として出力するアナログ素子を有するアナ
ログフィルタとを備えている雑音発生装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3012002A JP2795545B2 (ja) | 1991-02-01 | 1991-02-01 | 雑音発生装置 |
| US07/826,937 US5243303A (en) | 1991-02-01 | 1992-01-29 | Pseudo-random noise signal generator |
| DE69229686T DE69229686T2 (de) | 1991-02-01 | 1992-01-31 | Rauchsignalgenerator |
| EP92300847A EP0497618B1 (en) | 1991-02-01 | 1992-01-31 | Noise generating device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3012002A JP2795545B2 (ja) | 1991-02-01 | 1991-02-01 | 雑音発生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04247704A true JPH04247704A (ja) | 1992-09-03 |
| JP2795545B2 JP2795545B2 (ja) | 1998-09-10 |
Family
ID=11793382
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3012002A Expired - Fee Related JP2795545B2 (ja) | 1991-02-01 | 1991-02-01 | 雑音発生装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5243303A (ja) |
| EP (1) | EP0497618B1 (ja) |
| JP (1) | JP2795545B2 (ja) |
| DE (1) | DE69229686T2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20030049803A (ko) * | 2001-12-17 | 2003-06-25 | (주) 윌텍정보통신 | 부가성 백색잡음 발생 장치 |
Families Citing this family (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5914827A (en) * | 1996-02-28 | 1999-06-22 | Silicon Systems, Inc. | Method and apparatus for implementing a noise generator in an integrated circuit disk drive read channel |
| JP3512939B2 (ja) * | 1996-03-12 | 2004-03-31 | 株式会社ルネサステクノロジ | 疑似乱数発生回路及び双方向シフトレジスタ |
| US5789890A (en) * | 1996-03-22 | 1998-08-04 | Genmark Automation | Robot having multiple degrees of freedom |
| US5786951A (en) * | 1996-06-05 | 1998-07-28 | Cirrus Logic, Inc. | Sampled amplitude read channel employing a discrete time noise generator for calibration |
| KR100611955B1 (ko) * | 1999-07-20 | 2006-08-11 | 삼성전자주식회사 | 스크램블러 |
| US6301364B1 (en) | 1999-10-06 | 2001-10-09 | Acoustic Technologies, Inc. | Tagging echoes with low frequency noise |
| US6631390B1 (en) | 2000-03-06 | 2003-10-07 | Koninklijke Philips Electronics N.V. | Method and apparatus for generating random numbers using flip-flop meta-stability |
| US6882689B2 (en) * | 2000-12-12 | 2005-04-19 | The Regents Of The University Of California | Pseudo-chaotic communication method exploiting symbolic dynamics |
| EP1293856A1 (fr) * | 2001-09-18 | 2003-03-19 | EM Microelectronic-Marin SA | Circuit Intégré sécurisé comprenant des parties à caractère confidentiel, et procédé pour sa mise en action |
| US7015851B1 (en) * | 2004-10-26 | 2006-03-21 | Agilent Technologies, Inc. | Linearizing ADCs using single-bit dither |
| CN100413191C (zh) * | 2005-03-30 | 2008-08-20 | 昂宝电子（上海）有限公司 | 用于控制电源变换器中的开关频率变化的系统和方法 |
| RU2619468C1 (ru) * | 2016-05-31 | 2017-05-16 | Общество с ограниченной ответственностью "НаноПульс" | Способ работы импульсной радиолокационной системы и устройство для его реализации |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51111041A (en) * | 1975-03-26 | 1976-10-01 | Agency Of Ind Science & Technol | Irregular signal generator |
| JPS62129813U (ja) * | 1986-02-07 | 1987-08-17 |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3742381A (en) * | 1971-06-09 | 1973-06-26 | California Inst Of Techn | Wideband digital pseudo gaussian noise generator |
| JPS5541465A (en) * | 1978-09-20 | 1980-03-24 | Kawai Musical Instr Mfg Co | Band noise generator |
| US4218749A (en) * | 1978-09-25 | 1980-08-19 | Sangamo Weston, Inc. | Apparatus and method for digital noise synthesis |
| US4719643A (en) * | 1984-12-24 | 1988-01-12 | Gte Communication Systems Corporation | Pseudo random framing generator circuit |
| US4855944A (en) * | 1987-09-04 | 1989-08-08 | Rockwell International Corporation | Noise generator with shaped spectrum |
| US5153532A (en) * | 1989-05-24 | 1992-10-06 | Honeywell Inc. | Noise generator using combined outputs of two pseudo-random sequence generators |
-
1991
- 1991-02-01 JP JP3012002A patent/JP2795545B2/ja not_active Expired - Fee Related
-
1992
- 1992-01-29 US US07/826,937 patent/US5243303A/en not_active Expired - Lifetime
- 1992-01-31 DE DE69229686T patent/DE69229686T2/de not_active Expired - Fee Related
- 1992-01-31 EP EP92300847A patent/EP0497618B1/en not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51111041A (en) * | 1975-03-26 | 1976-10-01 | Agency Of Ind Science & Technol | Irregular signal generator |
| JPS62129813U (ja) * | 1986-02-07 | 1987-08-17 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20030049803A (ko) * | 2001-12-17 | 2003-06-25 | (주) 윌텍정보통신 | 부가성 백색잡음 발생 장치 |
Also Published As
| Publication number | Publication date |
|---|---|
| EP0497618A2 (en) | 1992-08-05 |
| DE69229686D1 (de) | 1999-09-09 |
| EP0497618A3 (en) | 1994-06-08 |
| JP2795545B2 (ja) | 1998-09-10 |
| EP0497618B1 (en) | 1999-08-04 |
| DE69229686T2 (de) | 1999-12-30 |
| US5243303A (en) | 1993-09-07 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JPH04247704A (ja) | 雑音発生装置 | |
| EP2000901A2 (en) | Mixed radix number generator with chosen statistical artifacts | |
| GB2419754A (en) | Analogue to digital converter utilsing analogue dither | |
| EP0240546A1 (en) | RANDOM SEQUENCE GENERATORS. | |
| Sewak et al. | FPGA implementation of 16 bit BBS and LFSR PN sequence generator: A comparative study | |
| CA2852832A1 (en) | Method and system for generating random numbers | |
| JP5670849B2 (ja) | 擬似乱数生成装置、および、擬似乱数生成方法 | |
| Cardoso et al. | A new PRNG hardware architecture based on an exponential chaotic map | |
| JP3917864B2 (ja) | 疑似ランダム信号生成方法及びその装置 | |
| Singh et al. | FPGA Implementation of Chaos based Pseudo Random Number Generator | |
| US7379955B1 (en) | Device for and method of generating pseudo-random sequence uniformly distributed over any range | |
| JP3886359B2 (ja) | 雑音発生器、雑音発生方法およびプログラム | |
| Tasheva | A short survey of p-ary pseudo-random sequences | |
| Falih | A Pseudorandom Binary Generator Based on Chaotic Linear Feedback Shift Register | |
| JP3425163B2 (ja) | 乱数生成装置 | |
| HUP0001735A2 (hu) | Többvivős eljárás digitális adatok továbbítására és eszköz ilyen eljárás foganatosítására | |
| Alioto et al. | On the suitability of digital maps for integrated pseudo-RNGs | |
| SU1023326A1 (ru) | Генератор псевдослучайных последовательностей | |
| CN117289899A (zh) | 一种量子随机数生成系统 | |
| EP2372528A1 (en) | Pseudo-noise generator | |
| GB2031197A (en) | Pseudo-random noise generator | |
| Mukherjee et al. | Parameterizable testing scheme for FIR filters | |
| CN113849155A (zh) | 一种基于伪随机序列的自适应噪声抑制方法及系统 | |
| Walidainy et al. | Design and Implementations of Linear Congruential Generator into FPGA | |
| RU2208289C1 (ru) | Широкополосный цифровой генератор шума |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980615 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090626 Year of fee payment: 11 |
|
| LAPS | Cancellation because of no payment of annual fees |