JPH04223785A - 映像信号補間処理方法 - Google Patents
映像信号補間処理方法Info
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- JPH04223785A JPH04223785A JP2414489A JP41448990A JPH04223785A JP H04223785 A JPH04223785 A JP H04223785A JP 2414489 A JP2414489 A JP 2414489A JP 41448990 A JP41448990 A JP 41448990A JP H04223785 A JPH04223785 A JP H04223785A
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- 238000000034 method Methods 0.000 claims description 6
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- 238000001514 detection method Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/915—Television signal processing therefor for field- or frame-skip recording or reproducing
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/01—Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level
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- H04N7/012—Conversion between an interlaced and a progressive signal
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- Computer Graphics (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Television Systems (AREA)
- Television Signal Processing For Recording (AREA)
- Color Television Systems (AREA)
- Controls And Circuits For Display Device (AREA)
- Picture Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は映像処理装置におけるフ
ィールド信号をインターレス信号に変換する際の映像信
号補間処理方法に関する。
ィールド信号をインターレス信号に変換する際の映像信
号補間処理方法に関する。
【０００２】
【従来の技術】ビデオテープレコーダ（ＶＴＲ）、ビデ
オディスクあるいは画面メモリを用いた映像信号装置で
は、１フィールド分の映像信号のみを用いてインターレ
ス信号を得る場合がある。この場合、第１の例として同
一信号によって、２フィールドインターレスを行う方法
がある。例えば、図８Ａに示す奇数（ＯＤＤ）フィール
ド信号が与えられているときに、図８Ｂに示すように偶
数（ＥＶＥＮ）フィールドには奇数フィールドど同一の
信号を出力するようにする。ここで図８Ｃは図８Ｂのラ
インを対応して横から見たものである。また、第２の例
として平均値補間処理方法が知られている。図９は、こ
の平均値補間処理方法を実現するための平均値補間回路
を示している。この平均値補間回路は奇数信号が１ライ
ン遅延回路２と１／２割り算回路４に入力されており、
さらに１ライン遅延回路２の出力信号が１／２割り算回
路６に入力される。この１／２割り算回路６と１／２割
り算回路４の出力信号を加算器８で加算し、この加算器
８の出力信号と入力奇数信号とを、奇数あるいは偶数信
号で選択する。これによって、図１０Ａのように与えら
れているフィールドの２ラインの平均値補間処理により
、図１０Ｂに示すように他のフィールドが生成されるも
のである。なお図１０Ｄは図１０Ｃのラインを対応して
横から見たものである。このように１フィールド分の映
像信号のみを用いてインターレス信号に変換している。
オディスクあるいは画面メモリを用いた映像信号装置で
は、１フィールド分の映像信号のみを用いてインターレ
ス信号を得る場合がある。この場合、第１の例として同
一信号によって、２フィールドインターレスを行う方法
がある。例えば、図８Ａに示す奇数（ＯＤＤ）フィール
ド信号が与えられているときに、図８Ｂに示すように偶
数（ＥＶＥＮ）フィールドには奇数フィールドど同一の
信号を出力するようにする。ここで図８Ｃは図８Ｂのラ
インを対応して横から見たものである。また、第２の例
として平均値補間処理方法が知られている。図９は、こ
の平均値補間処理方法を実現するための平均値補間回路
を示している。この平均値補間回路は奇数信号が１ライ
ン遅延回路２と１／２割り算回路４に入力されており、
さらに１ライン遅延回路２の出力信号が１／２割り算回
路６に入力される。この１／２割り算回路６と１／２割
り算回路４の出力信号を加算器８で加算し、この加算器
８の出力信号と入力奇数信号とを、奇数あるいは偶数信
号で選択する。これによって、図１０Ａのように与えら
れているフィールドの２ラインの平均値補間処理により
、図１０Ｂに示すように他のフィールドが生成されるも
のである。なお図１０Ｄは図１０Ｃのラインを対応して
横から見たものである。このように１フィールド分の映
像信号のみを用いてインターレス信号に変換している。
【０００３】
【発明が解決しようとする課題】しかしながら、従来例
の第１の例では、図８Ｂに示す偶数ライン（ａ）、奇数
ライン（ｂ）間でラインフリッカが発生して、斜め線が
階段状になり、またＶジッタ状に見えるという欠点があ
る。すなわち、垂直方向の変化が激しい高い周波数成分
を有するところがインターレスキャリヤによって折り返
され、３０Ｈｚのフリッカとなる。所謂、垂直方向の映
像変化点の中心がフィールドによって相違するものであ
る。また、第２の例の平均値補間処理方法では前記の第
１の例に対して斜め線が滑らかであり、ラインフリッカ
が低減する。しかし、このライン平均として得られた映
像信号は５２５／２ラインでデップ点を有するような垂
直のＬＰＦでろ波されたものであり、見かけ上の先鋭度
が落ちるものとなる。さらに垂直方向に細かく変化する
（例えば、細かい横縞）ところは、大面積のフリッカに
なる。極端な例として、図１１Ａに示すような奇数フィ
ールドの映像が１ラインごとに変化する映像信号を平均
値補間処理すると図１１Ｂ（なお、図１１Ｃは、この図
１１Ｂを横から見たものであり、偶数フイールドが平均
化されている。）に示すように生成さたフィールドはＤ
Ｃ成分が大きくなり、図１２に示すように与えられたフ
ィールドとは絵柄が異なってしまう等の欠点がある。
の第１の例では、図８Ｂに示す偶数ライン（ａ）、奇数
ライン（ｂ）間でラインフリッカが発生して、斜め線が
階段状になり、またＶジッタ状に見えるという欠点があ
る。すなわち、垂直方向の変化が激しい高い周波数成分
を有するところがインターレスキャリヤによって折り返
され、３０Ｈｚのフリッカとなる。所謂、垂直方向の映
像変化点の中心がフィールドによって相違するものであ
る。また、第２の例の平均値補間処理方法では前記の第
１の例に対して斜め線が滑らかであり、ラインフリッカ
が低減する。しかし、このライン平均として得られた映
像信号は５２５／２ラインでデップ点を有するような垂
直のＬＰＦでろ波されたものであり、見かけ上の先鋭度
が落ちるものとなる。さらに垂直方向に細かく変化する
（例えば、細かい横縞）ところは、大面積のフリッカに
なる。極端な例として、図１１Ａに示すような奇数フィ
ールドの映像が１ラインごとに変化する映像信号を平均
値補間処理すると図１１Ｂ（なお、図１１Ｃは、この図
１１Ｂを横から見たものであり、偶数フイールドが平均
化されている。）に示すように生成さたフィールドはＤ
Ｃ成分が大きくなり、図１２に示すように与えられたフ
ィールドとは絵柄が異なってしまう等の欠点がある。
【０００４】本発明の映像信号補間処理方法は、この課
題に鑑みてなされ、斜め線の階段状変化およびＶジッタ
状のラインフリッカが減少するとともに、見かけ上の先
鋭度が低下せず、さらに垂直方向の細かい変化部でフリ
ッカが発生せずに良好な補間処理ができる優れた映像信
号補間処理方法を提供することを目的とする。
題に鑑みてなされ、斜め線の階段状変化およびＶジッタ
状のラインフリッカが減少するとともに、見かけ上の先
鋭度が低下せず、さらに垂直方向の細かい変化部でフリ
ッカが発生せずに良好な補間処理ができる優れた映像信
号補間処理方法を提供することを目的とする。
【０００５】
【課題を解決するための手段】本発明は、例えば、図１
乃至図６の映像信号補間処理方法に示すように、１フィ
ールド分の映像信号のみを用いてインターレス信号を得
る映像信号補間処理方法において、垂直方向に変化のな
い部分では、与えられたフィールドの信号をそのまま用
いて他フィールドとし、あるいは平均値補間処理とし、
垂直方向にステップ状に変化する部分では平均値補間処
理とし、垂直方向に細かく繰り返す変化のある部分では
、与えられたフィールドの信号をそのまま用いて他フィ
ールドを生成するように補間処理を施すものである。
乃至図６の映像信号補間処理方法に示すように、１フィ
ールド分の映像信号のみを用いてインターレス信号を得
る映像信号補間処理方法において、垂直方向に変化のな
い部分では、与えられたフィールドの信号をそのまま用
いて他フィールドとし、あるいは平均値補間処理とし、
垂直方向にステップ状に変化する部分では平均値補間処
理とし、垂直方向に細かく繰り返す変化のある部分では
、与えられたフィールドの信号をそのまま用いて他フィ
ールドを生成するように補間処理を施すものである。
【０００６】
【作用】この発明の映像信号補間処理方法では、斜め線
の階段状変化およびＶジッタ状のラインフリッカが減少
するとともに、先鋭度が低下せずさらに垂直方向の細か
い変化部でフリッカが発生せずに、良好な補間処理がで
きるものとなる。
の階段状変化およびＶジッタ状のラインフリッカが減少
するとともに、先鋭度が低下せずさらに垂直方向の細か
い変化部でフリッカが発生せずに、良好な補間処理がで
きるものとなる。
【０００７】
【実施例】以下、この発明の映像信号補間処理方法の一
実施例を図面を参照して詳細に説明する。この補間処理
方法は垂直方向に変化のない部分では、（１）与えられ
たフィールドの信号をそのまま用いて他フィールドとす
る補間処理とし、あるいは平均値補間処理とする。また
、（２）垂直方向にステップ状に変化する部分では平均
値補間処理とし、続いて、（３）垂直方向に細かく繰り
返す変化の、ある部分では与えられたフィールドの信号
をそのまま用いて他フィールドを生成するものである。 このような（１），（２），（３）の補間処理の適応に
は周知のロジカルフィルターを用いれば良い。
実施例を図面を参照して詳細に説明する。この補間処理
方法は垂直方向に変化のない部分では、（１）与えられ
たフィールドの信号をそのまま用いて他フィールドとす
る補間処理とし、あるいは平均値補間処理とする。また
、（２）垂直方向にステップ状に変化する部分では平均
値補間処理とし、続いて、（３）垂直方向に細かく繰り
返す変化の、ある部分では与えられたフィールドの信号
をそのまま用いて他フィールドを生成するものである。 このような（１），（２），（３）の補間処理の適応に
は周知のロジカルフィルターを用いれば良い。
【０００８】図１はロジカルフィルターの基本構成を示
している。ここで最小値検出回路（以下、必要に応じて
ＭＩＮと記載する）２０、２２、２４は比較される２つ
の信号の小さい方を出力し、最大値検出回路（以下、必
要に応じてＭＡＸと記載する）３０、３２、３４は大き
い方を出力するものである。故に、ＭＩＮ２４とＭＡＸ
３４の出力を加算部４０で合成し、且つ、この出力を１
／２にしたロジカルフィルターの出力Ｘは、Ｘ＝１／２
［ＭＩＮ｛ＭＡＸ（Ａ，Ｂ），ＭＡＸ（Ｂ，Ｃ）｝＋Ｍ
ＡＸ｛ＭＩＮ（Ａ，Ｂ），ＭＩＮ（Ｂ，Ｃ）｝］で表さ
れる。
している。ここで最小値検出回路（以下、必要に応じて
ＭＩＮと記載する）２０、２２、２４は比較される２つ
の信号の小さい方を出力し、最大値検出回路（以下、必
要に応じてＭＡＸと記載する）３０、３２、３４は大き
い方を出力するものである。故に、ＭＩＮ２４とＭＡＸ
３４の出力を加算部４０で合成し、且つ、この出力を１
／２にしたロジカルフィルターの出力Ｘは、Ｘ＝１／２
［ＭＩＮ｛ＭＡＸ（Ａ，Ｂ），ＭＡＸ（Ｂ，Ｃ）｝＋Ｍ
ＡＸ｛ＭＩＮ（Ａ，Ｂ），ＭＩＮ（Ｂ，Ｃ）｝］で表さ
れる。
【０００９】図２は３つの入力信号のＡライン，Ｂライ
ン，Ｃラインのレベル差で表わされる８つの入力パター
ンについて、その結果である出力Ｘを示したものである
。ここで図２の（ｆ）、（ｇ）の入力パターンでは３つ
のＡライン，Ｂライン，Ｃラインの最大値と最小値の平
均値が出力されており、他の入力パターンと区別されて
いる。
ン，Ｃラインのレベル差で表わされる８つの入力パター
ンについて、その結果である出力Ｘを示したものである
。ここで図２の（ｆ）、（ｇ）の入力パターンでは３つ
のＡライン，Ｂライン，Ｃラインの最大値と最小値の平
均値が出力されており、他の入力パターンと区別されて
いる。
【００１０】図３は図２のロジカルフィルターを補間処
理回路に適用したものである。すなわち、この補間処理
回路は前記の（１）、（２）、（３）のように垂直方向
に変化のない部分では、与えられたフィールドの信号を
、そのまま用いて他フィールドとし、あるいは平均値補
間処理とし、さらに、垂直方向にステップ状に変化する
部分では平均値補間処理とし、続いて、垂直方向に細か
く繰り返す変化のある部分では、与えられたフィールド
の信号をそのまま用いて他フィールドを生成する。垂直
方向に３ライン分の映像信号パターンから補間処理信号
、例えば、奇数フィールドのＡライン，Ｂライン，Ｃラ
インが与えられたなら、ロジカルフィルターによって、
ＢラインとＣラインの間に位置する偶数フィールドのラ
インが得られる。したがって、図３の出力Ｘは、Ｘ＝１
／２［ＭＩＮ｛ＭＡＸ（Ａ，Ｃ），ＭＡＸ（Ｂ，Ｃ）｝
＋ＭＡＸ｛ＭＩＮ（Ａ，Ｃ），ＭＩＮ（Ｂ，Ｃ）｝］で
表される。
理回路に適用したものである。すなわち、この補間処理
回路は前記の（１）、（２）、（３）のように垂直方向
に変化のない部分では、与えられたフィールドの信号を
、そのまま用いて他フィールドとし、あるいは平均値補
間処理とし、さらに、垂直方向にステップ状に変化する
部分では平均値補間処理とし、続いて、垂直方向に細か
く繰り返す変化のある部分では、与えられたフィールド
の信号をそのまま用いて他フィールドを生成する。垂直
方向に３ライン分の映像信号パターンから補間処理信号
、例えば、奇数フィールドのＡライン，Ｂライン，Ｃラ
インが与えられたなら、ロジカルフィルターによって、
ＢラインとＣラインの間に位置する偶数フィールドのラ
インが得られる。したがって、図３の出力Ｘは、Ｘ＝１
／２［ＭＩＮ｛ＭＡＸ（Ａ，Ｃ），ＭＡＸ（Ｂ，Ｃ）｝
＋ＭＡＸ｛ＭＩＮ（Ａ，Ｃ），ＭＩＮ（Ｂ，Ｃ）｝］で
表される。
【００１１】図４は図３に示す補間処理回路の入力パタ
ーンと出力Ｘの補間処理結果を示している。図４におい
て、Ｂライン，Ｃライン間のｍで補間処理しようとした
場合に注目すると、（ａ），（ｈ）は垂直方向に変化の
ない部分であり、与えられたフィールドの信号をそのま
ま用いて、出力Ｘとして示すように他フィールドとなる
。（ｄ）（ｅ）のステップ状に変化する部分では、平均
値補間処理となっている。（ｂ），（ｃ）のステップ変
化後の平坦部では 与えられたフィールドの信号をそ
のまま用いて他フィールドとなる。（ｆ），（ｇ）は繰
り返し変化のある部分を示しており、与えられたフィー
ルドの信号をそのまま用いて他フィールドが生成される
。
ーンと出力Ｘの補間処理結果を示している。図４におい
て、Ｂライン，Ｃライン間のｍで補間処理しようとした
場合に注目すると、（ａ），（ｈ）は垂直方向に変化の
ない部分であり、与えられたフィールドの信号をそのま
ま用いて、出力Ｘとして示すように他フィールドとなる
。（ｄ）（ｅ）のステップ状に変化する部分では、平均
値補間処理となっている。（ｂ），（ｃ）のステップ変
化後の平坦部では 与えられたフィールドの信号をそ
のまま用いて他フィールドとなる。（ｆ），（ｇ）は繰
り返し変化のある部分を示しており、与えられたフィー
ルドの信号をそのまま用いて他フィールドが生成される
。
【００１２】図５は、この図４の補間処理を示すもので
あり奇数フィールド（１）から、ロジカルフィルターに
よって、偶数フィールド（２）が適正、すなわち、変化
のない平坦部（ｐ）と、ステップ状に変化する部分（ｑ
）と、繰り返し変化のある部分（ｒ）が適性に生成され
ることを示している。
あり奇数フィールド（１）から、ロジカルフィルターに
よって、偶数フィールド（２）が適正、すなわち、変化
のない平坦部（ｐ）と、ステップ状に変化する部分（ｑ
）と、繰り返し変化のある部分（ｒ）が適性に生成され
ることを示している。
【００１３】次に、このような処理を実現する具体的回
路を示す。図６は図３に示す補間処理回路をデジタル信
号処理で行う場合の構成である。３０，３２は１Ｈ遅延
ライン（例えば、ＦＩＦＯ）であり、コンパレータ３４
、３６、３８によって、３つのＡライン，Ｂライン，Ｃ
ラインのレベルの大小関係を調べる。すなわち、コンパ
レータ３４でＡ＞Ｂを比較してＡラインのレベルが大き
い場合に出力信号を送出する。また、同様にコンパレー
タ３６でＡ＞Ｃおよびコンパレータ３８でＢ＞Ｃを比較
し、その比較結果をデコーダ４０に入力する。そして、
デコーダ４０で解析した制御信号でデジタルスイッチＳ
Ｗ１およびＳＷ２を切り換える。すなわち、スイッチＳ
Ｗ１の出力はＭＩＮ｛ＭＡＸ（Ａ，Ｃ），ＭＡＸ（Ｂ，
Ｃ）｝の結果が得られる。さらにスイッチＳＷ２の出力
にはＭＡＸ｛ＭＩＮ（Ａ，Ｃ），ＭＩＮ（Ｂ，Ｃ）｝の
結果が得られるようにする。これを加算器４２で合成し
、１／２割り算部４４でレベル整合の処理を施し、さら
に、奇数／偶数の信号をデコーダ４０に入力することで
、奇数フィールドのデータから偶数フィールドのデータ
を補間処理によって求める場合は、奇数のときはスイッ
チＳＷ１，ＳＷ２がＢラインの位置に固定され、偶数の
ときはロジカルフィルターとしてスイッチＳＷ１，ＳＷ
２が動くようにする。なお、このデジタル信号処理の補
間処理回はアナログ信号処理でも構成できる。
路を示す。図６は図３に示す補間処理回路をデジタル信
号処理で行う場合の構成である。３０，３２は１Ｈ遅延
ライン（例えば、ＦＩＦＯ）であり、コンパレータ３４
、３６、３８によって、３つのＡライン，Ｂライン，Ｃ
ラインのレベルの大小関係を調べる。すなわち、コンパ
レータ３４でＡ＞Ｂを比較してＡラインのレベルが大き
い場合に出力信号を送出する。また、同様にコンパレー
タ３６でＡ＞Ｃおよびコンパレータ３８でＢ＞Ｃを比較
し、その比較結果をデコーダ４０に入力する。そして、
デコーダ４０で解析した制御信号でデジタルスイッチＳ
Ｗ１およびＳＷ２を切り換える。すなわち、スイッチＳ
Ｗ１の出力はＭＩＮ｛ＭＡＸ（Ａ，Ｃ），ＭＡＸ（Ｂ，
Ｃ）｝の結果が得られる。さらにスイッチＳＷ２の出力
にはＭＡＸ｛ＭＩＮ（Ａ，Ｃ），ＭＩＮ（Ｂ，Ｃ）｝の
結果が得られるようにする。これを加算器４２で合成し
、１／２割り算部４４でレベル整合の処理を施し、さら
に、奇数／偶数の信号をデコーダ４０に入力することで
、奇数フィールドのデータから偶数フィールドのデータ
を補間処理によって求める場合は、奇数のときはスイッ
チＳＷ１，ＳＷ２がＢラインの位置に固定され、偶数の
ときはロジカルフィルターとしてスイッチＳＷ１，ＳＷ
２が動くようにする。なお、このデジタル信号処理の補
間処理回はアナログ信号処理でも構成できる。
【００１４】図７は、このアナログ信号処理のための回
路図等を示している。この場合、コンパレータ３４、３
６、３８、すなわち、図７ＡのＭＩＮ２０，２２，２４
は図７Ｂに示すＥＣＬ（エミッタ結合ロジック）比較器
を用いる。同様に図７ＣのＭＡＸ３０，３２，３４は図
７Ｄに示すＥＣＬ（エミッタ結合ロジック）比較器を用
いる。図７Ｂに示すＥＣＬ比較器はトランジスタＴＲ１
およびＴＲ２のベースに入力されて比較される２つの信
号Ａ、Ｂのから、小さいレベルの信号がエミッタに接続
された抵抗器Ｒ１と接地間に出力される。同様に図７Ｄ
に示すＥＣＬ比較器はトランジスタＴＲ４およびＴＲ５
のベースに入力されて比較される２つの信号Ａ、Ｂのか
ら大きいレベルの信号がエミッタの抵抗器Ｒ２と接地間
に出力される。他の構成、すなわち、補間処理を実行す
る場合の他の部分は図６に示す構成と同一にすれば良い
。このように、図６に示すデジタル信号処理の補間回路
では、斜め線の階段状変化およびＶジッタ状のラインフ
リッカが減少するとともに、見かけ上の先鋭度が低下せ
ずさらに垂直方向の細かい変化部でフリッカが発生せず
、比較的簡単な構成で良好な補間処理ができるものとな
る。
路図等を示している。この場合、コンパレータ３４、３
６、３８、すなわち、図７ＡのＭＩＮ２０，２２，２４
は図７Ｂに示すＥＣＬ（エミッタ結合ロジック）比較器
を用いる。同様に図７ＣのＭＡＸ３０，３２，３４は図
７Ｄに示すＥＣＬ（エミッタ結合ロジック）比較器を用
いる。図７Ｂに示すＥＣＬ比較器はトランジスタＴＲ１
およびＴＲ２のベースに入力されて比較される２つの信
号Ａ、Ｂのから、小さいレベルの信号がエミッタに接続
された抵抗器Ｒ１と接地間に出力される。同様に図７Ｄ
に示すＥＣＬ比較器はトランジスタＴＲ４およびＴＲ５
のベースに入力されて比較される２つの信号Ａ、Ｂのか
ら大きいレベルの信号がエミッタの抵抗器Ｒ２と接地間
に出力される。他の構成、すなわち、補間処理を実行す
る場合の他の部分は図６に示す構成と同一にすれば良い
。このように、図６に示すデジタル信号処理の補間回路
では、斜め線の階段状変化およびＶジッタ状のラインフ
リッカが減少するとともに、見かけ上の先鋭度が低下せ
ずさらに垂直方向の細かい変化部でフリッカが発生せず
、比較的簡単な構成で良好な補間処理ができるものとな
る。
【００１５】
【発明の効果】以上の説明から理解されるように、この
発明の映像信号補間処理方法は、与えられたフィールド
の信号をそのまま用いて他フィールドとし、あるいは平
均値補間処理として斜め線の階段状変化が低減し、さら
に垂直方向にステップ状に変化する部分では平均値補間
処理として、Ｖジッタ状のラインフリッカが減少する。 また垂直方向に細かく繰り返す変化のある部分では与え
られたフィールドの信号をそのまま用いて他フィールド
を生成するようにしているため、見かけ上の先鋭度が低
下せずさらに垂直方向の細かい変化部でフリッカが発生
し難いものとなり、良好な補間処理ができる効果がある
。
発明の映像信号補間処理方法は、与えられたフィールド
の信号をそのまま用いて他フィールドとし、あるいは平
均値補間処理として斜め線の階段状変化が低減し、さら
に垂直方向にステップ状に変化する部分では平均値補間
処理として、Ｖジッタ状のラインフリッカが減少する。 また垂直方向に細かく繰り返す変化のある部分では与え
られたフィールドの信号をそのまま用いて他フィールド
を生成するようにしているため、見かけ上の先鋭度が低
下せずさらに垂直方向の細かい変化部でフリッカが発生
し難いものとなり、良好な補間処理ができる効果がある
。
【図１】本発明の映像信号補間処理方法を実現するため
のロジカルフィルターの基本構成図である。
のロジカルフィルターの基本構成図である。
【図２】図１のロジカルフィルターの基本構成図の動作
説明に供され、入力信号のＡ，Ｂ，Ｃラインがレベル差
の８つの場合の結果を示す図である。
説明に供され、入力信号のＡ，Ｂ，Ｃラインがレベル差
の８つの場合の結果を示す図である。
【図３】図１に示す基本構成のロジカルフィルターを本
発明の映像信号補間処理方法に適用した補間処理回路の
ブロック線図である。
発明の映像信号補間処理方法に適用した補間処理回路の
ブロック線図である。
【図４】図３に示す補間処理回路の動作説明に供され、
入力パターンと出力の補間処理結果を示す図である。
入力パターンと出力の補間処理結果を示す図である。
【図５】図４にあって、奇数フィールドから偶数フィー
ルドが適正に生成される状態の補間処理を示す図である
。
ルドが適正に生成される状態の補間処理を示す図である
。
【図６】本発明の映像信号補間処理方法を実現するため
のデジタル信号処理における補間処理回路を示すブロッ
ク線図である。
のデジタル信号処理における補間処理回路を示すブロッ
ク線図である。
【図７】Ａ，Ｂ，Ｃ，Ｄは補間処理回路がアナログ信号
処理の場合ののＥＣＬ比較器の構成を示す回路図である
。
処理の場合ののＥＣＬ比較器の構成を示す回路図である
。
【図８】Ａ，Ｂ，Ｃは従来の動作説明に供され、１フィ
ールド分の映像信号のみを用いてインターレス信号を得
る場合の補間処理の動作説明に供される図である。
ールド分の映像信号のみを用いてインターレス信号を得
る場合の補間処理の動作説明に供される図である。
【図９】従来の平均値補間処理方法が適用される平均値
補間処理回路の構成を示すブロック線図である。
補間処理回路の構成を示すブロック線図である。
【図１０】Ａ，Ｂ，Ｃは図９に示す平均値補間処理回路
における平均値補間処理の動作説明に供される図である
。
における平均値補間処理の動作説明に供される図である
。
【図１１】Ａ，Ｂ，Ｃは図１０における平均値補間処理
の説明に供される図である。
の説明に供される図である。
【図１２】図１０における平均値補間処理の説明に供さ
れ、与えられたフィールドとは絵柄が異なってしまう場
合を示す斜視図である。
れ、与えられたフィールドとは絵柄が異なってしまう場
合を示す斜視図である。
２０、２２、２４ 最小値検出回路（ＭＩＮ）３０、
３２、３４ 最大値検出回路（ＭＡＸ）３４、３６、
３８ コンパレータ ４０ デコーダ ＳＷ１、ＳＷ２ デジタルスイッチ ４２ 加算器 ４４ １／２割り算部
３２、３４ 最大値検出回路（ＭＡＸ）３４、３６、
３８ コンパレータ ４０ デコーダ ＳＷ１、ＳＷ２ デジタルスイッチ ４２ 加算器 ４４ １／２割り算部
Claims (1)
- 【請求項１】 １フィールド分の映像信号のみを用い
てインターレス信号を得る映像信号補間処理方法におい
て、垂直方向に変化のない部分では、与えられたフィー
ルドの信号をそのまま用いて他フィールドとし、あるい
は平均値補間処理とし、垂直方向にステップ状に変化す
る部分では平均値補間処理とし、垂直方向に細かく繰り
返す変化のある部分では、与えられたフィールドの信号
をそのまま用いて他フィールドを生成するように補間処
理を施すことを特徴とする映像信号補間処理方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2414489A JPH04223785A (ja) | 1990-12-26 | 1990-12-26 | 映像信号補間処理方法 |
| US07/805,615 US5231497A (en) | 1990-12-26 | 1991-12-12 | Method of interpolating one video image field to create an interlaced image field |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2414489A JPH04223785A (ja) | 1990-12-26 | 1990-12-26 | 映像信号補間処理方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04223785A true JPH04223785A (ja) | 1992-08-13 |
Family
ID=18522962
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2414489A Pending JPH04223785A (ja) | 1990-12-26 | 1990-12-26 | 映像信号補間処理方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5231497A (ja) |
| JP (1) | JPH04223785A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0529903A2 (en) * | 1991-08-23 | 1993-03-03 | Mitsubishi Denki Kabushiki Kaisha | Image processing system |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11298862A (ja) * | 1998-04-10 | 1999-10-29 | Seiko Epson Corp | 画像処理方法及び画像表示装置 |
| JP3365333B2 (ja) * | 1999-03-03 | 2003-01-08 | 日本電気株式会社 | 解像度変換装置 |
| JP2004320507A (ja) * | 2003-04-17 | 2004-11-11 | Sony Corp | 映像信号処理装置、映像信号処理方法、撮像装置、再生装置、受信装置 |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0799804B2 (ja) * | 1981-07-13 | 1995-10-25 | ソニー株式会社 | フィルタ装置 |
| JPH0669227B2 (ja) * | 1984-07-11 | 1994-08-31 | ソニー株式会社 | Ｙ／ｃ分離器 |
| JPH02131689A (ja) * | 1988-07-22 | 1990-05-21 | Toshiba Corp | フィールド内補間回路 |
| NL8802365A (nl) * | 1988-09-27 | 1990-04-17 | Philips Nv | Werkwijze en schakeling voor het verwerken van een beeldsignaal. |
| GB2231460B (en) * | 1989-05-04 | 1993-06-30 | Sony Corp | Spatial interpolation of digital video signals |
-
1990
- 1990-12-26 JP JP2414489A patent/JPH04223785A/ja active Pending
-
1991
- 1991-12-12 US US07/805,615 patent/US5231497A/en not_active Expired - Lifetime
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0529903A2 (en) * | 1991-08-23 | 1993-03-03 | Mitsubishi Denki Kabushiki Kaisha | Image processing system |
| EP0529903A3 (en) * | 1991-08-23 | 1995-03-22 | Mitsubishi Electric Corp | Image processing system |
| US5550936A (en) * | 1991-08-23 | 1996-08-27 | Mitsubishi Denki Kabushiki Kaisha | Image processing system |
Also Published As
| Publication number | Publication date |
|---|---|
| US5231497A (en) | 1993-07-27 |
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