JPH04188641A - 厚膜回路基板 - Google Patents
厚膜回路基板Info
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- JPH04188641A JPH04188641A JP2313378A JP31337890A JPH04188641A JP H04188641 A JPH04188641 A JP H04188641A JP 2313378 A JP2313378 A JP 2313378A JP 31337890 A JP31337890 A JP 31337890A JP H04188641 A JPH04188641 A JP H04188641A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[発明の目的]
(産業上の利用分野)
本発明は厚膜回路基板に間し、特に、ワイヤボンディン
グにおけるボンディング性を向上させるようにした厚膜
回路基板に関する。
グにおけるボンディング性を向上させるようにした厚膜
回路基板に関する。
(従来の技術)
近年、電子機器の小型軽量化を図るために、ハイブリッ
ドICが多用されてきている。このハイブリッドICは
、印刷回路基板にチップタイプの受動素子及び能動素子
等を実装したものである。
ドICが多用されてきている。このハイブリッドICは
、印刷回路基板にチップタイプの受動素子及び能動素子
等を実装したものである。
印刷回路基板は、一般にアルミナ等の絶縁基板に導電性
ペースト及び抵抗ペースト等を印刷して焼成することに
より、配線パターン及び抵抗体等を形成している。この
ようなハイブリッドICにおいては、高密度化及び高機
能化するために、フリップチップ及びワイヤボンディン
グ等を採用した半導体素子の実装方法が実用化されつつ
ある。
ペースト及び抵抗ペースト等を印刷して焼成することに
より、配線パターン及び抵抗体等を形成している。この
ようなハイブリッドICにおいては、高密度化及び高機
能化するために、フリップチップ及びワイヤボンディン
グ等を採用した半導体素子の実装方法が実用化されつつ
ある。
第11図は半導体素子の実装方法としてワイヤボンディ
ングを採用した従来の厚膜回路基板を示す一部断面図で
ある。
ングを採用した従来の厚膜回路基板を示す一部断面図で
ある。
アルミナ等の絶縁基板1上には、スクリーン印刷法によ
って銅ペーストを印刷して焼成することにより、配線層
2を形成している。配線層2相互間にはチップ部品3を
実装している。また、絶縁基板コ、上には銅ペーストに
よるダイボンディングバッー′−ド4も形成しており、
このグイボンデイングパッド4上には、銀ペースト等を
用いて半導体素子5を接着している。この半導体素子5
は金ワイヤ6 によるポールボンディングによって、
配線層2とワイヤボンディングされる。
って銅ペーストを印刷して焼成することにより、配線層
2を形成している。配線層2相互間にはチップ部品3を
実装している。また、絶縁基板コ、上には銅ペーストに
よるダイボンディングバッー′−ド4も形成しており、
このグイボンデイングパッド4上には、銀ペースト等を
用いて半導体素子5を接着している。この半導体素子5
は金ワイヤ6 によるポールボンディングによって、
配線層2とワイヤボンディングされる。
これらの半導体素子5、金ワイヤ6及び配線層2の一部
を被覆するように、樹脂ボッティングによって樹脂保護
層7を形成しており、これにより、金ワイヤ6を保護し
ている。
を被覆するように、樹脂ボッティングによって樹脂保護
層7を形成しており、これにより、金ワイヤ6を保護し
ている。
第12図は金ワイヤ6と配線層2との接続部分く以下、
2ndボンディング部という)を拡大して示す説明図で
ある。
2ndボンディング部という)を拡大して示す説明図で
ある。
金ワイヤ6の端部を、ボンディングツール8の熱圧着に
よって、配線層2の表面にボンディングしている。この
場合、配線層2の膜厚が比較的厚い(25μm以上)こ
とから、ボンディング時のボンディングツール8の沈み
込み量りは大きい。
よって、配線層2の表面にボンディングしている。この
場合、配線層2の膜厚が比較的厚い(25μm以上)こ
とから、ボンディング時のボンディングツール8の沈み
込み量りは大きい。
このため、2ndボンディング部において、金ワイヤ6
の端部にワイヤ切れ等のボンディング不良が生じること
がある。なお、膜厚が大きくなるほど沈み込み量りも大
きくなり、例えば、配線層2の膜厚が約25μmである
場合には、沈み込み量りは約9μmとなる。
の端部にワイヤ切れ等のボンディング不良が生じること
がある。なお、膜厚が大きくなるほど沈み込み量りも大
きくなり、例えば、配線層2の膜厚が約25μmである
場合には、沈み込み量りは約9μmとなる。
また、ボンディングの良不良な示す初期ボンディング率
も膜厚の厚さが厚くなると低下し、配線層2の膜厚を約
25μmとすると、初期ボンディング率は30%以下に
低下してしまう。
も膜厚の厚さが厚くなると低下し、配線層2の膜厚を約
25μmとすると、初期ボンディング率は30%以下に
低下してしまう。
更に、配線層2の膜厚が厚い場合には金ワイヤ6の引っ
張り強度も低下し、配線層2の膜厚が約25μmでは金
ワイヤ6の引っ張り強度は4g・f以下である。
張り強度も低下し、配線層2の膜厚が約25μmでは金
ワイヤ6の引っ張り強度は4g・f以下である。
(発明が解決しようとする課題)
このように、上述した従来の厚膜回路基板においては、
配線層の膜厚が比較的厚いことから、ワイヤボンディン
グ時にボンディング不良が発生すると共に、接合部が強
度不足となってしまうという問題点があった。
配線層の膜厚が比較的厚いことから、ワイヤボンディン
グ時にボンディング不良が発生すると共に、接合部が強
度不足となってしまうという問題点があった。
本発明はかかる問題点に鑑みてなされたものであって、
ワイヤボンディング時のボンディング不良の発生を防止
するとともに、接合強度を向上させることができる厚膜
回路基板を提供することを目的とする。
ワイヤボンディング時のボンディング不良の発生を防止
するとともに、接合強度を向上させることができる厚膜
回路基板を提供することを目的とする。
[発明の構成]
(課題を解決するための手段)
本発明に係る厚膜回路基板は、絶縁基板と、この絶縁基
板上に形成する配線層及びダイボンディングパッドと、
このグイボンデイングノ\・yド上に設ける半導体素子
と、前記配線層に接続するように前記絶縁基板上に厚さ
が略10μm以下に形成し前記半導体素子がワイヤボン
ディングされるボンディングパッドとを具備したもので
ある。
板上に形成する配線層及びダイボンディングパッドと、
このグイボンデイングノ\・yド上に設ける半導体素子
と、前記配線層に接続するように前記絶縁基板上に厚さ
が略10μm以下に形成し前記半導体素子がワイヤボン
ディングされるボンディングパッドとを具備したもので
ある。
(作用)
本発明においては、ボンディングバ・ンドの厚さを略1
0μm以下に形成しているので、半導体素子をワイヤボ
ンディングする場合のボンディングツールの沈み込み髪
は小さく、ボンディング不良の発生は防止される。また
、ポンプイングツへ・ンドの硬度も比較的高いので、ボ
ンディングの接続強度は高い。
0μm以下に形成しているので、半導体素子をワイヤボ
ンディングする場合のボンディングツールの沈み込み髪
は小さく、ボンディング不良の発生は防止される。また
、ポンプイングツへ・ンドの硬度も比較的高いので、ボ
ンディングの接続強度は高い。
(実施例)
以下、図面を参照して本発明の実施例について説明する
。第1図は本発明に係る厚膜回路基板の一実施例を示す
一部断面図である。
。第1図は本発明に係る厚膜回路基板の一実施例を示す
一部断面図である。
アルミナ等の絶縁基板1上には、スクリーン印刷法によ
って、配線J!12、ダイボンデイングパ・ンド4及び
ボンディングパッド11を形成している。
って、配線J!12、ダイボンデイングパ・ンド4及び
ボンディングパッド11を形成している。
配線層12は、ボンディングパッド11の一部を覆うよ
うにして形成しており、この部分において配線J112
とボンディングパッド11とを電気的に接続している。
うにして形成しており、この部分において配線J112
とボンディングパッド11とを電気的に接続している。
配線層12及びダイボンディングパッド4の厚さは、従
来と同様に、約25μm以下であり、ボンディングパッ
ド11の厚さは約10μm以下である。配線層12相互
間にはチップ部品3を実装しており、ダイボンディング
パッド4上には半導体素子5を接着している。半導体素
子5とボンディングパッド11とは金ワイヤ6によるポ
ールボンディングによって接続している。更に、金ワイ
ヤ6を保護するために、半導体素子5、金ワイヤ6、ボ
ンディングパッド11及び絶縁基板1の一部を被覆する
ように、樹脂保護層7を形成している。
来と同様に、約25μm以下であり、ボンディングパッ
ド11の厚さは約10μm以下である。配線層12相互
間にはチップ部品3を実装しており、ダイボンディング
パッド4上には半導体素子5を接着している。半導体素
子5とボンディングパッド11とは金ワイヤ6によるポ
ールボンディングによって接続している。更に、金ワイ
ヤ6を保護するために、半導体素子5、金ワイヤ6、ボ
ンディングパッド11及び絶縁基板1の一部を被覆する
ように、樹脂保護層7を形成している。
次に、第2図を参照して第1図の厚膜回路基板の製造方
法を説明する。第2図(a>乃至(e)は製造方法を工
程順に示す一部断面図である。
法を説明する。第2図(a>乃至(e)は製造方法を工
程順に示す一部断面図である。
先ず、第2図(a)に示すように、アルミナ等の絶縁基
板1上に銅ペーストをスクリーン印刷することによって
、ボンディングパッド11を形成する。この場合には、
スクリーンのエマルジョン厚等を適宜設定して、焼成後
のボンディングパッド11の膜厚が10μm以下となる
ようにする。
板1上に銅ペーストをスクリーン印刷することによって
、ボンディングパッド11を形成する。この場合には、
スクリーンのエマルジョン厚等を適宜設定して、焼成後
のボンディングパッド11の膜厚が10μm以下となる
ようにする。
次に、第2図(b)に示すように、同様にして銅ペース
トをスクリーン印刷し、配線層12及びダイボンディン
グパッド4を形成する。この場合には、ボンディングパ
ッド11の一部を覆うようにして配線層12を形成して
おり、ボンディングパッド11と配線層12との電気的
接続を行っている。この配線Jii12及びダイボンデ
ィングパッド4は、従来と同様に、焼成後の膜厚が約2
5μm以下となるように設定する0次いで、ボンディン
グパッド11、配線層12及びダイボンディングパッド
4を同時に焼成する。
トをスクリーン印刷し、配線層12及びダイボンディン
グパッド4を形成する。この場合には、ボンディングパ
ッド11の一部を覆うようにして配線層12を形成して
おり、ボンディングパッド11と配線層12との電気的
接続を行っている。この配線Jii12及びダイボンデ
ィングパッド4は、従来と同様に、焼成後の膜厚が約2
5μm以下となるように設定する0次いで、ボンディン
グパッド11、配線層12及びダイボンディングパッド
4を同時に焼成する。
次に、第2図(c)に示すように、配線層12相互間に
チップ部品3を実装する。次いで、第2図(d)に示す
ように、ダイボンディングパッド4上に銀ペースト等を
用いて半導体素子5を接着する。
チップ部品3を実装する。次いで、第2図(d)に示す
ように、ダイボンディングパッド4上に銀ペースト等を
用いて半導体素子5を接着する。
次に、第2図(e)に示すように、金ワイヤ6をボール
ボンディングすることによって、半導体素子5とボンデ
ィングパッド11とを接続する。こうして、半導体素子
5と配線層12とが電気的に接続される。
ボンディングすることによって、半導体素子5とボンデ
ィングパッド11とを接続する。こうして、半導体素子
5と配線層12とが電気的に接続される。
最後に、樹脂保護層7を樹脂ボッティングによって構成
して、金ワイヤ6を保護する。
して、金ワイヤ6を保護する。
このように構成された実施例の作用について第3図の説
明図及び第4図乃至第7図のグラフを参照して説明する
。第3図は第1図の2ndボンディング部を拡大して示
している。
明図及び第4図乃至第7図のグラフを参照して説明する
。第3図は第1図の2ndボンディング部を拡大して示
している。
金ワイヤ6は、前述したように、膜厚が比較的薄い(1
0μm以下)。したがって、金ワイヤ6とボンディング
パッド11との2ndボンディング部においては、第3
図に示すように、図示しないボンディングツールによる
沈み込み量りは比較的小さい。このため、2ndボンデ
ィング部においてはワイヤ切れ等の発生が防止され、良
好なボンディングを得ることができる。
0μm以下)。したがって、金ワイヤ6とボンディング
パッド11との2ndボンディング部においては、第3
図に示すように、図示しないボンディングツールによる
沈み込み量りは比較的小さい。このため、2ndボンデ
ィング部においてはワイヤ切れ等の発生が防止され、良
好なボンディングを得ることができる。
第4図は横軸に銅厚膜の厚さをとり縦軸にボンディング
ツールの沈み込み量りをとって、銅厚膜A、Hの沈み込
み特性を示すグラフである。
ツールの沈み込み量りをとって、銅厚膜A、Hの沈み込
み特性を示すグラフである。
この第4図に示すように、膜厚が薄いほどボンディング
ツールの沈み込み量りは小さく、例えば、銅厚膜Aにお
いては、膜厚が6μmである場合の沈み込みIDは約2
μmであり、銅厚膜Bでは、膜厚が5μmである場合の
沈み込み量りは1μm以下となっている。
ツールの沈み込み量りは小さく、例えば、銅厚膜Aにお
いては、膜厚が6μmである場合の沈み込みIDは約2
μmであり、銅厚膜Bでは、膜厚が5μmである場合の
沈み込み量りは1μm以下となっている。
第5図は横軸に銅厚膜の厚さをとり縦軸に加重100g
での銅厚膜表面のビッカース硬度をとって、銅厚膜A、
Bの表面の硬度特性を示すグラフである。
での銅厚膜表面のビッカース硬度をとって、銅厚膜A、
Bの表面の硬度特性を示すグラフである。
この第5図に示すように、膜厚が薄いほどビッカース硬
度は高くなる。したがって、比較的薄い膜厚のボンディ
ングパッド11表面の硬度は比較的大きい、このため、
ポールボンディング時にボンディングツールをボンディ
ングパッド11に比較的大きな力で押しつけることがで
き、十分な圧着力が得られる。また、ボンディングツー
ルの沈み込み量りも低減される。
度は高くなる。したがって、比較的薄い膜厚のボンディ
ングパッド11表面の硬度は比較的大きい、このため、
ポールボンディング時にボンディングツールをボンディ
ングパッド11に比較的大きな力で押しつけることがで
き、十分な圧着力が得られる。また、ボンディングツー
ルの沈み込み量りも低減される。
また、第6図は横軸に銅厚膜の厚さをとり縦軸にボンデ
ィングの良不良を示す初期ボンディング率をとって、銅
厚膜の厚さと初期ボンディング率との関係を示している
。
ィングの良不良を示す初期ボンディング率をとって、銅
厚膜の厚さと初期ボンディング率との関係を示している
。
第6図から明らかなように、膜厚が薄いほど初期ボンデ
ィング率は向上する。すなわち、第4図及び第5図に示
すように、膜厚が薄い場合には、ボンディングツールの
沈み込み量りが減少することから2ndボンディング時
のワイヤ切れが防止されると共に、ボンディングパッド
11が高硬度であることからボンディングツールによっ
て金ワイヤ6を十分にボンディングパッド11に押しつ
けることができるからである。
ィング率は向上する。すなわち、第4図及び第5図に示
すように、膜厚が薄い場合には、ボンディングツールの
沈み込み量りが減少することから2ndボンディング時
のワイヤ切れが防止されると共に、ボンディングパッド
11が高硬度であることからボンディングツールによっ
て金ワイヤ6を十分にボンディングパッド11に押しつ
けることができるからである。
第7図は横軸に銅厚膜の厚さをとり縦軸に金ワイヤ6の
引っ張り強度をとって、径が25μmの金ワイヤを使用
した場合の引っ張り強度特性を示している。
引っ張り強度をとって、径が25μmの金ワイヤを使用
した場合の引っ張り強度特性を示している。
この第7図に示すように、膜厚が薄いほど金ワイヤ6の
引っ張り強度は向上する。これは、膜厚が薄い場合には
、沈み込み量りが小さく、また、ボンディングパッド1
1が高硬度であることから、ワイヤ切れを発生させるこ
となく金ワイヤ6の十分な圧着が可能であるからである
。
引っ張り強度は向上する。これは、膜厚が薄い場合には
、沈み込み量りが小さく、また、ボンディングパッド1
1が高硬度であることから、ワイヤ切れを発生させるこ
となく金ワイヤ6の十分な圧着が可能であるからである
。
このように、本実施例においては、膜厚が比較的薄いボ
ンディングパッド11を配線層12に電気的に接続する
ようにして絶縁基板1上に形成し、半導体素子5を金ワ
イヤ6のポールボンディングによってボンディングパッ
ド11にボンディングすることにより、半導体素子5を
配線層12に電気的に接続している。ボンディングパッ
ド11の膜厚が比較的薄いことから、沈み込み量りが小
さく、また、ボンディングパッド11が高硬度となるの
で、ワイヤ切れ等のボンディング不良が発生することを
防止すると共に、強い接続強度を得ることができる。
ンディングパッド11を配線層12に電気的に接続する
ようにして絶縁基板1上に形成し、半導体素子5を金ワ
イヤ6のポールボンディングによってボンディングパッ
ド11にボンディングすることにより、半導体素子5を
配線層12に電気的に接続している。ボンディングパッ
ド11の膜厚が比較的薄いことから、沈み込み量りが小
さく、また、ボンディングパッド11が高硬度となるの
で、ワイヤ切れ等のボンディング不良が発生することを
防止すると共に、強い接続強度を得ることができる。
第8図は本発明の他の実施例に係る厚膜回路基板を示す
一部断面図である。第8図において第1図と同一の構成
要素には同一符号を付して説明を省略する。
一部断面図である。第8図において第1図と同一の構成
要素には同一符号を付して説明を省略する。
絶縁基板1上には、スクリーン印刷法によって、配線層
15及びダイボンデインクパッド4を形成している。本
実施例においては、配線層15及びダイボンディングパ
ッド4の厚さは、約10μm以下である。配線層15相
互間にはチップ部品3を実装しており、ダイボンディン
グパッド4上には半導体素子5を接着している。半導体
素子5と配線層15とを金ワイヤ6によるポールボンデ
ィングによって接続している。
15及びダイボンデインクパッド4を形成している。本
実施例においては、配線層15及びダイボンディングパ
ッド4の厚さは、約10μm以下である。配線層15相
互間にはチップ部品3を実装しており、ダイボンディン
グパッド4上には半導体素子5を接着している。半導体
素子5と配線層15とを金ワイヤ6によるポールボンデ
ィングによって接続している。
このように構成された実施例においては、配線層15の
膜厚が比較的薄いことから、金ワイヤ6と配線層15と
のボンディング時の沈み込み量りは低減され、また、配
線層15は高硬度に形成される。
膜厚が比較的薄いことから、金ワイヤ6と配線層15と
のボンディング時の沈み込み量りは低減され、また、配
線層15は高硬度に形成される。
このため、本実施例においても、第1図の実施例と同様
の効果を得ることができ、ワイヤ切れ等のボンディング
不良の発生は低減されると共に強い接続強度が得られる
。更に、ボンディングパッドを形成していないので、工
程数が少ないという利点もある。
の効果を得ることができ、ワイヤ切れ等のボンディング
不良の発生は低減されると共に強い接続強度が得られる
。更に、ボンディングパッドを形成していないので、工
程数が少ないという利点もある。
第9図は本発明の他の実施例に係る厚膜回路基板を説明
するための説明図である。第9図(a)。
するための説明図である。第9図(a)。
(b)は製造方法を工程順に示している。第9図におい
て第1図と同一の構成要素には同一符号を付して説明を
省略する。
て第1図と同一の構成要素には同一符号を付して説明を
省略する。
先ず、第9図(a)に示すように、絶縁基板1上に銅ペ
ーストをスクリーン印刷することによって、配線層16
及びダイボンディングパッド4を形成する。この場合に
は、従来と同様に約25μm以下の膜厚に設定する。
ーストをスクリーン印刷することによって、配線層16
及びダイボンディングパッド4を形成する。この場合に
は、従来と同様に約25μm以下の膜厚に設定する。
次に、第9図(b)に示すように、ダイボンディングパ
ッド4近傍の配線層16の一端部をケミカルエツチング
等によって除去し、この端部17において膜厚を10μ
m以下にする。
ッド4近傍の配線層16の一端部をケミカルエツチング
等によって除去し、この端部17において膜厚を10μ
m以下にする。
このように構成された実施例においては、ダイボンディ
ングパッド4上に半導体素子を接着し、配線層16の端
部17において図示しない金ワイヤによるポールボンデ
ィングを行う。
ングパッド4上に半導体素子を接着し、配線層16の端
部17において図示しない金ワイヤによるポールボンデ
ィングを行う。
本実施例においても、第1図の実施例と同様の効果が得
られることは明らかである。
られることは明らかである。
第10図は本発明の他の実施例に係る厚膜回路基板を説
明するための説明図である。第10図(a)は銅ペース
トの印刷に用いるスクリーンを示しており、第10図(
b)は絶縁基板1上に、配線層、ダイボンディングパッ
ド及びボンディングパッドを形成した状態を示している
。
明するための説明図である。第10図(a)は銅ペース
トの印刷に用いるスクリーンを示しており、第10図(
b)は絶縁基板1上に、配線層、ダイボンディングパッ
ド及びボンディングパッドを形成した状態を示している
。
本実施例においては、第10図(a)に示すように、ス
クリーン20はステンレスメツシュ21及び乳剤層22
より構成されている。乳剤層22には開口部23(波線
部)が設けられており、この開口部23を介して図示し
ない銅ベース)・を押し出すことにより、絶縁基板1上
に配線層24、ダイボンディングパッド25及びボンデ
ィングパッド26を形成するようになっている。乳剤層
22はボンディングパッド26形成部分に対応した部分
27の厚さが薄く形成されている。
クリーン20はステンレスメツシュ21及び乳剤層22
より構成されている。乳剤層22には開口部23(波線
部)が設けられており、この開口部23を介して図示し
ない銅ベース)・を押し出すことにより、絶縁基板1上
に配線層24、ダイボンディングパッド25及びボンデ
ィングパッド26を形成するようになっている。乳剤層
22はボンディングパッド26形成部分に対応した部分
27の厚さが薄く形成されている。
スクリーン印刷によって形成される厚膜の厚さは、乳剤
層22の厚さによって制御されることから、乳剤層22
の部分27に対応した位置には、薄いボンディングパッ
ド26が形成される。こうして、第10図(b)に示す
ように、絶縁基板1上には膜厚が約25μm以下の配線
層24及びダイボンディングパッド25と、膜厚が約1
0μm以下のボンディングパッド26とが形成される。
層22の厚さによって制御されることから、乳剤層22
の部分27に対応した位置には、薄いボンディングパッ
ド26が形成される。こうして、第10図(b)に示す
ように、絶縁基板1上には膜厚が約25μm以下の配線
層24及びダイボンディングパッド25と、膜厚が約1
0μm以下のボンディングパッド26とが形成される。
以後、他の実施例と同様に、チップ部品及び半導体素子
を搭載して、金ワイヤによるワイヤボンディングを行う
。
を搭載して、金ワイヤによるワイヤボンディングを行う
。
本実施例においても、第1図の実施例と同様の効果が得
られることは明らかである。更に、本実施例においては
、エツチング処理を必要とせず、第9図の実施例よりも
工程数を減少させることができる。
られることは明らかである。更に、本実施例においては
、エツチング処理を必要とせず、第9図の実施例よりも
工程数を減少させることができる。
[発明の効果コ
以上説明したように本発明によれば、ワイヤボンディン
グ時のボンディング不良の発生を防止するとともに、接
合強度を向上させることができるという効果を有する。
グ時のボンディング不良の発生を防止するとともに、接
合強度を向上させることができるという効果を有する。
第1図は本発明に係る厚膜回路基板の一実施例を示す一
部断面図、第2図は実施例の製造方法を工程順に示す一
部断面図、第3図は実施例の作用を説明するための説明
図、第4図乃至第7図は実施例の作用を説明するための
グラフ、第8図は本発明の他の実施例を示す一部断面図
、第9図は本発明の他の実施例を説明するための説明図
、第10図は本発明の他の実施例を説明するための説明
図、第11図は従来の厚膜回路基板を示す一部断面図、
第12図は第11図中の2ndボンディング部を拡大し
て示す説明図である。 1・・・絶縁基板、4・・・ダイボンディングパッド、
5・・・半導体素子、6・・・金ワイヤ、11・・・ボ
ンディングパッド、12・・・配線層。 ′LI〉々−区だ招
部断面図、第2図は実施例の製造方法を工程順に示す一
部断面図、第3図は実施例の作用を説明するための説明
図、第4図乃至第7図は実施例の作用を説明するための
グラフ、第8図は本発明の他の実施例を示す一部断面図
、第9図は本発明の他の実施例を説明するための説明図
、第10図は本発明の他の実施例を説明するための説明
図、第11図は従来の厚膜回路基板を示す一部断面図、
第12図は第11図中の2ndボンディング部を拡大し
て示す説明図である。 1・・・絶縁基板、4・・・ダイボンディングパッド、
5・・・半導体素子、6・・・金ワイヤ、11・・・ボ
ンディングパッド、12・・・配線層。 ′LI〉々−区だ招
Claims (1)
- 【特許請求の範囲】 絶縁基板と、 この絶縁基板上に形成する配線層及びダイボンディング
パッドと、 このダイボンディングパッド上に設ける半導体素子と、 前記配線層に接続するように前記絶縁基板上に厚さが略
10μm以下に形成し前記半導体素子がワイヤボンディ
ングされるボンディングパッドとを具備したことを特徴
とする厚膜回路基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2313378A JPH04188641A (ja) | 1990-11-19 | 1990-11-19 | 厚膜回路基板 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2313378A JPH04188641A (ja) | 1990-11-19 | 1990-11-19 | 厚膜回路基板 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04188641A true JPH04188641A (ja) | 1992-07-07 |
Family
ID=18040548
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2313378A Pending JPH04188641A (ja) | 1990-11-19 | 1990-11-19 | 厚膜回路基板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04188641A (ja) |
-
1990
- 1990-11-19 JP JP2313378A patent/JPH04188641A/ja active Pending
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