JPH04103741U - 入力インタフエイス回路 - Google Patents

入力インタフエイス回路

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JPH04103741U
JPH04103741U JP186991U JP186991U JPH04103741U JP H04103741 U JPH04103741 U JP H04103741U JP 186991 U JP186991 U JP 186991U JP 186991 U JP186991 U JP 186991U JP H04103741 U JPH04103741 U JP H04103741U
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JP
Japan
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circuit
input
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low
branch
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Application number
JP186991U
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English (en)
Inventor
優 荒井
Original Assignee
日本電気株式会社
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Abstract

(57)【要約】 【構成】スイッチインタフェイス盤２１，２２は、入力
の低次群信号１，２を分岐出力する分岐回路Ｄと分岐出
力を選択して出力する選択回路Ｓとを備え動作している
ときマウント情報を出力する。インタフェイス盤２３，
２４は、スイッチインタフェイス盤２１，２２からマウ
ント情報が入力されないとき分岐回路Ｄによる減衰量に
対応する減衰器Ａを介して入力の低次群信号５，９の振
幅等化を行う自動利得制御回路ＡＧＣを備える。 【効果】低次群信号が伝送される伝送路の減衰歪を正確
に補正できる。

Description

【考案の詳細な説明】
【０００１】
【産業上の利用分野】
本考案は、ｎ本の低次群信号をｎ多重信号として伝送するデジタル伝送装置に 使用する低次群信号を入力する入力インタフェイス回路に関する。
【０００２】
【従来の技術】
図２及び図３は従来の入力インタフェイス回路の一例のブロック図である。
【０００３】 図２においてデジタル伝送装置に入力される主信号系と予備系の低次群信号の ２本に対し注目すると、低次群信号２ａはスイッチインタフェイス盤２２ａに入 力され、分岐回路回路Ｄにより、２本の低次群信号５ａ，６ａに分けられ、片方 の低次群信号５ａは、スイッチインタフェイス盤２１ａに入力され、他方の低次 群信号６ａは選択回路Ｓに入力され、選択信号１１ａにより、スイッチインタフ ェイス盤２１ａからの低次群信号４ａと、低次群信号６ａとが選択され、インタ フェイス盤２４ａに低次群信号８ａとして出力される。この低次群信号８ａを受 けた自動利得制御回路ＡＧＣでは、伝送路による減衰歪（周波数特性を持つ）と 、分岐回路Ｄによる減衰量（周波数特性を持たない）とを増幅補正している。た だし分岐回路Ｄによる減衰量に関しては、一定であるので、一定の増幅を有して いる。よって自動利得制御回路ＡＧＣは伝送路の減衰歪による周波数特性を補正 するための利得に関し、自動可変となっている。
【０００４】
【考案が解決しようとする課題】
上述した従来の入力インタフェィス回路において、図３の点線で示すスイッチ インタフェイス盤２２ａが未実装のとき、低次群信号２ａは直接インタフェイス 盤２４ａに入力されるため、低次群信号２ａは分岐回路Ｄによる減衰量が除かれ 、入力レベルが高くなっているので自動利得制御回路ＡＧＣでは伝送路による減 衰歪を等化できないという欠点がある。
【０００５】
【課題を解決するための手段】
本考案の入力インタフェイス回路は、入力の低次群信号を分岐出力する分岐回 路と、前記分岐出力を選択して出力する選択回路とを備えたスイッチインタフェ イス盤が動作しているときマウント情報を出力する手段と、前記マウント情報が 入力されないとき前記分岐回路による減衰量に対応する減衰器を介して入力の前 記低次群信号の振幅等化を行う自動利得制御回路を備えるインタフェィス盤とを 有する。
【０００６】
【実施例】
次に本考案について図面を参照して説明する。図１は本考案の一実施例のブロ ック図である。
【０００７】 本実施例は図１において、スイッチインタフェイス盤２１，２２は、入力の低 次群信号１，２を分岐出力する分岐回路Ｄと分岐出力を選択して出力する選択回 路Ｓとを備えて動作しているときマウント情報５，９を出力する。インタフェイ ス盤２３，２４は、スイッチインタフェイス盤２１，２２からマウント情報が入 力されないとき分岐回路Ｄによる減衰量に対応する減衰器Ａを介して入力の低次 群信号５，９の振幅等化を行う自動利得制御回路ＡＧＣを備える。
【０００８】 次に動作について説明すると、スイッチインタフェイス盤２２が未実装のとき 、マウント情報９によりインタフェイス盤２４は未実装の情報を受け、スイッチ ＳＷ１，２により減衰器Ａの入っている系が選択され低次群信号２は減衰器Ａを 通過し、自動利得制御回路ＡＧＣに入力される。また、スイッチＳＷ１，２はス ルーの回路を選択し、低次群信号は、減衰器Ａを通過しなくなる。
【０００９】
【考案の効果】
以上説明したように本考案は、スイッチインタフェイス盤のマウント情報を監 視し、減衰器の挿入及び除去を行なって自動利得制御回路に低次群信号が入力さ れることにより、伝送路の減衰歪を正確に補正できるという効果がある。
【図面の簡単な説明】
【図１】本考案の一実施例のブロック図である。
【図２】従来の入力インタフェイス回路の一例のブロッ
ク図である。
【図３】従来の入力インタフェイス回路の一例のブロッ
ク図である。
【符号の説明】
２１，２２ スイッチインタフェイス盤 ２３，２４ インタフェイス盤 Ａ 減衰器 ＡＧＣ 自動利得制御回路 Ｄ 分岐回路 Ｓ 選択回路 ＳＷ１，２ スイッチ

Claims (1)

    【実用新案登録請求の範囲】
  1. 【請求項１】 入力の低次群信号を分岐出力する分岐回
    路と、前記分岐出力を選択して出力する選択回路とを備
    えたスイッチインタフェイス盤が動作しているときマウ
    ント情報を出力する手段と、前記マウント情報が入力さ
    れないとき前記分岐回路による減衰量に対応する減衰器
    を介して入力の前記低次群信号の振幅等化を行う自動利
    得制御回路を備えるインタフェィス盤とを有することを
    特徴とする入力インタフェイス回路。
JP186991U 1991-01-25 1991-01-25 入力インタフエイス回路 Pending JPH04103741U (ja)

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JPH04103741U true JPH04103741U (ja) 1992-09-07

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